JPH02125436A - ダイボンディング装置 - Google Patents

ダイボンディング装置

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Publication number
JPH02125436A
JPH02125436A JP27907488A JP27907488A JPH02125436A JP H02125436 A JPH02125436 A JP H02125436A JP 27907488 A JP27907488 A JP 27907488A JP 27907488 A JP27907488 A JP 27907488A JP H02125436 A JPH02125436 A JP H02125436A
Authority
JP
Japan
Prior art keywords
silver paste
paste
roller
pellet
thickness
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP27907488A
Other languages
English (en)
Inventor
Masahiro Nakano
正博 中野
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Nippon Electric Kagoshima Ltd
NEC Kagoshima Ltd
Original Assignee
Nippon Electric Kagoshima Ltd
NEC Kagoshima Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nippon Electric Kagoshima Ltd, NEC Kagoshima Ltd filed Critical Nippon Electric Kagoshima Ltd
Priority to JP27907488A priority Critical patent/JPH02125436A/ja
Publication of JPH02125436A publication Critical patent/JPH02125436A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/74Apparatus for manufacturing arrangements for connecting or disconnecting semiconductor or solid-state bodies
    • H01L24/741Apparatus for manufacturing means for bonding, e.g. connectors
    • H01L24/743Apparatus for manufacturing layer connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/74Apparatus for manufacturing arrangements for connecting or disconnecting semiconductor or solid-state bodies and for methods related thereto
    • H01L2224/741Apparatus for manufacturing means for bonding, e.g. connectors
    • H01L2224/743Apparatus for manufacturing layer connectors

Landscapes

  • Engineering & Computer Science (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Die Bonding (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はダイボンディング装置に関し、特に吐出された
銀ペーストを均一に広げる機構に関する。
〔従来の技術〕
従来のダイボンディング装置は、ディスペンス方式もし
くはスタンピング方式により、銀ペーストをリードフレ
ーム上に塗布した後、エアーブローにより銀ペーストを
拡散させてその膜厚調整を行っていた。この方式によれ
ば銀ペーストの特性変化すなわち粘度の上昇あるいは成
分の分離による吐出量の変化、及びエアーブロー圧力の
ばらつき等により、安定した銀ペーストの広がりや厚さ
が得られないため、所望のダイボンディング形状(0,
35’のベレットでベレット下の銀ペースト厚2〜5μ
、ペレット側面へのはい上がり20〜50μ)が得られ
ず、頻繁にエアーブローを施して銀ペースト量の広がり
の調整が必要である。
第3図にディスペンス方式のダイボンディング機構を示
す。
図に示すように、シリンジ11から銀ペースト12をリ
ードフレーム14上に定量の銀ペースト13を塗布し、
エアーブローノズル15からリードフレーム14上の銀
ペースト13にエアーを吹付けて銀ペースト16を拡散
させ、吸着針17にて吸着したベレット18をリードフ
レーム14の銀ペースト16にて接着させていた。
〔発明が解決しようとする課題〕
上述した従来のエアーブロ一方式によって銀ペーストを
広げる方式では、銀ペーストの特性変化による吐出量の
変化、エアーブローのばらつきのために、銀ペーストの
広がりや厚さを微小領域内でコントロールすることは困
難であった。
特にペレットの構造上ジャンクションのガードされてい
ない半導体素子では銀ペースト量を増しすぎると、ジャ
ンクションまで銀ペーストがはい上がり、リーク不良に
到る。
また1反対に銀ペースト量を減らすと、ペレットがはが
れやすい状況に到る。またペレットの小型化、パッケー
ジの小型化に対応するために、銀ペーストの吐出量もさ
らに微量(0,350のチップで0.02〜0.04m
g/p)のコントロールが必要となり、銀ペーストの吐
出量の小さなばらつきがリーク不良、ペレットはがれの
トラブルの原因となっていた。
以上に述べたように、現状のエアープロ一方式では理想
のダイボンディング形状を得るための十分な工程能力を
有しておらず、頻繁な銀ペースト量、広がりの調整が必
要であった。
本発明の目的は前記課題を解決したダイボンディング装
置を提供することにある。
〔課題を解決するための手段〕
前記目的を達成するため、本発明は銀ペーストを使用す
るダイボンディング装置において、板上に吐出された銀
ペーストの表面を機械的接触圧を作用させて該銀ペース
トの膜厚調整を行う均し機構を装備したものである。
〔実施例〕
以下、本発明の実施例を図により説明する。
(実施例1) 第1図は本発明の実施例1を示す構成図である。
図において1本発明に係る均し機構は銀ペーストの表面
を均らすローラ1を備えており、該ローラ1を水平移動
する作用杆1aに昇降可能に吊下したもの・である、該
ローラ1がリードフレーム2のマウントエリアに塗布さ
れた銀ペースト3上で左右に動くことにより銀ペースト
3を均一に広げる作用を有している。またローラ1を昇
降させてその高さ位置を変化させ、ローラ1による銀ペ
ースト厚調整高さ4を調整することにより、ペレット直
下の銀ペースト厚や、ペレット側面にはい上がる銀ペー
スト量のコントロールが可能となる。この機構によって
銀ペーストの吐出量の微調整が不要となり、多めの銀ペ
ーストの吐出量でも均一な銀ペースト厚を確保でき、ダ
イボンディングの不良であるペレットはがれ、銀ペース
トのはい上がりによるリーク不良のポテンシャルを小さ
くすることができる。
(実施例2) 第2図は本発明の実施例2を示す構成図である6本実施
例は軸5aのまわりに回転する回転式ヘラ5を備えてお
り、回転式ヘラ5を回転させつつ軸5aを水平移動させ
てヘラ5により銀ペースト3を均らしその膜厚を均一化
させ、一方軸5aの高さ位置を変更させることにより、
回転ヘラ5による銀ペース厚調整高さ4を調整するもの
である。
〔発明の効果〕
以上説明したように本発明はローラもしくは回転式ヘラ
等により機械的に加圧して銀ペーストを均らし、所要範
囲に広げるため、所望の銀ペースト厚を安定して得るこ
とができ、従って、ペレットはがれや銀ペーストのはい
上がりによるリーク不良を低減できる効果がある。
【図面の簡単な説明】
第1図、第2図は本発明の各実施例を示す構成図、第3
図は従来のダイボンディング機構を示す構成図である。 1・・・銀ペースト厚調整用ローラ 2・・・リードフレーム 3・・・吐出直後の銀ペースト 5・・・銀ペースト厚調整用回転ヘラ 特許出願人  鹿児島日本電気株式会社第 図 銀ベシスト 第 図 第3図

Claims (1)

    【特許請求の範囲】
  1. (1)銀ペーストを使用するダイボンディング装置にお
    いて、板上に吐出された銀ペーストの表面を機械的接触
    圧を作用させて該銀ペーストの膜厚調整を行う均し機構
    を装備したことを特徴とするダイボンディング装置。
JP27907488A 1988-11-04 1988-11-04 ダイボンディング装置 Pending JPH02125436A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP27907488A JPH02125436A (ja) 1988-11-04 1988-11-04 ダイボンディング装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP27907488A JPH02125436A (ja) 1988-11-04 1988-11-04 ダイボンディング装置

Publications (1)

Publication Number Publication Date
JPH02125436A true JPH02125436A (ja) 1990-05-14

Family

ID=17606052

Family Applications (1)

Application Number Title Priority Date Filing Date
JP27907488A Pending JPH02125436A (ja) 1988-11-04 1988-11-04 ダイボンディング装置

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Country Link
JP (1) JPH02125436A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO1995011521A1 (en) * 1993-10-23 1995-04-27 Christopher David Dobson Method and apparatus for the planarization of layers on semiconductor substrates
WO2001018860A3 (en) * 1999-09-09 2002-01-17 Allied Signal Inc Improved apparatus and methods for integrated circuit planarization

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO1995011521A1 (en) * 1993-10-23 1995-04-27 Christopher David Dobson Method and apparatus for the planarization of layers on semiconductor substrates
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