JPH01179634U - - Google Patents

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JPH01179634U
JPH01179634U JP7600888U JP7600888U JPH01179634U JP H01179634 U JPH01179634 U JP H01179634U JP 7600888 U JP7600888 U JP 7600888U JP 7600888 U JP7600888 U JP 7600888U JP H01179634 U JPH01179634 U JP H01179634U
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output
buffer amplifier
signal input
control input
current switch
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Description

【図面の簡単な説明】
第1図は本考案に係るFETスイツチ回路の一
実施例を示す構成回路図、第2図はFETスイツ
チ回路の従来例を示す構成回路図である。 7,8……電圧加算回路、S,S……制御
入力、V,V……信号入力、T,T……
FET、Q,Q……電流スイツチ、A,A
……バツフアアンプ、D,D……出力ダイ
オード。

Claims (1)

  1. 【実用新案登録請求の範囲】 制御入力に対応して信号入力のスイツチングを
    行うFETスイツチ回路において、 制御入力によつて制御される電流スイツチと、
    信号入力が接続するバツフアアンプと、このバツ
    フアフンプの出力に一定の電圧を加算しその出力
    ダイオードを介して前記電流スイツチの一端に接
    続する電圧加算回路と、この電圧加算回路の出力
    がそのゲート端子に接続し前記バツフアアンプの
    出力がそのソース端子に接続するFETとを備え
    たことを特徴とするFETスイツチ回路。
JP7600888U 1988-06-08 1988-06-08 Pending JPH01179634U (ja)

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JP7600888U JPH01179634U (ja) 1988-06-08 1988-06-08

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JP7600888U JPH01179634U (ja) 1988-06-08 1988-06-08

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JPH01179634U true JPH01179634U (ja) 1989-12-22

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ID=31301054

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61293017A (ja) * 1985-04-26 1986-12-23 トライクイント セミコンダクタ インコ−ポレイテツド アナログ・スイツチ回路

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61293017A (ja) * 1985-04-26 1986-12-23 トライクイント セミコンダクタ インコ−ポレイテツド アナログ・スイツチ回路

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