JPH01160371A - H−ブリッジ段を通る電流の大きさと方向を検出する電流検出回路 - Google Patents
H−ブリッジ段を通る電流の大きさと方向を検出する電流検出回路Info
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
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- G—PHYSICS
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- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
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- H02P7/00—Arrangements for regulating or controlling the speed or torque of electric DC motors
- H02P7/03—Arrangements for regulating or controlling the speed or torque of electric DC motors for controlling the direction of rotation of DC motors
- H02P7/04—Arrangements for regulating or controlling the speed or torque of electric DC motors for controlling the direction of rotation of DC motors by means of a H-bridge circuit
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は、負荷を駆動するスイッチングモー1′のため
の回路、特に負荷に導かれる電流をコントロールするた
めの回路アレンジメイントに関する。
の回路、特に負荷に導かれる電流をコントロールするた
めの回路アレンジメイントに関する。
(従来技術の説明)
電気モーフをコントロールする装置、より一般的には誘
導負荷へ電流を導くための装置はいわゆるパルス幅変1
!i (PWM)技術を利用する。この技術は、その周
波数とデエーティサイクルがクロックシグナルとその反
転シグナル(否定シグナル)によりコーントロールされ
る方形波駆動シグナルを使用する「H−ブリッジ」段に
より行われ、前記クロックシグナル及び反転シグナルは
、それぞれブ1J7ジコンフイギユレーシリンに配置さ
れかつサプライとブラウンj!又は前記ブリッジ段の仮
想グラウンドノード間の負荷の機能的なス・イツチング
を行う2対のスイッチに加えられる。負荷に導かれる電
流の追跡とコントロールのためのシステムを形成するた
めには、H−ブリッジ段の2個のブランチの仮想グラウ
ンドノードと回路の真のグラウンド間に接続された検出
抵抗がしばしば使用される。これらの検出抵抗は、負荷
を遣って流れる電流にi(えることが必要とされるパワ
ー素子であることが必須であり、この理由のため殆どの
場合に集積された駆動回路に外部的に接続された個別部
品であり、かつこれらはしばしば良好に決定された正確
性と温度係数特性を有しなければな4らずかつ検出でき
るインダクタンスを有しないものでなければならないた
め一般に装置に関する顕著なコスト係数を示す。
導負荷へ電流を導くための装置はいわゆるパルス幅変1
!i (PWM)技術を利用する。この技術は、その周
波数とデエーティサイクルがクロックシグナルとその反
転シグナル(否定シグナル)によりコーントロールされ
る方形波駆動シグナルを使用する「H−ブリッジ」段に
より行われ、前記クロックシグナル及び反転シグナルは
、それぞれブ1J7ジコンフイギユレーシリンに配置さ
れかつサプライとブラウンj!又は前記ブリッジ段の仮
想グラウンドノード間の負荷の機能的なス・イツチング
を行う2対のスイッチに加えられる。負荷に導かれる電
流の追跡とコントロールのためのシステムを形成するた
めには、H−ブリッジ段の2個のブランチの仮想グラウ
ンドノードと回路の真のグラウンド間に接続された検出
抵抗がしばしば使用される。これらの検出抵抗は、負荷
を遣って流れる電流にi(えることが必要とされるパワ
ー素子であることが必須であり、この理由のため殆どの
場合に集積された駆動回路に外部的に接続された個別部
品であり、かつこれらはしばしば良好に決定された正確
性と温度係数特性を有しなければな4らずかつ検出でき
るインダクタンスを有しないものでなければならないた
め一般に装置に関する顕著なコスト係数を示す。
(発明の構成)
本発明の対象である電流のセンスと大きさを検出するた
めの回路は、駆動ブリフジ回路の共通の仮想グラウンド
ノードと真のグラウンドノード間に接続された単一の検
出抵抗を使用することにより、H−ブリッジ段の負荷に
導かれる電流の大きさとセンスに関する完全な情報を形
成することを許容する。
めの回路は、駆動ブリフジ回路の共通の仮想グラウンド
ノードと真のグラウンドノード間に接続された単一の検
出抵抗を使用することにより、H−ブリッジ段の負荷に
導かれる電流の大きさとセンスに関する完全な情報を形
成することを許容する。
(好適な実施例の説明)
公知技術に対する本発明の異なった態様及び利点は・連
の図面を参照しながら行う引き続く説明により、より容
易に理解されるであろう。
の図面を参照しながら行う引き続く説明により、より容
易に理解されるであろう。
第1図は、公知技術による、負荷を流れる電流の大きさ
とセンスを検出するための回路が設置されたH−ブリッ
ジ段の原理的な回路ダイアダラムであり、 第2図及び第3図は、第1図の回路の代表的な2種類の
典型的なシグナルダイアダラムを示し、第4図は、本発
明の一態様である負荷を通る電流の大きさとセンスを検
出するための回路を利用するH−ブリッジ段の原理的な
回路ダイアグラムを示し、 第5図は、第4図の回路の代表的なシグナルダイアダラ
ムであり、 第6図は、MOSトランジスタにより駆動されるアナロ
グス−(7チを利用する第4図の回路の他の態様の回路
ダイアグラムである。
とセンスを検出するための回路が設置されたH−ブリッ
ジ段の原理的な回路ダイアダラムであり、 第2図及び第3図は、第1図の回路の代表的な2種類の
典型的なシグナルダイアダラムを示し、第4図は、本発
明の一態様である負荷を通る電流の大きさとセンスを検
出するための回路を利用するH−ブリッジ段の原理的な
回路ダイアグラムを示し、 第5図は、第4図の回路の代表的なシグナルダイアダラ
ムであり、 第6図は、MOSトランジスタにより駆動されるアナロ
グス−(7チを利用する第4図の回路の他の態様の回路
ダイアグラムである。
誘導負荷りを駆動するためのH−ブリッジ段は従来の符
号を使用して第1図中に示されている。
号を使用して第1図中に示されている。
数段は、それぞれ駆動シグナルINI及び反転シグナル
INIにより駆動される4個のスイッチSW1、SW4
及びSW2、SW3により形成され、前記反転シグナル
はインパークIにより前記IN1シグナルの否定として
得られる。完全にする目的のため、第1図中には再循環
ダイオードDI、D4及びD2、D3も示されている。
INIにより駆動される4個のスイッチSW1、SW4
及びSW2、SW3により形成され、前記反転シグナル
はインパークIにより前記IN1シグナルの否定として
得られる。完全にする目的のため、第1図中には再循環
ダイオードDI、D4及びD2、D3も示されている。
ブリッジコンフィギュレーシ#ンとして配置された前記
2対のスイッチ(っまりSWI、SW4及びSW2.5
W3)は、駆動シグナルINI及びロゴの対応持続時間
により決定されるある種の「デユーティサイクル」の関
数として、サプライノードVsと仮想グラウンドノード
(第1図に示した回路の場合はノードv1及びv2に一
致する)間の負荷りを機能的に(パルス幅変調技術に従
って)ス・イツチングする。
2対のスイッチ(っまりSWI、SW4及びSW2.5
W3)は、駆動シグナルINI及びロゴの対応持続時間
により決定されるある種の「デユーティサイクル」の関
数として、サプライノードVsと仮想グラウンドノード
(第1図に示した回路の場合はノードv1及びv2に一
致する)間の負荷りを機能的に(パルス幅変調技術に従
って)ス・イツチングする。
前記負荷の駆動のコントロールは、前記負荷りを通って
流れる電流の大きさ(モデュラス)とセンス(方向)を
検出することに基づ(。
流れる電流の大きさ(モデュラス)とセンス(方向)を
検出することに基づ(。
第1図の回路中に具体化された広く使用される技術によ
ると、前記検出回路は、回路の前記2個の仮想グラウン
ドノードV1及びv2と該回路の真のグラウンドノード
間にそれぞれ接続された2個の別個の検出トランジスタ
R1及びR2を使用している。これら2個の検出トラン
ジスタR1及びR2を横切る電圧シグナル(つまり電圧
v1及びV2)は差動検出増幅器Asの入力に供給され
る。
ると、前記検出回路は、回路の前記2個の仮想グラウン
ドノードV1及びv2と該回路の真のグラウンドノード
間にそれぞれ接続された2個の別個の検出トランジスタ
R1及びR2を使用している。これら2個の検出トラン
ジスタR1及びR2を横切る電圧シグナル(つまり電圧
v1及びV2)は差動検出増幅器Asの入力に供給され
る。
前記回路の代表的なシグナルダイアダラムが第2図及び
第3図に示されている。 50%異なる入力シグナルの
[デューティサ・fクル]で動作する、従って前記負荷
(誘導負荷であると仮定する)を通る電流を動作条件か
ら異なる平均値に調整すると仮定することにより、駆動
シグナルINI (ある種のアユ−ティサイクルを有
する)、前記2個の仮想グラウンドノードVl及び■2
の電圧、前記差動増幅器Asの出力電圧を示すタイムダ
イアダラムを第2図に示すように描くことができる。
第3図に示されている。 50%異なる入力シグナルの
[デューティサ・fクル]で動作する、従って前記負荷
(誘導負荷であると仮定する)を通る電流を動作条件か
ら異なる平均値に調整すると仮定することにより、駆動
シグナルINI (ある種のアユ−ティサイクルを有
する)、前記2個の仮想グラウンドノードVl及び■2
の電圧、前記差動増幅器Asの出力電圧を示すタイムダ
イアダラムを第2図に示すように描くことができる。
図示の場合は、前記増幅器の出力シグナルは正の極性を
有しこのシグナル(Vout)の大きさは前記負荷りを
流れる電流の大きさに比例する。
有しこのシグナル(Vout)の大きさは前記負荷りを
流れる電流の大きさに比例する。
、逆に、第1図のダイアグラム中に示した状態の駆動シ
グナルINIと相補的である駆動シグナルIN*を加え
ると仮定すると、対応するシグナルは第3図のダイアグ
ラム中に示されたフオームを取る。前記増幅器Asの出
力シグナルは基本的には同じ大きさであるが逆(負)の
極性を有している。
グナルINIと相補的である駆動シグナルIN*を加え
ると仮定すると、対応するシグナルは第3図のダイアグ
ラム中に示されたフオームを取る。前記増幅器Asの出
力シグナルは基本的には同じ大きさであるが逆(負)の
極性を有している。
容易に理解できるように、このような従来技術の検出回
路によると、唯1個の検出抵抗を使用したのみでは前記
負荷を通って流れる電流の方向を検出することはできな
い。
路によると、唯1個の検出抵抗を使用したのみでは前記
負荷を通って流れる電流の方向を検出することはできな
い。
これは第4図に概略的に示した本発明の一態様を示す検
出回路により可能にすることができる。
出回路により可能にすることができる。
この図面では、他のものと同じよ−うに、異なった図面
に示された回路と共通の等価の素子を表示するために同
じ符号及び数字を使用している。
に示された回路と共通の等価の素子を表示するために同
じ符号及び数字を使用している。
図面から分かるように、該回路は該回路の単で共通の仮
想グラウンドノードv1と真のグラウンドノード間に接
続された単・の検出抵抗Rを使用する。前記ブリッジ段
の負荷L′に導かれた電流の完全情報の必要な再構築は
、クロック駆動シグナルINI及びその否定「Kゴによ
りそれぞれが駆動され、それぞれの入力に、共通の仮想
駆動ノードの電圧シグナル(第1の相の間のvl)、及
び反転アナログバンファBINにより得られるその反転
シグナル(第2の相の間のV2)が加えられる、2個の
スイッチswA:1びSWBにより形成される2個の入
力を有するアナログマルチプレ7クス(MPX)により
行われる。マルチプレックスの出力シグナル(MPX
0UT)は次いでコンパレータの非反転入力(+)に
加えられ、他の(反転)入力(−)には、コントロール
電圧(Vref)が好適に加えられる。
想グラウンドノードv1と真のグラウンドノード間に接
続された単・の検出抵抗Rを使用する。前記ブリッジ段
の負荷L′に導かれた電流の完全情報の必要な再構築は
、クロック駆動シグナルINI及びその否定「Kゴによ
りそれぞれが駆動され、それぞれの入力に、共通の仮想
駆動ノードの電圧シグナル(第1の相の間のvl)、及
び反転アナログバンファBINにより得られるその反転
シグナル(第2の相の間のV2)が加えられる、2個の
スイッチswA:1びSWBにより形成される2個の入
力を有するアナログマルチプレ7クス(MPX)により
行われる。マルチプレックスの出力シグナル(MPX
0UT)は次いでコンパレータの非反転入力(+)に
加えられ、他の(反転)入力(−)には、コントロール
電圧(Vref)が好適に加えられる。
容易に分かるように、−度あるコントロール電圧Vre
fが設定されると、前記コンパレータC9出力シグナル
は、前記H−ブリッジ段の負荷りを通って流れる電流の
大きさと方向に関する所望の情報を含んでいる。前記コ
ンパレータの出力シグナルの振幅は、電流の量に比例し
、一方その極性(参照つまりコントロール電圧Vref
に関するもの)は電流のセンスを表示する。後により詳
述するように、このことは第4図の回路を表示する異な
ったシグナルのタイムダイアグラムにより第5図中に図
示されている。
fが設定されると、前記コンパレータC9出力シグナル
は、前記H−ブリッジ段の負荷りを通って流れる電流の
大きさと方向に関する所望の情報を含んでいる。前記コ
ンパレータの出力シグナルの振幅は、電流の量に比例し
、一方その極性(参照つまりコントロール電圧Vref
に関するもの)は電流のセンスを表示する。後により詳
述するように、このことは第4図の回路を表示する異な
ったシグナルのタイムダイアグラムにより第5図中に図
示されている。
PWMコントロール及びm 節ループは、コンパレータ
Cの出力シグナルを、その他の入力Sにタイミングクロ
ックシグナルが加えられるフリンプーフラップQの入力
Rに供給することにより、第4図に示すような従来の方
法で完了させることができる。これは、駆動シグナルI
NIと同期的である追跡電流のセンスシグナルを反転し
又反転させないことを許容する。
Cの出力シグナルを、その他の入力Sにタイミングクロ
ックシグナルが加えられるフリンプーフラップQの入力
Rに供給することにより、第4図に示すような従来の方
法で完了させることができる。これは、駆動シグナルI
NIと同期的である追跡電流のセンスシグナルを反転し
又反転させないことを許容する。
前記クロックシグナル、駆動シグナルINI、共通の仮
想ノードのポテンシャルの2個の「相」つまりマルチプ
レックスMPXの・方の入力に直接供給されるvlと前
記マルチプレックスM P Xの他の入力に供給される
予めインバータBINにより反転されたv2、及び前記
マルチプレックスMPXの出力シグナルMPX OU
Tが第5図のり・fムダイアグラム中に示されている。
想ノードのポテンシャルの2個の「相」つまりマルチプ
レックスMPXの・方の入力に直接供給されるvlと前
記マルチプレックスM P Xの他の入力に供給される
予めインバータBINにより反転されたv2、及び前記
マルチプレックスMPXの出力シグナルMPX OU
Tが第5図のり・fムダイアグラム中に示されている。
該MPX OUTシグナルの振幅は、前記ブリッジ段
の負荷りを通って流れる電流の量に比例し、一方前記コ
ンパレータCの対応する出力シグナルの極性は該コンパ
レータCの他の入力(−)に加えられる電圧Vrefの
極性により決定される。
の負荷りを通って流れる電流の量に比例し、一方前記コ
ンパレータCの対応する出力シグナルの極性は該コンパ
レータCの他の入力(−)に加えられる電圧Vrefの
極性により決定される。
従って前記負荷を通って流れる電流のセンスの反転はV
refの極性の単に反転することにより容易に行うこと
ができる。
refの極性の単に反転することにより容易に行うこと
ができる。
本発明の回路は、集積されたパワーバイポーラトランジ
スタ又はMOS)ランジスタのいずれかにより、H−ブ
リッジ段の集積を行うような用途において特に好都合で
ある。これらの態様では、マルチプレックスは2個の集
積されたアナログスイッチにより好適に形成される。こ
のような集積回路は第6図に示され、ここではブリッジ
段のパワースイッチ(SWl、S W 4及びSW3、
S V/2)が同数のパワーMO5)ランジスタととも
に形成され、一方マルチプレンクスMPXは、それぞれ
が一方がN チャンネルで他方がP チャンネルである
相補MO5)ランジスタ対つまり0MO3技術により形
成された2個のアナログスイ。
スタ又はMOS)ランジスタのいずれかにより、H−ブ
リッジ段の集積を行うような用途において特に好都合で
ある。これらの態様では、マルチプレックスは2個の集
積されたアナログスイッチにより好適に形成される。こ
のような集積回路は第6図に示され、ここではブリッジ
段のパワースイッチ(SWl、S W 4及びSW3、
S V/2)が同数のパワーMO5)ランジスタととも
に形成され、一方マルチプレンクスMPXは、それぞれ
が一方がN チャンネルで他方がP チャンネルである
相補MO5)ランジスタ対つまり0MO3技術により形
成された2個のアナログスイ。
チにより形成されている。
第1図は、公知技術に従って負荷を流れる電流の大きさ
と電流を検出するための回路が設置されたH−ブリッジ
段の原理的な回路グイアゲラム、第2図及び第3図は、
第1図の回路の代表的な2種類の典型的なシグナルダ・
イアグラム、第4図は、本発明の−B様である負荷を通
る電流とその大きさを検出するための回路を利用するH
−ブリッジ段の原理的な回路ダイアグラム、第5図は、
第4図の回路の代表的なシグナルダイアダラム、第6図
は、MOS)ランジスタにより駆動されるアナログスイ
ッチを利用する第4図の回路の変形例を示す回路ダイア
グラムである。 特許出願人 工ンセヂエッセ トムソンマイクロエレク
トロニクス
と電流を検出するための回路が設置されたH−ブリッジ
段の原理的な回路グイアゲラム、第2図及び第3図は、
第1図の回路の代表的な2種類の典型的なシグナルダ・
イアグラム、第4図は、本発明の−B様である負荷を通
る電流とその大きさを検出するための回路を利用するH
−ブリッジ段の原理的な回路ダイアグラム、第5図は、
第4図の回路の代表的なシグナルダイアダラム、第6図
は、MOS)ランジスタにより駆動されるアナログスイ
ッチを利用する第4図の回路の変形例を示す回路ダイア
グラムである。 特許出願人 工ンセヂエッセ トムソンマイクロエレク
トロニクス
Claims (5)
- (1)H−ブリッジコンフィギュレーションに配置され
かつ該H−ブリッジ段のサプライノードと仮想グラウン
ドノード間の負荷を機能的にスイッチングする2対のア
ナログスイッチのそれぞれに加えられるクロック方形波
駆動シグナルとその反転シグナルを使用して、前記H−
ブリッジ段によりスイッチングモードで駆動される負荷
を通る電流の大きさとセンスを検出するための回路にお
いて、 該回路の前記仮想グラウンドノードと真のグラウンドノ
ード間に接続された単一の検出抵抗と、それぞれ前記駆
動シグナルと前記反転駆動シグナルとにより駆動される
2個のスイッチを含んで成り、前記駆動シグナルにより
駆動されるスイッチに対応する入力が前記仮想グラウン
ドノードに接続され、かつ前記反転駆動シグナルにより
駆動されるスイッチに対応する入力が前記仮想グラウン
ドノードに接続された入力を有する反転アナログバッフ
ァの出力に接続されているこれら2個の入力を有するア
ナログマルチプレックスと、2個の入力ターミナルと1
個の出力ターミナルを有し、前記アナログマルチプレッ
クスの出力がその第1の入力ターミナルに接続され、か
つ参照電圧がその第2の入力ターミナルに加えられるコ
ンパレータとを含んで成ることを特徴とする回路。 - (2)マルチプレックスがMOSトランジスタにより形
成されたアナログスイッチ対により形成されている請求
項1に記載の検出回路。 - (3)ブリッジコンフィギュレーションに配置されかつ
ブリッジ段のサプライノードと仮想グラウンドノード間
の負荷を機能的にスイッチングする2対のアナログスイ
ッチのそれぞれに加えられるクロック方形波駆動シグナ
ルとその反転シグナルによりスイッチングモードの負荷
を駆動し、かつ前記負荷を通って流れる電流の大きさと
センスを検出するための回路手段を有するH−ブリッジ
段において、 該検出回路が、 回路の前記仮想グラウンドノードと真のグラウンドノー
ド間に接続された単一の検出抵抗と、それぞれ前記駆動
シグナルと前記反転駆動シグナルとにより駆動される2
個のスイッチを含んで成り、該駆動シグナルにより駆動
されるスイッチに対応する入力が前記仮想グラウンドノ
ードに接続され、かつ前記反転駆動シグナルにより駆動
されるスイッチに対応する入力が前記仮想グラウンドノ
ードに接続された入力を有する反転アナログバッファの
出力に接続されたこれら2個の入力を有するアナログマ
ルチプレックスと、 2個の入力ターミナルと1個の出力ターミナルを有し、
前記アナログマルチプレックスの出力がその第1の入力
ターミナルに接続され、かつ参照電圧がその第2の入力
ターミナルに加えられるコンパレータとを含んで成るこ
とを特徴とするH−ブリッジ段。 - (4)マルチプレックスがMOSトランジスタにより形
成されたアナログスイッチ対により形成されている請求
項3に記載のブリッジ段。 - (5)コンパレータの出力ターミナルがフリップフラッ
プの入力ターミナルに接続されかつ該フリップフラップ
の他の入力ターミナルにクロックシグナルが加えられ、 前記フリップフラップ出力シグナルが駆動シグナルを構
成し、かつ参照電圧の極性がブリッジ段の負荷を通って
流れる電流のセンスを決定する請求項3に記載のブリッ
ジ段。
Applications Claiming Priority (2)
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