JPH01135002A - 混成ｉｃ閉ループ抵抗トリミング方法 - Google Patents
混成ｉｃ閉ループ抵抗トリミング方法Info
- Publication number
- JPH01135002A JPH01135002A JP62292039A JP29203987A JPH01135002A JP H01135002 A JPH01135002 A JP H01135002A JP 62292039 A JP62292039 A JP 62292039A JP 29203987 A JP29203987 A JP 29203987A JP H01135002 A JPH01135002 A JP H01135002A
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- JP
- Japan
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- resistance
- trimming
- resistor
- loop
- closed
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- Pending
Links
- 238000009966 trimming Methods 0.000 title claims abstract description 27
- 238000000034 method Methods 0.000 claims description 7
- 239000004020 conductor Substances 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 2
- 238000005259 measurement Methods 0.000 description 2
- 238000007796 conventional method Methods 0.000 description 1
- 229910000679 solder Inorganic materials 0.000 description 1
Landscapes
- Apparatuses And Processes For Manufacturing Resistors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、混成ＩＣ閉ループ抵抗トリミング方法に関す
るものである。
るものである。
従来の混成ＩＣ閉ループ抵抗トリミングは、たとえば特
開昭５２−１５３５７１号のようにトリミング前にあら
かじめ閉ループを切断しておき、トリミングを施した後
切断部をはんだ等で接続する方法や、閉ループ中のトリ
ミング対象外の抵抗素子に流れる電流を電気的な操作に
よシ零にする回路を用いて、トリミング対象抵抗素子に
トリミングを施す方法などによシ行っていた。
開昭５２−１５３５７１号のようにトリミング前にあら
かじめ閉ループを切断しておき、トリミングを施した後
切断部をはんだ等で接続する方法や、閉ループ中のトリ
ミング対象外の抵抗素子に流れる電流を電気的な操作に
よシ零にする回路を用いて、トリミング対象抵抗素子に
トリミングを施す方法などによシ行っていた。
しかしながら、これらの従来技術においては、閉ループ
の切断・接続を行なわなければならないことや、ハード
ウェアを追加しなければならないことなどのような問題
点があった。
の切断・接続を行なわなければならないことや、ハード
ウェアを追加しなければならないことなどのような問題
点があった。
本発明の目的は、閉ループを構成する谷抵抗素子のトリ
ミングを、閉ループを構成しない抵抗素子のトリミング
方法へのソフトウェアの追加だけで達成することにある
。
ミングを、閉ループを構成しない抵抗素子のトリミング
方法へのソフトウェアの追加だけで達成することにある
。
本発明は、混成ＩＣの３つ以上の抵抗素子から成る閉ル
ープ抵抗を構成する各抵抗素子を、閉ループのまま測定
することにより、各抵抗素子の初期抵抗値を算出した後
、各抵抗素子を閉ループのまま所定の抵抗値に調整する
ことを特徴とする。
ープ抵抗を構成する各抵抗素子を、閉ループのまま測定
することにより、各抵抗素子の初期抵抗値を算出した後
、各抵抗素子を閉ループのまま所定の抵抗値に調整する
ことを特徴とする。
本発明は、閉ループを構成する３つ以上の抵抗素子につ
いて、閉ループ中の抵抗素子数と同数の異なった測定点
での測定を行ない、各抵抗素子の抵抗値を算出すること
により、それらの抵抗素子のトリミングを実現し、閉ル
ープを構成しない抵抗素子のトリミング方法へのソフト
ウェアの追加だけで達成できる◎ 〔実施例〕 以下本発明を図に示す実施例に従って具体的に説明する
。
いて、閉ループ中の抵抗素子数と同数の異なった測定点
での測定を行ない、各抵抗素子の抵抗値を算出すること
により、それらの抵抗素子のトリミングを実現し、閉ル
ープを構成しない抵抗素子のトリミング方法へのソフト
ウェアの追加だけで達成できる◎ 〔実施例〕 以下本発明を図に示す実施例に従って具体的に説明する
。
第１図は本発明による混成ＩＣ閉ループ抵抗トリミング
方法の一実施例を示すもので、トリミング前に導体パッ
ド１−２間、２−５間、３−１間のループ抵抗値を測定
し、その測定値から各抵抗素子４． ５． ６のトリミ
ング前初期素子抵抗値を真出し、これらの初期素子抵抗
値をもとに、各抵抗素子をその目標素子抵抗値にトリミ
ングするものである。
方法の一実施例を示すもので、トリミング前に導体パッ
ド１−２間、２−５間、３−１間のループ抵抗値を測定
し、その測定値から各抵抗素子４． ５． ６のトリミ
ング前初期素子抵抗値を真出し、これらの初期素子抵抗
値をもとに、各抵抗素子をその目標素子抵抗値にトリミ
ングするものである。
１−２間、２−３間、３−１間の測定ループ抵抗値Ｘｓ
７＋ ｚを、抵抗素子４． ５． ６の初期素子抵
抗値ｒ１ ｔ ｒ２ｓ ｒ５で表わすと、となるから、
初期素子抵抗値ｒ、＊ ｒ２１ ｒ３は、となる。
７＋ ｚを、抵抗素子４． ５． ６の初期素子抵
抗値ｒ１ ｔ ｒ２ｓ ｒ５で表わすと、となるから、
初期素子抵抗値ｒ、＊ ｒ２１ ｒ３は、となる。
これによシ、初期素子抵抗値ｒ１． ｒ２ａ ｒ５を算
出することができる。抵抗素子４． ５． ６のトリミ
ング目標素子抵抗値をＲ，、Ｒ２，Ｒ５とすると、最初
ら、ｘ＝Ｘｏとなるまで抵抗素子４にトリミングを施せ
ば、抵抗素子４の素子抵抗値をＲ１とすることができる
。
出することができる。抵抗素子４． ５． ６のトリミ
ング目標素子抵抗値をＲ，、Ｒ２，Ｒ５とすると、最初
ら、ｘ＝Ｘｏとなるまで抵抗素子４にトリミングを施せ
ば、抵抗素子４の素子抵抗値をＲ１とすることができる
。
次に、Ｙｏ＝−５五コ＋ Ｒ，）−を定め、２−３間の
ルＲ，＋Ｒ２＋ｒ。
ルＲ，＋Ｒ２＋ｒ。
一プ抵抗値Ｙを測定しながら、Ｙ ＝ Ｙｏとなるまで
抵抗素子５にトリミングを施せは、抵抗素子５の素子抵
抗値をＲ２とすることができる。最後に、ｚ。
抵抗素子５にトリミングを施せは、抵抗素子５の素子抵
抗値をＲ２とすることができる。最後に、ｚ。
−［（、（Ｒ，＋Ｒρ−と定め、３−１間のループ抵抗
値１（１＋８２＋Ｒ。
値１（１＋８２＋Ｒ。
２を測定しながら、Ｌ： ” Ｚ Ｏとなるまで抵抗素
子６にトリミングを施せば、抵抗素子６の素子抵抗値を
Ｒ５とすることができる。
子６にトリミングを施せば、抵抗素子６の素子抵抗値を
Ｒ５とすることができる。
以上の操作の流れ図を第２図に示す。これは、容易にソ
フトウェア化でき、このようにすれば、ハードウェアの
追加なしに、閉ループ抵抗トリミングが可能となる。
フトウェア化でき、このようにすれば、ハードウェアの
追加なしに、閉ループ抵抗トリミングが可能となる。
上記した実施例は、抵抗素子が３つの場合の閉ループ抵
抗トリミング方法であるが、第３図のように、５つの抵
抗素子で構成される複数の閉ループ抵抗にトリミングを
施す場合、抵抗素子１２．１３゜１４を１つの抵抗素子
として第１の実施例と同じ方法で抵抗素子１０．Ｉｔに
トリミングを施した後、抵抗素子１０．１ｔ、 １２を
１つの抵抗素子として第１の実施例と同様の方法で抵抗
素子１２．１３．１４にトリミングを施せば、それぞれ
の抵抗素子について所定の目標素子抵抗値にトリミング
することができるＯ また、第４図のように、５つの抵抗素子で構成される１
つの閉ループ抵抗にトリミングを施す場合、抵抗素子１
７．１８．１９を１つの抵抗素子として第１の実施例と
同じ方法で抵抗素子１５．１６にトリミングを施し、次
に、抵抗素子１．５．１６．１９を１つの抵抗素子とし
て第１の実施例と同じ方法で抵抗素子１７．１８にトリ
ミングを施した後、抵抗素子１５゜１６および抵抗素子
１７．１８をそれぞれ１つの抵抗素子として第１の実施
例と同様の方法で抵抗素子１９にトリミングを施せば、
それぞれの抵抗素子について所定の目標素子抵抗値にト
リミング前ができる〇 以上のような操作は３つ以上の任意の抵抗素子数で構成
される閉ループについて可能であシ容易にソフトウェア
化でき、このようにすれば、ハードウェアの追加なしに
、閉ループ抵抗トリミングが可能となる。 − 〔発明の効果〕 以上述べたように、本発明によれば、閉ループを構成す
る抵抗素子を閉ループのまま所定の抵抗値に調整するこ
とができるので、ハードウェアを追加する必要がなく経
済的である０
抗トリミング方法であるが、第３図のように、５つの抵
抗素子で構成される複数の閉ループ抵抗にトリミングを
施す場合、抵抗素子１２．１３゜１４を１つの抵抗素子
として第１の実施例と同じ方法で抵抗素子１０．Ｉｔに
トリミングを施した後、抵抗素子１０．１ｔ、 １２を
１つの抵抗素子として第１の実施例と同様の方法で抵抗
素子１２．１３．１４にトリミングを施せば、それぞれ
の抵抗素子について所定の目標素子抵抗値にトリミング
することができるＯ また、第４図のように、５つの抵抗素子で構成される１
つの閉ループ抵抗にトリミングを施す場合、抵抗素子１
７．１８．１９を１つの抵抗素子として第１の実施例と
同じ方法で抵抗素子１５．１６にトリミングを施し、次
に、抵抗素子１．５．１６．１９を１つの抵抗素子とし
て第１の実施例と同じ方法で抵抗素子１７．１８にトリ
ミングを施した後、抵抗素子１５゜１６および抵抗素子
１７．１８をそれぞれ１つの抵抗素子として第１の実施
例と同様の方法で抵抗素子１９にトリミングを施せば、
それぞれの抵抗素子について所定の目標素子抵抗値にト
リミング前ができる〇 以上のような操作は３つ以上の任意の抵抗素子数で構成
される閉ループについて可能であシ容易にソフトウェア
化でき、このようにすれば、ハードウェアの追加なしに
、閉ループ抵抗トリミングが可能となる。 − 〔発明の効果〕 以上述べたように、本発明によれば、閉ループを構成す
る抵抗素子を閉ループのまま所定の抵抗値に調整するこ
とができるので、ハードウェアを追加する必要がなく経
済的である０
第１図は本発明の第１の実施例の使用方法を説明するた
めのパター７図、第２図は操作フロー図、第６凶、第４
図はそれぞれ第２．第５の実施例の使用方法を説明する
ための回路臼である。 １．２． ３・・・得体パッド、４． ５．６． １０
． Ｉｔ。 １２、 ＋５．１４．１５．１６．１７．１８．１９・
・・抵抗素子。 第 １ 図 ］ 第 ３ 図 ％ ４図 ４〜６，１０〜１９４６４Ｌ素す
めのパター７図、第２図は操作フロー図、第６凶、第４
図はそれぞれ第２．第５の実施例の使用方法を説明する
ための回路臼である。 １．２． ３・・・得体パッド、４． ５．６． １０
． Ｉｔ。 １２、 ＋５．１４．１５．１６．１７．１８．１９・
・・抵抗素子。 第 １ 図 ］ 第 ３ 図 ％ ４図 ４〜６，１０〜１９４６４Ｌ素す
Claims (1)
- 混成ＩＣの３つ以上の抵抗素子から成る閉ループ抵抗を
構成する各抵抗素子を、閉ループのまま測定することに
より、各抵抗素子の初期抵抗値を算出した後、各抵抗素
子を閉ループのまま所定の抵抗値に調整することを特徴
とする混成ＩＣ閉ループ抵抗トリミング方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62292039A JPH01135002A (ja) | 1987-11-20 | 1987-11-20 | 混成ｉｃ閉ループ抵抗トリミング方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62292039A JPH01135002A (ja) | 1987-11-20 | 1987-11-20 | 混成ｉｃ閉ループ抵抗トリミング方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01135002A true JPH01135002A (ja) | 1989-05-26 |
Family
ID=17776741
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62292039A Pending JPH01135002A (ja) | 1987-11-20 | 1987-11-20 | 混成ｉｃ閉ループ抵抗トリミング方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01135002A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7441974B2 (en) | 2003-10-13 | 2008-10-28 | L'oréal | Packaging and applicator device |
-
1987
- 1987-11-20 JP JP62292039A patent/JPH01135002A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7441974B2 (en) | 2003-10-13 | 2008-10-28 | L'oréal | Packaging and applicator device |
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