JPH01129922U - - Google Patents
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- Publication number
- JPH01129922U JPH01129922U JP2300588U JP2300588U JPH01129922U JP H01129922 U JPH01129922 U JP H01129922U JP 2300588 U JP2300588 U JP 2300588U JP 2300588 U JP2300588 U JP 2300588U JP H01129922 U JPH01129922 U JP H01129922U
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- JP
- Japan
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- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Analogue/Digital Conversion (AREA)
Description
第１図はこの考案に係るＤ／Ａコンバータの実
施例を示す回路図、第２図は同上実施例における
デイジタル入力に対する出力アナログ量の一例を
示す図、第３図は従来のＤ／Ａコンバータを示す
回路図、第４図は一般的な電流加算方式Ｄ／Ａコ
ンバータを示す回路図、第５図は第３図の従来例
におけるデイジタル入力に対する出力アナログ量
を示す図である。 ３ａ〜３ｄ：デイジタル信号の入力端子、４：
電流加算手段としての非反転加算回路を構成する
オペアンプ、５：カレントミラー回路（電流設定
手段）。
施例を示す回路図、第２図は同上実施例における
デイジタル入力に対する出力アナログ量の一例を
示す図、第３図は従来のＤ／Ａコンバータを示す
回路図、第４図は一般的な電流加算方式Ｄ／Ａコ
ンバータを示す回路図、第５図は第３図の従来例
におけるデイジタル入力に対する出力アナログ量
を示す図である。 ３ａ〜３ｄ：デイジタル信号の入力端子、４：
電流加算手段としての非反転加算回路を構成する
オペアンプ、５：カレントミラー回路（電流設定
手段）。
Claims (1)
- 【実用新案登録請求の範囲】 デイジタル入力の各ビツトに対応した電流を加
算してアナログ量を出力する電流加算手段が備え
られた電流加算方式のＤ／Ａコンバータにおいて
、 前記電流加算手段に所定の設定電流を加算させ
る電流設定手段を付設したことを特徴とするＤ／
Ａコンバータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2300588U JPH01129922U (ja) | 1988-02-25 | 1988-02-25 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2300588U JPH01129922U (ja) | 1988-02-25 | 1988-02-25 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01129922U true JPH01129922U (ja) | 1989-09-05 |
Family
ID=31241631
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2300588U Pending JPH01129922U (ja) | 1988-02-25 | 1988-02-25 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01129922U (ja) |
-
1988
- 1988-02-25 JP JP2300588U patent/JPH01129922U/ja active Pending
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