JPH0419826U - - Google Patents

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JPH0419826U
JPH0419826U JP1990058677U JP5867790U JPH0419826U JP H0419826 U JPH0419826 U JP H0419826U JP 1990058677 U JP1990058677 U JP 1990058677U JP 5867790 U JP5867790 U JP 5867790U JP H0419826 U JPH0419826 U JP H0419826U
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JP
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delay circuit
delay
output signal
output
switch
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JP1990058677U
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【図面の簡単な説明】
第１図はこの考案の一実施例による遅延回路を
示す回路図、第２図は第１図の主要部分の波形図
、第３図は従来の遅延回路を示す回路図、第４図
は第３図の主要部分の波形図である。 図において、１は入力端子、２〜５，７〜１０
は反転アンプ、６は出力端子、１１はスイツチを
示す。なお、図中、同一符号は同一、又は相当部
分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. 基準となるデイジタル信号の入力手段と、前記
    デイジタル信号を遅延させる一定の遅延量を持つ
    た遅延素子を多段接続した第１の遅延回路と、前
    記第１の遅延回路の出力信号を遅延させる一定の
    遅延量を持つた遅延素子を多段接続した第２の遅
    延回路と、前記第１の遅延回路の出力信号と前記
    第２の遅延回路の出力信号とを入力して、前記デ
    イジタル入力信号によつて前記２つの出力信号の
    どちらかを選択するスイツチと、前記スイツチの
    出力を取り出す手段とを備えたことを特徴とする
    遅延回路。
JP1990058677U 1990-05-31 1990-05-31 Pending JPH0419826U (ja)

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JP1990058677U JPH0419826U (ja) 1990-05-31 1990-05-31

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JPH0419826U true JPH0419826U (ja) 1992-02-19

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