JP7538345B2 - マルチチップモジュールの寿命を評価するための評価モジュール及び評価方法 - Google Patents
マルチチップモジュールの寿命を評価するための評価モジュール及び評価方法 Download PDFInfo
- Publication number
- JP7538345B2 JP7538345B2 JP2023519405A JP2023519405A JP7538345B2 JP 7538345 B2 JP7538345 B2 JP 7538345B2 JP 2023519405 A JP2023519405 A JP 2023519405A JP 2023519405 A JP2023519405 A JP 2023519405A JP 7538345 B2 JP7538345 B2 JP 7538345B2
- Authority
- JP
- Japan
- Prior art keywords
- chip
- module
- evaluation
- substrate
- life
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
- 238000011156 evaluation Methods 0.000 title claims description 171
- 239000000758 substrate Substances 0.000 claims description 66
- 238000012360 testing method Methods 0.000 claims description 56
- 230000035882 stress Effects 0.000 claims description 35
- HBMJWWWQQXIZIP-UHFFFAOYSA-N silicon carbide Chemical compound [Si+]#[C-] HBMJWWWQQXIZIP-UHFFFAOYSA-N 0.000 claims description 26
- 229910010271 silicon carbide Inorganic materials 0.000 claims description 25
- 238000000034 method Methods 0.000 claims description 24
- 230000008646 thermal stress Effects 0.000 claims description 20
- 230000017525 heat dissipation Effects 0.000 claims description 14
- 238000004364 calculation method Methods 0.000 claims description 6
- 238000012854 evaluation process Methods 0.000 claims description 6
- 239000000463 material Substances 0.000 claims description 6
- GNFTZDOKVXKIBK-UHFFFAOYSA-N 3-(2-methoxyethoxy)benzohydrazide Chemical compound COCCOC1=CC=CC(C(=O)NN)=C1 GNFTZDOKVXKIBK-UHFFFAOYSA-N 0.000 claims description 4
- FGUUSXIOTUKUDN-IBGZPJMESA-N C1(=CC=CC=C1)N1C2=C(NC([C@H](C1)NC=1OC(=NN=1)C1=CC=CC=C1)=O)C=CC=C2 Chemical compound C1(=CC=CC=C1)N1C2=C(NC([C@H](C1)NC=1OC(=NN=1)C1=CC=CC=C1)=O)C=CC=C2 FGUUSXIOTUKUDN-IBGZPJMESA-N 0.000 claims description 4
- 230000005484 gravity Effects 0.000 claims description 4
- 238000004088 simulation Methods 0.000 claims description 3
- 230000000930 thermomechanical effect Effects 0.000 claims description 2
- 239000010410 layer Substances 0.000 description 13
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 8
- BQCADISMDOOEFD-UHFFFAOYSA-N Silver Chemical compound [Ag] BQCADISMDOOEFD-UHFFFAOYSA-N 0.000 description 6
- 239000011889 copper foil Substances 0.000 description 6
- 238000002474 experimental method Methods 0.000 description 6
- 230000008569 process Effects 0.000 description 5
- 230000015556 catabolic process Effects 0.000 description 4
- 238000006731 degradation reaction Methods 0.000 description 4
- 229910052751 metal Inorganic materials 0.000 description 4
- 239000002184 metal Substances 0.000 description 4
- 230000032683 aging Effects 0.000 description 3
- 230000008859 change Effects 0.000 description 3
- 230000009471 action Effects 0.000 description 2
- 239000000919 ceramic Substances 0.000 description 2
- 229910052802 copper Inorganic materials 0.000 description 2
- 239000010949 copper Substances 0.000 description 2
- PMHQVHHXPFUNSP-UHFFFAOYSA-M copper(1+);methylsulfanylmethane;bromide Chemical compound Br[Cu].CSC PMHQVHHXPFUNSP-UHFFFAOYSA-M 0.000 description 2
- 238000010168 coupling process Methods 0.000 description 2
- 239000004519 grease Substances 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- 238000004806 packaging method and process Methods 0.000 description 2
- 229920001296 polysiloxane Polymers 0.000 description 2
- 239000002356 single layer Substances 0.000 description 2
- 238000005245 sintering Methods 0.000 description 2
- 238000006243 chemical reaction Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000004044 response Effects 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
Images
Classifications
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
- G01R31/00—Arrangements for testing electric properties; Arrangements for locating electric faults; Arrangements for electrical testing characterised by what is being tested not provided for elsewhere
- G01R31/28—Testing of electronic circuits, e.g. by signal tracer
- G01R31/2851—Testing of integrated circuits [IC]
- G01R31/2884—Testing of integrated circuits [IC] using dedicated test connectors, test elements or test circuits on the IC under test
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
- G01R31/00—Arrangements for testing electric properties; Arrangements for locating electric faults; Arrangements for electrical testing characterised by what is being tested not provided for elsewhere
- G01R31/26—Testing of individual semiconductor devices
- G01R31/2642—Testing semiconductor operation lifetime or reliability, e.g. by accelerated life tests
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- General Engineering & Computer Science (AREA)
- Testing Of Individual Semiconductor Devices (AREA)
Description
上記の評価モジュールを準備するステップaと、
複数群のテスト応力及び前記評価モジュールの数を決定するステップbと、
前記評価モジュールに対して加速寿命テストを行うステップcと、
前記評価モジュールの各群のテスト応力での信頼性関数を計算するステップdと、
前記評価モジュールの寿命予測モデルを計算するステップeと、
前記マルチチップモジュールの各群のテスト応力での信頼性関数を計算するステップfと、
前記マルチチップモジュールの寿命予測モデルを計算するステップgと、
前記マルチチップモジュールの実際の動作状況での寿命を計算するステップhと、
を含む方法がさらに提供される。
ステップS1:負荷モデルを利用して負荷変化vload(t)から負荷電流iload(t)を決定する、
ステップS2:回路モデルを利用して負荷電流iload(t)からモジュール電流idevice(t)を決定する、
ステップS3:損失モデルを利用してモジュール電流idevice(t)からモジュール損失pdevice(t)を決定する、
ステップS4:熱モデルを利用してモジュール損失pdevice(t)からチップジャンクション温度Tdevice(t)を決定する、
ステップS5:レインフロー計数法を利用してチップジャンクション温度Tdevice(t)からモジュールテスト応力ΔTjとTjmを決定する。
Claims (17)
- 第1の基板(110)と前記第1の基板(110)上の取付位置に配置された複数の被評価チップ(130)とを含むマルチチップモジュール(100)の寿命を評価するために用いられる評価モジュール(200)であって、
前記マルチチップモジュール(100)の前記第1の基板(110)と同等に構成されており、且つ、前記マルチチップモジュール(100)の前記第1の基板(110)上の取付位置に対応する取付位置を有する第2の基板(210)と、
前記マルチチップモジュール(100)の前記複数の被評価チップ(130)と同等に構成されており、且つ、その数は前記マルチチップモジュール(100)の前記複数の被評価チップ(130)の数よりも少なくとも1つ少ない、少なくとも1つの評価チップ(230)と、
を備え、
前記少なくとも1つの評価チップ(230)は、前記少なくとも1つの評価チップ(230)と、前記少なくとも1つの評価チップ(230)に対応する前記被評価チップ(130)とが、放熱性能及び受ける熱応力において同等になるように、前記少なくとも1つの評価チップ(230)に対応する前記被評価チップ(130)が配置された前記第1の基板(110)上の取付位置に対応する前記第2の基板(210)上の少なくとも1つの取付位置に配置される、
ことを特徴とする評価モジュール(200)。 - 前記少なくとも1つの評価チップ(230)は、単一のチップである、ことを特徴とする請求項1に記載の評価モジュール(200)。
- 前記評価モジュール(200)は、前記第2の基板(210)上に配置された少なくとも1つのチップ代替部材(231)をさらに備え、且つ、前記少なくとも1つの評価チップ(230)と前記少なくとも1つのチップ代替部材(231)とは、前記評価モジュール(200)の構造が評価過程においてバランスを保持し得るように構成される、ことを特徴とする請求項1に記載の評価モジュール(200)。
- 前記少なくとも1つのチップ代替部材(231)は、前記第2の基板(210)上の取付位置に配置される、ことを特徴とする請求項3に記載の評価モジュール(200)。
- 前記少なくとも1つの評価チップ(230)と前記少なくとも1つのチップ代替部材(231)とは、それぞれ少なくとも三角形を含む多角形の頂点に配置され、前記第2の基板(210)が水平に配置されたとき、前記少なくとも1つの評価チップ(230)及び前記少なくとも1つのチップ代替部材(231)の上方に設けられた部材の重心線は、前記多角形により画定される領域を通過する、ことを特徴とする請求項4に記載の評価モジュール(200)。
- 前記少なくとも1つのチップ代替部材(231)は、前記少なくとも1つの評価チップ(230)の熱機械的性能に合った材料により作製される、ことを特徴とする請求項3乃至5のいずれか一項に記載の評価モジュール(200)。
- 前記少なくとも1つの評価チップ(230)は、炭化珪素MOSFETチップであり、且つ、前記少なくとも1つのチップ代替部材(231)は、炭化珪素により作製される、ことを特徴とする請求項6に記載の評価モジュール(200)。
- 前記マルチチップモジュール(100)は、第3の基板(120)をさらに備え、
前記マルチチップモジュール(100)の前記複数の被評価チップ(130)は、前記マルチチップモジュール(100)の前記第1の基板(110)と前記第3の基板(120)との間に配置され、
前記評価モジュール(200)は、第4の基板(220)をさらに備え、
前記評価モジュール(200)の前記少なくとも1つの評価チップ(230)は、前記評価モジュール(200)の前記第2の基板(210)と前記第4の基板(220)との間に配置される、ことを特徴とする請求項1に記載の評価モジュール(200)。 - 前記評価モジュール(200)は、前記第2の基板(210)と前記第4の基板(220)との間に配置された少なくとも1つのチップ代替部材(231)をさらに備え、且つ、前記第2の基板(210)が水平に配置されたとき、前記少なくとも1つの評価チップ(230)と前記少なくとも1つのチップ代替部材(231)とは、前記第4の基板(220)が評価過程において構造のバランスを保持し得るように構成される、ことを特徴とする請求項8に記載の評価モジュール(200)。
- マルチチップモジュール(100)の寿命を評価するための方法であって、
請求項1乃至9のいずれか一項に記載の評価モジュール(200)を準備するステップaと、
複数群のテスト応力及び前記評価モジュール(200)の数を決定するステップbと、
前記評価モジュール(200)に対して加速寿命テストを行うステップcと、
前記評価モジュール(200)の各群のテスト応力での信頼性関数を計算するステップdと、
前記評価モジュール(200)の寿命予測モデルを計算するステップeと、
前記マルチチップモジュール(100)の各群のテスト応力での信頼性関数を計算するステップfと、
前記マルチチップモジュール(100)の寿命予測モデルを計算するステップgと、
前記マルチチップモジュール(100)の実際の動作状況での寿命を計算するステップhと、
を含むことを特徴とする方法。 - 前記ステップfは、
iを1乃至nの整数、nを前記マルチチップモジュールにおけるチップの数、Nfiを前記マルチチップモジュールの各チップの寿命、ΔTjiを前記マルチチップモジュールの各チップのチップジャンクション温度の変動幅とするとき、前記ステップeにおいて計算された定数αe、βeにより、下記式
iを1乃至nの整数、nを前記マルチチップモジュールにおけるチップの数、Ri(t)を前記マルチチップモジュールの各チップの信頼度、tを前記マルチチップモジュールの寿命とするとき、下記式
をさらに含む、ことを特徴とする請求項13に記載の方法。 - 前記マルチチップモジュール(100)の各チップのチップジャンクション温度の変動幅は、シミュレーションにより得られる、ことを特徴とする請求項16に記載の方法。
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PCT/CN2020/118319 WO2022061863A1 (zh) | 2020-09-28 | 2020-09-28 | 用于评估多芯片模块寿命的评估模块和评估方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2023543050A JP2023543050A (ja) | 2023-10-12 |
JP7538345B2 true JP7538345B2 (ja) | 2024-08-21 |
Family
ID=80844872
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2023519405A Active JP7538345B2 (ja) | 2020-09-28 | 2020-09-28 | マルチチップモジュールの寿命を評価するための評価モジュール及び評価方法 |
Country Status (3)
Country | Link |
---|---|
JP (1) | JP7538345B2 (ja) |
DE (1) | DE112020007216T5 (ja) |
WO (1) | WO2022061863A1 (ja) |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2016532074A (ja) | 2013-07-01 | 2016-10-13 | 株式会社日立製作所 | はんだ接合の予備診断のための電子アセンブリ |
CN106291309A (zh) | 2016-09-22 | 2017-01-04 | 全球能源互联网研究院 | 一种功率半导体芯片测试单元及其测试方法 |
JP2019114659A (ja) | 2017-12-22 | 2019-07-11 | 東レエンジニアリング株式会社 | 実装方法および実装装置 |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US10156512B2 (en) * | 2013-03-01 | 2018-12-18 | Futurewei Technologies, Inc. | System and method for measuring thermal reliability of multi-chip modules |
CN105069258A (zh) * | 2015-09-02 | 2015-11-18 | 北京智芯微电子科技有限公司 | 一种芯片设计可靠性的评估方法及装置 |
CN107991597A (zh) * | 2017-12-28 | 2018-05-04 | 江苏中科君芯科技有限公司 | 一种igbt可靠性测试的控制方法、装置及系统 |
-
2020
- 2020-09-28 JP JP2023519405A patent/JP7538345B2/ja active Active
- 2020-09-28 DE DE112020007216.9T patent/DE112020007216T5/de active Pending
- 2020-09-28 WO PCT/CN2020/118319 patent/WO2022061863A1/zh active Application Filing
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2016532074A (ja) | 2013-07-01 | 2016-10-13 | 株式会社日立製作所 | はんだ接合の予備診断のための電子アセンブリ |
CN106291309A (zh) | 2016-09-22 | 2017-01-04 | 全球能源互联网研究院 | 一种功率半导体芯片测试单元及其测试方法 |
JP2019114659A (ja) | 2017-12-22 | 2019-07-11 | 東レエンジニアリング株式会社 | 実装方法および実装装置 |
Also Published As
Publication number | Publication date |
---|---|
WO2022061863A1 (zh) | 2022-03-31 |
JP2023543050A (ja) | 2023-10-12 |
DE112020007216T5 (de) | 2023-03-09 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
CN103782381B (zh) | 包括在衬底上的管芯以及在管芯上具有开窗的散热器的电子组件 | |
EP0222144B1 (en) | A wafer-scale semiconductor device | |
US8193625B2 (en) | Stacked-chip packaging structure and fabrication method thereof | |
KR20110097698A (ko) | 평가용 반도체칩, 평가 시스템 및 그의 리페어 방법 | |
US20170154835A1 (en) | Electronic module and method of manufacturing the same | |
CN106098646A (zh) | 半导体装置 | |
KR102084108B1 (ko) | 다층 배선 기판 및 이를 이용한 프로브 카드 | |
CN104798198B (zh) | 半导体装置 | |
KR100910614B1 (ko) | 반도체 장치 및 그의 제조방법 | |
JP7538345B2 (ja) | マルチチップモジュールの寿命を評価するための評価モジュール及び評価方法 | |
JPS62159448A (ja) | 集積回路ウエハ | |
JP4635901B2 (ja) | モジュールパッケージ | |
CN114282397B (zh) | 用于评估多芯片模块寿命的评估模块和评估方法 | |
JP2010251551A (ja) | 電子回路基板およびパワー半導体モジュール | |
JP5894515B2 (ja) | 半導体装置、寿命推定装置、寿命推定方法 | |
US6620638B1 (en) | Testing of multi-chip electronic modules | |
US11791232B2 (en) | Packaging structure and packaging method of digital circuit | |
JPS63293965A (ja) | 半導体装置およびその製造方法 | |
Liu et al. | Investigation on copper clip bonding structure for power package | |
CN112886558A (zh) | 一种功率半导体芯片并联结构及其驱动回路过流失效抑制方法 | |
KR20100016885A (ko) | 세라믹 프로브 카드의 제조 방법 | |
Dai et al. | Real-time degradation monitoring and lifetime estimation of 3D integrated bond-wire-less double-sided cooled power switch technologies | |
Ren et al. | An Improved Double-layer Spacer in Double-sided Cooling Power Module | |
CN218385186U (zh) | 一种半导体封装结构 | |
Roy et al. | Design and Fabrication of an Inverter Module Co-Designed With the Busbar and Gate Driver |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20230327 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20240207 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20240501 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20240710 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20240808 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 7538345 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |