JP7454748B2 - フォロワモードのビデオ動作 - Google Patents
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Description
本出願は、2020年9月14日出願の米国特許仮出願第63/078,300号の優先権および利益を主張し、その全体があらゆる目的のために参照により本明細書に組み込まれる。
Claims (20)
- プロセッサによって、画像データの第1のフレームを受信することと、ここで画像データの前記第1のフレームはアクティブ部分およびアイドル部分を有し、前記アクティブ部分は第1の電子デバイスの第1のディスプレイによって1つ以上の画像を提示するためのデータを有し、前記アイドル部分は前記プロセッサが画像データの第2のフレームを処理する前に待機する時間に対応し、
画像データの前記第1のフレームの前記アイドル部分の間に、前記プロセッサによって第2の電子デバイスから信号を受信することと、ここで前記第2の電子デバイスは前記第1のディスプレイとは別個であり、
画像データの前記第1のフレームの前記アイドル部分の間に前記第2の電子デバイスから前記信号が受信されたことに応答して、前記プロセッサによって画像データの前記第1のフレームに後続する画像データの第2のフレームを処理することと、を有し、
前記信号がパルスを有し、前記第2のフレームの処理が前記パルスの終わりに開始する、方法。 - 前記プロセッサによって前記時間が経過したか否かを判定することと、ここで前記時間の経過中には前記第2の電子デバイスから前記信号が受信されておらず、
前記時間が経過したことに応答して、前記プロセッサによって画像データの前記第2のフレームの処理を開始することと、
をさらに有する、請求項1に記載の方法。 - 前記時間が設定可能である、請求項2に記載の方法。
- 前記画像データの前記第1のフレームは複数のラインを有し、前記信号を受信せずに前記時間が経過したことによって割り込みが発生した場合、前記プロセッサによって、前記複数のラインのうち前記割り込みに対応するラインの番号をデバッグのためにメモリにログ記録することをさらに有する、請求項2に記載の方法。
- 前記画像データの前記第1のフレームは複数のラインを有し、前記第1のフレームの前記アクティブ部分で前記第2の電子デバイスから前記信号を受信した場合、前記プロセッサによって、前記複数のラインのうち前記信号の最初の受信に対応するラインの番号をデバッグのためにメモリにログ記録すること、をさらに有する、請求項2に記載の方法。
- 前記画像データの前記第1のフレームは複数のラインを有し、前記信号が前記アイドル部分で前記第2の電子デバイスから受信されていないことに応答して割り込みが発生した場合、前記プロセッサによって、前記割り込みに対応するラインの番号をデバッグのためにメモリにログ記録することをさらに有する、請求項1に記載の方法。
- 前記信号がパルスを有する、請求項1から6のいずれか1項に記載の方法。
- 画像データの前記第1のフレームの前記アイドル部分が、前記画像データの前記第2のフレームの垂直フロントポーチ(VFP)部分の直前にある、請求項1から6のいずれか1項に記載の方法。
- 前記パルスが第1の電圧から第2の電圧への第1の遷移と、前記第2の電圧から前記第1の電圧への第2の遷移とを有する、請求項1から6のいずれか1項に記載の方法。
- 前記プロセッサにより、画像データの前記第1のフレームに対応する複数のラインの各ラインの先頭を追跡し、前記信号を受信した場合、次のラインの先頭で前記第2のフレームの処理を開始することをさらに有する、請求項1から6のいずれか1項に記載の方法。
- ディスプレイと、
画像処理回路と、を有する電子デバイスであって、
前記画像処理回路は、
画像データのフレームを受信し、ここで画像データの前記フレームはアクティブ部分およびアイドル部分を有し、前記アクティブ部分は第1の電子デバイスの第1のディスプレイによって1つ以上の画像を提示するためのデータを有し、
画像データの前記フレームの前記アイドル部分の間に、追加のディスプレイから信号を受信し、ここで前記追加のディスプレイは前記ディスプレイとは別個であり、
前記追加のディスプレイから前記信号が受信されたことに応答して、画像データの追加のフレームの処理を開始する、ように構成され、前記ディスプレイは第1のクロックに関連付けられ、前記追加のディスプレイは第2のクロックに関連付けられ、前記信号は、前記ディスプレイおよび前記追加のディスプレイによって提示されている、画像データの前記追加のフレームの1つ以上の追加画像を同期させるように構成される、電子デバイス。 - 前記画像処理回路は、前記ディスプレイおよび前記追加のディスプレイによって前記1つ以上の追加画像を提示するようにさらに構成される、請求項11に記載の電子デバイス。
- 前記第1のクロックは前記第2のクロックに対してドリフトしている、請求項11または12に記載の電子デバイス。
- 前記画像処理回路は、前記信号が前記追加のディスプレイから受信された後に、画像データの前記追加のフレームの処理を開始するようにさらに構成される、請求項13に記載の電子デバイス。
- 1つ以上の動作を実行するように構成された画像処理回路であって、前記1つ以上の動作が、
画像データのフレームを受信することと、ここで画像データの前記フレームはアクティブ部分と、アイドル部分とを有し、前記アクティブ部分は第1の電子デバイスの第1のディスプレイによって1つ以上の画像を提示するためのデータを有し、画像データの前記フレームは画像データの複数のラインを有し、
画像データの前記フレームの前記アイドル部分の間に第2の電子デバイスから信号を受信することと、ここで前記信号は前記複数のラインの第1のラインの間に受信され、前記第2の電子デバイスは第1のディスプレイと別個であり、
前記第2の電子デバイスから前記信号を受信したことに応答して、画像データの前記フレームの処理を、前記第1のラインの直後の前記複数のラインの第2のラインで開始することと、
を含む、画像処理回路。 - 前記1つ以上の動作は、
時間が経過したか否かを判定することと、ここで前記時間の間には前記第2の電子デバイスから前記信号が受信されておらず、
前記時間が経過したことに応答して、前記複数のラインの予め定められたラインで画像データの前記フレームの処理を開始することと、
をさらに含む、請求項15に記載の画像処理回路。 - 前記1つ以上の動作は、前記予め定められたラインの先頭で前記画像データの前記フレームの前記処理を開始するために前記複数のラインの各ラインの先頭を追跡することをさらに含む、請求項16に記載の画像処理回路。
- 前記1つ以上の動作は、前記アイドル部分の間に前記信号が前記第2の電子デバイスから受信されていないことに応答して割り込みが発生した場合に、前記割り込みに対応する前記フレームのラインの番号をデバッグのためにメモリにログ記録することをさらに含む、請求項15に記載の画像処理回路。
- 前記1つ以上の画像は、前記第1のディスプレイおよび、前記第2の電子デバイスの第2のディスプレイによって提示される、請求項15から18のいずれか1項に記載の画像処理回路。
- 前記第2の電子デバイスは第2のディスプレイを有する、請求項15から18のいずれか1項に記載の画像処理回路。
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