JP7353470B2 - 表示パネルの駆動装置、駆動方法および表示装置 - Google Patents
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- 1フレーム内で、表示パネルにおけるサブ画素へ走査信号を複数回出力し、前記複数回のうちの毎回、複数のサブフレームに分けて前記表示パネルにおけるサブ画素へ走査信号を出力するように構成される行走査回路と、
複数の前記サブフレーム内で前記サブ画素に対応する表示データを含む表示データストリームを受信し、前記表示データに含まれたアナログビット表示データおよびデジタルビット表示データに基づいて前記表示データストリームを分岐し、分岐された表示データストリームを列走査回路に出力するように構成されるデータプロセッサと、
前記データプロセッサに電気的に接続された列走査回路であって、前記アナログビット表示データに基づき、明状態アナログデータ電圧に対応するデータ信号を生成し、前記デジタルビット表示データに基づき、生成した暗状態デジタルデータ電圧に対応するデータ信号または前記明状態アナログデータ電圧に対応するデータ信号を前記表示パネルの対応するサブ画素に出力するように構成される列走査回路と、を含み、
前記列走査回路には、列走査タイミング回路、および明状態アナログデータ電圧生成回路が含まれ、
前記列走査タイミング回路は、複数の第1の入力端、複数の第2の入力端および複数の出力端を含み、前記列走査タイミング回路の第1の入力端が前記明状態アナログデータ電圧生成回路に電気的に接続され、前記列走査タイミング回路の第2の入力端が暗状態デジタルデータ電圧を入力するように構成され、
前記データプロセッサは、前記明状態アナログデータ電圧生成回路が前記アナログビット表示データに基づいて明状態アナログデータ電圧に対応するデータ信号を生成するように、前記アナログビット表示データを前記明状態アナログデータ電圧生成回路に出力し、および、前記列走査タイミング回路が前記デジタルビット表示データに基づき、前記出力端が暗状態デジタルデータ電圧に対応するデータ信号または前記明状態アナログデータ電圧に対応するデータ信号を出力するよう制御するように、前記デジタルビット表示データを前記列走査タイミング回路に出力することによって、分岐された表示データストリームを前記列走査回路に出力するように構成される、
表示パネルの駆動装置。 - 前記列走査タイミング回路には、複数のゲーティングモジュールが含まれ、
各々の前記ゲーティングモジュールは、チャネルタイプが異なる第1のトランジスターおよび第2のトランジスターを含み、
前記第1のトランジスターのゲートおよび前記第2のトランジスターのゲートは、前記デジタルビット表示データを受信し、前記デジタルビット表示データに基づいてオンまたはオフにするように構成され、前記第1のトランジスターの第1の電極が前記列走査タイミング回路の第1の入力端にそれぞれ対応して電気的に接続され、前記第1のトランジスターの第2の電極が前記列走査タイミング回路の出力端にそれぞれ対応して電気的に接続され、前記第2のトランジスターの第1の電極が前記列走査タイミング回路の第2の入力端にそれぞれ対応して電気的に接続され、前記第2のトランジスターの第2の電極が前記列走査タイミング回路の出力端にそれぞれ対応して電気的に接続されている、請求項1に記載の表示パネルの駆動装置。 - 前記行走査回路および前記列走査回路に電気的に接続される、前記行走査回路および前記列走査回路が同時に走査動作を行うよう制御するように構成されるタイミングコントローラと、
前記複数の第2の入力端に接続される、前記暗状態デジタルデータ電圧を提供するように構成される第1の電源と、をさらに含む請求項2に記載の表示パネルの駆動装置。 - 請求項1~3のいずれか1項に記載の表示パネルの駆動装置、および前記駆動装置に接続された表示パネルを含む、表示装置。
- 前記表示パネルには、画素回路を含むサブ画素が含まれ、
前記画素回路は、データ書き込みトランジスター、駆動トランジスター、走査信号入力端、データ信号入力端および発光素子を含み、
前記走査信号入力端は、前記駆動装置の行走査回路に電気的に接続され、前記行走査回路から出力された走査信号を受信するように構成され、
前記データ信号入力端は、前記駆動装置の列走査回路に電気的に接続され、前記列走査回路から出力されたデータ信号を受信するように構成され、
前記データ書き込みトランジスターは、前記駆動トランジスター、走査信号入力端およびデータ信号入力端に電気的に接続され、前記データ信号入力端により受信されたデータ信号を前記駆動トランジスターのゲートに書き込むように構成され、
前記駆動トランジスターは、前記発光素子に電気的に接続され、前記駆動トランジスターのゲート電圧に基づいて前記発光素子が発光するように駆動するように構成される、請求項4に記載の表示装置。 - 前記画素回路には、蓄積コンデンサ、第1の電圧入力端および第2の電圧入力端がさらに含まれ、および/または、前記表示装置には、走査線、および/または、データ線、および/または、画像データ信号処理チップがさらに含まれ、
前記蓄積コンデンサの第1の端が前記駆動トランジスターのゲートに電気的に接続され、前記蓄積コンデンサの第2の端が前記駆動トランジスターの第1の電極に電気的に接続され、前記第1の電圧入力端が前記駆動トランジスターの第1の電極に電気的に接続され、前記駆動トランジスターの第2の電極が前記発光素子の第1の電極に電気的に接続され、前記発光素子の第2の電極が前記第2の電圧入力端に電気的に接続されている、請求項5に記載の表示装置。 - 行走査回路が、1フレーム内で、表示パネルにおけるサブ画素へ走査信号を複数回出力し、前記複数回のうちの毎回、複数のサブフレームに分けて前記表示パネルにおけるサブ画素へ走査信号を出力することと、
データプロセッサが、複数の前記サブフレーム内で前記サブ画素に対応する表示データを含む表示データストリームを受信し、前記表示データに含まれたアナログビット表示データおよびデジタルビット表示データに基づいて前記表示データストリームを分岐し、分岐された表示データストリームを列走査回路に出力することと、
前記列走査回路が、前記アナログビット表示データに基づき、明状態アナログデータ電圧に対応するデータ信号を生成し、前記デジタルビット表示データに基づき、暗状態デジタルデータ電圧に対応するデータ信号または前記明状態アナログデータ電圧に対応するデータ信号を前記表示パネルの対応するサブ画素に出力することと、を含み、
前記列走査回路には、列走査タイミング回路、および明状態アナログデータ電圧生成回路が含まれ、
前記列走査タイミング回路は、複数の第1の入力端、複数の第2の入力端および複数の出力端を含み、前記列走査タイミング回路の第1の入力端が前記明状態アナログデータ電圧生成回路に電気的に接続され、前記列走査タイミング回路の第2の入力端が暗状態デジタルデータ電圧を入力するように構成され、
前記データプロセッサは、分岐された表示データストリームを列走査回路に出力し、
前記データプロセッサは、前記明状態アナログデータ電圧生成回路が前記アナログビット表示データに基づいて明状態アナログデータ電圧に対応するデータ信号を生成するように、前記アナログビット表示データを前記明状態アナログデータ電圧生成回路に出力し、および、前記列走査タイミング回路が前記デジタルビット表示データに基づき、前記出力端が暗状態デジタルデータ電圧に対応するデータ信号または前記明状態アナログデータ電圧に対応するデータ信号を出力するよう制御するように、前記デジタルビット表示データを前記列走査タイミング回路に出力することを含む、
表示パネルの駆動方法。 - 前記アナログビット表示データのビット数が1よりも大きく、
前記アナログビット表示データに対応する前記明状態アナログデータ電圧には、第1のゾーンおよび第2のゾーンが含まれ、
前記第1のゾーンにおける最大明状態アナログデータ電圧が前記第2のゾーンにおける最小明状態アナログデータ電圧よりも小さく、
前記第1のゾーンにおける複数の前記明状態アナログデータ電圧が非線形分布となり、前記第2のゾーンにおける複数の前記明状態アナログデータ電圧が線形分布となる、請求項7に記載の表示パネルの駆動方法。 - 前記行走査回路が、1フレーム内で、前記表示パネルにおけるサブ画素へ走査信号を複数回出力し、毎回、複数のサブフレームに分けて前記表示パネルにおけるサブ画素へ走査信号を出力することは、
前記行走査回路が、1フレーム内で、前記サブ画素へ走査信号をn回出力するとともに、毎回、k個のサブフレームに分けて前記サブ画素へ走査信号を出力することを含み、
そのうち、nは、前記列走査回路から提供可能な前記明状態アナログデータ電圧の値の数であり、
前記列走査回路から提供可能な前記明状態アナログデータ電圧の値の数と前記アナログビット表示データのビット数とは、正の相関を有し、
kは、前記デジタルビット表示データのビット数である、請求項7に記載の表示パネルの駆動方法。 - データプロセッサが、複数の前記サブフレーム内で前記サブ画素に対応する表示データを含む表示データストリームを受信し、前記表示データに含まれたアナログビット表示データおよびデジタルビット表示データに基づいて前記表示データストリームを分岐し、分岐された表示データストリームを列走査回路に出力することは、
前記データプロセッサが、前記サブフレーム内で前記サブ画素に対応する表示データを含む表示データストリームを受信し、前記表示データストリームにおける各々の表示データを前記アナログビット表示データおよび前記デジタルビット表示データに分岐することと、
前記データプロセッサが、複数のサブフレーム内で前記サブ画素に対応するデジタルビット表示データに対してデータ結合を行い、同じ行における前記サブ画素に対応するデジタルビット表示データのうち同じデジタルビットのデジタルビット表示データを1つのデータに結合し、各々のサブフレーム内で、前記列走査回路へ、対応するデジタルビット表示データからなる前記データを出力することとを含む、請求項7に記載の表示パネルの駆動方法。
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