JP7328560B2 - 発光装置の製造方法および発光装置 - Google Patents
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Description
同一面側にp側の電極およびn側の電極を備える発光素子を基材上に設置する工程を含む、発光装置の製造方法であって、
前記工程が順に
前記基材上に、正極側の配線シード層と負極側の配線シード層とを形成することと、
前記基材上における前記発光素子が載置される領域内にレジストパターンの少なくとも一部を形成することと、
前記p側の電極と前記正極側の配線シード層とが離隔して対向し、かつ前記n側の電極と前記負極側の配線シード層とが離隔して対向するように、前記レジストパターン上に前記発光素子を載置することと、
前記レジストパターンをマスクとして、前記正極側の配線シード層と該正極側の配線シード層と離隔配置された前記p側の電極との間、および前記負極側の配線シード層と該負極側の配線シード層と離隔配置された前記n側の電極との間をめっき接合することと、
前記レジストパターンを除去することと
を含む、発光装置の製造方法が供される。
基材と、前記基材上に配置される、正極側の配線及び負極側の配線と、を備える配線基材と、
前記配線基材上に位置し、p側の電極及びn側の電極を備える発光素子と、
前記正極側の配線と前記p側の電極との間をつなぐ第1の導電部材と、
前記負極側の配線と前記n側の電極との間をつなぐ第2の導電部材と、
を備え、
断面視で、前記第1の導電部材および前記第2の導電部材の少なくとも一方の導電部材の外側側面は、前記配線の外側端部と前記電極の外側端部とを結ぶ直線よりも外側に突出する、発光装置が供される。
以下、図面に基づいて本発明の一実施形態に係る発光装置の製造方法について詳細に説明する。なお、以下の説明では、必要に応じて特定の方向や位置を示す用語を用いる。しかしながら、これらの用語の使用は図面を参照した発明の理解を容易にするためであって、これらの用語の意味によって本発明の技術的範囲が制限されるものではない。また、複数の図面に表れる同一符号の部分は同一または同等の部分を指す。
以下、図面を参照しながら、本発明の実施形態1に係る発光装置の製造方法について説明する。
図1Aは、基材上への配線シード層の形成態様を模式的に示す斜視図である。
図1Bは、レジストパターンの形成態様を模式的に示す斜視図である。
図1Bに示すように基材10上における発光素子30が載置される領域にレジストパターン20を形成しても良いし、レジストパターン20の一部が発光素子30が載置される領域から外側にはみ出てもよい。
図1Cは、発光素子の載置態様を模式的に示す斜視図である。
図1Dは、配線シード層と発光素子の電極との間のめっき接合態様を模式的に示す斜視図である。
図1Eは、レジストパターンの除去態様を模式的に示す斜視図である。
以下、図面を参照しながら、本発明の実施形態2に係る発光装置の製造方法について説明する。
図2Aは、基材上への配線シード層の形成態様を模式的に示す平面図である。図2Bは、図2AのI-I’間における基材上への配線シード層の形成態様を模式的に示す断面図である。
図2Cは、レジストパターンの形成態様を模式的に示す平面図である。図2Dは、図2CのII-II’間におけるレジストパターンの形成態様を模式的に示す断面図である。
図2Eは、キャリア基材上に発光素子が搭載された発光素子搭載キャリア基材を模式的に示す斜視図である。図2Fは、発光素子搭載キャリア基材を第1のレジストパターン上に載置する態様を模式的に示す平面図である。図2Gは、図2FのIII-III’間における第1のレジストパターン上への発光素子搭載キャリア基材の載置態様を模式的に示す断面図である。
キャリア基材500上に樹脂材料400を連続塗布して樹脂材料400付キャリア基材500を得る。例えば、樹脂材料400としては、シリコーン系樹脂材、エポキシ系樹脂材、およびアクリル系樹脂材から成る群から選択される少なくとも1種の樹脂材が挙げられる。又、キャリア基材500としては、ガラス基材等を用いることができる。
樹脂材料400付キャリア基材500上に発光素子300を貼り合わせる。具体的には、少なくとも2つの発光素子300の発光面340と単一のキャリア基材500上の樹脂材料400とが接するように、単一の樹脂材料付きキャリア基材500上に発光素子300を貼り合わせる。
図2Jは、配線シード層と発光素子の電極との間のめっき接合態様を模式的に示す断面図である。
図2Kは、レジストパターンの除去態様を模式的に示す断面図である。
上記実施形態1および2の製造方法により得られた発光装置は以下の構成を採り得る。図3は、本発明の一実施形態に係る発光装置の構成を模式的に示す断面図である。図4は、本発明の別実施形態に係る発光装置の構成を模式的に示す断面図である。図3に示すように、本発明の一実施形態に係る発光装置70は、基材10と、基材10上に配置される、正極側の配線11及び負極側の配線12と、を備える配線基材10Xと、配線基材10X上に位置し、p側の電極31及びn側の電極32を備える発光素子30と、正極側の配線11とp側の電極31との間をつなぐ第1の導電部材P1と、負極側の配線12とn側の電極32との間をつなぐ第2の導電部材P2と、を備える。
10X、10Xα 配線基材
11 正極側の配線シード層
11a、11αa 正極側の配線端部
12 負極側の配線シード層
12a、12αa 負極側の配線端部
20 レジストパターン
30、30α 発光素子
31、31α 発光素子のP側の電極
31a、31αa P側の電極の端部
32、32α 発光素子のn側の電極
32a、32αa n側の電極の端部
33 発光素子の電極面
70、70α 発光装置
100 基材
110 正極側の配線シード層
120 負極側の配線シード層
210 第1のレジストパターン
220 第2のレジストパターン
300 発光素子
310 発光素子のP側の電極
320 発光素子のn側の電極
330 発光素子の電極面
340 発光素子の発光面
400 樹脂材料
500 キャリア基材
600 発光素子搭載キャリア基材
P 導電部材
P1、P1α 第1の導電部材
P11 第1の導電部材の外側側面
P12 第1の導電部材の内側側面
P2、P2α 第2の導電部材
P21 第2の導電部材の外側側面
P22 第2の導電部材の内側側面
PX、PY 導電部材の突出端部
C パッド導電部材
Claims (12)
- 同一面側にp側の電極およびn側の電極を備える発光素子を基材上に設置する工程を含む、発光装置の製造方法であって、
前記工程が順に
所定の間隔を置いて正極側の配線シード層と負極側の配線シード層とを形成した基材を準備することと、
前記基材上における前記発光素子が載置される領域内にレジストパターンの少なくとも一部を形成することと、
前記p側の電極と前記正極側の配線シード層とが離隔して対向し、かつ前記n側の電極と前記負極側の配線シード層とが離隔して対向するように、前記レジストパターン上に前記発光素子を載置することと、
前記レジストパターンをマスクとして、前記正極側の配線シード層と該正極側の配線シード層と離隔配置された前記p側の電極との間、および前記負極側の配線シード層と該負極側の配線シード層と離隔配置された前記n側の電極との間をめっき接合することと、
前記レジストパターンを除去することと
を含む、発光装置の製造方法。 - 同一面側にp側の電極およびn側の電極を備える発光素子を基材上に設置する工程を含む、発光装置の製造方法であって、
前記工程が順に
前記基材上に、正極側の配線シード層と負極側の配線シード層とを形成することと、
前記基材上における前記発光素子が載置される領域内にレジストパターンの少なくとも一部を形成することと、
前記p側の電極と前記正極側の配線シード層とが離隔して対向し、かつ前記n側の電極と前記負極側の配線シード層とが離隔して対向するように、前記レジストパターン上に前記発光素子を載置することと、
前記レジストパターンをマスクとして、前記正極側の配線シード層と該正極側の配線シード層と離隔配置された前記p側の電極との間、および前記負極側の配線シード層と該負極側の配線シード層と離隔配置された前記n側の電極との間をめっき接合することと、
前記レジストパターンを除去することと
を含む、発光装置の製造方法。 - 前記発光素子の平面サイズよりも小さい平面サイズを有する前記レジストパターンを形成する、請求項1又は2に記載の製造方法。
- 前記レジストパターンが粘着性を有し、それによって前記載置される前記発光素子を貼付け支持可能となっている、請求項1~3のいずれかに記載の製造方法。
- 前記基材が非透明である、請求項1~4のいずれかに記載の製造方法。
- 前記基材上に前記発光素子を少なくとも2つ配置する発光装置の製造方法であって、
前記正極側の配線シード層と前記負極側の配線シード層とがそれぞれ略同一方向に延在するように前記基材上に各配線シード層を形成し、
前記基材上にて所定の間隔をおいて少なくとも2つの発光素子が載置される領域内に前記レジストパターンの少なくとも一部をそれぞれ形成し、各レジストパターン上に前記発光素子をそれぞれ載置する、請求項1~5のいずれかに記載の製造方法。 - 前記正極側の前記配線シード層上又は前記負極側の配線シード層上の、相互に隣り合う一方の前記発光素子と他方の前記発光素子との間となる部分に、第2のレジストパターンを更に形成する、請求項6に記載の製造方法。
- 前記正極側の前記配線シード層又は前記負極側の配線シード層の延在方向に対して垂直な方向の一端から他端に連続して、前記第2のレジストパターンを形成する、請求項7に記載の製造方法。
- 前記レジストパターンおよび前記第2のレジストパターンの除去後、前記第2のレジストパターンの除去箇所において前記配線シード層を切断する、請求項7又は8に記載の製造方法。
- 前記レジストパターン上に前記発光素子を載置する前に、前記発光素子の発光面とキャリア基材とが対向するように前記発光素子を前記キャリア基材上に設けて、発光素子搭載キャリア基材を準備する工程を含み、
前記発光素子搭載キャリア基材の前記発光素子の電極面と前記レジストパターンとが対向するように、前記レジストパターン上に前記発光素子搭載キャリア基材を設け、該発光素子搭載キャリア基材から前記キャリア基材を剥離する、請求項6~9のいずれかに記載の製造方法。 - 平面視で、前記正極側の配線シード層と前記負極側の配線シード層の少なくとも一方が凹部を含み、前記レジストパターンを前記凹部内に入り込むように形成する、請求項1~10のいずれかに記載の製造方法。
- 断面視で、前記発光素子が載置される前記レジストパターンの高さを、前記正極側の前記配線シード層および前記負極側の配線シード層の高さよりも高くする、請求項1~11のいずれかに記載の製造方法。
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Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
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---|---|---|---|---|
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Patent Citations (6)
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---|---|---|---|---|
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US20150187746A1 (en) | 2012-06-25 | 2015-07-02 | Taiwan Semiconductor Manufacturing Company, Ltd. | Package on Package Devices and Methods of Packaging Semiconductor Dies |
JP2014013818A (ja) | 2012-07-04 | 2014-01-23 | Sony Corp | デバイスおよび電子装置 |
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US20170092631A1 (en) | 2015-09-29 | 2017-03-30 | Infineon Technologies Austria Ag | Interconnection Structure, LED Module and Method |
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