JP7287421B2 - パラメータ調整装置 - Google Patents

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Description

本開示は、パラメータ調整装置に関する。
制御対象を制御する制御方法として、例えば、PID(Proportional Integral Differential)制御等のフィードバック制御が従来から採用されている。また、フィードバック制御で用いられる制御ゲインを調整するゲインスケジュール制御が知られている(例えば、特許文献1参照)。
特開2011-14031号公報
ゲインスケジュール制御においては、制御対象の状態や外部環境に応じて制御パラメータを変更する。しかし、ゲインスケジュール制御の場合には、通常、多くの数のパラメータを調整する必要があり、パラメータ調整に多大な作業時間や計算負荷が必要であった。
本開示の一態様の目的は、ゲインスケジュール制御の制御パラメータを迅速かつ精度良く求めることができるパラメータ調整装置を提供することである。
本開示の一態様に係るパラメータ調整装置は、PID制御を行う制御器と、前記制御器の出力を入力とする制御対象と、制御ゲインを調整するゲインスケジュール部と、目標値と参照応答の伝達関数である参照モデルとを備え、前記制御対象の出力が前記制御器の入力にフィードバックされる制御システムにおいて、前記PID制御のスケジューリング関数に応じて前記制御ゲインが変化する制御パラメータを求めるパラメータ調整装置であって、前記制御パラメータおよびスケジューリングパラメータを含む多項式のスケジューリング関数を設定する関数設定部と、前記制御器の出力である第1出力データと、前記スケジューリング関数に基づいて制御される前記制御対象の出力である第2出力データとを取得するデータ取得部と、前記第1出力データおよび前記第2出力データに基づき推定した前記制御器に入力する入力信号を前記参照モデルに入力した場合の前記参照モデルの出力である第3出力データと、前記第2出力データとの誤差に関する評価関数の評価値に基づいて、前記スケジューリング関数の前記制御パラメータを求めるパラメータ算出部と、を有し、前記評価関数は、VIMT(Virtual Internal Model Tuning)を用いたゲインスケジュールPID(Proportional Integral Differential)制御のための評価関数である。
本開示によれば、ゲインスケジュール制御の制御パラメータを迅速かつ精度良く求めることができる。
本開示の実施の形態に係るゲインスケジュール制御システムを説明するための模式図 本開示の実施の形態に係る速度型のPID制御器を説明するための模式図 本開示の実施の形態に係るパラメータ調整装置の構成の一例を示す模式図 本開示の実施の形態に係るパラメータ調整装置が実行する処理の流れの一例を示すフローチャート
以下、本開示の実施の形態について、図面を参照しながら説明する。なお、各図において共通する構成要素については同一の符号を付し、それらの説明は適宜省略する。
<ゲインスケジュール制御の概要>
本開示の実施の形態に係るゲインスケジュール制御の概要について、図1を参照しながら説明する。ゲインスケジュール制御は、制御対象の状態や外部環境に応じて、制御に用いるパラメータ(制御パラメータまたは制御器パラメータといってもよい)を変更し、所望の制御性能を実現する手法である。
図1は、本実施の形態に係るゲインスケジュール制御システム(以下、単に制御システムともいう)100を説明するための模式図である。図1において、rは目標値を意味し、eは偏差を意味し、uは制御入力(以下、入力信号ともいう)を意味し、yは出力を意味し、xは状態量を意味する。
図1に示すように、制御システム100は、制御器102と、制御対象104と、ゲインスケジュール部106と、参照モデル108と、を有する。制御システム100はフィードバック系であり、制御対象104の出力は、制御器102の入力にフィードバックされる。
制御器102は、制御器パラメータを引数とする関数で表現される。制御器パラメータのゲインは、PID制御のスケジューリング関数に応じて変化する。制御器102は、下記の式(1)、式(2)のように記述される。
下記式(1)、式(2)において、ρは制御器パラメータを意味し、Ψ(z)は有理関数ベクトルを意味し、f(x,w)はスケジューリング関数を意味し、wはパラメータベクトルを意味する。また、wiは、i番目のスケジューリング関数を構成するパラメータベクトルである。
Figure 0007287421000001
Figure 0007287421000002
図1に示す制御システム100では、目標値rから出力yまでの伝達特性が、設計者が決めた参照モデル108に一致するようなゲインスケジューラを構成するパラメータベクトルwを自動で調整する。すなわち、本実施の形態では、下記の式(3)に示す評価関数を最小にするゲインスケジュールを構成するスパースな最適パラメータを得ることを目的とする。
下記式(3)において、Mは参照モデル108を意味し、λは重み係数を意味し、第二項はwに関する重みを意味する。
Figure 0007287421000003
制御対象104は、下記の式(4)または式(5)で表現可能な、非線形であるSISO(Single-Input Single-Output)システムを想定する。
Figure 0007287421000004
Figure 0007287421000005
上記式(4)、式(5)において、fは未知な非線形関数を意味し、uは制御入力を意味し、yは出力を意味し、n、nはそれぞれ入力と出力の未知の次数を意味する。また、xは状態量を意味し、θはスケジューリングパラメータを意味し、A,B、C、Dは有界でθに対して連続な未知な連続関数を意味する。本実施の形態では、制御対象104が上記式(4)で表現できる場合にはy(k)に関する値をスケジューリングパラメータの候補とし、制御対象104が上記式(5)で表現できる場合には状態量xに関する値をスケジューリングパラメータの候補とする。
本実施の形態では、VIMT(Virtual Internal Model Tuning)を用いる。VIMTの評価関数は、例えば、下記の式(6)、式(7)で表される。式(7)において、Mは、参照モデル108を意味し、y(C)は、初期パラメータを用いた時の閉ループ系の応答を意味する。
Figure 0007287421000006
Figure 0007287421000007
ゲインスケジュール制御ではゲインが急激に変化することにより閉ループ系を不安定にすることがある。その対策として、本実施の形態では、速度型PID制御器を採用し、スケジューリング関数を多項式で定義する。
制御器102は、PID制御を行う。制御器102は、速度型のPID制御器である。速度型のPID制御においては、PID制御の変化分(微分)が前回操作量に足される。速度型のPID制御を採用する場合には、積分項のリセットが不要であり、仮にゲインが急激に変化しても制御入力が急激に変化し難いという利点がある。ゲインが急激に変化すると、制御入力に時間変化が生じシステムへの外乱となる影響が発生しやすいが、速度型のPID制御の場合には上記の影響が少ない。
図2は、速度型のPID制御器を説明するための模式図である。図2において、e(t)は制御偏差であり、入力r(t)から出力y(t)を減算したものである。Kp(t)、Ki(t)、Kd(t)は、それぞれ比例ゲイン、積分ゲイン、微分ゲインである。△は差分演算子を表す。
図2に示す速度型のPID制御器の場合の出力uは、下記の式(8)、式(9)のように記述される。
Figure 0007287421000008
Figure 0007287421000009
制御対象104には、制御器102の出力が入力として入力される。図1に示す制御入力uが、制御対象104に制御量として入力される。また、制御対象104の出力は、図1に示す出力yである。
ゲインスケジュール部106は、制御器102の制御ゲインを調整する。例えば、ゲインスケジュール部106は、制御器102の状態量に応じて制御ゲインを調整する。本実施の形態では、ゲインスケジュール部106は、多項式であるスケジューリング関数に基づいて制御器102を制御する。スケジューリング関数は、ここでは、スケジューリングパラメータで規定される。スケジューリングパラメータとしては、通常、制御対象の位置、速度等の状態量、および温度等の外部環境の信号が用いられる。スケジューリング関数は、例えば、下記の式(10)のように2次多項式で記述される。
Figure 0007287421000010
上記式(10)において、K(x)はスケジューリング関数(PIDゲインのスケジューラ)を意味し、xはスケジューリングパラメータ(l=1、2)を意味し、xsfはスケジューリングパラメータから構成される関数ベクトル(基底関数)を意味する。wは、PIDゲインに関する重み係数(回帰係数)ベクトルであり、制御パラメータである。一般的に、スケジューリングパラメータとしては、制御対象104の位置、速度等の状態量、および温度等の外部環境の信号が用いられる。なお、ここでは、スケジューリングパラメータを2つとし、スケジューリング関数を2次多項式としたが、これに限定されない。
上述した多項式のスケジューリング関数を用いる場合には、記憶するパラメータの数を抑えられる。また、ゲインが連続的に変化するため、急激なゲイン変化が発生し難くなる。
参照モデル108は、目標値と参照応答の伝達関数であり、制御対象104に入力する入力信号rが入力される。制御システム100は、制御対象104の出力yと、参照モデル108の出力とを、一致させるように制御する。
制御システム100は、評価関数としてデータ駆動制御であるVIMTを適用し、制御対象104の入出力データと参照モデル108とから、制御パラメータを自動調整する。具体的には、以下のようにパラメータを調整する。
まず、制御システム100は、ゲインスケジューリング関数の重み係数の最適値を求める評価関数を導出する。具体的には、制御システム100は、VIMTの評価関数である上記式(6)、式(7)と、ゲインスケジュールPID制御に関する上記式(8)、式(9)、式(10)とに基づいて、VIMTを用いたゲインスケジュールPID制御(GS-PID-VIMT)のための評価関数を導出する。この評価関数は、下記の式(11)、式(12)のように記述される。
Figure 0007287421000011
Figure 0007287421000012
上記式(11)、式(12)におけるwおよびXは、下記の式(13)、式(14)のように記述される。
Figure 0007287421000013
Figure 0007287421000014
上記式(14)において、Ψiは、式(9)に示したΨのi番目の要素である。
評価関数J(w)は、パラメータベクトルwに関して線形である。このため、最小二乗法を用いると、制御パラメータの最適解wは、下記の式(15)、式(16)、式(17)で求められる。
Figure 0007287421000015
Figure 0007287421000016
Figure 0007287421000017
本実施の形態では、評価関数にラッソ回帰を適用しうる。ラッソ(LASSO:least absolute shrinkage and selection operator)回帰とは、高次元の情報から本質的に低次元の情報を高精度に抽出する手法である。具体的には、ラッソ回帰は、正則化項を導入することで、影響の少ない重み係数を0にするスパース性を有する。本実施の形態では、上記式(14)の最適解を求めるにあたり、ラッソ回帰を適用する。これにより、重み係数の過適合を抑制でき、スパース性の高い制御器を得ることが可能となる。
上記式(14)に正則化を追加した評価関数は、下記の式(18)のように記述される。
Figure 0007287421000018
上記式(18)において、λは、正の定数であり、正則化項と二乗誤差の和の項との間の相対的な強さを調整するパラメータである。λの値を変えることで、スパース性を調整することが可能である。
最適なλを求めるために、クロスバリデーション(交差検証)を利用してもよい。クロスバリデーションとは、標本データを分割し、その一部をまず解析して、残る部分でその解析のテストを行い、解析自身の妥当性の検証・確認に当てる手法である。なお、最初に解析するデータはtraining set(訓練データ)と呼ばれ、他のデータはtesting set(テストデータ)と呼ばれる。
上述した制御システム100は、例えば、トラック等の車両に搭載された制御対象を制御するシステムとして利用されうる。より具体的には、制御システム100は、ディーゼルエンジンのブースト圧と吸入新気量を目標値に追従させるため、EGR(Exhaust Gas Recirculation)およびVNT(Variable Nozzle Turbo)の協調制御に利用される。または、制御システム100は、クラッチの変速制御に利用されてもよい。
<パラメータ調整装置の構成>
本実施の形態に係るパラメータ調整装置1の構成について、図3を参照しながら説明する。パラメータ調整装置1は、上述した制御システム100のスケジューリング関数の制御パラメータを調整する情報処理装置(コンピュータといってもよい)である。
図3は、パラメータ調整装置1の構成の一例を示す模式図である。図3に示すように、パラメータ調整装置1は、記憶部20と、制御部30と、を有する。
記憶部20は、コンピュータのBIOS(Basic Input Output System)等を格納するROM(Read Only Memory)、作業領域となるRAM(Random Access Memory)を含む。また、記憶部20は、OS(Operating System)、アプリケーションプログラム、および、当該アプリケーションプログラムの実行時に参照される種々の情報を格納する大容量記憶装置である。大容量記憶装置としては、例えば、HDD(Hard Disk Drive)またはSSD(Solid State Drive)等が挙げられる。記憶部20は、例えば、スケジューリング関数の制御パラメータを記憶する。
制御部30は、CPU(Central Processing Unit)および/またはGPU(Graphics Processing Unit)等のプロセッサである。制御部30は、記憶部20に記憶されたプログラムを実行することによって、関数設定部32、データ取得部34、およびパラメータ算出部36として機能する。
関数設定部32は、スケジューリング関数を設定する。具体的には、関数設定部32は、制御パラメータとスケジューリングパラメータとを含む多項式のスケジューリング関数を設定する。そのスケジューリング関数は、例えば、上記式(10)で示される2次多項式で表されるが、これに限定されず、3次以上の多項式で表されてもよい。
関数設定部32は、設定したスケジューリング関数を示す情報を、パラメータ算出部36に出力する。
データ取得部34は、制御器102の出力である第1出力データを取得する。例えば、データ取得部34は、第1出力データとして、図1に示す入力uを取得する。
また、データ取得部34は、制御対象104の出力である第2出力データを取得する。すなわち、データ取得部34は、関数設定部32が設定したスケジューリング関数に基づいて制御される制御対象104の第2出力データを取得する。例えば、データ取得部34は、第2出力データとして、図1に示す出力yを取得する。
データ取得部34は、取得した第1出力データおよび第2出力データをパラメータ算出部36に出力する。
パラメータ算出部36は、第1出力データおよび第2出力データに基づいて、スケジューリング関数の制御パラメータを求める。パラメータ算出部36は、第1出力データおよび第2出力データに基づいて評価関数を求めることにより、制御パラメータを求める。その手順について、以下に説明する。
まず、パラメータ算出部36は、第1出力データ(入力u)および第2出力データ(出力y)に基づいて、制御器102に入力する入力信号を推定する。例えば、パラメータ算出部36は、入力信号rを推定する。
次に、パラメータ算出部36は、推定した入力信号rを参照モデル108に入力した場合の、参照モデル108の出力である第3出力データを求める。
次に、パラメータ算出部36は、求めた第3出力データと、データ取得部34が取得した第2出力データとの誤差に関する評価関数を求める。例えば、パラメータ算出部36は、上記式(11)、式(12)で示す評価関数(VIMTを用いたゲインスケジュールPID制御のための評価関数)を求める。
次に、パラメータ算出部36は、求めた評価関数の評価値に基づいて、スケジューリング関数の制御パラメータを求める。具体的には、パラメータ算出部36は、評価関数の評価値を最小化するように、制御パラメータを求める。これにより、目標値応答特性に優れた制御パラメータに調整できる。
上述したように、スケジューリング関数は、制御パラメータである重み係数と、スケジューリングパラメータとから成る。パラメータ算出部36は、スケジューリング関数の重み係数を、制御パラメータとして求める。
また、パラメータ算出部36は、ラッソ回帰の正則化を追加した評価関数(上記式(18)で示す評価関数)の評価値に基づいて、制御パラメータ(すなわち、重み係数)を求める。これにより、PIDゲインを構成する18個の重み係数は9個に減る。一方で、重み係数が9個であっても、18個の重み係数を用いたときと同等の結果を得ることができる。この結果、スパース性の高いPID制御器を求めることができる。
なお、本実施の形態のゲインスケジュール制御の場合には、ルックアップテーブルLUTを用いたゲインスケジュール制御に比べて、以下のような利点がある。LUTを用いた場合には、調整するパラメータが大量にあり、手作業で実験を繰り返しながら調整しており、開発工数が増加する。また、求めたパラメータが最適とは限らないという問題がある。これに対して、本実施の形態の場合には、制御パラメータ(重み係数)の数が減ると共に、求める制御パラメータが属人的でなくなり、最適なパラメータを得ることができる。
<パラメータ調整の流れ>
パラメータ調整の流れについて、図4を参照しながら説明する。
図4は、パラメータ調整装置1が実行する処理の流れを説明するためのフローチャートである。なお、制御システム100の目標値は、制御システム100の設計者によって予め設定されている。
まず、制御部30の関数設定部32は、スケジューリング関数を設定する(ステップS102)。すなわち、関数設定部32は、制御パラメータとスケジューリングパラメータとを含む多項式のスケジューリング関数を設定する。
その後、制御システム100に目標値が入力されると、データ取得部34は、制御器102の出力である第1出力データを取得する(ステップS104)。また、データ取得部34は、制御対象104の出力である第2出力データを取得する(ステップS106)。
次に、パラメータ算出部36は、スケジューリング関数の制御パラメータを求める(ステップS108)。例えば、パラメータ算出部36は、上記式(11)、式(12)の評価関数を用いて、スケジューリング関数の制御パラメータを求める。
次に、パラメータ調整装置1は、求めた制御パラメータを反映した制御器102の性能を確認する(ステップS110)。すなわち、パラメータ調整装置1は、ステップS108で求めた制御パラメータの制御システム100に対して目標値および外乱を入力した際に、制御対象104の出力が参照応答と一致しているかを確認する。これにより、求めた制御パラメータを適用した制御器102の性能を適切に評価できる。
<本実施の形態における効果>
パラメータ調整装置1は、制御パラメータとスケジューリングパラメータとを含む多項式のスケジューリング関数を設定する。そして、パラメータ調整装置1は、1組の入出力データ(第1出力データおよび第2出力データ)と、参照モデルを用いた評価関数の評価値とに基づいて、スケジューリング関数の制御パラメータを求める。これにより、システムを同定することなく、制御対象104の1組の入出力データを用いて、ゲインスケジュールの制御パラメータを調整できる。すなわち、試行錯誤を繰り返すことなく、制御パラメータを迅速かつ精度良く求めることができる。
また、例えば、VRFT(Virtual Reference Feedback Tuning)の評価関数を用いた場合では、開ループ試験または閉ループ試験のいずれでも適用可能であるが、プレフィルタの設計が必要となるため、設計者の負担が大きくなる。また、プレフィルタの設計次第では、高周波数を励起することになり、ノイズ成分の影響が大きくなって、最適パラメータが得られなくなる。これに対して、パラメータ調整装置1は、VIMTを用いたゲインスケジュールPID制御のための評価関数(上記式(11)、式(12)で示す評価関数)を用いる。これにより、閉ループ試験が前提とはなるものの、プレフィルタの設計が必要でなくなるので、設計者の負担を軽減できる。
さらに、パラメータ調整装置1は、ラッソ回帰を用いて最適化を行う。これにより、制御パラメータをより削減できるので、制御器の記憶容量を低減することができる。
以上、本開示について実施の形態を用いて説明したが、本開示の技術的範囲は上記実施の形態に記載の範囲には限定されず、その要旨の範囲内で種々の変形および変更が可能である。例えば、装置の全部または一部は、任意の単位で機能的又は物理的に分散・統合して構成することができる。また、複数の実施の形態の任意の組み合わせによって生じる新たな実施の形態も、本開示の実施の形態に含まれる。組み合わせによって生じる新たな実施の形態の効果は、もとの実施の形態の効果を併せ持つ。
本開示のパラメータ調整装置は、フィードバック制御における制御パラメータを調整する技術全般に有用である。
1 パラメータ調整装置
32 関数設定部
34 データ取得部
36 パラメータ算出部
102 制御器
104 制御対象
106 ゲインスケジュール部
108 参照モデル

Claims (4)

  1. PID制御を行う制御器と、前記制御器の出力を入力とする制御対象と、制御ゲインを調整するゲインスケジュール部と、目標値と参照応答の伝達関数である参照モデルとを備え、前記制御対象の出力が前記制御器の入力にフィードバックされる制御システムにおいて、前記PID制御のスケジューリング関数に応じて前記制御ゲインが変化する制御パラメータを求めるパラメータ調整装置であって、
    前記制御パラメータおよびスケジューリングパラメータを含む多項式のスケジューリング関数を設定する関数設定部と、
    前記制御器の出力である第1出力データと、前記スケジューリング関数に基づいて制御される前記制御対象の出力である第2出力データとを取得するデータ取得部と、
    前記第1出力データおよび前記第2出力データに基づき推定した前記制御器に入力する入力信号を前記参照モデルに入力した場合の前記参照モデルの出力である第3出力データと、前記第2出力データとの誤差に関する評価関数の評価値に基づいて、前記スケジューリング関数の前記制御パラメータを求めるパラメータ算出部と、
    を有し、
    前記評価関数は、
    VIMT(Virtual Internal Model Tuning)を用いたゲインスケジュールPID(Proportional Integral Differential)制御のための評価関数である、
    パラメータ調整装置。
  2. 前記パラメータ算出部は、前記スケジューリング関数の重み係数である制御パラメータを求める、
    請求項1に記載のパラメータ調整装置。
  3. 前記パラメータ算出部は、ラッソ回帰の正則化を追加した前記評価関数の評価値に基づいて、前記制御パラメータを求める、
    請求項1または2に記載のパラメータ調整装置。
  4. 前記制御器は、速度型のPID制御器である、
    請求項1から3のいずれか1項に記載のパラメータ調整装置。
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