JP7262028B2 - 三角関数演算装置 - Google Patents
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Description
以下、図面及び表を参照して、比較例に係る三角関数演算装置50について説明し、本実施形態に係る三角関数演算装置10との比較について説明する。図6に、比較例に係る三角関数演算装置50を示す。比較例に係る三角関数演算装置50は、本実施形態に係る三角関数演算装置10における補正部40を有さない点で異なり、演算回路30による演算値をアドレス信号に対応する正弦sin(α+β)に相当する値とする。なお、比較例に係る三角関数演算装置50におけるアドレス発生器11、三角関数テーブル20及び演算回路30は、本実施形態に係る三角関数演算装置10と同様の機能であるため、説明を省略し、それぞれ同一の構成要素について同一の参照符号を付与している。
11 アドレス発生器
12 記憶部
20 三角関数テーブル
21 第1の三角関数テーブル
22 第2の三角関数テーブル
30 演算回路
31 第1の乗算回路
32 第2の乗算回路
33、42 加算回路
40 補正部
41 補正値テーブル
Claims (5)
- 位相に対応した複数のビット列からなるアドレス信号を発生するアドレス発生器と、
前記アドレス信号の上位ビットによって示される位相の各々に対応する第1の正弦及び第1の余弦、前記アドレス信号の下位ビットによって示される位相の各々に対応する第2の正弦及び第2の余弦を記憶した三角関数テーブルと、
前記三角関数テーブルを参照することにより抽出された、前記アドレス信号に対応した前記第1の正弦、前記第1の余弦、前記第2の正弦及び前記第2の余弦を用いた演算処理により前記アドレス信号に対応した正弦を演算値として出力する演算回路と、
前記アドレス信号に応じた補正値に基づいて、前記演算値を補正する補正部と、
を備える三角関数演算装置。 - 前記補正部は、前記アドレス信号によって示される位相の各々に対応する補正値を記憶した補正値テーブルを含み、前記補正値テーブルを参照することによって抽出された、前記アドレス信号に対応した補正値に基づいて、前記演算値を補正する
請求項1に記載の三角関数演算装置。 - 前記三角関数テーブルは、
前記アドレス信号の上位ビットによって示される位相の各々に対応する前記第1の正弦及び前記第1の余弦を記憶した第1の三角関数テーブルと、
前記アドレス信号の下位ビットによって示される位相の各々に対応する前記第2の正弦及び前記第2の余弦を記憶した第2の三角関数テーブルと、
を含む請求項1または請求項2に記載の三角関数演算装置。 - 前記演算回路は、
前記第1の正弦と前記第2の余弦との積を出力する第1の乗算回路と、
前記第2の正弦と前記第1の余弦との積を出力する第2の乗算回路と、
前記第1の乗算回路の出力値と前記第2の乗算回路の出力値とを加算する加算回路と、
を含む請求項1から請求項3のいずれか1項に記載の三角関数演算装置。 - 位相に対応した複数のビット列からなるアドレス信号を発生するアドレス発生器と、
前記アドレス信号の上位ビットによって示される位相の各々に対応する第1の正弦及び第1の余弦、前記アドレス信号の下位ビットによって示される位相の各々に対応する第2の正弦及び第2の余弦を記憶した三角関数テーブルと、
前記三角関数テーブルを参照することにより抽出された、前記アドレス信号に対応した前記第1の正弦、前記第1の余弦、前記第2の正弦及び前記第2の余弦を用いた演算処理により前記アドレス信号に対応した余弦を演算値として出力する演算回路と、
前記アドレス信号に応じた補正値に基づいて、前記演算値を補正する補正部と、
を備える三角関数演算装置。
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