JP7249185B2 - 光ラッチ回路及び電子装置 - Google Patents
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Description
上記電子装置の場合、電池が放電(待機電力)により蓄積された電力が消費され、ユーザが電子装置を起動させようとした際に動作しないことがある。
このため、電子装置における待機電力を極限まで抑制し、在庫期間及び非動作期間などの期間を含めて電力の消費を低減する必要がある。
そして、電子装置を起動させる際に、電池の電極と電子装置の電極との間の絶縁体を外して、電池と電子装置との間に電流を流す方法が用いられている。
また、接点スイッチを用いて、電子装置を起動させる際に、電池の電極と電子装置の電極との間を接続する構成もある。
さらに、樹脂などで封止する必要がある電子装置の場合、電池の電極と電子装置の電極との間絶縁体を介挿することはできない。
また、スイッチングを行なうための可動部が必要であり、この可動部を封止する構造が複雑となり、可動部が稼働することにより、可動部が劣化することで封止材の封止性能が劣化する。
この場合、光ラッチ回路に対して光が到達するように、封止材に透明樹脂が用いられる。
図9に示すように、光検知部は、フォトダイオード101及び102と、電圧検知器103とから構成されている。
ラッチ回路制御部104は、フォトダイオード101に光が照射された場合、SRラッチ105をセットして、出力信号OUTDを例えば「H」レベルとする。また、ラッチ回路制御部104は、フォトダイオード102に光が照射された場合、SRラッチ105をリセットして、出力信号OUTDを例えば「L」レベルとする。
この構成により、フォトダイオード101(あるいは102)に光が照射された場合、照射した光の光量に対応した光電流がバッテリからフォトダイオード101(あるいは102)を介して流れるため、バッテリの消耗を早めてしまう。
このため、在庫期間や非動作期間であっても、上述した光電流が流れることにより、消費電流の低減が十分に行えず、バッテリの電力の消費を抑制させ、バッテリの寿命を伸ばすことが困難である。
また、非動作期間において電子装置を起動させない場合、上記器具を電子装置に取り付け、一方、電子装置を起動させる際、器具を取り外すなどの作業が発生して、取り扱いが面倒となる。
以下、図面を参照して、本発明の第1の実施形態について説明する。図1は、本発明の第1の実施形態による電子装置における光ラッチ回路の構成例を示す概略ブロック図である。
この図1において、光ラッチ回路1は、電圧検知器11、光発電素子12及びフィードバック抵抗13を備えている。駆動対象回路200は、光ラッチ回路1の出力端子OUTから供給される駆動制御信号により、駆動あるいは停止される。駆動及び停止の各々は、例えば電源供給を行なうか否かなどにより制御される。本実施形態において、駆動対象回路200は、例えば、駆動制御信号の信号レベルが「H」レベルの場合に駆動し、「L」レベルの場合に停止する。
光発電素子12は、上述した発光ダイオードではなく、フォトダイオードまたは太陽電池でも良い。しかしながら、光起電力により出力される電圧は、発光ダイオードが最も高く、かつ値段が安価なため、発光ダイオードを利用することが望ましい。
これにより、光ラッチ回路1は、発電電圧VI1が閾値電圧VTH1を超えているため、ステップS102に処理を進める。
これにより、電圧検知器11は、発電電圧VI1が閾値電圧VTHを超えていないため、ステップS101の処理を繰返す。
このため、光発電素子12に対して所定の光強度を超える光が照射されなくなっても、電圧検知器11は、判定出力端子OUTPUTから出力する駆動制御信号SCを、「H」レベルに保持(ラッチ)する。
これにより、光ラッチ回路1は、出力端子OUTから駆動対象回路200に、「H」レベルに保持された駆動制御信号SCを供給し、駆動対象回路200を継続して駆動させる。
すなわち、所定の光強度の光が照射されない限り、消費されるのは光発電素子12が生成した発電電力に限定され、電圧検知器11が出力する駆動制御信号SCの電圧レベルを変更する動作を行なわないため、バッテリの電力が消費されることはない。
図3において、電圧検知器11は、MOS(metal oxide semiconductor)トランジスタQ1、Q2、Q3及びQ4と、リード抵抗111と、インバータ112とを備えている。
MOSトランジスタQ1及びG2は、エンハンスメント型のPチャネルMOSトランジスタである。
また、MOSトランジスタQ3は、デプレッション型のNチャネルMOSトランジスタである。MOSトランジスタQ4は、エンハンスメント型のNチャネルMOSトランジスタである。
インバータ112は、例えばMOSトランジスタで構成されているNOTゲート回路である。
MOSトランジスタQ2は、ソースが電源VDDに接続されており、ゲートがMOSトランジスタQ1のドレイン及びMOSトランジスタQ3のドレインに接続されており、ドレインがMOSトランジスタQ1のゲート、MOSトランジスタQ4のドレイン及びインバータ112の入力端子T112Iに接続されている。
MOSトランジスタQ4は、ドレインがMOSトランジスタQ1のゲート、MOSトランジスタQ2のドレイン及びインバータ112の入力端子T112Iに接続されている。
インバータ112は、入力端子T112IがMOSトランジスタQ1のゲート、MOSトランジスタQ2のドレイン及びMOSトランジスタQ4のドレインに接続されている。
そして、この計測された発電電圧VI1と同一の電圧(あるいはある程度マージンを持たせた電圧)が光ラッチ回路1が駆動制御信号SCを「L」レベルから「H」レベルに変化させる閾値電圧VTH1となるように、MOSトランジスタQ1、Q2、Q3及びQ4のトランジスタサイズ及び閾値電圧が設定される。
これにより、MOSトランジスタQ3のソースの電圧が上昇し、MOSトランジスタQ3に流れるドレイン電流ID3が低下する。
また、MOSトランジスタQ4のゲートの電圧が上昇し、MOSトランジスタQ4にドレイン電流ID4が流れ始める。
このとき、MOSトランジスタQ2に流れるドレイン電流ID2より、MOSトランジスタQ4に流れるドレイン電流ID4の電流値が大きくなるため、接続点N2の電圧が「L」レベルとなる。
これにより、インバータ112は、入力端子T112Iに「L」レベルの電圧が印加されるため、出力端子T112Oから「H」レベルの電圧を出力する(駆動制御信号SCの「H」レベルの出力)。
これにより、MOSトランジスタQ4のゲートに「L」レベルが印加されるため、MOSトランジスタQ1がオンし、接続点N1が「H」レベルとなる。
そして、MOSトランジスタQ2は、ゲートに「H」レベルの電圧が印加されるため、オフする。
上述した処理により、光発電素子12に照射される光の強度が予め設定された強度を超えた場合、接続点N1の電圧が「L」レベルから「H」レベルに変化し、接続点N2の電圧が「H」レベルから「L」レベルに変化する(光ラッチ回路1のセット)。
したがって、閾値電圧VTH1は、MOSトランジスタQ2の閾値電圧及びドレイン電流ID2と、MOSトランジスタQ4の閾値電圧及びドレイン電流ID4とにより、入力端子INPUT1から供給される発電電圧VI1に対応して設定される。
これにより、例えば、光発電素子12に照射される光の強度が予め設定された強度を超えた際の発電電圧VI1が「0.4V」である場合、MOSトランジスタQ3の閾値電圧が「-0.3V」とし、MOSトランジスタQ4の閾値電圧を「0.4V」とする。この場合、発電電圧VI1が「0.4V」に上昇するまで、MOSトランジスタQ4がオンしないため、基本的には、電源VDD(すなわち、バッテリ)から消費電流は流れない。また、このとき、MOSトランジスタQ1がオフしているため、MOSトランジスタQ3にも消費電流は流れていない。
以下、図面を参照して、本発明の第2の実施形態について説明する。図4は、本発明の第2の実施形態による光ラッチ回路の構成例を示す概略ブロック図である。
この図4において、光ラッチ回路1Aは、電圧検知器11、光発電素子12、14及びフィードバック抵抗13を備えている。本実施形態において、図1の電子装置と同様に、駆動対象回路200が、例えば、駆動制御信号SCの信号レベルが「H」レベルの場合に駆動し、「L」レベルの場合に停止する。
この、光発電素子14は、第1の実施形態で説明した光発電素子12と同様の特性を有し、照射される光の光強度に対応した光起電力により発電電圧VI2を生成する。
光強度に対応して出力される上記発電電圧VI2は、絶対値としては第1の実施形態における発電電圧VI1と同一の電圧であるが、入力端子INPUT1と接地点との間に、逆方向に取り付けられているため、電圧の極性が逆となる。
例えば、光発電素子12に照射される光の強度が予め設定された強度を超えた際の発電電圧VI1が「0.4V」である場合、同様の光強度の光が照射された際、光発電素子14は「-0.4V」の発電電圧VI2を出力する。
そして、光ラッチ回路11Aは、発電電圧VI2が閾値電圧VTH2(すなわち、-0/4V)未満の場合、駆動制御信号SCの電圧レベルを、「H」レベルから「L」レベルに変化させる。
上記閾値電圧VTH2は、光発電素子14に対して照射される光の強度が予め設定された強度を超えた際の発電電圧VI2に対応して設定されている。
しかしながら、実施形態においては、光ラッチ回路1Aが駆動制御信号SCを、「L」レベルから「H」レベルに変化させ(セット)、かつ「H」レベルから「L」レベルに変化させる(リセット)双方向の変化が行える。
これにより、本実施形態によれば、駆動制御信号SCを「L」レベル及び「H」レベル間で切替えることができ、図1の駆動対象回路200を駆動させたり、停止させたりすることが可能となる。
したがって、光発電素子12及び14の双方に同時に所定の光強度の光が照射された場合、誤動作する可能性がある。
このため、光発電素子12及び14の双方に同時に光が照射されないように、電子装置において、光発電素子12が配置される位置と、光発電素子14が配置される位置とは離間して設けられている。
本実施形態の場合、例えば、所定の範囲にスポット的に光を照射する光照射装置を用い、離間して設けられた光発電素子12あるいは14のいずれか一方にのみ、照射される光の強度が予め設定された強度を超える光を照射して用いる。
また、光発電素子12及び14が遮光材によりマスクされており、いずれか一方の遮光材を外して、いずれか一方に光を照射するように構成しても良い。
このため、電圧検知器11の入力端子INPUT1には、発電電圧VI2が印加されている。
このため、光発電素子14に光が照射されることにより、光発電素子14が生成する発電電圧VI2が低下する際、光発電素子14に流れる電流がフィードバック抵抗13に流れる電流より大きければ、電圧検知器11の入力端子INPUT1に印加される発電電圧VI2が閾値電圧VTH2未満となる。
発電電圧VI2が閾値電圧VTH2未満となることにより、MOSトランジスタQ4がオフとなり、MOSトランジスタQ3がオンする。
この結果、接続点N1が「H」レベルから「L」レベルに変化し、接続点N2が「L」レベルから「H」レベルに変化する。
これにより、インバータ112は、入力端子T112Iに「H」レベルの電圧が印加されるため、出力端子T112Oから「L」レベルの電圧を出力する(駆動制御信号SCの「L」レベルの出力)。
したがって、閾値電圧VTH2は、MOSトランジスタQ1の閾値電圧及びドレイン電流ID1と、MOSトランジスタQ3の閾値電圧及びドレイン電流ID3と、フィードバック抵抗13の抵抗値(例えば、10MΩを中心とする所定の範囲の抵抗値など)とにより、入力端子INPUT1から供給される発電電圧VI2に対応して設定される。
以下、図面を参照して、本発明の第3の実施形態について説明する。図5は、本発明の第3の実施形態による光ラッチ回路の構成例を示す概略ブロック図である。
この図5において、光ラッチ回路1Bは、電圧検知器11、光発電素子12、16、カレントミラー回路17及びフィードバック抵抗13を備えている。本実施形態において、図1の電子装置と同様に、駆動対象回路200が、例えば、駆動制御信号SCの信号レベルが「H」レベルの場合に駆動し、「L」レベルの場合に停止する。
この、光発電素子16は、第1の実施形態で説明した光発電素子12と同様の特性を有し、照射される光の光強度に対応した光起電力により発電電圧VI4を生成する。
光強度に対応して出力される上記発電電圧VI4は、入力端子INPUT2と接地点との間に、順方向に取り付けられているため、発電電圧VI1と同一の極性で同一の電圧である発電電圧VI4を生成する。
MOSトランジスタQ5は、ドレイン及びゲートが電流入力端子TI1とMOSトランジスタQ6のゲートに接続され、ソースが接地点に接続されている。
MOSトランジスタQ6は、ドレインが電流出力端子TO1に接続され、ゲートがMOSトランジスタQ5のドレイン及びゲートに接続され、ソースが接地点に接続されている。
カレントミラー回路17は、電流出力端子TO1が電圧検知器11の入力端子INPUT1に接続されている。
このため、電圧検知器11の入力端子INPUT1には、発電電圧VI4が印加されている。
ここで、光発電素子16に光が照射されることにより、光発電素子14が生成する発電電圧VI4が上昇して、MOSトランジスタQ5に発電電圧VI4に対応する電流を流す。これにより、MOSトランジスタQ5及びQ6のトランジスタサイズの比に対応し、MOSトランジスタQ6には、MOSトランジスタQ5に流れる電流に対して、トランジスタサイズの比を乗じた電流が流れる。
このため、MOSトランジスタQ5に流れる電流が、フィードバック抵抗13を介して流れるフィードバック電流Ifより小さい場合でも、MOSトランジスタQ6のトランジスタサイズをMOSトランジスタQ5より大きくすることで、入力端子INPUT1を「L」レベルに引き下げることができる。
そして、MOSトランジスタQ1に流れるドレイン電流ID1が、MOSトランジスタQ3に流れるドレイン電ID3流より大きくなり、MOSトランジスタQ2がオンし、MOSトランジスタQ1がオフする。
この結果、接続点N1が「H」レベルから「L」レベルに変化し、接続点N2が「L」レベルから「H」レベルに変化する。
これにより、インバータ112は、入力端子T112Iに「H」レベルの電圧が印加されるため、出力端子T112Oから「L」レベルの電圧を出力する(駆動制御信号SCの「L」レベルの出力)。
したがって、閾値電圧VTH2は、MOSトランジスタQ1の閾値電圧及びドレイン電流ID1と、MOSトランジスタQ3の閾値電圧及びドレイン電流ID3と、フィードバック抵抗13の抵抗値(例えば、10MΩを中心とする所定の範囲の抵抗値など)とにより、入力端子INPUT1から供給される発電電圧VI2に対応して設定される。
本実施形態によれば、駆動制御信号SCを「L」レベル及び「H」レベル間で切替えることができ、図1の駆動対象回路200を駆動させたり、停止させたりすることが可能となる。
以下、図面を参照して、本発明の第4の実施形態について説明する。図6は、本発明の第4の実施形態による光ラッチ回路の構成例を示す概略ブロック図である。
この図6において、光ラッチ回路1Cは、電圧検知器11、光発電素子12、フィードバック抵抗13及びダイオード18を備えている。本実施形態において、図1の電子装置と同様に、駆動対象回路200が、例えば、駆動制御信号SCの信号レベルが「H」レベルの場合に駆動し、「L」レベルの場合に停止する。
このダイオード18は、判定出力端子OUTPUTと入力端子INPUT1との間に、フィードバック抵抗13と直列に接続されて介挿されている。ここで、ダイオード18は、判定出力端子OUTPUTから入力端子INPUT1に対して順方向に接続されている。ダイオード18は、例えば、アノードが判定出力端子OUTPUTに接続され、カソードがフィードバック抵抗13の一端に接続されている。フィードバック抵抗13は他端が入力端子INPUT1に接続されている。
これにより、判定出力端子OUTPUTから出力される駆動制御信号SCが「L」レベルの場合において、光発電素子12が出力する発電電圧VI1の低減を防止することができ、光発電素子12の光起電力が少なくとも、入力端子INPUT1の電圧を上昇させることが可能となる。
入力端子INPUT1に「H」レベルの駆動制御信号SCが印加された際の電圧検知器11の動作は、第1の実施形態と同様のため、説明を省略する。
すなわち、本実施形態によれば、光発電素子16に照射される光の強度が予め設定された強度を低減し、光発電素子12に入射する光が弱い光強度でも、駆動制御信号SCを「L」レベルから「H」レベルに変化させ、かつ判定出力端子OUTPUTから出力される駆動制御信号SCが「H」レベルで保持(ラッチ)させることができる。
以下、図面を参照して、本発明の第5の実施形態について説明する。図7は、本発明の第5の実施形態による光ラッチ回路の構成例を示す概略ブロック図である。
この図6において、光ラッチ回路1Dは、電圧検知器11、光発電素子12、フィードバック抵抗13及び遅延(ディレイ)回路18を備えている。本実施形態において、図1の電子装置と同様に、駆動対象回路200が、例えば、駆動制御信号SCの信号レベルが「H」レベルの場合に駆動し、「L」レベルの場合に停止する。
この遅延回路19は、判定出力端子OUTPUTと入力端子INPUT1との間に、フィードバック抵抗13と直列に接続されて介挿されている。ここで、遅延回路19は、例えば、一端が判定出力端子OUTPUTに接続され、他端がフィードバック抵抗13の一端に接続されている。フィードバック抵抗13は他端が入力端子INPUT1に接続されている。
電圧検知器11は、発電電圧VI1が閾値電圧VTH1を超えている場合、判定出力端子OUTPUTから出力される駆動制御信号SCを「L」レベルから「H」レベルに変化させる。
このとき、光発電素子12に対し、予め設定された強度を超える光が遅延回路19の遅延時間を超えて照射されない場合、遅延回路19は、フィードバック抵抗13を介して、駆動制御信号SCが「H」レベルであっても、出力端子OUTDから出力する遅延信号DSCを「L」レベルに維持し、駆動制御信号SCの「L」レベルから「H」レベルの変化が入力端子INPUT1に伝搬させない。
入力端子INPUT1に「H」レベルの駆動制御信号SCが印加された際の電圧検知器11の動作は、第1の実施形態と同様のため、説明を省略する。
図9(a)は、縦軸が光発電素子12が出力する発電電圧VI1の電圧値を示し、横軸が時間を示している。
図9(b)は、縦軸が電圧検知器11の判定出力端子OUTPUTから出力される駆動制御信号SCの電圧レベルを示し、横軸が時間を示している。
図9(c)は、縦軸が遅延回路19の出力端子OUTDから出力される遅延信号DSCの電圧レベルを示し、横軸が時間を示している。
これにより、光発電素子12は、閾値電圧VTH1を超える発電電圧VI1を生成する。
そして、電圧検知器11は、入力端子INPUT1に上記発電電圧VI1が供給され、判定出力端子OUTPUTから出力する駆動制御信号SCの電圧レベルを、「L」レベルから「H」レベルに変化させる。
このとき、遅延回路19は、遅延時間Tdが経過していないため、出力端子OUTDから出力する遅延信号DSCの電圧レベルを「L」レベルに維持する。
また、光ラッチ回路1Dは、出力端子OUTから出力される駆動制御信号SCの電圧レベルを、「L」レベルから「H」レベルに変化させる。
これにより、光発電素子12は、閾値電圧VTH1以下の発電電圧VI1を生成する。
そして、電圧検知器11は、入力端子INPUT1に上記発電電圧VI1が供給され、判定出力端子OUTPUTから出力する駆動制御信号SCの電圧レベルを、「H」レベルから「L」レベルに変化させる。
このとき、遅延回路19は、遅延時間Tdが経過せずに、駆動制御信号SCの電圧レベルが「H」レベルから「L」レベルに変化したため、出力端子OUTDから出力される遅延信号DSCの電圧レベルを「L」レベルに維持する。
また、光ラッチ回路1Dは、出力端子OUTから出力される駆動制御信号SCの電圧レベルを、「H」レベルから「L」レベルに変化させる。
これにより、光発電素子12は、閾値電圧VTH1を超える発電電圧VI1を生成する。
そして、電圧検知器11は、入力端子INPUT1に上記発電電圧VI1が供給され、判定出力端子OUTPUTから出力する駆動制御信号SCの電圧レベルを、「L」レベルから「H」レベルに変化させる。
このとき、遅延回路19は、遅延時間Tdが経過していないため、出力端子OUTDから出力される遅延信号DSCの電圧レベルを、駆動制御信号SCの「L」レベルを維持する。
このとき、電圧検知器11は、入力端子INPUT1に閾値電圧VTH1を超える発電電圧VI1が供給されているため、判定出力端子OUTPUTから出力する駆動制御信号SCの電圧レベルを、「H」レベルに維持している。
これにより、遅延回路19は、遅延時間Tdが経過したため、出力端子OUTDから出力する遅延信号DSCの電圧レベルを「L」レベルから「H」レベルに変化させる。
これにより、光発電素子12は、閾値電圧VTH1以下の発電電圧VI1を生成する。
しかしながら、電圧検知器11は、遅延回路19の出力端子OUTDからフィードバック抵抗13を介して、入力端子INPUT1に「H」レベルの遅延信号DSCが供給されている。このため、電圧検知器11は、判定出力端子OUTPUTから出力する駆動制御信号SCの電圧レベルを「H」レベルで維持する。
上記処理により、光ラッチ回路1Dは、光発電素子12から供給される発電電圧VI1が閾値電圧VTH1以下においても、出力端子OUTから出力される駆動制御信号SCの電圧レベルを「H」レベルでラッチし、「H」レベルの駆動制御信号SCを継続して出力する。
11…電圧検知器
12,14,16…光発電素子
13…フィードバック抵抗
17…カレントミラー回路
18…ダイオード
19…遅延回路
111…リード抵抗
112…インバータ
200…駆動対象回路
Q1,Q2,Q3,Q4,Q5,Q6…MOSトランジスタ
Claims (9)
- 第1入力端子から入力される第1発電電圧と予め設定された第1閾値電圧とを比較し、前記第1発電電圧が前記第1閾値電圧を超えた場合、セット信号を判定出力端子から出力する電圧検知器と、
前記第1入力端子と接地点との間に順方向に接続され、光が照射された際に光起電力により所定の前記第1発電電圧を前記第1入力端子に出力する第1光発電素子と、
前記第1入力端子と前記判定出力端子との間に介挿されたフィードバック抵抗と
を備え、
前記第1光発電素子は、前記第1入力端子に直接接続されている、
ことを特徴とする光ラッチ回路。 - 前記フィードバック抵抗が、
予め設定された光強度以上の光が照射され、前記第1光発電素子から前記電圧検知器に前記第1入力端子から電流が流れ込んだ際、当該第1入力端子の電圧が前記第1閾値電圧を超える抵抗値に設定されている
ことを特徴とする請求項1に記載の光ラッチ回路。 - 前記判定出力端子から前記第1入力端子に対して順方向となるように、前記判定出力端子と前記第1入力端子との間に、前記フィードバック抵抗と直列に接続されたダイオードをさらに備える
ことを特徴とする請求項1または請求項2に記載の光ラッチ回路。 - 前記判定出力端子と前記第1入力端子との間に前記フィードバック抵抗と直列に接続されており、前記判定出力端子から出力される電圧信号の前記第1入力端子への伝搬を所定の時間遅延させる遅延回路をさらに備える
ことを特徴とする請求項1または請求項2に記載の光ラッチ回路。 - 前記第1光発電素子と並列に、前記第1入力端子と接地との間に逆方向に接続された第2光発電素子をさらに備える
ことを特徴とする請求項1から請求項4のいずれか一項に記載の光ラッチ回路。 - 前記電圧検知器の第2入力端子と接地との間に逆方向に接続された第2光発電素子をさらに備え、
前記電圧検知器が、前記第2入力端子から入力される前記第2光発電素子の第2発電電圧と予め設定された第2閾値電圧とを比較し、前記第2発電電圧が前記第2閾値電圧を超えた場合、前記判定出力端子からセット信号の出力を停止する
ことを特徴とする請求項1から請求項4のいずれか一項に記載の光ラッチ回路。 - カレントミラー回路と、
前記カレントミラー回路の入力電流端子と接地との間に順方向に接続された第2光発電素子と、
をさらに備え、
前記カレントミラー回路の出力電流端子が前記第1入力端子に接続されている
ことを特徴とする請求項1から請求項4のいずれか一項に記載の光ラッチ回路。 - 前記電圧検知器が、
電源にソースが接続された第1PMOSトランジスタと、
前記電源にソースが接続され、前記第1PMOSトランジスタのゲートにドレインが接続され、当該第1PMOSトランジスタのドレインにゲートが接続された第2PMOSトランジスタと、
ドレインが前記第1PMOSトランジスタのドレインに接続され、ゲートが接地され、ソースが前記第1入力端子に接続されたデプレッション型の第1NMOSトランジスタと、
ドレインが前記第2PMOSトランジスタのドレインに接続され、ゲートが前記第1光発電素子を介して接地され、ソースが接地されたエンハンスメント型の第2NMOSトランジスタと、
入力端子が前記第2PMOSトランジスタのドレインに接続され、出力端子が前記判定出力端子に接続されたインバータと
を備える
ことを特徴とする請求項1から請求項7のいずれか一項に記載の光ラッチ回路。 - 請求項1からから請求項8のいずれか一項に記載の光ラッチ回路と、
所定の処理を行なう駆動対象回路と
を備え、
前記光ラッチ回路が判定出力端子から前記セット信号が供給された場合、前記駆動対象回路が駆動を開始する
ことを特徴とする電子装置。
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Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010219642A (ja) | 2009-03-13 | 2010-09-30 | Toshiba Corp | 光通信用受信回路 |
JP2011205433A (ja) | 2010-03-25 | 2011-10-13 | Seiko Instruments Inc | 光センサを用いた近接センサ |
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---|---|---|---|---|
JPS58219823A (ja) * | 1982-06-14 | 1983-12-21 | Nec Home Electronics Ltd | フオトラツチ回路 |
US4731640A (en) * | 1986-05-20 | 1988-03-15 | Westinghouse Electric Corp. | High resistance photoconductor structure for multi-element infrared detector arrays |
JPS6336612A (ja) * | 1986-07-31 | 1988-02-17 | Mitsubishi Electric Corp | 光論理入力回路 |
US4964687A (en) * | 1989-09-29 | 1990-10-23 | The Boeing Company | Optical latch and method of latching data using same |
US5404373A (en) * | 1991-11-08 | 1995-04-04 | University Of New Mexico | Electro-optical device |
US5281805A (en) * | 1992-11-18 | 1994-01-25 | Nippon Sheet Glass Co., Ltd. | Optical-input latch-circuit cell array |
JP3243899B2 (ja) * | 1993-07-20 | 2002-01-07 | ソニー株式会社 | 光信号の復調方法 |
JP3775574B2 (ja) * | 2001-05-22 | 2006-05-17 | シャープ株式会社 | 光結合装置 |
US7008218B2 (en) * | 2002-08-19 | 2006-03-07 | Abb Inc. | Combustion emission estimation with flame sensing system |
JP5057894B2 (ja) * | 2007-08-31 | 2012-10-24 | セイコーインスツル株式会社 | 電圧検出回路及びそれを用いた発振器 |
JP5797850B2 (ja) * | 2012-10-12 | 2015-10-21 | シャープ株式会社 | 光センサおよび電子機器 |
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Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010219642A (ja) | 2009-03-13 | 2010-09-30 | Toshiba Corp | 光通信用受信回路 |
JP2011205433A (ja) | 2010-03-25 | 2011-10-13 | Seiko Instruments Inc | 光センサを用いた近接センサ |
JP6336612B2 (ja) | 2014-03-14 | 2018-06-06 | ヒタチ ケミカル カンパニー アメリカ, リミテッド | 電気化学的方法により導電性表面上に膜形成可能なベンゾチアジアゾール系共役分子 |
US20160308515A1 (en) | 2015-04-15 | 2016-10-20 | Balanstring Technology, Llc | Low-Cost, Capacitive-Coupled Level Shifter Scalable for High-Voltage Applications |
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