JP7229360B2 - Oledアレイ基板、表示パネル及び表示装置 - Google Patents
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Description
Claims (11)
- OLEDアレイ基板であって、
第1の表示領域と第2の表示領域とを含み、
前記第1の表示領域は、前記第2の表示領域に隣接し、
前記第1の表示領域は、アレイ状に配列された第1のOLED画素を含み、
前記第2の表示領域は、アレイ状に配列された第2のOLED画素を含み、
前記第2のOLED画素の画素密度は、前記第1のOLED画素の画素密度よりも小さく、
同一行に位置される第2のOLED画素の第2の画素駆動ユニットと、第1のOLED画素の第1の画素駆動ユニットとが、同一の第一の走査線に接続され、隣接する2つの前記第一の走査線の間に少なくとも1つの第二の走査線が存在し、そのうち、1つの前記第二の走査線が同一行の第1のOLED画素の第1の画素駆動ユニットのみに接続され、
および/または、
同一列に位置される第2のOLED画素の第2の画素駆動ユニットと、第1のOLED画素の第1の画素駆動ユニットとが、同一組の第一類データ線に接続され、隣接する2組の前記第一類データ線の間に少なくとも1組の第二類データ線が存在し、1組に属される前記第二類データ線が同一列の第1のOLED画素の第1の画素駆動ユニットのみに接続されることを特徴とするOLEDアレイ基板。 - 隣接する2つの第一の走査線の間には、第二の走査線が1本のみ存在し、及び/又は、隣接する2組の前記第一類データ線の間には、1組に属される第二類データ線のみ存在し、
前記第1の表示領域の第n行の第1の画素駆動ユニットと、前記第2の表示領域の第1の行の第2の画素駆動ユニットとは、第1の行の第一の走査線に接続され、
前記第1の表示領域の第n+1行の第1の画素駆動ユニットは、1列の第二の走査線に接続され、
前記第1の表示領域の第n+2行の第1の画素駆動ユニットと、前記第2の表示領域の第2の行の第2の画素駆動ユニットとは、第2の行の第一の走査線に接続され、
nは1以上で整数であることを特徴とする請求項1に記載のOLEDアレイ基板。 - 前記第1の表示領域の第m列の第1の画素駆動ユニットと、前記第2の表示領域の第一列の第2の画素駆動ユニットとは、第一列の第一類データ線に接続され、
前記第1の表示領域の第m+1列の第1の画素駆動ユニットは、1列の第二類データ線に接続され、
前記第1の表示領域の第m+2列の第1の画素駆動ユニットと、前記第2の表示領域の第二列の第2の画素駆動ユニットとは、第二列の第一類データ線に接続され、
mは1以上で整数であることを特徴とする請求項2に記載のOLEDアレイ基板。 - 前記第1のOLED画素は、三角形に配列された第1の赤色サブ画素、第1の緑色サブ画素及び第1の青色サブ画素を含み、
前記第1の表示領域において奇数行の第1のOLED画素のサブ画素が第1順番で配列され、前記第1の表示領域において偶数行の第1のOLED画素のサブ画素が第2順番で配列され、前記第1順番は、第1の赤色サブ画素、第1の緑色サブ画素、および第1の青色サブ画素の順であり、前記第2順番は、第1の青色サブ画素、第1の緑色サブ画素、および第1の赤色サブ画素の順であり、
前記第1の画素駆動ユニットは、並列配列された第1の画素回路と、第2の画素回路と、第3の画素回路とを備え、前記第1の画素回路は、前記第1の赤色サブ画素に接続され、前記第2の画素回路は、前記第1の緑色サブ画素に接続され、前記第3の画素回路は、前記第1の青色サブ画素に接続され、
奇数行の前記第1の画素駆動ユニットの画素回路を第3順番で配置し、偶数行の前記第1の画素駆動ユニットの画素回路を第4順番で配置し、前記第3順番は、第1の画素回路、第2の画素回路、第3の画素回路の順であり、第4順番は、第3の画素回路、第2の画素回路、第1の画素回路の順であり、
前記第2のOLED画素が、三角形に配列された第2の赤色サブ画素、第2の緑色サブ画素及び第2の青色サブ画素を含み、
前記第2の表示領域で奇数行の第2のOLED画素のサブ画素は、第5順番で配列され、前記第2の表示領域で偶数行の第2のOLED画素のサブ画素は第6順番で配列され、または、前記第2の表示領域で奇数行の前記第2のOLED画素の前記サブ画素が前記第6順番で配列され、前記第2の表示領域で偶数行の前記第2のOLED画素の前記サブ画素が前記第5順番で配列され、前記第5順番は第2の青色サブ画素、第2の緑色サブ画素、第2の赤色サブ画素の順であり、第6順番は第2の赤色サブ画素、第2の緑色サブ画素、第2の青色サブ画素の順であり、
前記第2の画素駆動ユニットは、並列配列された第4の画素回路、第5の画素回路、及び第6の画素回路を含み、前記第4の画素回路は前記第2の赤色サブ画素に接続され、前記第5の画素回路は前記第2の緑色サブ画素に接続され、前記第6の画素回路は前記第2の青色サブ画素に接続され、
奇数行の前記第2の画素駆動ユニットの画素回路は第7順番で配列され、偶数行の前記第2の画素駆動ユニットの画素回路は第8順番で配列され、前記第7順番は第6の画素回路、第5の画素回路、第4の画素回路の順であり、第8順番は第4の画素回路、第5の画素回路、第6の画素回路の順であり、
一組の前記第一類データ線は、第1のデータ線、第2のデータ線、及び第3のデータ線を含み、前記第1のデータ線は赤色データ信号を伝送するように構成され、前記第2のデータ線は緑色データ信号を伝送するように構成され、前記第3のデータ線は青色データ信号を伝送するように構成され、
前記第4の画素回路は前記第1のデータ線に接続され、前記第5の画素回路は前記第2のデータ線に接続され、前記第6の画素回路は前記第3のデータ線に接続されることを特徴とする請求項2に記載のOLEDアレイ基板。 - 第3の表示領域をさらに含み、前記第3の表示領域は、前記第2の表示領域に隣接し、前記第3の表示領域は、前記第2の表示領域に前記第1の表示領域から離れた側に位置し、前記第3の表示領域の透光率は、前記第1の表示領域の透光率よりも大きく、前記第3の表示領域の透光率は、前記第2の表示領域の透光率よりも大きいことを特徴とする請求項1に記載のOLEDアレイ基板。
- 前記第3の表示領域は、アレイ状に配列された第3のOLED画素を含み、前記第3のOLED画素の画素密度は、前記第1の表示領域の前記第1のOLED画素の前記画素密度よりも低く、前記第3のOLED画素の画素密度は、前記第2の表示領域の前記第2のOLED画素の前記画素密度よりも低く、
前記第2の表示領域において前記第3の表示領域側に隣接する第2のOLED画素のサイズは、前記第2の表示領域において第1の表示領域側に隣接する第2のOLED画素のサイズよりも大きく、
前記第2の表示領域において前記第3の表示領域側に隣接して2つで隣接する前記第2のOLED画素の間の距離は、前記第2の表示領域において第1の表示領域側に隣接して2つで隣接する前記第2のOLED画素の間の距離よりも小さいことを特徴とする請求項5に記載のOLEDアレイ基板。 - 前記第3のOLED画素は、三角形に配置された第3の赤色サブ画素、第3の緑色サブ画素、および第3の青色サブ画素を含み、
前記第3の表示領域で前記第2の表示領域に隣接する境界領域は、前記第3のOLED画素の第3の画素駆動ユニットを有し、前記第3の画素駆動ユニットは、第7の画素回路、第8の画素回路及び第9の画素回路を有し、同一行の全ての前記第3の赤色サブ画素がいずれも前記第7の画素回路に接続され、同一行の全ての前記第3の緑色サブ画素がいずれも前記第8の画素回路に接続され、同一行の全ての前記第3の青色サブ画素がいずれも前記第9の画素回路に接続され、
一組の前記第一類データ線は、第1のデータ線、第2のデータ線、及び第3のデータ線を含み、前記第1のデータ線は赤色データ信号を伝送するように構成され、前記第2のデータ線は緑色データ信号を伝送するように構成され、前記第3のデータ線は青色データ信号を伝送するように構成され、
1行の第一の走査線が境界領域まで延びて前記第3の画素駆動ユニットに接続され、1組の第一類データ線が前記境界領域まで延びて前記第3の画素駆動ユニットに接続され、前記第7の画素回路が前記第1のデータ線に接続され、前記第8の画素回路が前記第2のデータ線に接続され、前記第9の画素回路が前記第3のデータ線に接続されることを特徴とする請求項6に記載のOLEDアレイ基板。 - 前記OLEDアレイ基板は、底板と、前記底板上に位置される第1の電極層と、前記第1の電極層上に位置される発光構造層と、前記発光構造層上に位置される第2の電極層と、を備え、
前記第3の表示領域に位置される第1の電極層は、第1の方向に沿って配列された複数の第1の電極群を含み、各前記第1の電極群は、複数の第1の電極を含み、前記第1の電極群の第1の電極は第2の方向に沿って配列され、前記第2の方向は前記第1の方向と交差し、各前記第1の電極は、1つ以上の第1の電極ブロックを含み、前記第1の電極が複数の第1の電極ブロックを含む場合に、隣接する2つの第1の電極ブロックは電気的に接続され、前記第3の表示領域は、複数のサブ表示領域を含み、各前記サブ表示領域の少なくとも1つの縁部は、前記第2の表示領域に隣接し、各前記第1の電極は、1つのサブ表示領域だけに配置され、異なる第1の電極は、異なる画素により駆動され、
前記第1の電極群の前記複数の第1の電極において、隣接する2つの前記第1の電極の間にギャップがあり、隣接する2つの前記第1の電極は絶縁されており、複数の前記第1の電極群の間の前記ギャップは、前記第1の方向にずれて配列され、
各前記第1の電極群は2つの第1の電極を有し、前記第3の表示領域は2つのサブ表示領域を有し、前記第1の電極群の前記2つの第1の電極はそれぞれに前記2つのサブ表示領域に設けられていることを特徴とする請求項5に記載のOLEDアレイ基板。 - 請求項1から8のいずれか一項に記載のOLEDアレイ基板と、
前記OLEDアレイ基板上に前記OLEDアレイ基板から離れた底板側に封止される封止層と、を含み、
前記OLEDアレイ基板はさらに第3の表示領域を含む場合、前記第3の表示領域の後面に感光素子が設けられることを特徴とする表示パネル。 - 前記第3の表示領域の少なくとも一部は、前記第2の表示領域に囲まれ、
前記封止層は、偏光子を含み、前記偏光子は、前記第1の表示領域及び前記第2の表示領域を覆い、前記第3の表示領域を覆わないことを特徴とする請求項9に記載の表示パネル。 - 素子領域を有する装置本体と、
請求項9に記載の表示パネルと、を含み、
前記表示パネルは、前記装置本体を覆い、
そのうち、前記OLEDアレイ基板は第3の表示領域をさらに含む場合、前記素子領域が前記第3の表示領域の後方に位置され、前記素子領域に、前記第3の表示領域を通過して発光または集光する感光素子が含まれることを特徴とする表示装置。
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