JP7206130B2 - 適応型インターフェイスストレージ装置 - Google Patents

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Description

本発明は永久ストレージに関する。さらに詳細には、構成可能なストレージインターフェイスを有するストレージ装置に関する。
永久ストレージ装置は、多様なアプリケーションで使用されることができ、多様なインターフェイスと共に動作される。幾つかのアプリケーションで、多数の異なるインターフェイスが使用されるシステムにおいて異なるストレージインターフェイスをサポートするストレージ装置の在庫を維持することは不都合な可能性がある。
従って、異なるストレージインターフェイスで動作することができるストレージ装置が必要である。
米国特許第９，７６７，８５６号公報 米国特許第９，７９８，６３６号公報
本発明の目的は、異なるストレージインターフェイスで動作することができるストレージ装置を提供することである。
本発明の実施形態によれば、後端ストレージインターフェイスコネクターと、後端ストレージインターフェイスコネクターと連結される適応可能（ａｄａｐｔａｂｌｅ）回路と、適応可能回路と連結される第１ルーティング回路と、第１マルチプレクサーと連結される前端ストレージインターフェイスコネクターと、を含み、第１状態又は第２状態で動作し、第１状態において前端ストレージインターフェイスコネクターで第１ストレージプロトコルに従って第１装置側ストレージインターフェイスを提供し、第２状態において前端ストレージインターフェイスコネクターで第１ストレージプロトコルとは異なる第２ストレージプロトコルに従って第２装置側ストレージインターフェイスを提供する、ように構成される適応型インターフェイスストレージ装置が提供される。
一実施形態で、適応型インターフェイスストレージ装置は、第１ＰＣＩｅ（Ｐｅｒｉｐｈｅｒａｌ Ｃｏｍｐｏｎｅｎｔ Ｉｎｔｅｒｃｏｎｎｅｃｔ ｅｘｐｒｅｓｓ）エンドポイント（ｅｎｄｐｏｉｎｔ）及び第２ＰＣＩｅエンドポイントを含み、第１ルーティング回路は、前端ストレージインターフェイスコネクターと連結される第１マルチプレクサーチャンネル共通ポートを有する第１マルチプレクサーチャンネル、及び前端ストレージインターフェイスコネクターと連結される第２マルチプレクサーチャンネル共通ポート、第１ＰＣＩｅエンドポイントと連結される第１選択可能（ｓｅｌｅｃｔａｂｌｅ）ポート、及び第２ＰＣＩｅエンドポイントと連結される第２選択可能ポートを有する第２マルチプレクサーを含む第１マルチプレクサーである。
一実施形態で、第１マルチプレクサーチャンネルは、第１ＰＣＩｅエンドポイントと連結される第３選択可能ポートを有する。
一実施形態で、第１マルチプレクサーチャンネルは、連結されない状態である第４選択可能ポートを有し、第１状態において第３選択可能ポートが選択され、第２状態において３選択可能ポートが選択される。
一実施形態で、第１ストレージプロトコルは、ＮＭＶｅである。
一実施形態で、適応可能回路は、前端ストレージインターフェイスコネクターの第１複数のコンダクターに連結され、第２状態で適応可能回路は、第１複数のコンダクターでイーサーネットインターフェイスを提供するように構成される。
一実施形態で、第２ストレージプロトコルは、イーサーネットインターフェイス上のＮＶＭｅｏＦ（ＮＶＭｅ ｏｖｅｒ Ｆａｂｒｉｃｓ）である。
一実施形態では、第１状態において、第１選択可能ポートが選択される。
一実施形態では、第２状態において、第２選択可能ポートが選択される。
一実施形態では、第２状態において、前端ストレージインターフェイスコネクターでＰＣＩｅ制御プレーン（ｐｌａｎｅ）を提供するようにさらに構成される。
一実施形態で、第１ＰＣＩエンドポイントは、４レーンＰＣＩｅエンドポイントであり、第２ＰＣＩｅエンドポイントは、４レーンエンドポイントであり、第２マルチプレクサーチャンネル共通ポートは、２つの入力レーンと２つの出力レーンを有する。
一実施形態で、適応可能回路は、構成ポートを有しシステム開始の時に、構成ポートを通じてビットファイルをロードするように構成されるプログラマブル（ｐｒｏｇａｒｍｍａｂｌｅ）適応可能回路である。
一実施形態で、第１ルーティング回路は、第１マルチプレクサーであり、適応型インターフェイスストレージ装置は、第１ビットファイルメモリと、第２ビットファイルメモリと、構成ポートと連結される第２マルチプレクサー共通ポート、第１ビットファイルメモリと連結される第１選択可能ポート、及び第２ビットファイルメモリと連結される第２選択可能ポートを有する第２マルチプレクサーと、を含む。
一実施形態では、第１状態で第１選択可能ポートが選択され、第２状態で第２選択可能ポートが選択される。
一実施形態で、前端ストレージインターフェイスコネクターは、Ｕ．２コネクターである。
一実施形態で、適応型インターフェイスストレージ装置は、第１状態及び第２状態の間で選択するための信号を受信するように構成される状態制御入力を含む。
一実施形態で、前端ストレージインターフェイスコネクターは、Ｅ６ピンを有するＵ．２コネクターであり、状態制御入力は、Ｅ６ピンである。
本発明の実施形態によれば、前端ストレージインターフェイスコネクターと、永久ストレージと、を含む適応型インターフェイスストレージ装置が提供され、適応型インターフェイスストレージ装置は、第１状態又は第２状態で動作し、適応型インターフェイスストレージ装置は、第１状態において前端ストレージインターフェイスコネクターで第１装置側ＮＶＭｅストレージインターフェイスを提供し、第２状態において前端ストレージインターフェイスコネクターで第２装置側ＮＶＭｅｏＦストレージインターフェイスを提供するように構成される。
本発明の異なる実施形態の場合に、ストレージシステムは、シャーシと、後端ストレージインターフェイスコネクター、後端ストレージインターフェイスコネクターと連結される適応可能回路、及び適応可能回路と連結される第１ルーティング回路を含む適応型インターフェイスストレージ装置と、を含み、適応型インターフェイスストレージ装置は、第１状態又は第２状態で動作し、第１状態において前端ストレージインターフェイスコネクターで第１ストレージプロトコルに従って第１装置側ストレージインターフェイスを提供し、第２状態において前端ストレージインターフェイスコネクターで第１ストレージプロトコルと異なる第２ストレージプロトコルに従って第２装置側ストレージインターフェイスを提供するように構成される。
一実施形態で、適応型インターフェイスストレージ装置は、第１状態と第２状態との間で選択するための信号を受信するように構成される状態制御入力をさらに含み、シャーシは状態制御入力で第１状態を選択するための信号を供給するためにハードワイヤ処理（ｈａｒｄ－ｗｉｒｅｄ）される。
外部ハードウェア前端マルチプレクサーを使用することは、適応可能回路を構成することがＰＣＩｅリンクのトレーニングのためのＰＣＩｅ標準によって割り当てられた時間より長い時間を消耗する場合に発生し得る問題を回避することができる。
本発明の実施形態に係る適応型インターフェイスストレージ装置のブロック図である。 本発明の実施形態に係る適応型インターフェイスストレージ装置のブロック図である。 本発明の実施形態に係る適応型インターフェイスストレージ装置のブロック図である。 本発明の実施形態に係る適応型インターフェイスストレージ装置を含むシャーシのブロック図である。 本発明の実施形態に係る適応型インターフェイスストレージ装置を含むシャーシのブロック図である。 本発明の実施形態に係る適応型インターフェイスストレージ装置のブロック図である。
添付された図面と関連して、以下で説明される詳細な説明は、本発明によって提供される適応型インターフェイスストレージ装置の例示的な実施形態の説明として意図されており、本発明が構成されるか、或いは使用されることができる唯一の形態を示すことを意図するものではない。説明は、図示された実施形態と関連して本発明の特徴を説明する。しかし、同一又は同等な機能及び構造が、発明の範囲内に含まれるように意図された異なる実施形態によって達成されることができる。本明細書で言及されるように、同一な構成要素番号は、同一な構成要素又は特徴を示すことが意図されている。
図１を参照すると、幾つかの実施形態で、適応型インターフェイスストレージ装置（ａｄａｐｔｉｖｅ ｉｎｔｅｒｆａｃｅ ｓｔｏｒａｇｅ ｄｅｖｉｃｅ）は、後端ストレージインターフェイスコネクター１０５、適応可能（ａｄａｐｔａｂｌｅ）回路１１０、前端ストレージインターフェイスコネクター１１５、及び、前端ストレージインターフェイスコネクター１１５と適応可能回路１１０との間に連結された前端マルチプレクサー１２０、を含む。このような構成要素は、後端ストレージインターフェイスコネクター１０５を通じて固定インターフェイスストレージ装置１０７（例えば、ＮＶＭｅ（ｎｏｎｖｏｌａｔｉｌｅ ｍｅｍｏｒｙ ｅｘｐｒｅｓｓ）、ＳＳＤ（Ｓｏｌｉｄ Ｓｔａｔｅ Ｄｒｉｖｅ）等）に連結されるアダプターモジュールとして動作し、ホストシャーシに１つ以上のストレージインターフェイスをサポートするストレージディバイスとして動作する。前端マルチプレクサーは、一般的に、信号を複数の利用可能である経路の中で１つにルーティングするための任意の適切な回路であるルーティング又はスイッチング回路の例示である。２つ以上の経路が利用可能である場合、ＰＣＩｅ（Ｐｅｒｉｐｈｅｒａｌ Ｃｏｍｐｏｎｅｎｔ Ｉｎｔｅｒｃｏｎｎｅｃｔ ｅｘｐｒｅｓｓ）スイッチのようなルーティング構成要素が使用される。一例として、ルーティングは、単なる２つの構成要素の間に存在し得る。
幾つかの実施形態で、適応型インターフェイスストレージ装置は（ｉ）３．５インチハードドライブフォームファクタ（又は“ＬＦＦ（Ｌａｒｇｅ Ｆｒｏｍ Ｆａｃｔｏｒ）”標準、又は（ｉｉ）２．５インチハードドライブフォームファクタ（又はＳＦＦ（Ｓｍａｌｌ Ｆｏｒｍ Ｄａｃｔｏｒ））、又は（ｉｉｉ）例えば、ＦＨ－ＦＬカードアウトライン（Ｆｕｌｌ－Ｈｅｉｇｈｔ、Ｆｕｌｌ Ｌｅｎｇｔｈ ｃａｒｄ ｏｕｔｌｉｎｅ）のような標準ＰＣＩｅカードフォームファクタ、又はＦＨ－ＨＬアウトライン（Ｆｕｌｌ－Ｈｅｉｇｈｔ、Ｈａｌｆ Ｌｅｎｇｔｈ ｏｕｔｌｉｎｅ）に従っている。
本明細書で使用される、“ストレージインターフェイス”は、（ｉ）ストレージ装置（例えば、ハードドライブ又はＳＳＤのような永久ストレージ装置）、及び、（ｉｉ）ストレージ装置に連結されるマザーボード又はプロセッサのようなホストとの間のインターフェイスである。幾つかの実施形態で、ホストは、電力及び機械的なサポート（マウンティング及び冷却）を提供し、ストレージ装置に連結され、他のホスト（例えば、サーバー）とストレージ装置との間の連結を提供するシャーシである。これと関連して、永久ストレージ装置とホストとの間のストレージインターフェイスで、ホストは、ストレージ装置に対する“ホスト側ストレージインターフェイス”、例えば、ホスト側ＮＶＭｅストレージインターフェイスを提供し（例えば、ホストは命令（例えば、読出し又は書込み命令）をＮＶＭｅインターフェイスを通じてストレージ装置に伝送し）、ストレージ装置は、“装置側ストレージ装置インターフェイス”、例えば装置側ＮＶＭｅストレージ装置インターフェイスをホストに提供する。他の例示として、ストレージインターフェイスは“ＮＶＭｅｏＦ（ＮＶＭｅ ｏｖｅｒ Ｆａｂｒｉｃｓ）”である。
適応可能回路１１０は、ＦＰＧＡ（Ｆｉｅｌｄ Ｐｒｏｇｒａｍｍａｂｌｅ Ｇａｔｅ Ａｒｒａｙ）のようなプログラマブル（ｐｒｏｇｒａｍｍａｂｌｅ）論理回路である。図１の実施形態は、適応可能回路１１０と前端ストレージインターフェイスコネクター１１５との間の１つ以上の連結（“イーサーネット連結”と称される）１２５を形成する１つ以上のコンダクターのセットをさらに含むことができ、適応可能回路１１０は、動作の幾つかのモード（又は“状態”）で、１つ以上のイーサーネットインターフェイス（例えば、図示されたように２つのイーサーネットインターフェイス）をイーサーネット連結１２５で提供するように構成される。前端ストレージインターフェイスコネクター１１５はＵ．２コネクターであり、Ｕ．２コネクターのＳＡＳポート０及びＳＡＳポート１ピンは、イーサーネット連結のために使用されることができる。
図１の適応型インターフェイスストレージ装置は、２つの状態、第１状態及び第２状態で動作するように構成される；第１状態において、適応型インターフェイスストレージ装置は、前端ストレージインターフェイスコネクターで第１ストレージプロトコル（例えば、“ＮＶＭｅ”）に従って装置側ストレージインターフェイスを提供するように構成され、第２状態において、適応型インターフェイスストレージ装置は、前端ストレージインターフェイスコネクター１１５で第２ストレージプロトコル（例えば、“ＮＶＭｅ ｏｖｅｒ Ｆａｂｒｉｃｓ”）に従って装置側ストレージインターフェイスを提供するように構成されている。
前端マルチプレクサー１２０は、２つの異なる装置側ストレージインターフェイスをサポートするために、第１状態及び第２状態で異なるように構成される。前端マルチプレクサー１２０は、図１に示されるように、第１マルチプレクサーチャンネル１２１と第２マルチプレクサーチャンネル１２２とを含む。第１マルチプレクサーチャンネル１２１及び第２マルチプレクサーチャンネル１２２の各々は、以下でさらに詳細に論議されるように制御される。幾つかの実施形態で、前端マルチプレクサー１２０、例えばクワッド１：２－２：１マルチプレクサーは、“Ｔｅｘａｓ Ｉｎｓｔｒｕｍｅｎｔｓ”から購入可能なモデル“ＳＮ６５ＬＶＣＰ１１４”集積回路のような信号コンディショニングを含む線形リドライバー（ｒｅｄｒｉｖｅｒ）で具現される。
本明細書で使用されるように、マルチプレクサーは、１つの共通ポート、２つ以上の選択可能（ｓｅｌｅｃｔａｂｌｅ）ポート、及び選択入力を有する装置である。動作の時、選択入力で受信された選択信号に応じて、マルチプレクサーは、共通ポートと選択可能ポートとの中で１つのポート（“選択されたポート”と称される）を連結する（即ち、それらの間で内部接続を作る）。各ポートは、１つのレーン幅又は様々なレーンの幅である。ポートの全てのレーンは、入力レーン又は出力レーンであり、ポートは、入力レーン及び出力レーンの組み合わせを含む。（出力レーンを有しない）共通入力ポート及び複数の選択可能出力レーンを含むマルチプレクサーは、デマルチプレクサー（ｄｅ－ｍｕｌｔｉｐｌｅｘｅｒ）と称されることもある。様々なレーン幅を有する共通ポートを有するマルチプレクサーは（“マルチプレクサーチャンネル”と称される）、複数のマルチプレクサーと同等であり、各マルチプレクサーチャンネルはさらに少ないレーンを有し（これによってマルチプレクサーチャンネルの総レーン数がマルチプレクサーのレーン数と同一である）、共有された選択入力連結を有する（即ち、各々が同一な選択信号ソースに連結された選択入力を有する）。幾つかの実施形態で、複数のマルチプレクサーチャンネルが、単一集積回路（“Ｔｅｘａｓ Ｉｎｓｔｒｕｍｅｎｔｓ”から購入可能なモデル“ＳＮ６５ＬＶＣＰ１１４”集積回路など）に含まれてよい。このような集積回路は、例として４つの独立なチャンネル（各々が１つのレーン幅）を含み、各々が別の独立な選択入力を有するので、集積回路は、４つの選択入力を有する。
このように、“Ｔｅｘａｓ Ｉｎｓｔｒｕｍｅｎｔｓ”で購入することができるモデル“ＳＮ６５ＬＶＣＰ１１４”のような信号コンディショニングを有する線形リドライバーであるクワッド１：２－２：１マルチプレクサーが採用される場合には、単一マルチプレクサー（例えば、前端マルチプレクサー１２０）、又は２つのマルチプレクサーチャンネル（第１マルチプレクサーチャンネル１２１及び第２マルチプレクサーチャンネル１２２）、又は８個のマルチプレクサーチャンネルとして称され、各々は、１つのレーン幅を有する（共に４つの入力レーン及び４つの出力レーン提供する）。
適応可能回路１１０は、以下で、さらに具体的に説明されるように、前端ストレージインターフェイスコネクター１１５で、装置側ストレージインターフェイス又は制御プレーンインターフェイスの具現の一部を形成する、第１ＰＣＩｅエンドポイント１４１及び第２ＰＣＩｅエンドポイント１４２を含む。後端ストレージインターフェイスコネクター１０５で、後端ストレージインターフェイスコネクター１０５と連結される固定インターフェイスストレージ装置１０７にホスト側ストレージインターフェイスを具現するための１つ以上のＰＣＩｅルートポート（又は、ルートコンプレックス）１５０も含む。
図２Ａを参照すると、幾つかの実施形態では、適応型インターフェイスストレージ装置が第１状態で動作する時、第１マルチプレクサーチャンネルの第１選択可能ポートが選択され、第２マルチプレクサーチャンネルの第１選択可能ポートが選択される。図２Ａでは、異なる環境（例えば、適応型インターフェイスストレージ装置が第２状態で動作する時）でこれらの連結を生成するコンダクターが存在するにも拘らず、このような構成は、容易な理解のために、第１マルチプレクサーチャンネルの第２選択可能ポート及び第２マルチプレクサーチャンネルの第２選択可能ポートで終わるラインを図面から省略することによって図示されている。第２ＰＣＩｅエンドポイント１４２は、（（以下でさらに具体的に説明されるように）適応可能回路１１０のプログラミングの結果として）存在しないか、或いは（選択されない第２マルチプレクサーチャンネルの第２選択可能であるポートの結果として）存在するが、使用されないことがある。同様に、適応可能インターフェイスストレージ装置が（適応可能回路１１０のプログラミングの結果として）第１状態で動作する時、イーサーネット連結１２５は、動作可能である；容易な理解のために、イーサーネット連結によって採用されるコンダクターが（例えば、適応型インターフェイスストレージ装置が第２状態で動作する時）存在するにも拘らず、イーサーネット連結１２５を示す（例えば、図１で）ラインを図２Ａから省略することによって図示されている。
第１状態において、前端ストレージインターフェイスコネクター１１５に存在する装置側ストレージインターフェイスは、ＮＶＭｅである。適応型インターフェイスストレージ装置は、ホスト（例えば、以下でさらに具体的に説明されるように、適応型インターフェイスストレージ装置を収容するシャーシに連結されたホスト）からＮＶＭｅ命令を受信し、その命令は、前端マルチプレクサー１２０、適応可能回路１１０、及び後端ストレージインターフェイスコネクター１０５を通じて、固定インターフェイスストレージ装置１０７に伝送される。固定インターフェイスストレージ装置１０７は、各命令を処理し、適応型インターフェイスストレージ装置が、適応可能回路１１０、前端マルチプレクサー１２０、及び前端ストレージインターフェイスコネクター１１５を通じて、ホストに伝達する命令応答を、受信された各命令に応答して伝送する。適応可能インターフェイスストレージ装置は、１ｘ４ＮＶＭｅ装置側ストレージインターフェイスをホストに提供する。第１ＰＣＩｅエンドポイント１４１は、１ｘ４ＰＣＩｅエンドポイントである；１ｘ４ＮＶＭｅ装置側ストレージインターフェイスの４つのレーンの中で２つ（例えば、第１番目の２つのレーン、レーン“０”及び“１”）は、第１マルチプレクサーチャンネル１２１を通じて第１ＰＣＩｅエンドポイント１４１に連結され、４つのレーンの中で他の２つ（例えば、第３及び第４レーン、レーン“２”及び“３”）は、第２マルチプレクサーチャンネル１２２を通じて第１ＰＣＩｅエンドポイント１４１と連結されている。
図２Ｂを参照すると、幾つかの実施形態で、適応型インターフェイスストレージ装置は、第２状態で動作する時、第１マルチプレクサーチャンネルの第１選択可能ポートが選択され、第２マルチプレクサーチャンネルの第２選択可能ポートが選択される。図２Ｂで、（例えば、適応型インターフェイスストレージ装置が第１状態で動作する時）他の環境でこのような連結を生成するコンダクターが存在するにも拘らず、容易な理解のために、この構成は、第１マルチプレクサーチャンネルの第２選択可能ポート及び第２マルチプレクサーチャンネルの第１選択可能ポートで終わるラインを図面から省略することによって図示されている。
第２状態において、前端ストレージインターフェイスコネクター１１５で提供された装置側ストレージインターフェイスは、１つ以上のイーサーネット連結１２５上の“ＮＶＭｅ ｏｖｅｒ Ｆａｂｒｉｃｓ”である。適応型インターフェイスストレージ装置は、イーサーネット連結１２５を通じて“ＮＶＭｅ ｏｖｅｒ Ｆａｂｒｉｃｓ”命令を受信し、その命令は、適応可能回路１１０及び後端ストレージインターフェイスコネクター１０５を通じて、固定インターフェイスストレージ装置１０７に伝達される。適応可能回路１１０は、前端ストレージインターフェイスコネクター１１５で採用される“ＮＶＭｅ ｏｖｅｒ Ｆａｂｒｉｃｓ”ストレージプロトコルと後端ストレージインターフェイスコネクター１０５で採用されるＮＶＭｅストレージプロトコルとの間の変換のためのイーサーネット－ＮＶＭｅブリッジ２１０を含む。
適応型インターフェイスストレージ装置が第１状態で動作する時のように、適応型インターフェイスストレージ装置が第２状態で動作する時、固定インターフェイスストレージ装置１０７は、ストレージ装置１０７が受信した各命令を処理して、各々の受信された命令に対して後端ストレージインターフェイスコネクター１０５を通じて適応型インターフェイスストレージ装置が適応可能回路１１０及び前端ストレージインターフェイスコネクター１１５を通じて戻して伝送する命令応答を伝送する。適応型インターフェイスストレージ装置は、“ＮＶＭｅ ｏｖｅｒ Ｆａｂｒｉｃｓ”装置側ストレージインターフェイスをホストに提供する。
適応型インターフェイスストレージ装置が第２状態で動作する時、第１ＰＣＩｅエンドポイント１４１は、１ｘ４ＰＣＩｅエンドポイントであり、第２ＰＣＩｅエンドポイント１４２も１ｘ４ＰＣＩｅエンドポイントである；第１ＰＣＩｅエンドポイント１４１及び第２ＰＣＩｅエンドポイント１４２が、共に第１前端ストレージインターフェイスコネクター１１５で第１マルチプレクサーチャンネル１２１及び第２マルチプレクサーチャンネル１２２を通じて制御プレーン動作のための２ｘ２ＰＣＩｅリンクを提供する。このような制御プレーン動作は、例として、固定インターフェイスストレージ装置１０７の消去コードをアップデートするか、或いは適応型インターフェイスストレージ装置でファームウェアをアップグレードすることを含む。
図２Ａ及び図２Ｂから分かるように、第１マルチプレクサーチャンネル１２１の状態は、適応型インターフェイスストレージ装置の第１状態及び適応型インターフェイスストレージ装置の第２状態で同一である（そして、第１マルチプレクサーチャンネル１２１の第２選択可能ポートは“連結されない”、即ち、他のどの構成要素とも連結されない）。第２マルチプレクサーチャンネル１２２を通じて連結されたＰＣＩｅレーンに遅延等化（ｄｅｌａｙ ｅｑｕａｌｉｚａｔｉｏｎ）を提供するためのシステムに含まれる。適応型インターフェイスストレージ装置が第１状態で動作する時及び適応型ストレージ装置が第２状態で動作する時、全ての適応型インターフェイスストレージ装置は、ホスト側“１ｘ４ＮＶＭｅ”ストレージインターフェイスを固定インターフェイスストレージ装置１０７に提供し、以後、装置側“１ｘ４ＮＶＭｅ”ストレージインターフェイスを適応型インターフェイスストレージ装置に提供する。
図３Ａ及び図３Ｂを参照すると、幾つかの実施形態で、以上言及されたように、適応型インターフェイスストレージ装置が、シャーシに設置されている。適応型インターフェイスストレージ装置は、第１状態及び第２状態の間で選択するための信号を受信するピン（例えば、前端ストレージインターフェイスコネクター１１５がＵ．２コネクターである場合、Ｕ．２コネクターの”Ｅ６”ピン）を有する。シャーシは、第１状態で動作する適応型インターフェイスストレージ装置に信号するための接地電圧（図３Ａのように）、又は第２状態で動作する適応型インターフェイスストレージ装置に信号するための“Ｖｄｄ”（図３Ｂのように）にピンを連結する配線（ｗｉｒｉｎｇ）を有する。以下でさらに具体的に説明されるように、適応型インターフェイスストレージ装置の回路は、適応型インターフェイスストレージ装置が信号（例えば、“Ｅ６”ピンで受信された信号）により、前端マルチプレクサー１２０をセッティングすることによって、及び適応可能回路１１０をプログラミングすることによって識別された状態で動作するように惹起する。
図４を参照すると、幾つかの実施形態で、（適応可能回路１１０の構成ポート（例えば、適応可能回路１１０のＳＰＩ（Ｓｅｒｉａｌ Ｐｅｒｉｐｈｅｒａｌ Ｉｎｔｅｒｆａｃｅ）構成ポート）を通じて）開始される時、適応可能回路１１０によってロードされたビットファイルは、適応型インターフェイスストレージ装置が動作中である時の状態に基づいて選択される。例として、適応型インターフェイスストレージ装置が第１状態において動作する時、ビットファイルマルチプレクサー４１０は適応可能回路１１０の構成ポートを第１状態で動作するための適応可能回路１１０を構成するためのビットファイルを格納する第１メモリ４２１（例えば、ＳＰＩフラッシュメモリ）と連結させ、第２状態において、ビットファイルマルチプレクサー４１０は、適応可能回路１１０の構成ポートを第２状態で動作するための適応可能回路１１０を構成するためのビットファイルを格納する第２メモリ４２２（例えば、ＳＰＩフラッシュメモリ）と連結させる。これによって、メモリ４２１は、第１状態のためのビットファイルのみを格納し、メモリ４２２は第２状態のためのビットファイルのみを格納することができる。第１メモリ４２１及び第２メモリ４２２の各々のビットファイルの１つは、ＰＣＩｅ部分を含み、ＰＣＩｅ部分は、適応可能回路１１０に読み出し、先ず具現され、ＰＣＩｅエンドポイント１４１と１４２、及びルートポイント１５０が、ＰＣＩｅリンクトレーニングに正確な時間に参与するように構成されるように引き起こす。適応可能回路１１０の残りは、ＰＣＩｅリンクトレーニングが発生する間又はＰＣＩｅリンクトレーニングが成功的に完了された後、もしくは、ＰＣＩｅトレーニングの間及びＰＣＩｅトレーニングの後で、全てに構成される。（前端マルチプレクサー１２０によって生成される連結を適応可能回路１１０にプログラミングする代わりに）外部ハードウェア前端マルチプレクサー１２０を使用することは、適応可能回路１１０を構成することがＰＣＩｅリンクのトレーニングのためのＰＣＩｅ標準によって割り当てられた時間より長い時間を消耗する場合に発生し得る問題を回避することができる。
たとえ、ここでは、“第１”、“第２”、“第３”等の用語が、多様な要素、成分、領域、層、及び／又はセクションを説明するために使用されていても、このような要素、成分、領域、層、及び／又はセクションは、このような用語によって限定されないことが理解されるべきである。このような用語は、他の要素、成分、領域、層、又はセクションから１つの要素、構成、領域、層又はセクションを区別するために使用される。従って、後述する第１構成要素、成分、領域、層、又はセクションは、本発明の思想及び範囲を逸脱することなく、第２構成要素、成分、領域、層、又はセクションを指称することができる。
１つの要素又は図面で図示された他の構成要素又は特徴との特徴的な関係を説明することを容易にするために“下の”、“下”、“低い”、“特定部分の下”、“上に”、“上部”と同一の、空間的であり、相対的な用語が、ここにおいて使用され得る。空間的であり、相対的な用語は、図面で示された方向に加えて、使用又は動作で装置の他の方向を含むように意図されることが理解されるべきである。例えば、仮に、図面の装置を裏返したら、他の構成要素又は特徴の“下”又は“下の”又は“特定部分の下”として説明された構成要素は、他の構成要素又は特徴の“上に”合わせられるようになる。従って、“下の”又は“特定部分の下”の例示的な用語は、上又は下方向の全てを含むことができる。装置は、異なって合わせられ（例えば、９０°又は他の方向に回転されること）、そして、空間的であり相対的な技術語は、それに従って解釈されなければならない。また、２層の“間に”と指称される時、２層の間に１つの層のみがあるか、又は、１つ以上の間の層が存在することも、また理解されるべきである。
本明細書で使用された用語は、単に特定の実施形態を説明するためのものであり、本発明を限定しようとすることを意図するものではない。本明細書で使用されるように、“大体”、“約”の用語、及びこれらと同様な用語は、近似する用語として使用され、程度の用語としては、使用されなく、本発明の当業者によって識別される測定され又は計算された値の固有な変動を考慮するように意図されている。
本明細書で使用されるように、文脈上で明確に異なるように指示されない限り、単数形態は、本発明の概念の説明及び付加された請求項に使用される時、複数の形態を含むものと意図されている。そして、“含む”又は“含み、限定されない”の用語が本明細書に使用される場合は、記述された特徴、領域、数字、段階、動作、構成、及び／又は部品の存在を明記することであり、これらの１つ又はそれ以上の他の特徴、数字、段階、動作、構成、部品、及び／又は、グループの存在又は付加を排除しないものと、さらに理解されなければならない。本明細書で使用されるように、“及び／又は”の用語は、１つ以上の関連した羅列されたアイテムの任意の、及び、全ての組み合わせを含む。“少なくとも１つ”のような表現は、要素の全体リーストを修正し、そしてリーストの個別要素を修正しない。また、“することができる”の使用は、本発明の実施形態を説明する時、“本発明の１つ以上の実施形態”を称する。また、“例示的な”の用語は、例示又は実施形態を指称するように意図されている。本明細書で使用されたように、“使用する”、“使う”、及び“使用された“の用語は、“利用する”、“利用している”、そして“利用された”の用語の同意語であると各々看做され得る。
構成要素又はレイヤーが他の構成要素又はレイヤーと“上にある”、”連結される”、“結合される”、又は“隣接する”と言及される時は、他の構成要素又はレイヤー上に直接的にあるか、連結させるか、或いは結合されるか、或いは隣接することができ、もしくは、１つ以上の間に位置する構成要素又はレイヤーが存在することができる。反面、構成要素が他の構成要素又はレイヤーに“直接的に上にある”、“直接的に連結される”、“直接的に結合される”、又は“直ぐ隣接する”と言及される時は、間に位置する構成要素又はレイヤーが存在しない。
本明細書で羅列された任意の数の範囲は、羅列された範囲内に含まれる同一な数の正確性の全ての下位範囲を含むように意図されている。例として、“１．０で１０．０”の範囲は羅列された最小値１．０と羅列された最大値１０．０との間の（そして含まれた）全ての下位範囲を含むするように、即ち、例として、２．４で７．６のように、１．０と同一であるか、又は、大きい最小値及び１０．０と同一であるか、もしくは、小さい最小値を有する下位グループを含むように意図されている。本明細書で羅列された任意の最大数の制限は、ここに含まれる全てのさらに低い数の制限を含むように意図され、本明細書で羅列された任意の最小数の制限は、ここに含まれた全てのさらに高い数の制限を含むするように意図される。
本明細書では、適応型インターフェイスストレージ装置の例示的な実施形態が具体的に説明され図示されたが、多くの修正と変形が当業者にとっては明確である。従って、本開示の原理に従って説明される適応型インターフェイスストレージ装置について、本明細書で具体的に説明されること以外の実施形態が具現できることが理解されるべきである。
１０５ 後端ストレージインターフェイスコネクター
１０７ 固定インターフェイスストレージ装置
１１０ 適応可能回路
１１５ 前端ストレージインターフェイスコネクター
１２０ 前端マルチプレクサー
１２１ 第１マルチプレクサーチャンネル
１２２ 第２マルチプレクサーチャンネル
１２５ イーサーネット連結
１４１ 第１ＰＣＩｅエンドポイント
１４２ 第２ＰＣＩｅエンドポイント
１５０ ＰＣｌｅルートポイント
２１０ イーサーネットＮＶＭｅブリッジ

Claims (14)

  1. 第１コネクターと、
    前記第１コネクターに接続された第１回路と、
    前記第１回路に接続された第２回路と、
    前記第２回路に接続された第２コネクターと、
    を含み、
    前記第１回路は、第１エンドポイントおよび第２エンドポイントを含み、
    前記第２回路は、第１マルチプレクサーであって、
    第１マルチプレクサーチャンネルであり、
    前記第２コネクターに接続された、第１マルチプレクサーチャンネル共通ポートと、
    前記第１エンドポイントに接続された、第１マルチプレクサーチャンネル第１選択可能ポートと、
    接続されていない、第１マルチプレクサーチャンネル第２選択可能ポートと、
    を有する、第１マルチプレクサーチャンネルと、
    第２マルチプレクサーチャンネルであり、
    前記第２コネクターに接続された、第２マルチプレクサーチャンネル共通ポートと、
    前記第１エンドポイントに接続された、第２マルチプレクサーチャンネル第１選択可能ポートと、
    前記第２エンドポイントに接続された第２マルチプレクサーチャンネル第２選択可能ポートと、
    を有する、第２マルチプレクサーチャンネルと、
    を含む、装置であって、
    前記装置は、第１状態または第２状態で動作するように構成されており、
    前記第１状態では、前記第１マルチプレクサーチャンネル第１選択可能ポートが選択され、かつ、前記第２マルチプレクサーチャンネル第１選択可能ポートが選択されており、
    前記第２状態では、前記第１マルチプレクサーチャンネル第１選択可能ポートが選択され、かつ、前記第２マルチプレクサーチャンネル第２選択可能ポートが選択されており、
    前記装置は、
    前記第１状態において、前記第２コネクターで、第１プロトコルに従って第１インターフェイスを提供し、かつ、
    前記第２状態において、前記第２コネクターで、前記第１プロトコルとは異なる第２プロトコルに従って、第２インターフェイスを提供する、
    ように構成されている、
    装置。
  2. 前記第１プロトコルは、ＮＶＭｅである、
    請求項１に記載の装置。
  3. 前記第２プロトコルは、ＮＶＭｅｏＦ（ＮＶＭｅ ｏｖｅｒ Ｆａｂｒｉｃｓ）である、
    請求項２に記載の装置。
  4. 前記装置は、さらに、前記第２状態において、前記第２コネクターで、第１制御プレーンインターフェイスを提供するように構成されている、
    請求項１に記載の装置。
  5. 前記第１エンドポイントは、４レーンエンドポイントであり、
    前記第２エンドポイントは、４レーンエンドポイントであり、かつ、
    前記第１マルチプレクサーチャンネル共通ポートおよび前記第２マルチプレクサーチャンネル共通ポートは、合わせて、２つの入力レーンおよび２つの出力レーンを有する、
    請求項１に記載の装置。
  6. 前記第１回路は、プログラマブル適応可能回路であり、構成ポートを有し、かつ、システム開始の時に、前記構成ポートを通じてビットファイルをロードするように構成されている、
    請求項１に記載の装置。
  7. 前記装置は、さらに、
    第１ビットファイルメモリと、
    第２ビットファイルメモリと、
    第２マルチプレクサーと、
    を含み、
    前記第２マルチプレクサーは、
    前記構成ポートに接続された第２マルチプレクサー共通ポートと、
    前記第１ビットファイルメモリに接続された第２マルチプレクサーの第１選択可能ポートと、
    前記第２ビットファイルメモリに接続された第２マルチプレクサーの第２選択可能ポートと、
    を有する、
    請求項６に記載の装置。
  8. 前記第１状態では、前記第２マルチプレクサーの第１選択可能ポートが選択され、かつ、
    前記第２状態では、前記第２マルチプレクサーの第２選択可能ポートが選択される、
    請求項７に記載の装置。
  9. 前記第２コネクターは、Ｕ．２コネクターである、
    請求項１に記載の装置。
  10. 前記装置は、さらに、
    前記第１状態と前記第２状態との間を選択するための信号を受信するように構成されている状態制御入力、
    を含む、請求項１に記載の装置。
  11. 前記第２コネクターは、Ｅ６ピンを有するＵ．２コネクターであり、かつ、
    前記状態制御入力は、前記Ｅ６ピンである、
    請求項１０に記載の装置。
  12. 前記装置は、
    前記第１状態では、前記第２コネクターで、装置側ＮＶＭｅストレージインターフェイスを提供し、かつ、
    前記第２状態では、前記第２コネクターで、装置側ＮＶＭｅｏＦストレージインターフェイスを提供する、
    ように構成されている、
    請求項１に記載の装置。
  13. シャーシと、
    請求項１乃至１２いずれか一項に記載の装置と、
    を含む、システム。
  14. 前記装置は、さらに、前記第１状態と前記第２状態との間を選択するための信号を受信するように構成されている状態制御入力を含み、かつ、
    前記シャーシは、前記第１状態を選択する信号を前記状態制御入力へ供給するようにハードワイヤ処理されている、
    請求項１３に記載のシステム。
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Families Citing this family (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US11983138B2 (en) 2015-07-26 2024-05-14 Samsung Electronics Co., Ltd. Self-configuring SSD multi-protocol support in host-less environment
US11144496B2 (en) 2016-07-26 2021-10-12 Samsung Electronics Co., Ltd. Self-configuring SSD multi-protocol support in host-less environment
US11461258B2 (en) 2016-09-14 2022-10-04 Samsung Electronics Co., Ltd. Self-configuring baseboard management controller (BMC)
US10372659B2 (en) 2016-07-26 2019-08-06 Samsung Electronics Co., Ltd. Multi-mode NMVE over fabrics devices
US10346041B2 (en) 2016-09-14 2019-07-09 Samsung Electronics Co., Ltd. Method for using BMC as proxy NVMeoF discovery controller to provide NVM subsystems to host
US10210123B2 (en) 2016-07-26 2019-02-19 Samsung Electronics Co., Ltd. System and method for supporting multi-path and/or multi-mode NMVe over fabrics devices
US10521378B2 (en) 2018-03-09 2019-12-31 Samsung Electronics Co., Ltd. Adaptive interface storage device with multiple storage protocols including NVME and NVME over fabrics storage devices
CN111383154A (zh) * 2020-04-02 2020-07-07 广东金宇恒软件科技有限公司 一种数据接口及便于管理的公共财政预算管理一体化平台系统
TWI759772B (zh) * 2020-06-19 2022-04-01 英業達股份有限公司 快速周邊組件互連資料傳輸控制系統
US11770271B2 (en) 2020-08-21 2023-09-26 Samsung Electronics Co., Ltd. Data center

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2015528608A (ja) 2012-09-19 2015-09-28 コンバーサント・インテレクチュアル・プロパティ・マネジメント・インコーポレイテッドＣｏｎｖｅｒｓａｎｔ Ｉｎｔｅｌｌｅｃｔｕａｌ Ｐｒｏｐｅｒｔｙ Ｍａｎａｇｅｍｅｎｔ Ｉｎｃ． デュアルモードピン配列を有するフラッシュメモリコントローラ
US20170185554A1 (en) 2015-12-28 2017-06-29 Emc Corporation Fabric for modular solid-state storage systems
JP2018018514A (ja) 2016-07-26 2018-02-01 三星電子株式会社Ｓａｍｓｕｎｇ Ｅｌｅｃｔｒｏｎｉｃｓ Ｃｏ．，Ｌｔｄ． 多重モードで動作するストレージ装置及びそれを含むシステム

Family Cites Families (26)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20050251609A1 (en) * 2004-05-04 2005-11-10 Horng-Yee Chou Removable peripheral device
CN100479368C (zh) * 2007-06-15 2009-04-15 中兴通讯股份有限公司 交换机防火墙插板
US9736012B2 (en) * 2008-11-14 2017-08-15 Dell Products, Lp System and method for sharing storage resources
US20140089609A1 (en) 2012-09-26 2014-03-27 Advanced Micro Devices, Inc. Interposer having embedded memory controller circuitry
CN106104500B (zh) * 2013-11-26 2020-05-19 英特尔公司 存储数据的方法和设备
JP2017512350A (ja) * 2014-03-08 2017-05-18 ディアマンティ インコーポレイテッド 集中型ネットワーキング及びストレージのための方法及びシステム
US9304690B2 (en) * 2014-05-07 2016-04-05 HGST Netherlands B.V. System and method for peer-to-peer PCIe storage transfers
US10180889B2 (en) 2014-06-23 2019-01-15 Liqid Inc. Network failover handling in modular switched fabric based data storage systems
US9842075B1 (en) * 2014-09-12 2017-12-12 Amazon Technologies, Inc. Presenting multiple endpoints from an enhanced PCI express endpoint device
CN104572555B (zh) * 2014-12-15 2017-08-11 浙江大学 可重构自适应接口电路
US9767856B2 (en) 2015-02-10 2017-09-19 Netapp, Inc. High density storage device system
US10114778B2 (en) * 2015-05-08 2018-10-30 Samsung Electronics Co., Ltd. Multi-protocol IO infrastructure for a flexible storage platform
US10572426B2 (en) * 2015-06-02 2020-02-25 Nxp Usa, Inc. System-level redundancy in PCI express equipment
US10055379B2 (en) 2015-07-10 2018-08-21 SK Hynix Inc. Peripheral component interconnect express card
US20170068628A1 (en) * 2015-09-08 2017-03-09 Lenovo Enterprise Solutions (Singapore) Pte. Ltd. Reducing ethernet latency in a multi-server chassis
WO2017100941A1 (en) * 2015-12-18 2017-06-22 Nanoport Technology Inc. Protocol selection
US10210121B2 (en) 2016-01-27 2019-02-19 Quanta Computer Inc. System for switching between a single node PCIe mode and a multi-node PCIe mode
US10289560B2 (en) * 2016-03-10 2019-05-14 Toshiba Memory Corporation Switch module and storage system
US10346041B2 (en) * 2016-09-14 2019-07-09 Samsung Electronics Co., Ltd. Method for using BMC as proxy NVMeoF discovery controller to provide NVM subsystems to host
KR102155659B1 (ko) * 2016-07-26 2020-09-14 삼성전자주식회사 멀티-모드 장치 및 그것의 동작 방법
US20180188974A1 (en) * 2016-12-30 2018-07-05 Intel Corporation Computer program product, system, and method to allow a host and a storage device to communicate using different fabric, transport, and direct memory access protocols
US10141050B1 (en) * 2017-04-27 2018-11-27 Pure Storage, Inc. Page writes for triple level cell flash memory
CN107220195A (zh) 2017-05-26 2017-09-29 郑州云海信息技术有限公司 一种支持高密度NVMe存储的多路计算机系统架构
US11016924B2 (en) * 2018-03-01 2021-05-25 Samsung Electronics Co., Ltd. System and method for supporting multi-mode and/or multi-speed non-volatile memory (NVM) express (NVMe) over fabrics (NVMe-oF) devices
US10649940B2 (en) * 2018-03-05 2020-05-12 Samsung Electronics Co., Ltd. Modular system architecture for supporting multiple solid-state drives
US10521378B2 (en) * 2018-03-09 2019-12-31 Samsung Electronics Co., Ltd. Adaptive interface storage device with multiple storage protocols including NVME and NVME over fabrics storage devices

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2015528608A (ja) 2012-09-19 2015-09-28 コンバーサント・インテレクチュアル・プロパティ・マネジメント・インコーポレイテッドＣｏｎｖｅｒｓａｎｔ Ｉｎｔｅｌｌｅｃｔｕａｌ Ｐｒｏｐｅｒｔｙ Ｍａｎａｇｅｍｅｎｔ Ｉｎｃ． デュアルモードピン配列を有するフラッシュメモリコントローラ
US20170185554A1 (en) 2015-12-28 2017-06-29 Emc Corporation Fabric for modular solid-state storage systems
JP2018018514A (ja) 2016-07-26 2018-02-01 三星電子株式会社Ｓａｍｓｕｎｇ Ｅｌｅｃｔｒｏｎｉｃｓ Ｃｏ．，Ｌｔｄ． 多重モードで動作するストレージ装置及びそれを含むシステム

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