JP6583293B2 - Agc回路および無線受信機 - Google Patents
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Description
本発明は、高周波信号をベースバンド信号に変換する無線受信機のための自動利得制御(AGC)回路と、それを備えた無線受信機とに関するものである。
ダイレクトコンバージョン受信機は、アンテナで受信された高周波信号をそれと同一周波数の局部発振信号によってベースバンド信号へと変換する無線受信機である。この技術は、無線受信機の小型化、軽量化および低消費電力化に貢献する。しかしながら、回路固有の直流(DC)オフセットが発生するという問題があった。
この問題に対して、一般に、AGC回路の制御対象である可変利得増幅器(VGA)の信号経路にハイパスフィルタ(HPF)を挿入し、このHPF内のキャパシタによりDC成分を阻止するという対策をとる。
ある従来技術によれば、VGAの利得探索期間などの大きなDCオフセットが発生する可能性が高い期間では、HPFのカットオフ周波数を高くすることでDCオフセットを速やかに収束させ、これ以外の期間では、復調精度を向上させるためにHPFのカットオフ周波数を低くする(特許文献1参照)。
上記従来技術では、後に詳述するように、HPFのカットオフ周波数を高い値から低い値へ切り替えた際にVGAの出力に大きなDCオフセットが発生することがあった。
本発明の目的は、VGAの出力におけるDCオフセットの発生を抑制したAGC回路および無線受信機を提供することにある。
上記目的を達成するため、本発明に係るAGC回路は、高周波信号をベースバンド信号に変換する無線受信機のためのAGC回路において、ベースバンド信号を可変の利得で増幅する増幅回路と当該増幅回路に結合された可変のカットオフ周波数を持つHPFとを有するVGAと、当該VGAへ利得制御信号を供給する制御部と、高周波信号を一時的に遮断する遮断部とを備えた構成を採用し、制御部は、HPFのカットオフ周波数を高い値から低い値へ切り替える前に高周波信号の遮断を開始するように遮断部を制御する機能をさらに有することとしたものである。
また、本発明に係る無線受信機は、高周波信号をベースバンド信号に変換する検波器と、ベースバンド信号を可変の利得で増幅する増幅回路と当該増幅回路に結合された可変のカットオフ周波数を持つHPFとを有するVGAと、当該VGAへ利得制御信号を供給する制御部と、高周波信号を一時的に遮断する遮断部とを備えた無線受信機であって、制御部は、HPFのカットオフ周波数を高い値から低い値へ切り替える前に高周波信号の遮断を開始するように遮断部を制御する機能をさらに有することとしたものである。
本発明によれば、HPFのカットオフ周波数を高い値から低い値へ切り替える前に高周波信号を遮断することとしたので、高周波信号の遮断によりVGAの出力DCオフセットが速やかに収束した後に、HPFのカットオフ周波数が高い値から低い値へ切り替えられることとなる。よって、HPFのカットオフ周波数を高い値から低い値へ切り替える際のVGAの出力DCオフセットの発生が抑制される。
以下、本発明の実施形態を図面に基づいて詳細に説明する。
図1は、本発明に係るAGC回路を備えた無線受信機の構成例を示している。図1の無線受信機は、ダイレクトコンバージョン受信機であって、アンテナ10と、低雑音増幅器(LNA)20と、スイッチ30と、局部発振器40と、直交検波器50と、VGA60a,60bと、アナログ・デジタル変換器(ADC)70a,70bと、制御部80と、復調部90とを備えている。
アンテナ10は、高周波信号を受信する。LNA20は、受信した高周波信号を増幅して直交検波器50へ供給する。スイッチ30は、高周波信号を一時的に遮断するように、LNA20と直交検波器50との間に介在している。局部発振器40は、アンテナ10で受信された高周波信号と同一周波数の局部発振信号を生成する。直交検波器50は、局部発振器40からの局部発振信号により、LNA20からの高周波信号をベースバンド信号IおよびQに変換する。VGA60a,60bは、ベースバンド信号IおよびQをそれぞれ増幅する。増幅されたベースバンド信号VaおよびVbは、それぞれADC70a,70bに入力される。ADC70a,70bは、増幅されたベースバンド信号VaおよびVbをそれぞれデジタル信号に変換する。制御部80は、デジタル信号で表される振幅が所定値に近づくようにVGA60a,60bへ利得制御信号GNCを供給する。さらに、制御部80は、VGA60a,60bへカットオフ周波数(Fc)制御信号FCCを、スイッチ30へ遮断制御信号SWCをそれぞれ供給する機能を有する。復調部90は、制御部80によるVGA60a,60bの利得制御が完了した後に、ADC70a,70bからのデジタル化されたベースバンド信号を復調して、受信データを出力する。
図1中のスイッチ30と、VGA60a,60bと、ADC70a,70bと、制御部80とは、ダイレクトコンバージョン受信機のためのAGC回路を構成する。ここで、SWC=Hであれば、スイッチ30が閉じる結果、LNA20からの高周波信号が直交検波器50へ供給されて、ベースバンド信号IおよびQがVGA60a,60bの入力へ供給されるものとする。逆に、SWC=Lであれば、スイッチ30が開く結果、LNA20から直交検波器50への高周波信号の供給が遮断されるとともに、VGA60a,60bの入力へのベースバンド信号IおよびQの供給が遮断される。
図2は、図1中のVGA60aの内部構成例を示している。図1中の他のVGA60bの内部構成は、図2と同様であるので図示を省略する。図2のVGA60aは、十分な利得を得るために、3段の増幅回路61,62,63を有している。そして、1段目の増幅回路61の入力端にHPF64が、1段目の増幅回路61と2段目の増幅回路62との段間にHPF65が、2段目の増幅回路62と3段目の増幅回路63との段間にHPF66が、3段目の増幅回路63の出力端にHPF67がそれぞれ挿入されている。増幅回路61,62,63は、各々ベースバンド信号を可変の利得で増幅し、その各々の利得が利得制御信号GNCにより制御されるようになっている。また、HPF64,65,66,67は、各々可変のカットオフ周波数Fcを持ち、その各々のカットオフ周波数FcがFc制御信号FCCにより制御されるようになっている。
なお、VGA60aを構成する増幅回路の段数は任意である。各増幅回路に個別の利得制御信号が入力されてもよい。また、HPFは、増幅回路自体で生じるDCオフセットの抑制効果を高めるために増幅回路の入力端、出力端および段間にそれぞれ挿入することが可能であるが、必ずしもその全てに備える必要はない。また、各HPFのカットオフ周波数Fcは互いに異なってもよい。
図3は、図2中のHPF64の内部構成例を示している。図2中の他のHPF65,66,67の内部構成は、図3と同様であるので図示を省略する。図3のHPF64は、キャパシタCと抵抗器Rとで構成されている。そして、抵抗器Rの抵抗値がFc制御信号FCCにより制御されるようになっている。ここで、FCC=Hであれば、抵抗器Rが小さい抵抗値に制御されて、HPF64の回路時定数が小さくなり、そのカットオフ周波数Fcが高くなるものとする。逆に、FCC=Lであれば、抵抗器Rが大きい抵抗値に制御されて、HPF64の回路時定数が大きくなり、そのカットオフ周波数Fcが低くなる。
図4は、図1中の制御部80の内部部分構成例を示している。また、図5(a)〜図5(c)は、図4の回路の動作説明のための信号波形図である。なお、図4は、制御部80の内部構成のうち、Fc制御信号FCCおよび遮断制御信号SWCに関わる部分のみを示している。
図4の制御部80は、非反転出力を持つ第1の遅延回路81と、反転出力を持つ第2の遅延回路82と、論理和回路83とを備えている。第1の遅延回路81は、HレベルからLレベルへ遷移するカットオフ周波数(Fc)切り替え指令CMDを時間T1だけ遅延させることにより、図5(b)に示すようなFc制御信号FCCを出力する。第2の遅延回路82は、Fc切り替え指令CMDを時間T2だけ遅延させかつ出力論理を反転させる。ここに、T1≦T2とする。論理和回路83は、Fc切り替え指令CMDと第2の遅延回路82の出力とを受けて、図5(c)に示すような遮断制御信号SWCを出力する。
以上のとおり、図4の制御部80は、1つのFc切り替え指令CMDに基づいて、Fc制御信号FCCと、遮断制御信号SWCとを生成する回路を有している。また、図4の制御部80によれば、Fc制御信号FCCが立ち下がる前に遮断制御信号SWCが立ち下がるようにできる。つまり、この制御部80は、ハイパスフィルタ64〜67のカットオフ周波数Fcを高い値から低い値へ切り替える前に高周波信号の遮断を開始するようにスイッチ30を制御する機能を有する。さらに、図4の制御部80によれば、Fc制御信号FCCが立ち下がる前に遮断制御信号SWCが立ち上がらないようにできる。つまり、この制御部80は、ハイパスフィルタ64〜67のカットオフ周波数Fcを高い値から低い値へ切り替える前に高周波信号の遮断を終了しないようにスイッチ30を制御する機能をさらに有する。
図6(a)〜図6(d)は、図1の無線受信機の動作説明のための信号波形図である。また、図7(a)〜図7(d)は、図6(a)〜図6(d)の時間軸を拡大して示す信号波形図である。ここでは、無線LANやミリ波通信などのパケット受信機におけるように、パケット受信開始時点において利得探索のために受信利得を大きく変化させるものとしている。
制御部80は、初期状態では、VGA60a,60bへ利得制御信号GNCを供給して、それらの利得が大きくなるように制御している。つまり、受信した高周波信号が微弱な場合でも、その入力が検知できるよう、初期状態としてVGA60a,60bの利得は大きな値とされている。また、高周波信号の入力検知後は短時間で利得を大きく変更していく必要があるため、DCオフセットを速やかに収束させるべく、初期状態でFCC=HとしてHPF64〜67のカットオフ周波数Fcを大きな値にしておく。
パケット状の高周波信号の入力開始時刻を時刻0nsとする。それ以前では、図6(d)に示すように、増幅されたベースバンド信号Vaとして、LNA20からVGA60aまでの構成に起因した熱雑音による小さな振幅の信号が出力されている。図示の例では、熱雑音による振幅を大きく超える振幅の期間が約100nsを超えたことを以て、高周波信号入力の検知としている。
この条件で高周波信号の入力が検知されれば、図6(a)に示すように、利得制御信号GNCを上下させながら、ADC70a,70bからのデジタル信号で表される振幅が所定値に近くなる利得制御値を探索する(時刻110ns〜360ns)。
探索が終了すれば、図6(b)および図7(b)に示すように、Fc制御信号FCCをHレベルからLレベルへ切り替えることで(時刻370ns)、HPF64〜67のカットオフ周波数Fcを小さくする。これにより、復調精度を向上させた通常の受信状態にする。
その後は、デジタル信号で表される振幅が所定値にさらに近くなるよう、利得制御値を微調整してもよいし、そのまま復調部90で復調動作を行わせてもよい。なお、図6(a)〜図6(d)の例では、微調整無しとしている。
次に、遮断制御信号SWCについて説明する。図6(c)および図7(c)に示すように、制御部80は、Fc制御信号FCCを立ち下げるより前に高周波信号の遮断を開始(SWC=L)するようにスイッチ30を制御し、かつFc制御信号FCCを立ち下げた時点以後に高周波信号の遮断を終了(SWC=H)するようにスイッチ30を制御する。このようにして直交検波器50への入力信号の遮断を制御することにより、次のような作用効果が得られる。
受信開始時はFCC=Hとして、利得を調整する。この際は、HPF64〜67の回路時定数が小さいので、信号VaにDCオフセットが発生した場合であっても速やかに収束する。利得の調整が終了すると、遮断制御信号SWCをHレベルからLレベルへと変化させることで、直交検波器50への入力信号を遮断する。そうすると、その際に信号Vaの電圧値やHPF64〜67中のキャパシタCが蓄えている電圧値がゼロでなかった場合でも、まだFCC=Hの状態であるため、信号Vaの電圧は速やかに0に収束する(図7(d)の丸部分)。その後にFCC=Lとし、またSWC=Hとしても、信号Vaの電圧が0の状態から開始され、すなわちDCオフセットがない状態から開始することができる。したがって、この時点から利得の微調整をさらに行う場合にはDCオフセットにより利得調整が乱されることはなく、またすぐに通常の復調を開始する場合には復調信号の精度低下によるデータ誤りが発生することを防ぐことができる。
図8(a)〜図8(d)は、図1の無線受信機に対する比較例の動作説明のための信号波形図である。ここでは、Fc制御信号FCCの立ち下げタイミングにかかわらずスイッチ30の遮断動作を行わないように、SWC=Hの状態を保持することとしている。この場合には、利得の調整が終了して、Fc制御信号FCCをHレベルからLレベルへ立ち下げることでHPF64〜67のカットオフ周波数Fcを切り替えた際に、その時点の信号Vaの電圧値やHPF64〜67中のキャパシタCが蓄えている電圧値によっては、信号Vaに大きなDCオフセットが発生(図8(d)の例ではマイナス方向に大きなDCオフセットが発生)することがある。大きなDCオフセットが発生した場合にはこのDCオフセットが収束するまでに長い時間がかかる。したがって、この時点から利得の微調整をさらに行う場合にはDCオフセットにより利得調整が乱され、すぐに通常の復調を開始する場合には復調信号の精度低下によりデータ誤りが発生することになる。
なお、図1では信号遮断を、直交検波器50の出力であるベースバンド信号ではなく、直交検波前の高周波信号で行っている。これは、信号遮断を直交検波の後で行うと、直交検波器50の出力に含まれてVGA60a,60bに入力されるDCオフセットの値が信号遮断の有無により変化してしまうからである。その場合、信号遮断を解除した時点で新たなDCオフセットがVGA60a,60bに入力されることになり、VGA60a,60bの出力Va,Vbにも大きなDCオフセットが生じることになる。
また、図6(c)および図7(c)にて破線で示すように、スイッチ30の遮断を解除する時点を、HPF64〜67のカットオフ周波数Fcを小さくした後にすれば、制御信号タイミング生成の誤差や回路諸部の遅延があっても確実にDCオフセットを防ぐことができる。
最後に、ビームフォーミングに対応した無線受信機に係る3つの変形例について説明する。
図9は、図1の無線受信機の第1変形例を示している。図9の無線受信機は、複数のアンテナ11,12と、各々受信した高周波信号を増幅する複数のLNA21,22と、当該複数のLNA21,22の各々の出力の位相および振幅を調整しつつ合成出力を直交検波器50へ供給する移相器100とを備える。移相器100と直交検波器50との間に1つのスイッチ30が介在している。
図9の構成によれば、それぞれのアンテナ11,12で受信した高周波信号はLNA21,22で増幅された後、移相器100により調整および合成されてから、直交検波器50に供給される。この場合、遮断用のスイッチ30は1つで済む。ただし、図9の構成では、直交検波に用いる局部発振信号が移相器100に漏れ込み、それが直交検波されてDCオフセットが生じているような場合には、遮断制御信号SWCを切り替えるたびにDCオフセットが変化するため、DCオフセットの抑制が不十分になる。
図10は、図1の無線受信機の第2変形例を示している。図10の無線受信機は、複数のLNA21,22の各々と移相器100との間にそれぞれスイッチ31,32を有している。
図10の構成によれば、LNA21,22と移相器100との間にてスイッチ31,32で高周波信号をそれぞれ遮断する。図10の構成では、遮断用のスイッチ31,32は複数必要となるが、直交検波に用いる局部発振信号が移相器100に漏れ込み、それが直交検波されてDCオフセットが生じているような場合でも、DCオフセットを防ぐことができる。
図11は、図1の無線受信機の第3変形例を示している。図11の無線受信機は、図10中のスイッチ31,32の機能を、移相器110の利得ゼロ制御により達成するものである。
図11の構成によれば、位相器110の各信号に対する振幅利得をゼロにすることにより、各信号を遮断する。これにより、遮断用のスイッチを省くことができる。
以上説明してきたとおり、本発明に係るAGC回路および無線受信機は、HPFのカットオフ周波数を高い値から低い値へ切り替える際のVGAの出力DCオフセットの発生が抑制される効果を有し、高周波信号をベースバンド信号に変換する無線受信機などとして有用である。
10,11,12 アンテナ
20,21,22 低雑音増幅器(LNA)
30,31,32 スイッチ
40 局部発振器
50 直交検波器
60a,60b 可変利得増幅器(VGA)
61〜63 増幅回路
64〜67 ハイパスフィルタ(HPF)
70a,70b アナログ・デジタル変換器(ADC)
80 制御部
81,82 遅延回路
83 論理和回路
90 復調部
100,110 移相器
C キャパシタ
CMD カットオフ周波数(Fc)切り替え指令
FCC カットオフ周波数(Fc)制御信号
GNC 利得制御信号
I,Q ベースバンド信号
R 抵抗器
SWC 遮断制御信号
Va,Vb 増幅されたベースバンド信号
20,21,22 低雑音増幅器(LNA)
30,31,32 スイッチ
40 局部発振器
50 直交検波器
60a,60b 可変利得増幅器(VGA)
61〜63 増幅回路
64〜67 ハイパスフィルタ(HPF)
70a,70b アナログ・デジタル変換器(ADC)
80 制御部
81,82 遅延回路
83 論理和回路
90 復調部
100,110 移相器
C キャパシタ
CMD カットオフ周波数(Fc)切り替え指令
FCC カットオフ周波数(Fc)制御信号
GNC 利得制御信号
I,Q ベースバンド信号
R 抵抗器
SWC 遮断制御信号
Va,Vb 増幅されたベースバンド信号
Claims (10)
- 高周波信号をベースバンド信号に変換する無線受信機のための自動利得制御(AGC)回路であって、
前記ベースバンド信号を可変の利得で増幅する増幅回路と、当該増幅回路に結合された可変のカットオフ周波数を持つハイパスフィルタとを有する可変利得増幅器と、
前記可変利得増幅器へ利得制御信号を供給する制御部と、
前記高周波信号を一時的に遮断する遮断部とを備え、
前記制御部は、前記ハイパスフィルタのカットオフ周波数を高い値から低い値へ切り替える前に前記高周波信号の遮断を開始するように前記遮断部を制御する機能をさらに有するAGC回路。 - 請求項1記載のAGC回路において、
前記制御部は、前記ハイパスフィルタのカットオフ周波数を高い値から低い値へ切り替える前に前記高周波信号の遮断を終了しないように前記遮断部を制御する機能をさらに有するAGC回路。 - 請求項1記載のAGC回路において、
前記制御部は、前記ハイパスフィルタのカットオフ周波数を制御するためのカットオフ周波数制御信号と、前記遮断部における前記高周波信号の遮断を制御するための遮断制御信号とを、1つのカットオフ周波数切り替え指令に基づいて生成する回路を有するAGC回路。 - 高周波信号をベースバンド信号に変換する検波器と、
前記ベースバンド信号を可変の利得で増幅する増幅回路と、当該増幅回路に結合された可変のカットオフ周波数を持つハイパスフィルタとを有する可変利得増幅器と、
前記可変利得増幅器へ利得制御信号を供給する制御部と、
前記高周波信号を一時的に遮断する遮断部とを備えた無線受信機であって、
前記制御部は、前記ハイパスフィルタのカットオフ周波数を高い値から低い値へ切り替える前に前記高周波信号の遮断を開始するように前記遮断部を制御する機能をさらに有する無線受信機。 - 請求項4記載の無線受信機において、
前記制御部は、前記ハイパスフィルタのカットオフ周波数を高い値から低い値へ切り替える前に前記高周波信号の遮断を終了しないように前記遮断部を制御する機能をさらに有する無線受信機。 - 請求項4記載の無線受信機において、
前記制御部は、前記ハイパスフィルタのカットオフ周波数を制御するためのカットオフ周波数制御信号と、前記遮断部における前記高周波信号の遮断を制御するための遮断制御信号とを、1つのカットオフ周波数切り替え指令に基づいて生成する回路を有する無線受信機。 - 請求項4記載の無線受信機において、
前記高周波信号を増幅して前記検波器へ供給する低雑音増幅器をさらに備え、
前記遮断部は、前記低雑音増幅器と前記検波器との間に介在したスイッチを有する無線受信機。 - 請求項4記載の無線受信機において、
各々受信した高周波信号を増幅する複数の低雑音増幅器と、
前記複数の低雑音増幅器の各々の出力の位相および振幅を調整しつつ合成出力を前記検波器へ供給する移相器とをさらに備え、
前記遮断部は、前記移相器と前記検波器との間に介在したスイッチを有する無線受信機。 - 請求項4記載の無線受信機において、
各々受信した高周波信号を増幅する複数の低雑音増幅器と、
前記複数の低雑音増幅器の各々の出力の位相および振幅を調整しつつ合成出力を前記検波器へ供給する移相器とをさらに備え、
前記遮断部は、前記複数の低雑音増幅器の各々と前記移相器との間に介在した複数のスイッチを有する無線受信機。 - 請求項4記載の無線受信機において、
各々受信した高周波信号を増幅する複数の低雑音増幅器と、
前記複数の低雑音増幅器の各々の出力の位相および振幅を調整しつつ合成出力を前記検波器へ供給する移相器とをさらに備え、
前記遮断部の機能は、前記移相器の利得ゼロ制御により達成される無線受信機。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
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