JP4500187B2 - ダイレクトコンバージョン受信機 - Google Patents
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Description
本発明による複数バンド対応のダイレクトコンバージョン受信機は、周波数バンドの切り替えが発生した際に、ハイパスフィルタにおけるカットオフ周波数の切り替え制御を行うことにより、DCオフセットを速やかに収束させている。このようにして、周波数バンドの切り替えに伴う回路の切り替えによるDCオフセットの変動分を抑制することにより、AGC動作の安定化及び良好な受信性能の確保を実現することができる。
本発明による複数バンド対応のダイレクトコンバージョン受信機は、PLLシンセサイザに用いられるシリアルデータからの情報に基づいて、周波数バンドの切り替えの有無を判断している。そして、周波数バンドの切り替えが発生した場合は、ハイパスフィルタのカットオフ周波数を低い周波数から高い周波数へ切り替える制御を行うことで、複数バンド対応のダイレクトコンバージョン受信機におけるDCオフセットの低減化を実現し、かつ、AGC制御の安定化と高品質な受信特性を得ることができる。
本発明の実施の形態1におけるダイレクトコンバージョン受信機の特徴は、周波数バンドの切り替えが発生した場合に、ハイパスフィルタにおけるカットオフ周波数の切り替えを行うことである。ここで、ダイレクトコンバージョン受信機において、ハイパスフィルタのカットオフ周波数を切り替えることがDCオフセット値を低減させるために有効である理由について図を用いて説明する。
図6は、本発明の実施の形態2における複数バンド対応のダイレクトコンバージョン受信機の構成図である。図6に示す実施の形態2における複数バンド対応のダイレクトコンバージョン受信機は、図3に示す実施の形態1におけるダイレクトコンバージョン受信機の構成に対して、周波数の切り替えが発生したか否かを判定する周波数切り替え判定部33が追加された構成となっている。
2 アンテナ切り替えスイッチ
3a バンド1RF信号
3b バンド2RF信号
4a,4b フィルタ
5a,5b LNA
6a,6b 直交ミキサ
7a,7b 移相器
8a,8b VCO(Voltage Controlled Oscillator:電圧制御発振器)
9a,9b ループフィルタ
10 PLL回路
11 基準クロック
12a,12b Ich信号
13a,13b Qch信号
14a,14b,14c,14d ローパスフィルタ(LPF)
15a,15b,15c,15d,15e,15f 可変利得増幅器
16a,16b,16c,16d ハイパスフィルタ(HPF)
17a,17b オールパスフィルタ(APF)
18a,18b A/Dコンバータ
19 受信電力測定部
20 デコーダ
21 データ判定部
22 ゲイン算出部
23 ゲイン制御部
24 タイミング生成部
25 周波数制御部
26 シリアルインターフェース出力部
27 シリアルインターフェース入力部
28 可変利得増幅器制御部
29 ハイパスフィルタ(HPF)制御部
30 タイマ
31 バンド切り替え制御部
32 遅延回路
33 周波数切り替え判定部
Claims (6)
- 受信した復調信号の信号電力に対してIch/Qchの振幅値をほぼ一定にするためのAGC回路を有し、少なくとも2種類以上の異なる複数の受信周波数帯域を受信可能とする複数バンド対応のダイレクトコンバージョン受信機であって、
前記複数の受信周波数帯域のそれぞれに対応し且つ互いに独立した複数の系統のそれぞれにおいて、外部入力信号により制御対象とする対象周波数帯域の回路の起動及び制御対象としない非対象周波数帯域の回路の停止を行うLNA、直交ミキサ、移相器、及び電圧制御発振器と、
前記複数の受信周波数帯域で共有するローパスフィルタ、ハイパスフィルタ、ベースバンド可変利得増幅器、及びPLL回路と、
前記複数の受信周波数帯域の切り替えが行われる場合に、前記ハイパスフィルタのカットオフ周波数を高/低に切り替え制御を行うハイパスフィルタ制御部と、を備え、
前記ハイパスフィルタは、前記ハイパスフィルタ制御部の指示に基づいてカットオフ周波数を高/低の少なくとも2段階に切り替えることを特徴とする複数バンド対応のダイレクトコンバージョン受信機。 - 前記ハイパスフィルタ制御部は、前記ハイパスフィルタのカットオフ周波数を高くする切り替えを行った後、一定期間が経過した後にそのハイパスフィルタのカットオフ周波数を低くする制御を行うことを特徴とする請求項1に記載のダイレクトコンバージョン受信機。
- さらに、前記LNA、前記直交ミキサ、前記移相器、及び前記電圧制御発振器の周波数バンドの切り替え制御を行うための制御信号を遅延させる遅延回路を備え、
前記ハイパスフィルタにおけるカットオフ周波数の切り替え制御のタイミングは、前記遅延回路の遅延タイミングによって決定されることを特徴とする請求項2に記載のダイレクトコンバージョン受信機。 - 前記ハイパスフィルタにおけるカットオフ周波数の切り替え制御のタイミングは、前記電圧制御発振器の周波数制御を行う前記PLL回路へ周波数データを設定したとき、前回の設定値から周波数の切り替えが行われた場合に前記制御信号を前記遅延回路経由で出力制御することによって決定されることを特徴とする請求項3に記載のダイレクトコンバージョン受信機。
- 前記遅延回路は、前記LNA、前記直交ミキサ、及び前記移相器における周波数バンドの切り替え時の回路起動安定時間以上の遅延時間を発生させることを特徴とする請求項3又は請求項4に記載のダイレクトコンバージョン受信機。
- さらに、周波数切り替えの有無を判定して、周波数が切り替えられたときにカットオフ周波数の切り替えを行う周波数切り替え判定部を備えることを特徴とする請求項1乃至請求項5のいずれかに記載のダイレクトコンバージョン受信機。
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