JP6497331B2 - 制御装置および同期制御方法 - Google Patents
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Description
実施の形態1では、主軸側の遅れ(T1+T2)による同期ずれと、従軸側の遅れ(T3+T4)による同期ずれを別々に補償する。
主軸シフト量[N]=Vm[N]×(T1[N]+T2[N])・・・式1
あるいは、例えば式2に示すように主軸の平均加速度Am[N]を用いて主軸シフト量を算出することができる。
主軸シフト量[N]=Am[N]×(T1[N]+T2[N])2/2・・・式2
ここでは、主軸位置を主軸シフト量だけ進める方向にシフトさせてシフト後主軸位置とする。
従軸指令位置[N]=従軸指令位置[N−1]+G×(シフト後主軸位置[N]−シフト後主軸位置[N−1])・・・式3
このように、シフト後主軸位置を用いることで、制御周期Nにおける主軸側の遅れ(T1+T2)による同期ずれが補償される。
従軸補正量[N]=Vs[N]×(T3[N]+T4[N])・・・式4
あるいは、制御周期Nにおける従軸指令加速度As[N]より算出することができる。
従軸補正量[N]=As[N]×(T3[N]+T4[N])2/2・・・式5
補正後指令位置算出部13は、従軸指令位置を補正量だけ戻して補正後指令位置とし、補正後指令位置を、従軸位置信号生成部14に入力するとともに、補正量と補正後指令位置とを、メモリ17およびユーザ端末40のユーザプログラムに通知する。
実施の形態2では、主軸側の遅れ(T1+T2)による同期ずれと、従軸側の遅れ(T3+T4)による同期ずれをまとめて補償する。
図9(a)に示すように、実施の形態3のモーション制御システム1は、図示しないプロセッサを含むPLC(プログラマブルロジックコントローラ)3と、ターミナル8を含む通信ネットワーク21(例えば、EtherCAT(登録商標))と、主軸であるサーボモータ31mと、これを駆動するサーボドライバ31dと、従軸である3つのサーボモータ32mと、これらを駆動する3つのサーボドライバ32dと、エンコーダ44eとを備える。
3 同期制御装置(PLC)
5 プロセッサ
10 従軸指令位置算出部
11 従軸補正量算出部
13 補正後指令位置算出部
14 従軸位置信号生成部
15 動作開始処理部
16 主軸シフト部
17 メモリ
19 インターフェース
21 通信ネットワーク
31 主軸機構
31m サーボモータ(主軸)
32 従軸機構
32m サーボモータ(従軸)
40 ユーザ端末
110 サーボモータ(従軸)
140 メジャリングロール(主軸)
Claims (12)
- 主軸に従軸を同期させる制御装置であって、
前記主軸の位置情報を用いて従軸の指令位置を算出し、前記従軸に対して前記指令位置を出力する工程において、前記制御装置から前記従軸への前記指令位置の伝送による遅れと従軸の遅れとを前記指令位置の補正によって補償するプロセッサと、
前記補正にかかる補正量と補正後の指令位置を記憶するメモリを備え、
プロセッサの出力が強制終了されたときに、従軸は直近の補正後の指令位置に留まることが可能であり、
前記強制終了の後に出力を再開する場合に、直近の補正後の指令位置を基準として前記補正を行うか、直近の補正前の指令位置を基準として前記補正を行うかの選択が可能である制御装置。 - 前記プロセッサは、前記指令位置と、前記出力の伝送に要する伝送時間と、前記従軸の遅れ時間とを用いて前記補正を行う請求項1記載の制御装置。
- 前記プロセッサは、前記従軸が主軸に同期する動作以外の動作を行うときにメモリに記憶された補正量をゼロに戻す請求項1記載の制御装置。
- 前記プロセッサは、前記指令位置をパラメータとして含む演算式を用いて前記補正を行う請求項2記載の制御装置。
- 従軸位置によって前記従軸の遅れ時間が異なる場合に、前記プロセッサは、従軸の位置情報と補正量との関係を規定するテーブルを参照する請求項1記載の制御装置。
- 前記プロセッサは、従軸の位置情報が前記テーブルに記載されていない場合に直線補間あるいは曲線補間によって前記補正にかかる補正量を算出する請求項5記載の制御装置。
- 前記プロセッサは、前記補正にかかる補正量をユーザプログラムに通知する請求項1記載の制御装置。
- 前記出力は従軸の補正後の指令位置を示す信号であり、
前記プロセッサは、前記指令位置に基づく従軸速度が従軸の最高速度を超える場合に当該最高速度に基づく指令位置とし、前記最高速度では余る移動量を、以降の補正に繰り越す請求項1記載の制御装置。 - 前記最高速度では余る移動量が一定量を超える場合に、前記プロセッサは、従軸を異常としてその動作を停止させる請求項8記載の制御装置。
- 前記主軸および従軸それぞれとプロセッサとがネットワークを介して接続され、
前記プロセッサは、前記主軸の位置情報がネットワークを介してプロセッサに入力されるのに要する時間と、プロセッサが主軸の位置情報を受けてから前記指令位置の出力までに要する時間とによって生じる同期ずれを、主軸の位置の仮想的なシフトによって補償する請求項1記載の制御装置。 - 前記主軸および従軸それぞれとプロセッサとがネットワークを介して接続され、
前記プロセッサは、前記主軸の位置情報がネットワークを介してプロセッサに入力されるのに要する時間と、プロセッサが主軸の位置情報を受けてから前記指令位置の出力までに要する時間と、前記出力がネットワークを介して従軸に入力されるのに要する時間と、前記従軸の遅れ時間とによって生じる同期ずれを、前記指令位置の補正によって補償する請求項2記載の制御装置。 - 主軸の位置情報を用いて従軸の指令位置を算出し、従軸に対して前記指令位置に応じた出力を行うことで、前記主軸に従軸を同期させる同期制御方法であって、
前記従軸への指令位置の出力の伝送および従軸の遅れに起因する同期ずれを、前記指令位置の補正によって補償するファンクションブロックを使用し、
メモリに前記補正にかかる補正量と補正後の指令位置を保存し、
出力が強制終了されたときに、従軸は直近の補正後の指令位置に留まることが可能であり、
前記強制終了の後に出力を再開する場合に、直近の補正後の指令位置を基準として前記補正を行うか、直近の補正前の指令位置を基準として前記補正を行うかを選択する同期制御方法。
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