JP6311003B2 - マルチチップモジュール(mcm)及びそれを作製するための方法並びにシステム - Google Patents

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Description

背景
分野
本開示は、概して、マルチチップモジュール(multi-chip module:MCM)と、MCMを作製するための技術とに関する。より特定的には、本開示は、親水性層および疎水性層を用いることによって基板におけるネガ型特徴に自己埋込みされる(self-populated)ポジ型特徴を含むMCMに関する。
関連技術
技術者らは、近年、3次元(3D:3-dimensional)の半導体チップ積層体を組込むためにマルチチップモジュール(MCM)を用いることを提案してきた。このようなMCMに伴う主要な難題として、チップ同士を互いにアラインさせる点が挙げられる。
チップ同士をアラインさせるための一方策では、(丸い球状体などの)ポジ型特徴を用いて、MCMにおけるチップの対向面上において(ピットなどの)ネガ型特徴のペアを機械的に結合させる。特に、ポジ型特徴は、ペアのネガ型特徴と接合し、これにより、チップ同士を互いにアラインさせて結合させ得る。
しかしながら、ネガ型特徴においてポジ型特徴を位置決めするには費用および時間がかかる可能性がある。たとえば、ピックアンドプレイス・アセンブリ技術を用いて、MCMの作製中にネガ型特徴にポジ型特徴を投入することができるが、この工程は、典型的には進行速度が遅いため、MCMの費用が著しく増大する可能性がある。
したがって、上述の問題を被ることのないMCMおよびその作製技術が必要とされている。
概要
本開示の一実施形態は、第1の表面を有する第1の基板を含むマルチチップモジュール(MCM)を提供する。第1の基板は、第1の表面上に配置された第1のネガ型特徴を含む。所与の第1のネガ型特徴は、第1の表面よりも下方に窪んでおり、第1の端縁によって規定された第1の開口部を有する。第1の基板はさらに、第1のネガ型特徴に配置され、親水性材料を含む第1の層を含む。さらに、MCMは、第1のネガ型特徴における第1の層上に配置され、第1の表面よりも上に突き出ているポジ型特徴と、第1の表面に面する第2の表面を有する第2の基板とを含む。第2の基板は、第2の表面上に配置された第2のネガ型特徴を含む。なお、所与の第2のネガ型特徴が第2の表面よりも下方に窪んでおり、第2の端縁によって規定された第2の開口部を有することに留意されたい。さらに、第2のネガ型特徴は、第1の基板が第2の基板に機械的に結合されるように、ポジ型特徴に結合される。
いくつかの実施形態においては、ポジ型特徴は丸い球状体を含む。さらに、第1のネガ型特徴および第2のネガ型特徴はピットを含み得る。
加えて、第1の層は二酸化ケイ素を含み得る。
さらに、第1の基板は、第1のネガ型特徴を囲む第1の表面の領域に配置された第2の層を含み得る。第2の層は疎水性材料を含む。たとえば、第2の層はシリコーンを含み得る。この第2の層は、1nm未満の厚さを有してもよい。
さらに、第1の基板は、(シリコンなどの)半導体を含んでもよく、側壁角を有してもよい。この側壁角は半導体の対称面に対応し得る。たとえば、第1の基板は、水圧でウエハから割断されてもよい。
別の実施形態は、MCMを含むシステムを提供する。
別の実施形態は、MCMを作製するための方法を提供する。この方法においては、第1のネガ型特徴が第1の基板の第1の表面上に規定される。所与の第1のネガ型特徴は、第1の表面よりも下方に窪んでおり、第1の端縁によって規定された第1の開口部を有する。次いで、第1の層が第1のネガ型特徴に配置される。第1の層は親水性材料を含む。次いで、第2の層が、第1のネガ型特徴を囲む第1の表面の領域における第1の表面上に配置される。第2の層は疎水性材料を含む。さらに、ポジ型特徴は第1のネガ型特徴における第1の層上に配置される。ポジ型特徴は第1の表面よりも上に突き出ている。さらに、第2のネガ型特徴は、第2の基板のうち第1の表面に面する第2の表面上において規定される。所与の第2のネガ型特徴は第2の表面よりも下方に窪んでおり、第2の端縁によって規定された第2の開口部を有する。加えて、第2のネガ型特徴は、第1の基板が第2の基板に機械的に結合されるように、ポジ型特徴に機械的に結合される。
いくつかの実施形態においては、第2のネガ型特徴を機械的にポジ型特徴に結合する前に、第1の基板が、水圧でウエハから割断される。加えて、第2のネガ型特徴を機械的にポジ型特徴に結合する前に、第2の層が除去されてもよい。
本開示の実施形態に従ったマルチチップモジュール(MCM)を示すブロック図である。 本開示の実施形態に従った表面張力の計算を示す図である。 本開示の実施形態に従った、ピットへの球状体の埋込みを示す図である。 本開示の実施形態に従った、ピットへの球状体の埋込みを示す図である。 本開示の実施形態に従った基板の作製を示す図である。 本開示の実施形態に従った、図5における基板の作製を示す図である。 本開示の実施形態に従った、水圧による基板の割断を示す図である。 本開示の実施形態に従ったシステムを示すブロック図である。 本開示の実施形態に従った、MCMを作製するための方法を示すフローチャートである。
同様の参照番号が添付の図面全体にわたって対応する部分を指していることに留意されたい。さらに、同一部品の例が複数ある場合、共通の番号を接頭辞として用いてダッシュを用いて事例番号を付すことによって明示している。
詳細な説明
マルチチップモジュール(MCM)、MCMを含むシステム、およびMCMを作製するための技術についての実施形態を説明する。このMCMは少なくとも2つの基板を含む。少なくとも2つの基板は、当該基板の対向面上におけるポジ型特徴およびネガ型特徴によって機械的に結合され、アラインされる。これらのポジ型特徴およびネガ型特徴は、互いに接合し、互いに自己ロックし得る。ポジ型特徴は、ネガ型特徴における親水性層を用いて、基板のうち少なくとも1つの基板上のネガ型特徴に自己埋込みされてもよい。この親水性層は、基板のうち少なくとも1つの基板の上面上におけるネガ型特徴を囲む疎水性層とともに用いられてもよい。
この機械的結合技術は、大量生産に適合し得る。特に、ポジ型特徴およびネガ型特徴は、半導体プロセス技術を用いて、表面上に作製されてもよい。したがって、MCMのコストを著しく低減させ得る。
ここで、MCMの実施形態を説明する。図1は、MCM100を示すブロック図である。このMCMは、表面112−1を有する基板110と、表面112−1に面する表面112−2を有する基板114とを含む。たとえば、基板110および114はともに、チップであってもよく、または他の構成要素であってもよい。
基板110は、表面112−1上に配置されたネガ型特徴116を含み得る。(ネガ型特徴116−1などの)所与のネガ型特徴は表面112−1よりも下方に窪んでおり、端縁によって規定された開口部を有する。同様に、基板114は、表面112−2上に配置されたネガ型特徴118を含み得る。(ネガ型特徴118−1などの)所与のネガ型特徴は、表面112−2よりも下方に窪んでおり、端縁によって規定された開口部を有する。図1に示されるように、ネガ型特徴116および118はピットを含んでもよい。
さらに、ネガ型特徴116は親水性層120を含んでもよく、表面112−1上においてネガ型特徴116を囲む任意の疎水性層122があってもよい。さらに以下に記載されるように、これらの層により、MCM100の作製中にポジ型特徴124をネガ型特徴116に自己埋込みすることが可能になり得る。(丸い球状体などの)ポジ型特徴124は、部分的に、ネガ型特徴116に含まれてもよい。ポジ型特徴124の残りの部分は、表面112−1よりも上に突き出てもよく、対応するネガ型特徴118と接合してもよい。このようにして、ポジ型特徴124は、基板110と基板114とを(サブミクロンの精度で)機械的にアラインさせて結合させ得る。
具体的な実施形態においては、親水性層120の厚さは10nmであり、任意の疎水性層122の厚さは1nm未満(単分子層など)である。さらに、親水性層120は二酸化ケイ素を含んでもよく、任意の疎水性層122は(ポリジメチルシロキサンまたはPDMSなどの)シリコーンを含んでもよい。
いくつかの実施形態においては、ポジ型特徴124ならびにネガ型特徴116および118は、電源、接地および/または入出力信号を含んでおり、基板110と基板114とを電気的に結合し得る。しかしながら、いくつかの実施形態においては、機械的な結合をもたらすものとは別個の特徴(図示せず)によって電気的な結合が提供される。
基板110と基板114との機械的結合が再接合可能(remateable)であり得ることに留意されたい。たとえば、基板110と基板114との機械的結合は基板110と基板114とを引き離すことによって解除されてもよく、または、基板110と基板114とをともに保持する接着剤を溶解させることによって解除されてもよい。これにより、作製中または以降のテスト中にMCM100を再加工することが可能になり得る。しかしながら、いくつかの実施形態においては、機械的結合は再接合可能ではない。たとえば、ポジ型特徴124は、MCM100の作製および組立て中に、少なくとも部分的にリフローされてもよい。
MCM100における構成要素は、ウェハレベルのバッチ処理と適合し得る。これにより、MCM100を作製して組立てるコストを著しく削減し得る。
具体的な実施形態においては、疎水性パターンおよび親水性パターンを用いることにより、大規模なボール・イン・ピット型の自己埋込み(self-population)を実現し、これにより、MCMにおけるサブミクロンのチップ間アライメントを容易にし得る。球状のアライメント球状体は、(金またはサファイアなどの)非疎水性面または親水性面を有してもよく、(脱イオン化水などの)CMOS相容溶液中に分散させてもよく、対象のウエハ/チップの表面上のエッチピットは、親水性表面状態をもたらすように処理されてもよい。次いで、脱イオン化された球状水溶液(water-ball solution)は、埋込みヘッド(population head)に装填されてもよい。図3および図4を参照してさらに以下に説明されるように、球状体を分散させたいくらかの量の脱イオン化水が、走査技術によって、または滴下ヘッド技術によってピットを通過すると、埋込みがなされていないピットと部分的に重なる球状体が落下し、表面張力によって親水性ピットに捕らえられてもよい。走査ヘッド上および埋込み対象のチップ上における疎水性エリアを用いて、脱イオン化された球状水溶液を所期のピット内に閉じ込めてもよく、さらに、埋込みヘッドの誘導能力および効率を高めて、露出面全体が濡れるのを防いでもよい。加えて、これらの疎水性層は、球状体または微小球が不必要に失われたり散乱したりするのを防止または抑制し得る。埋込みの後、埋込まれていない球状体は、対象のウエハ/チップの疎水性表面上には残存し得ない。図7を参照して以下にさらに説明されるように、紫外線感応性テープが背面に取付けられているボール・イン・ピット埋込み型ウエハが搭載され、(PDMSなどの)シリコーン水圧割断基板を用いて水圧で割断され、これにより、ダイシングなしでチップを個片化(singulation)し得る。
したがって、ボール・イン・ピット自己埋込みは、親水性ピットと疎水性範囲区域とを組合せて達成することができる。この表面張力支援型のボール・イン・ピット埋込み技術(surface-tension-assisted ball-in-pit population technique)は、ウエハスケールまたはチップスケールで用いられてもよく、MCMを作製して組立てるための低コストのソリューションを提供し得る。
埋込まれた球状体をピットから持ち上げるための最小限の平均的力を推定することによって、ピットに球状体を保持するための表面張力が十分に大きいことを確認することができる。具体的には、図2は、親水性ピット内における単一の球状体の例を示す。この場合、少量の水によってピット側壁および球状体を湿らせて、埋込み中に適所に保持する。ピット内に球状体を保持するための表面張力が十分に大きいかどうかを確認するために、ピットから球状体を持ち上げるのに必要とされるであろう最小限の平均的力を計算する。特に、平均的な最小限の力Fは、球状体(Elift)を距離LCFだけ持ち上げるのに必要なエネルギから推定される。すなわち、
Figure 0006311003
ここで、σは脱イオン化水の表面張力であり、SHIJGは球状体の表面積である。Fが球状体に作用する重力Gよりもはるかに大きい場合、表面張力はピット内に球状体を保持するのに十分に大きいものである。球状体材料の接触角が90°と想定されていることに留意されたい。球状体の直径が188μmであり、ピット開口部が216μmである場合、計算された最低揚力は、球状体に対する重力よりも183倍大きいものとなる。表面張力がピット内に球状体を保持するのに十分に大きいものであるので、チップがひっくり返されたとしても、埋込まれた球状体は落下し得ない。この計算は、埋込み後のシナリオに基づくものであって、すなわち、球状体がピットに既に収容されていることに基づいている。埋込み中、球状体は溶液中に分散しているが、これは埋込み後のシナリオと全く異なっており、これら球状体を引き出すほどの表面張力は存在しない。先に述べたように、ボール・イン・ピット埋込みは、対象のピットにわたり脱イオン化水に浸された球状体の埋込みを走査することによって、または、いわゆる「滴下ヘッド」を用いることによって、達成され得る。両方の技術においては、脱イオン化水中に分散させた非疎水性球状体は、それらが埋込まれるであろうピットの上を誘導され得るかまたは移動し得る。
走査技術に関して、図3に示されるように、脱イオン化水中の球状体は走査ヘッドによって誘導されてもよく、ピットの表面または対象のウエハにわたって移動してもよい。この走査ヘッドがピットまたは一連のピットの上を移動すると、埋込みがなされていないピットのいずれの部分であってもそこを横切った球状体は、ピット内の水による表面張力のせいで、親水性ピットによって捕捉または捕獲され得る。さらに、疎水性範囲区域上に位置する球状体は、誘導されている水柱とともに遠ざかっていくので、後には透明な範囲区域が残存し得る。
滴下技術に関して、図4に示されるように、球状体および脱イオン化水を含む滴下ヘッドをピット配列とアラインさせ、次いで、接触するまで下方に移動させて、球状体を親水性ピットに滴下してもよい。代替的には、滴下ヘッドを、まず、ピットウエハの疎水性範囲区域に接触するまで下方に移動させ、次いで、短距離だけ横方向に走査させて、球状体の対応するピットを見つけて、それぞれのピットに球状体を落下させてもよい。この短走査支援型滴下技術により、滴下ヘッドとウエハ上の対象ピットとの間で必要とされるアラインメント精度を緩和させ得る。球状体をそれぞれの対象ピットに落下させた後、(たとえば、少なくとも数10ミクロンまたは数100ミクロンの)ピットから滴下ヘッドを遠ざけ、これにより、ピットに詰め込まれていなかった球状体を、ピットを囲む疎水性範囲区域と接触させるようにする。このようにわずかに横方向に移動させた後、滴下ヘッドをウエハ/チップ表面から持ち上げて、ピットウエハから水柱を分離し得る。これによっても、対象の表面上で球状体が散乱したり、意図せずに球状体が失われたりするというリスクを低減させ得る。したがって、ピット内には存在しない球状体は水柱の表面張力によって保持され、チップから運び去られる可能性がある。
対象のウエハ上におけるパターン疎水性層を用いることに加えて、性能を向上させるために、対象のウエハに面する表面上における(図3の走査ヘッドまたは図4の滴下ヘッドなどの)埋込みヘッド上に疎水性エリアが存在し得ることに留意されたい。この疎水性表面に加えて、埋込みヘッドと対象のウエハとの間の隙間に対して反比例する毛細管力を用いることにより、埋込みヘッド上の開口部のまわりに脱イオン化水を閉じ込めてもよい。隙間を大きくすることによって、毛細管力を小さくすることもでき、これにより、埋込みヘッドのまわりに水を集中させることを可能にし得る。しかしながら、この構成により、結果として、多層の球状体を埋込みヘッドの下に誘導させることとなるかもしれない。これらの球状体の層は互いに干渉し合って、歩留まりを低下させるおそれがある。したがって、ポジ型の底開口部を備えた埋込みヘッドが用いられてもよい。特に、中心隙間d1は、相対的により大きな周囲の隙間d2よりも小さくてもよい。この隙間d2は、ピットの埋込み時に球状体が過剰に湿ったり過剰に積層されたりするのを防ぐために用いられる。たとえば、d2は200μm直径の球状体に対して約500μmであってもよい。さらに、埋込みヘッドは、対象のウエハの表面に対して平行になるように調整されてもよい。これにより、水によって誘導される球状体が均等な毛細管力を受けて埋込まれることを確実にし得る。
疎水性表面修飾はスタンピング工程によって作製されてもよく、任意には、短いドライエッチング工程によって除去されてもよい。スタンピング工程とリソグラフィ工程を組合せることにより、作製された構造をバッチ製造と、これにより低コスト製造とに適したものにすることができるだろう。基板の作製を示す図5および図6に示されるように、作製工程は、疎水性パターン/親水性パターンを備えたピットウエハを作成する工程と、ピットに球状体を埋込む工程とを含み得る。次いで、図7に示されるように、ウエハは、マイクロ流体チャネルを備えたエラストマ基板を用いて、水圧で割断されてもよい。
図5および図6においては、ネガ型フォトレジストは、両面が窒化ケイ素でコーティングされたシリコンウェハ上で回転させられ、フォトリソグラフィを用いてパターン化されて、フォトレジスト開口部をもたらし得る。次いで、窒化物ドライエッチングを用いて、ウェットエッチングハードマスクを作成し得る。ピットアレイおよび割断線は、フォトレジスト剥離およびテトラメチルアンモニウムハイドロオキサイド(tetramethylammonium hydroxide:TMAH)シリコンウェットエッチングによって作り出されてもよい。次いで、二酸化ケイ素プラズマ化学気相成長法または熱酸化によって、ウェットエッチング用の窒化ケイ素ハードマスクが除去されてもよく、(二酸化ケイ素などの)親水性層がウエハの表面上、特にピット内、に形成されてもよい。さらに、疎水性のPDMSオリゴマー層がスタンピング工程によってウエハ範囲区域の表面上へ転写され(これにより、フォトリソグラフィを用いることなく表面に配置され)てもよい。たとえば、水とPDMSオリゴマー層との間の接触角は約90°であってもよい。ピットがネガ型構造であるので、ピット内の親水性表面はスタンピング工程中に影響を受けないかもしれない。この時点で、親水性ピットおよび疎水性範囲区域を備えたウエハのために、表面張力支援型球状体埋込みを行う準備が完了し得る。
球状体埋込み工程が完了すると、疎水性PDMSオリゴマー層が、任意には、短いドライエッチングによって大部分が除去されるかまたは完全に除去される可能性がある。特に、PDMSオリゴマー層の厚さはドライエッチング前は約5nm〜10nmであってもよく、ドライエッチング後には単分子層の厚さ以下であってもよい。PDMSのドライエッチング速度が二酸化ケイ素および(金またはサファイア表面を備えた)球状体のエッチング速度よりもはるかに速いので、短いドライエッチング工程であれば、下層にあるシリコンウェハに対して如何なる副作用ももたらし得ない。ドライエッチング後、水とシリコンウェハの表面との間の接触角は、90°よりもはるかに小さい可能性がある(すなわち、表面はもはや疎水性ではないかもしれない)。したがって、露出したすべてのウエハ範囲区域と、特にボンディングパッド区域とは、後処理のために洗浄され得る。
ウェハレベルで球状体を埋込んだ後、従来のダイシング作業とは逆に、水圧による割断技術を用いてチップを個片化してもよい。これは、水圧による基板の割断を示す図7に示される。特に、割断線としての浅くて長いエッチピットが、チップ間の個片化境界に沿ってウエハの表側に作製されてもよい。次いで、割断線が付けられ球状体が埋込まれたウエハは、マイクロ流体チャネルが埋込まれたエラストマ基板の上においてアラインされ、そこに搭載されてもよい。マイクロ流体チャネル内の水圧が上昇すると、流体チャネルとウエハとの間の変形可能な薄膜が曲がる可能性がある。このたわみにより、割断線の下に均等な割断力が加わり、これにより、ウエハ全体を割断して個々のチップに分離させ得る。ウエハの裏面に取付けられた紫外線感応性テープまたは接着剤を用いて、割断中の衝撃または応力を解放し、水圧による割断後に、チップをそれぞれの元の位置で維持し得る。紫外線感応性テープの裏面を約10分間紫外線に暴露した後、分離したチップをテープから引き剥がすことができる。このようにして、球状体またはポジ型特徴を分断してしまうことなく(すなわち、ネガ型特徴からこれら球状体またはポジ型特徴を叩き落とすことなく)、チップをウエハから個片化することができる。
再び図1を参照して、基板110は、それがウエハから水圧で割断されたことを示す特徴を有してもよい。特に、基板110は(シリコンなどの)半導体を含んでもよく、側壁角126を有してもよい。この側壁角は、半導体の対称面に対応し得る(90°に対して、54.7°など)。加えて、基板110のうち割断線に隣接する表面に沿った粗さは、ダイシング後の表面の粗さ未満であってもよい。
水圧による割断の際に用いられるマイクロ流体チャネルを備えたエラストマ基板は、開口チャネルを備えたPDMS底部分と最上膜とをともに接着することによって作製されてもよい。たとえば、開口チャネルを備えた底部分は、フォトレジストチャネルパターンを有するシリコン基板の上にPDMS部分を成型することによって作製されてもよい。PDMS最上膜は、石鹸水で前処理された別のウエハ上でPDMSをスピンコーティングすることによって得られてもよく、これにより、その後、膜からの剥離が容易になり得る。両方の部分に対して酸素プラズマ処理を行った後、開口チャネルを備えたPDMS底部分がPDMS膜の上に搭載されてもよい。次いで、マイクロ流体チャネルを備えたPDMS基板は、接着された2つの部分をウエハから剥離することによって得られてもよい。
MCMについての上述の実施形態のうち1つ以上はシステムおよび/または電子機器に含まれてもよい。これは、MCM810を含むシステム800を示すブロック図を示す図8に示される。概して、MCMは一連のチップモジュール(CM)またはシングルチップモジュール(SCM)を含んでもよく、所与のSCMは、半導体ダイなどの少なくとも1つの基板を含んでもよい。なお、MCMがしばしば「マクロチップ」と称されることに留意されたい。さらに、基板は、電磁的に結合された信号の近接通信(「電磁近接通信」と称される)を用いてMCMにおける他の基板、CMおよび/またはSCMと通信してもよい。たとえば、近接通信は、容量的に結合された信号の通信(「電気近接通信」)および/または(「光学近接通信」などの)光信号の通信を含み得る。いくつかの実施形態においては、電磁近接通信は、誘導的に結合された信号および/または導電的に結合された信号を含む。
さらに、MCMの実施形態は、VLSI回路、(波長分割多重におけるような)通信システム、記憶領域ネットワーク、データセンタ、(ローカルエリアネットワークなどの)ネットワーク、および/または、(マルチコアプロセッサコンピュータシステムなどの)コンピュータシステムを含むさまざまな応用例において用いられてもよい。たとえば、MCMは、マルチプロセッサブレードに結合されるバックプレーンに含まれてもよく、または、MCMは、(プロセッサ、メモリ、I/Oデバイスおよび/もしくは周辺機器などの)さまざまなタイプの構成要素を結合してもよい。いくつかの実施形態においては、MCMは、スイッチ、ハブ、ブリッジおよび/またはルータの機能を実行する。
なお、システム800が、サーバ、ラップトップコンピュータ、通信装置もしくはシステム、パソコン、タブレット、携帯電話、ワークステーション、メインフレームコンピュータ、ブレード、エンタープライズコンピュータ、データセンタ、携帯型計算装置、スーパーコンピュータ、ネットワーク接続ストレージ(network-attached-storage:NAS)システム、ストレージエリアネットワーク(storage-area-network:SAN)システム、および/または、別の電子計算装置を含み得るが、これらに限定されないことに留意されたい。さらに、所与のコンピュータシステムが一箇所にあり得ること、または、複数の地理的に分散した位置にわたって分布され得ることに留意されたい。
上述の実施形態におけるMCMは、より少数の構成要素または付加的な構成要素を含んでもよい。たとえば、図1におけるネガ型特徴116は、表面112−1上に堆積させた層において規定されてもよく、これらのネガ型特徴は、基板110上に堆積させた最上層の表面よりも下方に窪んでいてもよい。同様に、図1におけるポジ型特徴124は、(表面112−1または基板110上に堆積させた最上層の表面であり得る)局所的な表面よりも上に突き出てもよい。このため、上述の実施形態においては、基板の表面は、基板上に堆積させた層の表面または基板自体の表面を含むものと理解されるはずである。
さらに、これらの実施形態は、いくつかの別個の要素を有するものとして示されているが、これらのMCMおよびシステムは、この明細書中に記載される実施形態の構造的な概略図ではなく、存在し得るさまざまな特徴の機能的記述として意図されている。結果として、これらの実施形態においては、2つ以上の構成要素が単一の構成要素に組合わされてもよく、および/または、1つ以上の構成要素の位置が変更されてもよい。
なお、図1におけるポジ型特徴124ならびに/または図1におけるネガ型特徴116および118が、アディティブ法(すなわち材料堆積)および/またはサブトラクティブ法(すなわち材料除去)を用いて規定され得ることに留意されたい。たとえば、当該工程は、スパッタリング、等方性エッチング、異方性エッチング、フォトリソグラフィ技術、および/または、直接書込み技術を含み得る。加えて、これらの特徴は、半導体、金属、ガラス、サファイアおよび/または二酸化ケイ素を含む多種多様な材料を用いて作製されてもよい。
ここで、方法の実施形態を説明する。図9は、MCM100(図1)などのMCMを作製するための方法900を例示するフローチャートを示す。この方法において、第1のネガ型特徴が第1の基板の第1の表面上において規定される(動作910)。この場合、所与の第1のネガ型特徴は、第1の表面よりも下方に窪んでおり、第1の端縁によって規定された第1の開口部を有する。次いで、第1の層が第1のネガ型特徴に配置される。第1の層は親水性材料を含む(動作912)。次いで、第2の層が、第1のネガ型特徴を囲む第1の表面の領域における第1の表面上に配置される。第2の層は疎水性材料を含む(動作914)。さらに、ポジ型特徴が第1のネガ型特徴における第1の層上に配置される(動作916)。ポジ型特徴は第1の表面よりも上に突き出ている。さらに、第2のネガ型特徴が、第2の基板のうち第1の表面に面する第2の表面上において規定される(動作918)。この場合、所与の第2のネガ型特徴は、第2の表面よりも下方に窪んでおり、第2の端縁によって規定された第2の開口部を有する。加えて、第2のネガ型特徴は、第1の基板が第2の基板に機械的に結合されるように、ポジ型特徴に機械的に結合される(動作924)。
いくつかの実施形態においては、第2のネガ型特徴を機械的にポジ型特徴に結合する(動作924)前に、任意には、第2の層が除去されてもよい(動作920)。加えて、第2のネガ型特徴を機械的にポジ型特徴に結合する(動作924)前に、任意には、第1の基板が水圧でウエハから割断されてもよい(動作922)。
工程900のいくつかの実施形態においては、付加的な動作またはより少数の動作が行なわれる。さらに、動作の順序は変更されてもよく、および/または、2つ以上の動作が1回の動作に組合わされてもよい。
上述の説明は、如何なる当業者でも本開示を活用できるように意図されており、特定の用途およびその要件の文脈において提供される。さらに、本開示の実施形態の上述の記載は図示および説明だけを目的として提示されたものであり、これらは、網羅的になるよう意図されたものではなく、または、本開示を開示された形態に限定するよう意図されたものでもない。したがって、多くの変更例および変形例が当業者にとって明らかになるだろう。また、この明細書中において規定される一般原則は、本開示の精神および範囲から逸脱することなく他の実施形態および応用例に適用され得る。加えて、上述の実施形態の説明は、本開示を限定するよう意図されたものではない。このように、本開示は、図示される実施形態に限定されるよう意図されたものではないが、この明細書中に開示される原則および特徴と一致する最も広い範囲が与えられることとなる。

Claims (12)

  1. マルチチップモジュール(MCM)であって、
    第1の表面を有する第1の基板を備え、前記第1の基板は、
    前記第1の表面上に配置された第1のネガ型特徴を含み、所与の第1のネガ型特徴は、前記第1の表面よりも下方に窪んでいるとともに、第1の端縁によって規定された第1の開口部を有し、
    前記第1のネガ型特徴に配置された第1の層を含み、前記第1の層は親水性材料を含み、
    前記第1のネガ型特徴を囲む前記第1の表面のある領域に配置された第2の層を含み、前記第2の層は疎水性材料を含み、
    前記第1のネガ型特徴における前記第1の層上に配置されたポジ型特徴を備え、前記ポジ型特徴は、前記第1の表面よりも上に突き出ており、
    前記第1の表面に面する第2の表面を有する第2の基板を備え、前記第2の基板は、第2の表面上に配置された第2のネガ型特徴を含み、所与の第2のネガ型特徴は、第2の表面よりも下方に窪んでいるとともに、第2の端縁によって規定された第2の開口部を有し、
    前記第2のネガ型特徴は、前記第1の基板が前記第2の基板に機械的に結合されるように、前記ポジ型特徴に結合される、MCM。
  2. 前記ポジ型特徴は、丸い球状体を含む、請求項1に記載のMCM。
  3. 前記第1のネガ型特徴および前記第2のネガ型特徴は、ピットを含む、請求項1または2に記載のMCM。
  4. 前記第2の層は、1nm未満の厚さを有する、請求項に記載のMCM。
  5. 前記第2の層は、シリコーンを含む、請求項1から4のいずれか1項に記載のMCM。
  6. マルチチップモジュール(MCM)であって、
    第1の表面を有する第1の基板を備え、前記第1の基板は、
    前記第1の表面上に配置された第1のネガ型特徴を含み、所与の第1のネガ型特徴は、前記第1の表面よりも下方に窪んでいるとともに、第1の端縁によって規定された第1の開口部を有し、
    前記第1のネガ型特徴に配置された第1の層を含み、前記第1の層は親水性材料を含み、
    前記第1のネガ型特徴における前記第1の層上に配置されたポジ型特徴を備え、前記ポジ型特徴は、前記第1の表面よりも上に突き出ており、
    前記第1の表面に面する第2の表面を有する第2の基板を備え、前記第2の基板は、第2の表面上に配置された第2のネガ型特徴を含み、所与の第2のネガ型特徴は、第2の表面よりも下方に窪んでいるとともに、第2の端縁によって規定された第2の開口部を有し、
    前記第2のネガ型特徴は、前記第1の基板が前記第2の基板に機械的に結合されるように、前記ポジ型特徴に結合され、前記第1の層は、二酸化ケイ素を含む、MCM。
  7. 前記第1の基板は、半導体を含むとともに、側壁角を有し、
    前記第1の基板の前記側壁角は、前記半導体の対称面に対応する、請求項1〜のいずれか1項に記載のMCM。
  8. システムであって、
    プロセッサと、
    前記プロセッサによって実行されるように構成されたプログラムモジュールを格納するメモリと、
    MCMとを備え、前記MCMは、
    第1の表面を有する第1の基板を含み、前記第1の基板は、
    前記第1の表面上に配置された第1のネガ型特徴を含み、所与の第1のネガ型特徴は、前記第1の表面よりも下方に窪んでおり、第1の端縁によって規定された第1の開口部を有し、
    前記第1のネガ型特徴に配置された第1の層を含み、前記第1の層は親水性材料を含み、
    前記第1のネガ型特徴を囲む前記第1の表面のある領域に配置された第2の層を含み、前記第2の層は疎水性材料を含み、
    前記第1のネガ型特徴における前記第1の層上に配置されたポジ型特徴を備え、前記ポジ型特徴は、前記第1の表面よりも上に突き出ており、
    前記第1の表面に面する第2の表面を有する第2の基板を含み、前記第2の基板は、第2の表面上に配置された第2のネガ型特徴を含み、所与の第2のネガ型特徴は、第2の表面よりも下方に窪んでいるとともに、第2の端縁によって規定された第2の開口部を有し、
    前記第2のネガ型特徴は、前記第1の基板が前記第2の基板に機械的に結合されるように、前記ポジ型特徴に結合される、システム。
  9. MCMを作製するための方法であって、
    第1の基板の第1の表面上に第1のネガ型特徴を規定するステップを備え、所与の第1のネガ型特徴は、前記第1の表面よりも下方に窪んでいるとともに、第1の端縁によって規定された第1の開口部を有し、
    前記第1のネガ型特徴に第1の層を配置するステップを備え、前記第1の層は親水性材料を含み、
    第1のネガ型特徴を囲む第1の表面のある領域に第2の層を配置するステップを備え、前記第1の層は疎水性材料を含み、
    第1のネガ型特徴における前記第1の層上にポジ型特徴を配置するステップを備え、前記ポジ型特徴は、前記第1の表面よりも上に突き出ており、
    第2の基板の前記第1の表面に面する第2の表面上に第2のネガ型特徴を規定するステップを備え、所与の第2のネガ型特徴は、前記第2の表面よりも下方に窪んでいるとともに、第2の端縁によって規定された第2の開口部を有し、
    前記第1の基板が前記第2の基板に機械的に結合されるように、前記第2のネガ型特徴を機械的に前記ポジ型特徴に結合するステップを含む、方法。
  10. 前記第2のネガ型特徴を機械的に前記ポジ型特徴に結合する前に、前記方法は、前記第1の基板をウエハから水圧で割断するステップをさらに備える、請求項に記載の方法。
  11. 前記第2のネガ型特徴を機械的に前記ポジ型特徴に結合する前に、前記方法は、前記第2の層を除去するステップをさらに備える、請求項または10に記載の方法。
  12. 前記ポジ型特徴は丸い球状体を含み、前記第1のネガ型特徴および前記第2のネガ型特徴はピットを含む、請求項11のいずれか1項に記載の方法。
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS57126139A (en) * 1981-01-27 1982-08-05 Nec Home Electronics Ltd Manufacture of semiconductor device
US5006201A (en) * 1989-11-22 1991-04-09 Eastman Kodak Company Method of making a fiber optic array
US5681634A (en) * 1995-02-15 1997-10-28 Matsushita Electric Industrial Co., Ltd. Optical information medium, and method and apparatus for fabricating the same
US6114221A (en) * 1998-03-16 2000-09-05 International Business Machines Corporation Method and apparatus for interconnecting multiple circuit chips
US6965166B2 (en) 1999-02-24 2005-11-15 Rohm Co., Ltd. Semiconductor device of chip-on-chip structure
US6645432B1 (en) * 2000-05-25 2003-11-11 President & Fellows Of Harvard College Microfluidic systems including three-dimensionally arrayed channel networks
US7086134B2 (en) * 2000-08-07 2006-08-08 Shipley Company, L.L.C. Alignment apparatus and method for aligning stacked devices
US20020196440A1 (en) * 2000-12-14 2002-12-26 Steinberg Dan A. Structure for aligning chips in stacked arrangement
KR100662491B1 (ko) * 2000-12-27 2007-01-02 엘지.필립스 엘시디 주식회사 면발광 램프 및 그 제조방법
US6974604B2 (en) 2001-09-28 2005-12-13 Hrl Laboratories, Llc Method of self-latching for adhesion during self-assembly of electronic or optical components
US7870788B2 (en) * 2002-01-25 2011-01-18 Kinemetrics, Inc. Fabrication process and package design for use in a micro-machined seismometer or other device
KR100383383B1 (en) * 2002-06-22 2003-05-16 Fionix Inc Method for fabricating optical fiber block
US6874950B2 (en) * 2002-12-17 2005-04-05 International Business Machines Corporation Devices and methods for side-coupling optical fibers to optoelectronic components
US8426720B2 (en) * 2004-01-09 2013-04-23 Industrial Technology Research Institute Micro thermoelectric device and manufacturing method thereof
FR2878843B1 (fr) * 2004-12-02 2007-07-20 Saint Gobain Substrat protege contre les pollutions organiques
US7592707B2 (en) 2005-10-03 2009-09-22 Sun Microsystems, Inc. Method and apparatus for facilitating proximity communication and power delivery
JP4640643B2 (ja) * 2005-11-08 2011-03-02 日本電気硝子株式会社 光ファイバアレイ用基板及びその製造方法
CN100541784C (zh) * 2005-11-10 2009-09-16 沈育浓 堆叠式半导体芯片封装体
US7550846B2 (en) 2005-12-21 2009-06-23 Palo Alto Research Center Conductive bump with a plurality of contact elements
KR100723532B1 (ko) * 2006-06-19 2007-05-30 삼성전자주식회사 도전성 범프 형성용 몰드, 그 몰드 제조방법, 및 그몰드를 이용한 웨이퍼에 범프 형성방법
US8456392B2 (en) * 2007-05-31 2013-06-04 Nthdegree Technologies Worldwide Inc Method of manufacturing a light emitting, photovoltaic or other electronic apparatus and system
US8076178B2 (en) 2007-09-28 2011-12-13 Oracle America, Inc. Self-assembly of micro-structures
US7893531B2 (en) * 2007-09-28 2011-02-22 Oracle America, Inc. Integrated-circuit package for proximity communication
US7651021B2 (en) 2007-12-28 2010-01-26 Intel Corporation Microball attachment using self-assembly for substrate bumping
JP2009175504A (ja) * 2008-01-25 2009-08-06 Fujifilm Corp 光ファイバ構造体
JP2011044496A (ja) 2009-08-19 2011-03-03 Panasonic Corp 半導体デバイス及びそれを用いた半導体装置
WO2011026136A1 (en) * 2009-08-31 2011-03-03 Life Technologies Corporation Low-volume sequencing system and method of use
US8487429B2 (en) * 2009-09-22 2013-07-16 Oracle America, Inc. Assembly of multi-chip modules using sacrificial features
US8188581B2 (en) * 2009-09-28 2012-05-29 Oracle America, Inc. Mechanical coupling in a multi-chip module using magnetic components
US8218334B2 (en) * 2010-03-09 2012-07-10 Oracle America, Inc. Multi-chip module with multi-level interposer
US8648463B2 (en) * 2010-05-17 2014-02-11 Oracle International Corporation Assembly of multi-chip modules with proximity connectors using reflowable features
US8564137B2 (en) * 2010-11-05 2013-10-22 Stmicroelectronics, Inc. System for relieving stress and improving heat management in a 3D chip stack having an array of inter-stack connections
US8659161B2 (en) * 2011-06-21 2014-02-25 Oracle International Corporation Chip package with reinforced positive alignment features

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