JP6192469B2 - 撮像装置 - Google Patents
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Description
また、本発明は、第1の基板と、前記第1の基板と重なるように配置された第2の基板と、前記第1の基板上に行列状に配置された複数の画素を有する画素部と、前記第1の基板及び前記第2の基板のいずれか一方に配置され、前記複数の画素の1行毎又は複数行毎に供給される制御信号を出力する第1の垂直走査回路と、前記画素部と重なるように前記第2の基板に配置され、前記複数の画素の1行又は複数行に対応して設けられた第1のバッファであって、前記第1の垂直走査回路から出力された前記制御信号を伝送する信号線に接続された複数の第1のバッファと、を有し、前記第1の基板及び前記第2の基板のいずれか一方に配置され、前記複数の画素の1行毎又は複数行毎に供給される前記制御信号を前記第1の垂直走査回路と同期して出力する第2の垂直走査回路、を更に有し、前記複数の画素は、同一の行に配置された第1の画素及び第2の画素を含み、前記第1の画素には、前記第1の垂直走査回路から出力された前記制御信号が供給され、前記第2の画素には、前記第2の垂直走査回路から出力された前記制御信号が供給されることを特徴とする撮像装置である。
また、本発明は、第1の基板と、前記第1の基板と重なるように配置された第2の基板と、前記第1の基板上に行列状に配置された複数の画素を有する画素部と、前記第1の基板及び前記第2の基板のいずれか一方に配置され、前記複数の画素の1行毎又は複数行毎に供給される制御信号を出力する第1の垂直走査回路と、前記画素部と重なるように前記第2の基板に配置され、前記複数の画素の1行又は複数行に対応して設けられた第1のバッファであって、前記第1の垂直走査回路から出力された前記制御信号を伝送する信号線に接続された複数の第1のバッファと、を有し、前記複数の画素は、同一の行に配置された第3の画素及び第4の画素を含み、前記第3の画素には、前記第1の垂直走査回路から出力された前記制御信号が、前記信号線から前記第1のバッファを介さずに供給され、前記第4の画素には、前記第1の垂直走査回路から出力された前記制御信号が、前記信号線に接続された前記第1のバッファを介して供給されることを特徴とする撮像装置である。
まず、本発明の第1の実施形態を説明する。図1は、本実施形態による撮像装置1aの構成を示している。撮像装置1aは、第1の基板20及び第2の基板21の2枚の基板を有する。図1では第1の基板20と第2の基板21とが横に並んでいるが、実際には第1の基板20及び第2の基板21は両者が互いに重なるように配置されている。言い換えると、第1の基板20及び第2の基板21は、それぞれ2つの面を有しており、第1の基板20の一方の面と第2の基板21の一方の面とが対向するように配置されている。また、第1の基板20及び第2の基板21は、電気的に接続されている。
次に、本発明の第2の実施形態を説明する。本実施形態による撮像装置は、図1における第2の基板21を、図12に示す第2の基板22で置換して構成される。図12は、第2の基板22の構成を示している。図12に示す第2の基板22において、図1における第2の基板21と異なる点は、第2の基板22の第1の垂直走査回路10aと画素直下領域11との間に複数の第2のバッファ131が配置されている点である。
次に、本発明の第3の実施形態を説明する。本実施形態による撮像装置は、図1における第2の基板21を、図13に示す第2の基板23で置換して構成される。図13は、第2の基板23の構成を示している。図13に示す第2の基板23において、図12における第2の基板22と異なる点は、第2のバッファ131の代わりに第2のバッファ132が配置されていることである。
次に、本発明の第4の実施形態を説明する。本実施形態による撮像装置は、図1における第2の基板21を、図14に示す第2の基板24で置換して構成される。図14は、第2の基板24の構成を示している。図14に示す第2の基板24において、図12における第2の基板22と異なる点は、第2の垂直走査回路10bが配置されていると共に、画素直下領域11に複数の第1のバッファ130a,130b、複数の第2のバッファ132a,132bが配置されていることである。
次に、本発明の第5の実施形態を説明する。本実施形態による撮像装置は、図1における第2の基板21を、図15に示す第2の基板25で置換して構成される。図15は、第2の基板25の構成を示している。図15に示す第2の基板25において、図1における第2の基板21と異なる点は、画素直下領域11に第1の垂直走査回路10c、複数の第1のバッファ130a,130bが配置されている点である。
次に、本発明の第6の実施形態を説明する。本実施形態による撮像装置は、図1における画素直下領域11の構成を、図16に示す画素直下領域11の構成で置換して構成される。図16は、画素直下領域11の構成を示している。画素直下領域11は、複数の画素制御信号線12及び複数の第1のバッファ130を有する。
次に、本発明の第7の実施形態を説明する。図17は、本実施形態による撮像装置1bの構成を示している。撮像装置1bは、第1の基板20、第2の基板26、第3の基板27の3枚の基板を有する。図17では第1の基板20、第2の基板26、第3の基板27が横に並んでいるが、実際にはそれぞれの基板が互いに重なるように配置されている。
Claims (8)
- 第1の基板と、
前記第1の基板と重なるように配置された第2の基板と、
前記第1の基板上に行列状に配置された複数の画素を有する画素部と、
前記第1の基板及び前記第2の基板のいずれか一方に配置され、前記複数の画素の1行毎又は複数行毎に供給される制御信号を出力する第1の垂直走査回路と、
前記画素部と重なるように前記第2の基板に配置され、前記複数の画素の1行又は複数行に対応して設けられた第1のバッファであって、前記第1の垂直走査回路から出力された前記制御信号を伝送する信号線に接続された複数の第1のバッファと、
を有し、
前記第2の基板に配置され、前記複数の画素の1行又は複数行に対応して設けられた第2のバッファであって、前記第1のバッファが接続された前記信号線に接続された複数の第2のバッファを更に有する
撮像装置。 - 前記複数の第2のバッファは、前記画素部と重なるように配置されている、
請求項1に係る撮像装置。 - 前記第1の基板及び前記第2の基板のいずれか一方に配置され、前記複数の画素の1行毎又は複数行毎に供給される前記制御信号を前記第1の垂直走査回路と同期して出力する第2の垂直走査回路、
を更に有し、
前記複数の画素は、同一の行に配置された第1の画素及び第2の画素を含み、
前記第1の画素には、前記第1の垂直走査回路から出力された前記制御信号が供給され、
前記第2の画素には、前記第2の垂直走査回路から出力された前記制御信号が供給される、
請求項1〜請求項2のいずれか一項に係る撮像装置。 - 第1の基板と、
前記第1の基板と重なるように配置された第2の基板と、
前記第1の基板上に行列状に配置された複数の画素を有する画素部と、
前記第1の基板及び前記第2の基板のいずれか一方に配置され、前記複数の画素の1行毎又は複数行毎に供給される制御信号を出力する第1の垂直走査回路と、
前記画素部と重なるように前記第2の基板に配置され、前記複数の画素の1行又は複数行に対応して設けられた第1のバッファであって、前記第1の垂直走査回路から出力された前記制御信号を伝送する信号線に接続された複数の第1のバッファと、
を有し、
前記第1の基板及び前記第2の基板のいずれか一方に配置され、前記複数の画素の1行毎又は複数行毎に供給される前記制御信号を前記第1の垂直走査回路と同期して出力する第2の垂直走査回路、
を更に有し、
前記複数の画素は、同一の行に配置された第1の画素及び第2の画素を含み、
前記第1の画素には、前記第1の垂直走査回路から出力された前記制御信号が供給され、
前記第2の画素には、前記第2の垂直走査回路から出力された前記制御信号が供給される
ことを特徴とする撮像装置。 - 第1の基板と、
前記第1の基板と重なるように配置された第2の基板と、
前記第1の基板上に行列状に配置された複数の画素を有する画素部と、
前記第1の基板及び前記第2の基板のいずれか一方に配置され、前記複数の画素の1行毎又は複数行毎に供給される制御信号を出力する第1の垂直走査回路と、
前記画素部と重なるように前記第2の基板に配置され、前記複数の画素の1行又は複数行に対応して設けられた第1のバッファであって、前記第1の垂直走査回路から出力された前記制御信号を伝送する信号線に接続された複数の第1のバッファと、
を有し、
前記複数の画素は、同一の行に配置された第3の画素及び第4の画素を含み、
前記第3の画素には、前記第1の垂直走査回路から出力された前記制御信号が、前記信号線から前記第1のバッファを介さずに供給され、
前記第4の画素には、前記第1の垂直走査回路から出力された前記制御信号が、前記信号線に接続された前記第1のバッファを介して供給される
ことを特徴とする撮像装置。 - 前記第1の垂直走査回路は、前記画素部と少なくとも一部が重なるように配置されている、
請求項5に係る撮像装置。 - 前記複数の第1のバッファのうち、互いに隣接する2つの行に配置された2つの第1のバッファは、行方向にずれるように配置されている、
請求項1に係る撮像装置。 - 第1の基板と、
第2の基板と、
第3の基板と、
前記第1の基板上に行列状に配置された複数の画素を有する画素部と、
前記第3の基板に配置され、前記複数の画素の1行毎又は複数行毎に供給される制御信号を出力する第1の垂直走査回路と、
前記画素部と重なるように前記第2の基板に配置され、前記複数の画素の1行又は複数行に対応して設けられた第1のバッファであって、前記第1の垂直走査回路から出力された前記制御信号を伝送する信号線に接続された複数の第1のバッファと、
を有し、
前記第1の基板と前記第2の基板とが重なり、且つ、前記第3の基板が、前記第1の基板と対向する前記第2の基板の面とは反対側の面と重なり、
又は、前記第1の基板と前記第3の基板とが重なり、且つ、前記第2の基板が、前記第1の基板と対向する前記第3の基板の面とは反対側の面と重なり、
前記複数の画素は、同一の行に配置された第3の画素及び第4の画素を含み、
前記第3の画素には、前記第1の垂直走査回路から出力された前記制御信号が、前記信号線から前記第1のバッファを介さずに供給され、
前記第4の画素には、前記第1の垂直走査回路から出力された前記制御信号が、前記信号線に接続された前記第1のバッファを介して供給される
ことを特徴とする撮像装置。
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