JP6089597B2 - 画像形成装置およびその制御方法 - Google Patents
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Description
L0:通常状態
L0s:ASPMによる省電力状態(浅い)
L1:ASPMによる省電力状態(やや深い)
Rcv:L1→L0に復帰する際に、復帰用の準備を行うステート(リカバリーステート)
T1:省エネステートからの復帰時間
T2:データ転送時間
T3:省エネステートへの遷移が開始されるまでの時間
T4:lsync周期
11,12,14,21…ASIC
13,22…CPU
15…スキャナ
16…プロッタ
20…CTLボード
23…メモリ
30…PCIe Rootモジュール
31…PCIE論理層回路
32…Configレジスタ制御部
33…データ転送制御部
34…lsync信号生成部
35…主走査カウンタ
36…レジスタ制御部
38…End Pointモジュール
40…ASPM制御部
42…ASPM使用可否判断部
43…ライン利用率閾値設定部
44…ライン利用率計測部
46…データ転送期間カウンタ
50…PCIe Rootモジュール
51…PCIE論理層回路
52…Configレジスタ制御部
53…データ転送制御部
54…レジスタ制御部
55…主走査カウンタ
56…プリンタデータ転送用モジュール
57…アービタ
58…メモリコントローラ
60…ASPM制御部
62…ASPM使用可否判断部
63…ライン利用率閾値設定部
64…ライン利用率計測部
66…データ転送期間カウンタ
Claims (9)
- シリアルバスで接続された複数のデバイスを画像処理部に備える画像形成装置であって、
前記デバイスは、
データ転送時のライン利用率を計測するためのライン利用率計測部と、
前記シリアルバスの節電に係る電力管理機能の使用の可否を制御する電力管理機能使用可否判断部とを含み、
前記電力管理機能使用可否判断部は、
前記ライン利用率が下記式(1)によって定義されるライン利用率閾値より小さい場合にのみ前記電力管理機能をイネーブルに制御する、
画像形成装置。
(上記式(1)において、遷移準備時間は、通常状態から省電力状態への遷移が開始されるまでの時間を示し、復帰時間は、省電力状態から通常状態に復帰するまでの時間を示す。) - 前記復帰時間の値は、接続される2つのデバイスに固有の2つの復帰時間のうち、より大きい値である、請求項1に記載の画像形成装置。
- シリアルバスで接続された複数のデバイスを画像処理部に備える画像形成装置であって、
前記デバイスは、
データ転送時のライン利用率を計測するためのライン利用率計測部と、
前記シリアルバスの節電に係る電力管理機能の使用の可否を制御する電力管理機能使用可否判断部とを含み、
前記ライン利用率計測部は、
1ライン目のライン利用率を下記式(2)に基づいて計測し、
前記電力管理機能使用可否判断部は、
前記ライン利用率が所定のライン利用率閾値より小さい場合にのみ前記電力管理機能をイネーブルに制御する、
画像形成装置。 - 前記シリアルバスは、PCI Expressである、請求項1〜3のいずれか一項に記載の画像形成装置。
- シリアルバスで接続された複数のデバイスを画像処理部に備える画像形成装置であって、
前記デバイスは、
データ転送時のライン利用率を計測するためのライン利用率計測部と、
前記シリアルバスの節電に係る電力管理機能の使用の可否を制御する電力管理機能使用可否判断部とを含み、
前記電力管理機能使用可否判断部は、
スキャナデータ転送とプリンタデータ転送が同時的に実行される期間またはフルカラーのプリンタデータ転送のみが実行される期間は、前記電力管理機能をディスエーブルに制御し、
上流のデバイスからのスキャナデータ転送のみが実行される期間においては、該上流のデバイスにおける電力管理機能に係る制御内容を踏襲して前記電力管理機能を制御し、
モノクロまたは2色のプリンタデータ転送のみが実行される期間においては、前記ライン利用率が所定のライン利用率閾値より小さい場合にのみ前記電力管理機能をイネーブルに制御する、
画像形成装置。 - 前記シリアルバスは、PCI Expressである、請求項5に記載の画像形成装置。
- 前記ライン利用率閾値は、下記式(3)によって定義される、請求項5または6に記載の画像形成装置。
(上記式(3)において、遷移準備時間は、通常状態から省電力状態への遷移が開始されるまでの時間を示し、復帰時間は、省電力状態から通常状態に復帰するまでの時間を示し、(ドラム間ピッチ % lsync周期)は、ドラム間ピッチをlsync周期で除算した際の剰余に相当する時間を示す。) - 前記復帰時間の値は、接続される2つのデバイスに固有の2つの復帰時間のうち、より大きい値である、請求項7に記載の画像形成装置。
- 前記ライン利用率計測部は、1ライン目のライン利用率を下記式(4)に基づいて計測する、請求項6〜8のいずれか一項に記載の画像形成装置。
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JP2012241536A JP6089597B2 (ja) | 2011-11-04 | 2012-11-01 | 画像形成装置およびその制御方法 |
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JP2011241915 | 2011-11-04 | ||
JP2011241915 | 2011-11-04 | ||
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JP2013118630A JP2013118630A (ja) | 2013-06-13 |
JP6089597B2 true JP6089597B2 (ja) | 2017-03-08 |
Family
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Family Applications (1)
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JP2012241536A Active JP6089597B2 (ja) | 2011-11-04 | 2012-11-01 | 画像形成装置およびその制御方法 |
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Country | Link |
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JP2023112427A (ja) | 2022-02-01 | 2023-08-14 | キオクシア株式会社 | メモリシステム |
Family Cites Families (3)
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JP5182513B2 (ja) * | 2007-12-27 | 2013-04-17 | 株式会社リコー | 画像処理装置及びその省電力制御方法 |
JP5734034B2 (ja) * | 2011-03-10 | 2015-06-10 | キヤノン株式会社 | 情報処理装置、情報処理装置の制御方法、およびプログラム |
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2012
- 2012-11-01 JP JP2012241536A patent/JP6089597B2/ja active Active
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