JP5621909B2 - 情報処理装置、ストレージシステムおよび書き込み制御方法 - Google Patents
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Description
また、上記のストレージシステムによれば、第1の記憶装置および第2の記憶装置にそれぞれ格納するデータ量の削減効果と、第1の記憶装置へのデータ格納処理に要する時間の短縮効果とを両立させることができる。
〔第1の実施の形態〕
図1は、第1の実施の形態に係る情報処理装置の構成例を示す図である。
なお、書き込み制御部14は、例えば、次のような処理を行ってもよい。上記の第1の処理と第2の処理とを並列に実行させるとともに、第1の処理と第2の処理のどちらが先に終了するかを監視する。そして、書き込み制御部14は、第1の処理と第2の処理のうちの一方の処理が終了したことを検出したときに、実行が終了した処理によって記憶装置11に書き込まれたデータを有効な書き込みデータとしてもよい。
〔第2の実施の形態〕
図2は、第2の実施の形態に係るストレージシステムの全体構成例を示す図である。
チャネルプロセッサ300は、例えば、図3に示すようなコンピュータとして実現される。チャネルプロセッサ300は、CPU301によって装置全体が制御されている。CPU301には、バス308を介して、RAM(Random Access Memory)302および複数の周辺機器が接続されている。
次に、チャネルプロセッサ300がディスクアレイ装置110に対してデータを書き込む処理について説明する。
図4において、「受信処理」とは、ホスト装置500から送信されたデータブロックをチャネルプロセッサ300が受信し、受信したデータブロックがチャネルプロセッサ300内のRAM302に格納される処理を示す。また、「圧縮処理」とは、RAM302に格納されたデータブロックをCPU301が読み出して圧縮し、圧縮により得られた圧縮データがRAM302に格納される処理を示す。また、「書き込み処理」とは、RAM302に格納されたデータブロックまたは圧縮データが、ディスクアレイ装置110に送信されて格納される処理を示す。
図5において、データブロックD3a,D4aは、ともに圧縮後の残存率が90%であるものとする。ケース11は、データブロックD3aを受信して圧縮し、得られた圧縮データD3bをディスクアレイ装置110に書き込んだ後、続けてデータブロックD4aを受信して圧縮し、得られた圧縮データD4bをディスクアレイ装置110に書き込む処理を示す。このケース11の処理時間(T13―T10)は、データブロックD3a,D4aをともに圧縮せずにディスクアレイ装置110に書き込んだ場合の処理時間より長くなる。
VL制御プロセッサ200は、VL制御部211を備える。このVL制御部211の処理は、例えば、VL制御プロセッサ200が備えるCPUが所定のプログラムを実行することで実現される。また、VL制御プロセッサ200が備える記憶装置には、データ管理テーブル212が記憶される。
データ管理テーブル212には、データブロックごとにレコードが生成され、各レコードには、データブロックを識別するブロックIDと、ディスクアレイ装置110におけるデータブロックの格納位置情報とが登録される。図8の例では、データブロックの格納位置情報として、ディスクアレイ装置110においてデータブロックが格納された領域の先頭アドレスが登録されている。
受信処理部311は、VL制御プロセッサ200から書き込み制御部324に対してデータの書き込み要求が発せられると、ホスト装置500から書き込みが要求されたデータを構成するデータブロックを受信する。受信処理部311は、受信したデータブロックをRAM302に格納する。
書き込み処理部322,323は、それぞれ圧縮データおよびデータブロックを、例えば図9に示すような、圧縮フラグ341と実データ領域342とを含むデータ形式に変換して、ディスクアレイ装置110に書き込む。圧縮フラグ341は、実データ領域342に格納されたデータが、データブロックを圧縮した圧縮データであるか、あるいは非圧縮のデータブロックであるかを示す。例えば、書き込み処理部322は、圧縮フラグ341を「1」にするとともに、実データ領域342に圧縮処理部321が生成した圧縮データを格納する。一方、書き込み処理部323は、圧縮フラグ341を「0」にするとともに、実データ領域342に非圧縮のデータブロックを格納する。
[ステップS17]書き込み制御部324は、書き込み処理部322によってディスクアレイ装置110に書き込まれたデータの先頭アドレスを、書き込み処理部322から取得する。書き込み制御部324は、取得した先頭アドレスと、書き込みが終了したデータブロックのブロックIDとを、VL制御プロセッサ200内のデータ管理テーブル212に登録する。この登録処理により、書き込み処理部322によってディスクアレイ装置110に書き込まれたデータが有効化される。
[ステップS19]書き込み制御部324は、書き込み処理部323によってディスクアレイ装置110に書き込まれたデータの先頭アドレスを、書き込み処理部323から取得する。書き込み制御部324は、取得した先頭アドレスと、書き込みが終了したデータブロックのブロックIDとを、VL制御プロセッサ200内のデータ管理テーブル212に登録する。この登録処理により、書き込み処理部323によってディスクアレイ装置110に書き込まれたデータが有効化される。
上記の第2の実施の形態では、圧縮処理部321および書き込み処理部322による圧縮書き込み処理と、書き込み処理部323による非圧縮書き込み処理のいずれかが終了するまでの間、各処理が並列に実行される。これに対して、以下の第3の実施の形態では、圧縮処理部321による圧縮処理が終了した時点で、圧縮書き込み処理と非圧縮書き込み処理のどちらの処理時間が短いかを判定する。
[ステップS36]書き込み制御部324は、ステップS34で検出した圧縮データのデータ量A1と、ステップS35で検出した書き込み未実行のデータ量A2とを比較する。データ量A1がデータ量A2以下である場合(S36:Yes)、書き込み制御部324はステップS37の処理を実行する。一方、データ量A1がデータ量A2より大きい場合(S36:No)、書き込み制御部324はステップS40の処理を実行する。
上記の第2,第3の実施の形態では、圧縮書き込み処理と非圧縮書き込み処理とが並列に実行される期間があることから、チャネルプロセッサ300のCPU301の処理負荷が高くなる恐れがある。このため、圧縮書き込み処理と非圧縮書き込み処理とを並列に実行することで、チャネルプロセッサ300の処理性能が悪化し、データブロックごとの書き込み処理に要する時間がかえって長くなってしまう可能性がある。そこで、以下の第4の実施の形態では、CPU301の処理負荷が高い場合には、圧縮書き込み処理と非圧縮書き込み処理の一方のみが実行されるようにして、CPU301の処理負荷が高くなり過ぎないようにする。
[ステップS61]書き込み制御部324は、処理負荷検出部351からCPU301の使用率を取得する。CPU301の使用率が所定のしきい値を超えている場合(S61:Yes)、書き込み制御部324は、ステップS63の処理を実行する。一方、CPU301の使用率が所定のしきい値以下である場合(S61:No)、書き込み制御部324は、ステップS62の処理を実行する。
[ステップS65]圧縮処理部321による圧縮処理が終了し、得られた圧縮データがRAM302に格納されると、書き込み制御部324は、得られた圧縮データのデータ量D1を検出する。この処理では、書き込み制御部324は、例えば、圧縮データのデータ量D1を圧縮処理部321から取得する。
これらのステップS64,S66の処理により、圧縮書き込み処理が実行されることになる。
[ステップS69]書き込み制御部324は、圧縮処理部321に、次のデータブロックについての圧縮処理を実行させる。
[ステップS71]書き込み処理部322による圧縮データの書き込み処理が終了すると、書き込み制御部324は、書き込み処理部322によってディスクアレイ装置110に書き込まれたデータの先頭アドレスを、書き込み処理部322から取得する。書き込み制御部324は、取得した先頭アドレスと、書き込みが終了したデータブロックのブロックIDとを、VL制御プロセッサ200内のデータ管理テーブル212に登録する。この登録処理により、書き込み処理部322によってディスクアレイ装置110に書き込まれたデータが有効化される。
なお、ステップS71,S72の処理順は逆であってもよい。
[ステップS73]ホスト装置500から書き込みを要求された書き込みデータを構成するデータブロックのうち、ディスクアレイ装置110に書き込んでいないデータブロックがある場合には、書き込み制御部324は、変数Nが「0」であるかを判定する。変数Nが「1」以上である場合(S73:No)、ステップS69に戻り、書き込み制御部324は、次のデータブロックについての圧縮書き込み処理を圧縮処理部321および書き込み処理部322に実行させる。一方、変数Nが「0」である場合(S73:Yes)、書き込み制御部324は、ステップS61の処理を実行する。
[ステップS75]書き込み処理部323によるデータブロックの書き込み処理が終了すると、書き込み制御部324は、書き込み処理部323によってディスクアレイ装置110に書き込まれたデータの先頭アドレスを、書き込み処理部323から取得する。書き込み制御部324は、取得した先頭アドレスと、書き込みが終了したデータブロックのブロックIDとを、VL制御プロセッサ200内のデータ管理テーブル212に登録する。この登録処理により、書き込み処理部323によってディスクアレイ装置110に書き込まれたデータが有効化される。
なお、ステップS75,S76の処理順は逆であってもよい。
[ステップS77]ホスト装置500から書き込みを要求された書き込みデータを構成するデータブロックのうち、ディスクアレイ装置110に書き込んでいないデータブロックがある場合には、書き込み制御部324は、変数Nが「0」であるかを判定する。変数Nが「1」以上である場合(S77:No)、ステップS74に戻り、書き込み制御部324は、次のデータブロックについての非圧縮書き込み処理を書き込み処理部323に実行させる。一方、変数Nが「0」である場合(S77:Yes)、書き込み制御部324は、ステップS61の処理を実行する。
11 記憶装置
12 書き込み部
13 圧縮部
14 書き込み制御部
15 メモリ
Da データ
Db 圧縮データ
Claims (7)
- データを記憶装置に書き込む書き込み部と、
データを圧縮する圧縮部と、
前記記憶装置への書き込みが要求された第1のデータを前記書き込み部が前記記憶装置に書き込む第1の処理と、前記第1のデータを前記圧縮部が圧縮し、圧縮により得られた第2のデータを前記書き込み部が前記記憶装置に書き込む第2の処理とを並行して実行させ、前記第1の処理と前記第2の処理のうち処理終了時刻が遅い方の処理を中止させる書き込み制御部と、
を有することを特徴とする情報処理装置。 - 前記書き込み制御部は、前記第2の処理において前記圧縮部によって前記第2のデータが得られたとき、得られた前記第2のデータのデータ量と、前記第1のデータのうち前記第1の処理における書き込み未完了データのデータ量とを比較し、前記第2のデータのデータ量が前記書き込み未完了データのデータ量より大きい場合には、前記第1の処理を続行させるとともに前記第2の処理を中止させ、前記第2のデータのデータ量が前記書き込み未完了データのデータ量以下である場合には、前記第2の処理を続行させるとともに前記第1の処理を中止させることを特徴とすることを特徴とする請求項1記載の情報処理装置。
- 前記書き込み制御部は、前記第1の処理と前記第2の処理のうち一方の処理が終了したことを検出すると、終了していない他方の処理を中止させることを特徴とする請求項1記載の情報処理装置。
- 前記情報処理装置の処理負荷を検出する処理負荷検出部をさらに有し、
前記書き込み制御部は、前記第1のデータの書き込み要求を受け付けたとき、前記処理負荷検出部によって検出された処理負荷を示す値が所定値を超える場合には、前記第1の処理を実行させずに前記第2の処理を実行させる、
ことを特徴とする請求項1〜3のいずれか1項に記載の情報処理装置。 - 前記書き込み制御部は、前記処理負荷を示す値が所定値を超え、前記第2の処理を実行させたとき、前記圧縮部から得られた前記第2のデータのデータ量を検出し、前記第2のデータのデータ量が所定の判定しきい値以下である場合には、次に前記記憶装置への書き込みが要求されたデータについて、前記第1の処理を実行させずに前記第2の処理を実行させ、前記第2のデータのデータ量が前記判定しきい値を超える場合には、次に前記記憶装置への書き込みが要求されたデータについて、前記第2の処理を実行させずに前記第1の処理を実行させることを特徴とする請求項4記載の情報処理装置。
- 第1の記憶装置と、
第2の記憶装置と、
前記第1の記憶装置を一次ストレージとし、前記第2の記憶装置を二次ストレージとした階層型ストレージシステムの動作を制御するストレージ制御装置と、
上位装置から前記階層型ストレージシステム内のデータに対するアクセスが要求されたとき、前記第1の記憶装置にアクセスするアクセス装置と、
を有し、
前記アクセス装置は、
データを前記第1の記憶装置に書き込む書き込み部と、
データを圧縮する圧縮部と、
前記上位装置から前記階層型ストレージシステムへの書き込みが要求された第1のデータを前記書き込み部が前記第1の記憶装置に書き込む第1の処理と、前記第1のデータを前記圧縮部が圧縮し、圧縮により得られた第2のデータを前記書き込み部が前記第1の記憶装置に書き込む第2の処理とを並行して実行させ、前記第1の処理と前記第2の処理のうち処理終了時刻が遅い方の処理を中止させる書き込み制御部と、
を有することを特徴とするストレージシステム。 - 情報処理装置が、
記憶装置への書き込みが要求された第1のデータを前記記憶装置に書き込む第1の処理と、前記第1のデータを圧縮し、圧縮により得られた第2のデータを前記記憶装置に書き込む第2の処理とを並行して実行し、
前記第1の処理と前記第2の処理のうち処理終了時刻が遅い方の処理を中止する、
ことを特徴とする書き込み制御方法。
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