JP5617449B2 - 画像読取装置 - Google Patents
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Description
遅延回路は、上記フリップフロップ回路と1クロック内遅延補正部との双方で補正された上記取り込みタイミングと、それらの補正がいずれもなされていない上記取り込みタイミングとを、それぞれ複数の段階に遅延させる。そして、上記アナログ信号出力中の上記スペクトラム拡散クロックの周波数のレベルに応じて、上記遅延回路により上記いずれかの段階に遅延された上記取り込みタイミングがセレクタ部により選択され、補正後取り込みタイミングとして出力される。
また、本発明において、上記遅延回路によって遅延補正がなされる上記各段階の補正量は、順次一定量ずつ大きくなるように設定され、かつ、最も大きい補正量に上記一定量を加えた値が上記スペクトラム拡散クロックの最小周波数に対応する1周期分となるように設定されてもよい。
また、本発明において、上記各段階に個々に遅延補正された上記取り込みタイミングの上記セレクタ部への入力数は上記レベル分け部による分類の数よりも多く、上記セレクタ部が上記入力のうちのどれを選択して上記補正後取り込みタイミングとして出力すべきかを、上記レベル分け部による分類に対応付けて記憶した書き換え可能なテーブルを、更に備えてもよい。
次に、本発明の実施の形態を図面と共に説明する。図9は、本発明が適用された画像読取装置910の断面図である。図9に示すように、この画像読取装置910は、フラットベッド機構(FB)及び自動給紙機構(ADF:Automatic Document Feed)の双方を備えたタイプのものであり、この画像読取装置910は、フラットベッド部910aに対してカバー部910bを開閉可能に取り付けてなるクラムシェル構造となっている。
次に、図1は、画像読取装置910のCIS1に係る回路構成を表すブロック図である。なお、本実施の形態の画像読取装置910は、1チャンネルのCIS1を使用した画像読取装置である。図1に示すように、本実施の形態の画像読取装置910は、図示省略したクロックから一定周波数で発生された基準クロックの一例としての基本クロックCLOCKを周波数変調させてスペクトラム拡散クロック(以下、単に拡散クロックという)SSCG_CLKを生成するスペクトラム拡散クロック生成部の一例としてのSSCG(スペクトラム拡散クロックジェネレータ)2を備えている。SSCG2が出力する拡散クロックSSCG_CLKは、取り込みタイミング設定部の一例としてのクロック生成回路3に入力され、そのクロック生成回路3は、上記拡散クロックSSCG_CLKを基準にして次のような信号を出力する。
そこで、本実施の形態では、図1に示すように、AD変換クロックADCLKをタイミング調整回路10にて遅延補正した補正後AD変換クロックnew_ADCLKを、AD変換クロックADCLKの代わりにAD変換器7に入力することにより、AD変換タイミングのずれを次のように抑制している。
なお、本発明は上記実施の形態になんら限定されるものではなく、本発明の要旨を逸脱しない範囲で種々の形態で実施することができる。例えば、セレクト信号保持回路15は、少なくともAD変換クロックADCLKの変化するタイミングでセレクト信号が変化しないようにそのセレクト信号を保持するものであればよい。従って、セレクト信号の保持は、必ずしも画素転送クロックDEVCLKに同期する必要はない。
4…周波数検出回路 7…AD変換器 8…デジタル画像処理回路
10,110,210,310,340…タイミング調整回路
11,111,231,311…セレクタ回路
12,13,112,113…遅延回路
14…フリップフロップ 15…セレクト信号保持回路
17,18,232…遅延素子 119,319…テーブル変換部
230…クロック内タイミング調整回路 910…画像読取装置
Claims (4)
- 原稿画像を読み取ってその原稿画像に対応したアナログ信号を出力する光電変換素子と、
該光電変換素子が出力するアナログ信号をデジタル信号に変換するA/D変換部と、
スペクトラム拡散クロックを生成するスペクトラム拡散クロック生成部と、
該スペクトラム拡散クロック生成部が生成したスペクトラム拡散クロックを基準として、上記A/D変換部によりデジタル信号に変換されるアナログ信号の取り込みタイミングを設定する取り込みタイミング設定部と、
上記スペクトラム拡散クロックの周波数を複数のレベルに分類するレベル分け部と、
上記取り込みタイミング設定部によって設定された上記取り込みタイミングを、上記スペクトラム拡散クロックの1または複数周期分遅延させるフリップフロップ回路と、
上記フリップフロップ回路によって遅延される上記取り込みタイミングを、上記レベル分け部による分類に応じて、上記スペクトラム拡散クロックの1周期の範囲内で遅延補正する1クロック内遅延補正部と、
予め設定された複数の異なる補正量で上記取り込みタイミングを遅延補正する複数の遅延素子を備え、上記フリップフロップ回路によって上記いずれかの周期分遅延され、かつ、上記1クロック内遅延補正部によって遅延補正された上記取り込みタイミングと、上記フリップフロップ回路による遅延も上記1クロック内遅延補正部による遅延補正もなされていない上記取り込みタイミングとを、それぞれ複数の段階に遅延させる遅延回路と、
該遅延回路の上記各遅延素子により上記各段階に個々に遅延補正された上記取り込みタイミングがそれぞれ入力され、その複数の入力を、上記アナログ信号出力中の上記レベル分け部による分類に応じて選択し、補正後取り込みタイミングとして出力するセレクタ部と、
を備え、
上記セレクタ部から出力された上記補正後取り込みタイミングで取り込まれた上記アナログ信号を、上記A/D変換部がデジタル信号に変換することを特徴とする画像読取装置。 - 上記フリップフロップ回路は、上記取り込みタイミングを上記スペクトラム拡散クロックの1周期毎に段階的に遅延させ、
上記遅延回路は、上記フリップフロップ回路によって上記各段階に遅延された上記各取り込みタイミングと、上記フリップフロップ回路による遅延がなされていない上記取り込みタイミングとを、それぞれ複数の段階に遅延させることを特徴とする請求項1に記載の画像読取装置。 - 上記遅延回路によって遅延補正がなされる上記各段階の補正量は、順次一定量ずつ大きくなるように設定され、かつ、最も大きい補正量に上記一定量を加えた値が上記スペクトラム拡散クロックの最小周波数に対応する1周期分となるように設定されたことを特徴とする請求項1または2に記載の画像読取装置。
- 上記各段階に個々に遅延補正された上記取り込みタイミングの上記セレクタ部への入力数は上記レベル分け部による分類の数よりも多く、
上記セレクタ部が上記入力のうちのどれを選択して上記補正後取り込みタイミングとして出力すべきかを、上記レベル分け部による分類に対応付けて記憶した書き換え可能なテーブルを、
更に備えたことを特徴とする請求項1〜3のいずれか1項に記載の画像読取装置。
Priority Applications (1)
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JP2010194708A JP5617449B2 (ja) | 2010-08-31 | 2010-08-31 | 画像読取装置 |
Applications Claiming Priority (1)
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JP2010194708A JP5617449B2 (ja) | 2010-08-31 | 2010-08-31 | 画像読取装置 |
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JP2012054705A JP2012054705A (ja) | 2012-03-15 |
JP5617449B2 true JP5617449B2 (ja) | 2014-11-05 |
Family
ID=45907596
Family Applications (1)
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JP2010194708A Active JP5617449B2 (ja) | 2010-08-31 | 2010-08-31 | 画像読取装置 |
Country Status (1)
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JP4650548B2 (ja) * | 2008-09-30 | 2011-03-16 | ブラザー工業株式会社 | 画像読取装置 |
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2010
- 2010-08-31 JP JP2010194708A patent/JP5617449B2/ja active Active
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