JP5475859B2 - 画像表示駆動装置 - Google Patents
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Description
図1は、本実施の形態にかかる画像表示システム1の電気的な接続を示すブロック図である。画像表示システム1は、画像を表示する液晶ディスプレイ(LCD)2と、LCD2を制御する画像表示駆動装置となる液晶駆動装置(LCDC)3と、LCD2に表示する画像データを格納した記憶装置であるSDRAM4と、SDRAM4を制御してSDRAM読出し手順に従って画像データを読み出すメモリコントローラ5と、LCDC3とSDRAM4とを接続する内部バス6と、各部を集中的に制御するCPU7とを備えている。SDRAM4には、広い範囲の海域の画像の画像データが格納されており、その画像データの画像データエリアの範囲内でCPU7が表示エリアを指定して画像データを読み出して、LCD2に表示させる。
図3は、本実施の形態にかかる画像表示システム31の電気的な接続を示すブロック図である。画像表示システム31は、画像を表示する液晶ディスプレイ(LCD)2と、LCD2を制御する画像表示駆動装置となる液晶駆動装置(LCDC)3と、LCD2に表示する画像データを格納した記憶装置であるSDRAM4と、SDRAM4を制御するメモリコントローラ5と、LCDC3とSDRAM4とを接続する内部バス6と、各部を集中的に制御するCPU7とを備えている。SDRAM4には、広い範囲の海域の画像の画像データが格納されており、その画像データの画像データエリアの範囲内でCPU7が表示エリアを指定して画像データを読み出して、LCD2に表示させる。
図4は、本実施の形態にかかる画像表示システム41の電気的な接続を示すブロック図である。画像表示システム41は、画像を表示する液晶ディスプレイ(LCD)2と、LCD2を制御する画像表示駆動装置となる液晶駆動装置(LCDC)3と、LCD2に表示する画像データを格納した記憶装置であるSDRAM4と、SDRAM4を制御するメモリコントローラ5と、LCDC3とSDRAM4とを接続する内部バス6と、各部を集中的に制御するCPU7とを備えている。SDRAM4には、広い範囲の海域の画像の画像データが格納されており、その画像データの画像データエリアの範囲内でCPU7が表示エリアを指定して画像データを読み出して、LCD2に表示させる。
2 液晶ディスプレイ
3 液晶駆動装置
4 SDRAM
6 内部バス
11 アドレス発生回路
12 ラインバッファ
21 先頭アドレス補正回路
22 ラインバッファ書き込み回路
Claims (1)
- SDRAMに記憶されている画像データの一部のデータ転送要求があったときに、当該当該データ転送要求にかかる前記画像データを前記SDRAMから読み出して表示装置に出力する画像表示駆動装置において、
前記SDRAMから読み出した前記画像データを一時保存するバッファと、
前記バッファに一時保存されている画像データを表示装置に出力する出力手段と、
前記データ転送要求があったときは、当該データ転送要求にかかる前記画像データの先頭のアドレスが前記SDRAMと前記バッファとを接続しているバスのバス幅の先頭のアドレスと合致するか否かを判定する先頭アドレス判定手段と、
前記先頭アドレス判定手段により前記両先頭アドレスが合致していないと判定したときは、前記データ転送要求にかかる前記画像データの先頭のアドレスを前記バスのバス幅の先頭アドレスに変換する先頭アドレス変換手段と、
前記データ転送要求に基づいて前記画像データを前記SDRAMから読み出す画像データ読出手段と、
前記先頭アドレス判定手段により前記両先頭アドレスが合致しないと判定したときは、前記画像データ読出手段で読み出した前記画像データのうち、前記データ転送要求には含まれていないが前記画像データ読出手段で読み出した前記画像データには含まれているものを判定する不要画像データ判定手段と、
前記画像データ読出手段で読み出した前記画像データを前記不要画像データ判定手段により前記データ転送要求には含まれていないと判定した部分を除いて前記バッファに記憶する記憶手段と、
を備えていることを特徴とする画像表示駆動装置。
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