JP5375662B2 - 信号生成回路 - Google Patents
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イマ機能によるタイマ時間は、第2のしきい値Vtoと第1のしきい値Vc1との差(=Vto-Vc1)で調整することになるが、温度変動等によりその差(=Vto-Vc1)の値が変わるためタイマ時間が変わってしまう点が上記従来構成の信号生成回路の課題として認識されていた。
イッチ素子を有し、該スイッチ素子のオンオフを前記外部入力により制御することを特徴とする。
図1は、本発明の実施の形態に係る信号生成回路の構成を示すブロック図であり、回路に設けた共用する容量への充電を通してソフトスタート機能とタイマ機能を実現可能にするものである。図1において本発明の実施の形態に係る信号生成回路は、ソフトスタート機能とタイマ機能を実現可能とするために、電流供給回路11から供給する電流Issを、回路に設けた共用する容量(Css)12に供給するとともに、差動増幅器21の比較入力としてクランプ回路20に加える。クランプ回路20は、電流供給回路11の出力端子の端子電圧でもある容量(Css)12の電流供給回路11側端子電圧Vss(以下、単に端子電圧Vssともいう)と温度変化の(ほとんど)ない基準電圧であるソフトスタート完了指示電圧(第2の設定電圧)Vc10とを比較して、端子電圧Vssがスタート完了指示電圧Vc10をより上回るほど、スイッチ素子13を介して電流供給回路11の出力端子に接続されたNMOSFET(NチャネルMetal-Oxide-Semiconductor Field-Effect Transistor)22により、容量(Css)12に供給される電流をより多く引き抜く構成とすることにより、クランプ機能を実現する。このような構成を採用することにより、端子電圧Vssがクランプ回路20によりクランプされた電圧であるソフトスタート完了電圧(クランプ電圧)Vc1の温度変動を回避することができる。
、単相増幅器130の構成要素外のPMOSFET M10,M11と一緒になってカレントミラー回路を構成する。PMOSFET M12のゲートは、PMOSFET M10のゲートに接続されていて、PMOSFET M10のドレインに接続されたバイアス電流(Ib)をコピーして流すことができる。PMOSFET M12のドレインは、NMOSFET M17のドレインに接続されるとともにPMOSFET M18及びNMOSFET M19のゲートに接続されている。NMOSFET M17のゲートには信号Vo1が入力されている。そして、PMOSFET M12 とNMOSFET M17とのコンプリメンタリー接続は第1のインバータを構成する。またPMOSFET M18 とNMOSFET M19とはコンプリメンタリー接続され第2のインバータを構成する。なお、第2のインバータは通常のCMOSインバータであるが、第1のインバータはNMOSFET M17およびNMOSFET M17のドレインに接続されているプルアップ素子(PMOSFET M12からなる電流源)という構成になっている。そして第1のインバータと第2のインバータは縦続接続されて、インバータ2段で単相増幅器を構成する。PMOSFET M18 のドレインとNMOSFET M19のドレインからは単相増幅器130の出力信号としてVo2を出力する。この出力信号は、上述したように電流供給回路110の構成要素である、NMOSFET M00のゲートにドライバを介して接続され、またNMOSFET M01のゲートに反転回路を介して接続されている。
12 容量(Css)
13 スイッチ素子
20 クランプ回路
21 差動増幅器
22 NMOSFET
30 比較回路
31 単相増幅器
40 比較器
110 電流供給回路
120 差動増幅器
130 単相増幅器
M00,M01 NMOSFET
M02,M03 カレントミラー回路を構成するPMOSFET
M10,M11,M12 カレントミラー回路を構成するPMOSFET
M13,M14 VssとVc10を比較するNMOSFETから成る比較段
M15,M16 NMOSFETから成るカレントミラー回路
M12,M17 コンプリメンタリー接続されたMOSFETから成る第1のインバータ
M18,M19 コンプリメンタリー接続されたMOSFETから成る第2のインバータ
Claims (5)
- 電流供給回路の出力端子と接地端子の間に接続された容量と、前記出力端子の電圧が第1の設定電圧を超えたか否かを二値信号で出力する比較回路と、該比較回路の出力に応じて前記出力端子に供給する電流値を変更することができる電流供給回路と、前記出力端子の電圧を前記比較回路の中間出力により定められるクランプ電圧にクランプするクランプ回路とを有し、
前記電流供給回路は前記容量への電流の供給を第1の電流値で開始し、
前記比較回路は、前記出力端子の電圧と第2の設定電圧との差を増幅する差動増幅器と、該差動増幅器の出力信号を増幅して二値化信号化する単相増幅器とから構成され、
前記クランプ回路は、前記出力端子に接続されて前記出力端子から電流を引き抜き、引き抜く電流の大きさが前記差動増幅器の出力により制御されるトランジスタを備え、
前記出力端子の電圧が高いほど前記トランジスタが引き抜く電流を大きくするようにして、前記出力端子の電圧が前記クランプ電圧に達したときに前記第1の電流値と前記トランジスタが引き抜く電流が等しくなるようになす、
ことを特徴とする信号生成回路。 - 前記第1の設定電圧は前記差動増幅器の出力が前記単相増幅器のしきい値電圧に達するときの前記出力端子の電圧であり、
前記電流供給回路は、前記容量へ供給する電流を、前記単相増幅器の出力に応じて前記第1の電流値から第2の電流値に切り替え、
前記第1の設定電圧値が前記クランプ電圧より低い電圧であることを特徴とする請求項1に記載の信号生成回路。 - 前記差動増幅器の出力は前記出力端子の電圧に対し単調増加する信号であり、前記トランジスタはゲート端子に前記差動増幅器の出力が入力されるNチャネルMOSトランジスタであることを特徴とする請求項1または2に記載の信号生成回路。
- 前記トランジスタが電流を引く抜く経路に設けられたスイッチ素子を有し、該スイッチ素子のオンオフを前記外部入力により制御することを特徴とする請求項1ないし3のいずれか1項に記載の信号生成回路。
- 前記外部入力が過負荷信号であり、該過負荷信号が入力されると前記スイッチ素子がオフすることを特徴とする請求項4に記載の信号生成回路。
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