JP5330319B2 - タイミング回復ループのための位相検出器 - Google Patents
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Description
X=14・Ymc+8・Ymp
ここで、
XはFIRフィルタ308によって出力されるフィルタ済み信号309の現在の値であり、
Ymcはモジュール306によって出力される平均信号307の現在の値であり、
Ympは平均信号307の以前の(即ち、以前のクロックサイクルからの)値である。
Claims (10)
- 信号プロセッサであって、
アナログ入力信号をデジタル出力信号に変換する信号処理経路であって、該信号処理経路がマルチビットソフト値を生成し、各マルチビットソフト値が符号ビット及びマルチビット信頼度値を有する、信号処理経路、及び
該ソフト値の該マルチビット信頼度値の1以上のビット及び該符号ビットを用いて、該アナログ入力信号をサンプリングするための該信号処理経路によって使用されるサンプリングクロック信号を生成するタイミング回復ループ
を備え、
前記タイミング回復ループが、前記ソフト値の前記マルチビット信頼度値の1以上のビット及び前記符号ビットに基づいて推定タイミングエラー信号を生成する位相検出器を備え、該推定タイミングエラー信号が、局部発振器(LO)クロック信号を調整するのに使用されて前記サンプリングクロック信号を生成し、
前記位相検出器が、
前記ソフト値の前記マルチビット信頼度値の1以上のビット及び前記符号ビットに基づいて平均値を生成するモジュール、
該平均値をフィルタリングしてフィルタ済み値を生成するフィルタ、
該信号処理経路からの等化値を遅延させて遅延等化値を生成する第1の遅延モジュール、
該フィルタ済み値を遅延させて遅延フィルタ済み値を生成する第2の遅延モジュール、
該遅延等化値と該フィルタ済み値を乗算して第1の積を生成する第1のマルチプライヤ、
該等化値と該遅延フィルタ済み値を乗算して第2の積を生成する第2のマルチプライヤ、及び
該第1の積と該第2の積の差に基づいて前記推定タイミングエラー信号を生成する差分ノード
を備えた信号プロセッサ。 - 請求項1の信号プロセッサにおいて、前記信号処理経路が、
前記サンプリングクロック信号に基づいて前記アナログ入力信号をサンプリングしてデジタル入力信号を生成するアナログ−デジタルコンバータ(ADC)、
該デジタル入力信号を等化して等化信号を生成する等化器、
該等化信号から前記ソフト値を生成するソフト検出器、及び
該ソフト値を復号して前記デジタル出力信号を生成する復号器
を備えた信号プロセッサ。 - 請求項1の信号プロセッサにおいて、前記タイミング回復ループがさらに、
前記推定タイミングエラー信号をフィルタリングして平均エラー信号を生成するループフィルタ、及び
該平均エラー信号に基づいて前記LOクロック信号の位相を調整して前記サンプリングクロック信号を生成する補間器
を備えた信号プロセッサ。 - 請求項1の信号プロセッサにおいて、前記平均値を生成するモジュールが、前記ソフト値を対応の平均値に変換するルックアップテーブルを実行する。
- 請求項4の信号プロセッサにおいて、各ソフト値が、
前記対応の平均値の符号が前記ソフト値の前記符号ビットに基づき、
該対応の平均値の大きさが前記マルチビット信頼度値の1以上のビットの大きさに基づく、信号プロセッサ。 - 請求項5の信号プロセッサにおいて、前記マルチビット信頼度値が4ビットを含む信号プロセッサ。
- 信号処理のための信号プロセッサ実装方法であって、
(a)前記信号プロセッサがアナログ入力信号をマルチビットソフト値に変換するステップであって、各マルチビットソフト値が符号ビット及びマルチビット信頼度値を有するものである、ステップ、及び
(b)該アナログ入力信号をサンプリングするのに使用されるサンプリングクロック信号を生成するために前記信号プロセッサが該ソフト値のマルチビット信頼度値の1以上のビット及び該符号ビットを使用するステップ
を備え、
該ソフト値のマルチビット信頼度値の1以上のビット及び該符号ビットを使用する前記ステップであって、局部発振器(LO)クロック信号を調整し前記サンプリングクロック信号を生成するように、前記ソフト値の前記マルチビット信頼度値の1以上のビット及び前記符号ビットから推定タイミングエラー信号を生成することを含む、ステップ、及び
前記推定タイミングエラー信号を生成するステップであって、
前記ソフト値の前記マルチビット信頼度値の1以上のビット及び前記符号ビットに基づいて平均値を生成するステップ、
フィルタ済み値を生成するように該平均値をフィルタリングするステップ、
アナログ入力信号から遅延等化値を生成するステップ、
遅延等化値を生成するように信号処理経路からの等化値を遅延させるステップ、
遅延フィルタ済み値を生成するようにフィルタ済み値を遅延させるステップ、
第1の積を生成するように該遅延等化値と該フィルタ済み値を乗算するステップ、
第2の積を生成するように該等化値と該遅延フィルタ済み値を乗算するステップ、及び
該第1の積と該第2の積の差に基づいて前記推定タイミングエラー信号を生成するステップ
を備えた推定タイミングエラー信号を生成するステップ
を備えた信号プロセッサ実装方法。 - 請求項7の信号プロセッサ実装方法において、
デジタル入力信号を生成するように前記サンプリングクロック信号に基づいて前記アナログ入力信号をサンプリングするステップ、
等化信号を生成するように該デジタル入力信号を等化するステップ、
該等化信号から前記ソフト値を生成するステップ、及び
前記デジタル出力信号を生成するように該ソフト値を復号するステップ
をさらに備えた信号プロセッサ実装方法。 - 請求項7の信号プロセッサ実装方法において、
平均エラー信号を生成するように前記推定タイミングエラー信号をフィルタリングするステップ、及び
前記サンプリングクロック信号を生成するように該平均エラー信号に基づいて前記LOクロック信号の位相を調整するステップ、
をさらに備えた信号プロセッサ実装方法。 - 信号処理のための装置であって、
(a)アナログ入力信号をマルチビットソフト値に変換する手段であって、各マルチビットソフト値が符号ビット及びマルチビット信頼度値を有するものである、手段、及び
(b)該ソフト値のマルチビット信頼度値の1以上のビット及び該符号ビットを使用して、該アナログ入力信号をサンプリングするのに使用されるサンプリングクロック信号を生成する手段
を備え、手段(b)はさらに、
前記ソフト値の前記マルチビット信頼度値の1以上のビット及び前記符号ビットに基づいて推定タイミングエラー信号を生成する手段を備え、該推定タイミングエラー信号は、局部発振器(LO)クロック信号を調整するのに使用されて前記サンプリングクロック信号を生成し、
前記生成する手段が、
前記ソフト値の前記マルチビット信頼度値の1以上のビット及び前記符号ビットに基づいて平均値を生成する手段、
フィルタ済み値を生成するように該平均値をフィルタリングする手段、
遅延等化値を生成するように信号処理経路からの等化値を遅延させる手段、
遅延フィルタ済み値を生成するようにフィルタ済み値を遅延させる手段、
第1の積を生成するように該遅延等化値と該フィルタ済み値を乗算する手段、
第2の積を生成するように該等化値と該遅延フィルタ済み値を乗算する手段、及び
該第1の積と該第2の積の差に基づいて前記推定タイミングエラー信号を生成する手段
を備えた推定タイミングエラー信号を生成する手段
を備えた装置。
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