JP5238564B2 - プリディストータ - Google Patents
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Description
次に、プリディストータ301のルックアップテーブル23の詳細について説明する。図4は複数の増幅器で構成された増幅回路をモデル化した図であり、入力信号Xが入力され出力信号Yを出力する。ここで、入力信号X、および出力信号Yをともに周期Tsでサンプリングした離散時間信号をそれぞれx(nTs)、およびy(nTs)とし、表記を簡単にするためにそれぞれx(n)、およびy(n)で表すこととする。また、x(n)およびy(n)はともに実数成分と虚数成分を持つ複素数信号であり、x(n)およびy(n)に対する乗算、および加算は、それぞれ複素乗算、および複素加算を示すものとする。すなわち、先に説明した図1、及び図2においては、歪補償回路11には複素数信号が入力され、歪補償回路11と被補償回路401の間には図示しない直交変調器、D/A変換器、およびアップコンバータがあり、被補償回路401と制御部13の間には図示しないダウンコンバータ、A/D変換器、および直交復調器がある。図4のようにモデル化された増幅器の歪補償値を得るのに、複数のルックアップテーブルを用いる。すなわち、増幅器を構成する要素増幅器の歪特性を表す歪特性多項式を
j:要素増幅器の番号
J:要素増幅器の総数
r:正規化先行時間、または正規化遅延時間
R1j:j番目要素増幅器に対応する合成多項式の最大の正規化先行時間
R2j:j番目要素増幅器に対応する合成多項式の最大の正規化遅延時間
d:入力信号の正規化先行時間、または正規化遅延時間
D1j:j番目要素増幅器の最大の正規化先行時間
D2j:j番目要素増幅器の最大の正規化遅延時間
l:要素増幅器の合成多項式の次数
Lj:j番目要素増幅器の合成多項式の最大次数
k:要素増幅器の歪特性多項式の次数
Kj:j番目要素増幅器の歪多項式の最大次数
y(n)=Gx(n)
となり、線形であるのが理想的である。但し、Gは増幅装置の利得を表す実数定数である。ここでは、以降の議論を簡単にする目的で、G=1とおくこととする。
しかし、増幅回路の歪補償が十分でなければ、y(n)=x(n)とはならず、
例えば、0≦|x|≦8191を満たす全ての整数値である。
まず、従来のルックアップテーブルの更新方法について説明する。図7は、従来のプリディストータのルックアップテーブルの更新方法を説明するフローチャートである。ステップS101で、入力信号及び出力信号をサンプリングする。ステップS102で、入力信号と出力信号との差分を計算して誤差を算出する。ステップS103で、ステップS102で算出した誤差を小さくするようにルックアップテーブルを更新し、ステップS104で新たなルックアップテーブルを作成する。ステップS105で、歪補償値が存在しないアドレスの歪補償値を隣接するアドレスの歪補償値で直線補間し、当該アドレスの歪補償値を直線補間した値から取得する。更に、ステップS105では入力信号の振幅値(または電力値)の量子化ステップをさらに細かく設定したアドレスに対する歪補償値を直線補間した値から取得する。ステップS106で、当該アドレスを補間した歪補償値を用いたルックアップテーブルに差し替える。
Δw(i)=(Δw0(i),Δw1(i),・・・,ΔwK(i))T
である。
本発明では更新回数、または誤差信号e(i(N+M)+n)の電力に応じて更新係数μを適応的に変化させる。例えば、本発明の例として更新係数μを更新回数に応じて変化させる場合には、更新係数を
11:歪補償回路
13:制御部
21:遅延素子
22:強度算出部
23、23−0、23−5、23−11、23−13:ルックアップテーブル
23−1D:一変数ルックアップテーブル
23−2D:二変数ルックアップテーブル
23−MD:多変数ルックアップテーブル
24:複素乗算器
27:遅延部
31:遅延部
32、32−0、32−5、32−11、32−13:歪信号生成部
33:歪補償値生成部
401:被補償回路
511:遅延素子
512−j:振幅値関数(jは自然数)
513:要素増幅器
514:複素乗算器
515:積算器
X:入力信号
Y:出力信号
A:予歪補償信号
S、S−0、S−5、S−9、S−11、S−13:サンプリング信号
H、H−0、0,H−9,5、H−11,17:歪信号
Claims (4)
- ルックアップテーブルが入力信号に基づいて生成した予歪補償信号を被補償回路へ出力する歪補償回路と、
前記入力信号及び前記被補償回路の出力信号が入力され、前記ルックアップテーブルが前記入力信号に基づいて生成した歪補償値と前記入力信号とから計算した入力計算信号と、前記ルックアップテーブルが前記出力信号に基づいて生成した歪補償値と前記出力信号とから計算した出力計算信号との差分から誤差ルックアップテーブル内の全ての値を計算し、前記誤差ルックアップテーブルを前記ルックアップテーブルに加算して前記ルックアップテーブル内の全ての値を更新する制御部と、
を備えるプリディストータ。 - ルックアップテーブルが入力信号に基づいて生成した予歪補償信号を被補償回路へ出力する歪補償回路と、
前記予歪補償信号及び前記被補償回路の出力信号が入力され、前記予歪補償信号と前記ルックアップテーブルが前記出力信号に基づいて生成した出力計算信号との差分から誤差ルックアップテーブル内の全ての値を計算し、前記誤差ルックアップテーブルを前記ルックアップテーブルに加算して前記ルックアップテーブル内の全ての値を更新する制御部と、
を備えるプリディストータ。 - 前記制御部は、前記ルックアップテーブルを更新する際に前記誤差ルックアップテーブルに乗じる更新係数を、前記ルックアップテーブルを更新した回数に基づいて決定することを特徴とする請求項1又は2に記載のプリディストータ。
- 前記制御部は、前記ルックアップテーブルを更新する際に前記誤差ルックアップテーブルに乗じる更新係数を、前記予歪補償信号と前記計算信号との差分に基づいて決定することを特徴とする請求項1又は2に記載のプリディストータ。
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JP2009065890A JP5238564B2 (ja) | 2009-03-18 | 2009-03-18 | プリディストータ |
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JP2009065890A JP5238564B2 (ja) | 2009-03-18 | 2009-03-18 | プリディストータ |
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Family
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Family Applications (1)
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JP2009065890A Active JP5238564B2 (ja) | 2009-03-18 | 2009-03-18 | プリディストータ |
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2009
- 2009-03-18 JP JP2009065890A patent/JP5238564B2/ja active Active
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