JP5205221B2 - メモリ制御装置およびこれを用いた計量器 - Google Patents
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Description
2 検針装置
11 検出部
12 制御装置
13 メモリ
14 表示部
15 通信部
16 電源
21 制御部
22 第1一致検出部
23 第2一致検出部
31 マスタメモリ(第1メモリ)
32 バックアップメモリ(第2メモリ)
Claims (2)
- 複数ビットからなる第1特定信号と複数ビットからなる第2特定信号とを重複しないタイミングで順次に出力する制御部と、
前記制御部からの第1特定信号によって示されるコードと内部に保持している第1暗証コードとが一致した場合に第1書込許可信号を生成する第1一致検出部と、
前記第1一致検出部からの第1書込許可信号に応答して外部からのデータを書き込む第1メモリと、
前記制御部からの第2特定信号によって示されるコードと内部に保持している第2暗証コードとが一致した場合に第2書込許可信号を生成する第2一致検出部と、
前記第2一致検出部からの第2書込許可信号に応答して前記第1メモリに書き込んだデータと同一のデータを書き込む第2メモリと、
を備えることを特徴とするメモリ制御装置。 - 流量を検出する検出部と、
複数ビットからなる第1特定信号と複数ビットからなる第2特定信号とを重複しないタイミングで順次に出力する制御部と、
前記制御部からの第1特定信号によって示されるコードと内部に保持している第1暗証コードとが一致した場合に第1書込許可信号を生成する第1一致検出部と、
前記第1一致検出部からの第1書込許可信号に応答して前記検出部からの流量を表すデータを書き込む第1メモリと、
前記制御部からの第2特定信号によって示されるコードと内部に保持している第2暗証コードとが一致した場合に第2書込許可信号を生成する第2一致検出部と、
前記第2一致検出部からの第2書込許可信号に応答して前記第1メモリに書き込んだデータと同一のデータを書き込む第2メモリと、
を備えることを特徴とする計量器。
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JP2008291136A JP5205221B2 (ja) | 2008-11-13 | 2008-11-13 | メモリ制御装置およびこれを用いた計量器 |
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