JP4763371B2 - 表示装置 - Google Patents
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Description
スイッチング素子に映像信号を供給する駆動回路と、走査信号を出力する駆動回路と、昇圧回路とを設ける。
スイッチング素子に映像信号を供給する駆動回路と、走査信号を出力する駆動回路と、昇圧回路とを設ける。
量素子C4は一方の電極が、基準電圧Vsに接続しており、昇圧された電圧を保持する出力容量を形成している。
次に図9を用いて図8の回路の動作を説明する。図9には昇圧パルスΦ1、2、3、4と、ノードN14、N19、N15の電圧を示した。また図9では各降圧動作を代表して、昇圧容量C9に降圧、保持された電圧がトランジスタNMT15を介して、昇圧容量C10に保持される動作について説明する。なお、わかりやすくするために、基準電圧Vs(昇圧パルスのロウレベル)を0Vで説明する。
Claims (9)
- 第1の基板と、第2の基板と、
前記第1の基板に設けられた複数の画素電極と、
前記画素電極に映像信号を供給する画素スイッチング素子と、
前記画素スイッチング素子に映像信号を供給する映像信号線と、
前記画素スイッチング素子を制御する走査信号を供給する走査信号線とを有し、
前記第1の基板に前記画素スイッチング素子と同様の工程で
前記映像信号を出力する第1の駆動回路と、
前記走査信号を出力する第2の駆動回路と、
昇圧回路とを設け、
前記昇圧回路には、フレキシブル基板を介して電源電圧が入力され、
前記昇圧回路は第1の容量素子と第2の容量素子と、前記第1と第2の容量素子との間に設けられた第1のスイッチング素子と、
該第1のスイッチング素子の制御端子に接続された第3の容量素子と、
前記第1の容量素子と前記第3の容量素子との間に設けられ、ダイオード接続した第2のスイッチング素子と、
前記第3の容量素子と前記第1の容量素子との間に設けられ、前記第3の容量素子と前記第1の容量素子とを電気的に接続し、制御端子が前記第2の容量素子に接続された第3のスイッチング素子を有し、
前記第3の容量素子で前記第1のスイッチング素子の制御端子に印加される電圧を昇圧し、
前記第2の容量素子で、前記第3のスイッチング素子の制御端子に印加される電圧を昇圧し、
前記昇圧回路で昇圧された電源電圧が前記第1の駆動回路と第2の駆動回路とに供給されることを特徴とする表示装置。 - 第1の基板と、第2の基板と、
前記第1の基板に設けられた複数の画素電極と、
前記画素電極に映像信号を供給する画素スイッチング素子と、
前記画素スイッチング素子に映像信号を供給する映像信号線と、
前記画素スイッチング素子を制御する走査信号を供給する走査信号線とを有し、
前記第1の基板に前記画素スイッチング素子と同様の工程で
前記映像信号を出力する第1の駆動回路と、
前記走査信号を出力する第2の駆動回路と、
昇圧回路とを設け、
前記昇圧回路には、フレキシブル基板を介して電源電圧が入力され、
前記昇圧回路は、
第1の電極と第2の電極とを有する第1の容量素子と、
第3の電極と第4の電極とを有する第2の容量素子と、
前記第1の容量素子の第1の電極に接続された第1のクロック信号線と、
前記第2の容量素子の第3の電極に接続された第2のクロック信号線と、
前記第1の容量素子の第2の電極と前記第2の容量素子の第4の電極とを電気的に接続する第1のスイッチング素子と、
該第1のスイッチング素子の制御端子に第5の電極が接続され、第6の電極が第3のクロック信号線に接続した第3の容量素子と、
前記第1の容量素子の第2の電極と前記第3の容量素子の第5の電極との間に設けられ、前記第2の電極と前記第5の電極とをダイオード接続した第2のスイッチング素子と、
前記第3の容量素子の第5の電極と前記第1の容量素子の第2の電極との間に設けられ、制御端子が前記第2の容量素子の第4の電極に接続された第3のスイッチング素子を有し、
前記第3の容量素子の第5の電極を昇圧させることで前記第1のスイッチング素子の制御端子に前記第1の容量素子に保持された電圧より高い電圧を印加し、
前記第2の容量素子の第4の電極の電圧を昇圧させることで、前記第3のスイッチング素子をオン状態として前記第3の容量素子の第5の電極と、前記第1の容量素子の第2の電極とを導通させ、
前記昇圧回路で昇圧された電源電圧が前記第1の駆動回路と前記第2の駆動回路とに供給されることを特徴とする表示装置。 - 第1の基板と、第2の基板と、
前記第1の基板に設けられた複数の画素電極と、
前記画素電極に映像信号を供給する画素スイッチング素子と、
前記画素スイッチング素子に映像信号を供給する映像信号線と、
前記画素スイッチング素子を制御する走査信号を供給する走査信号線とを有し、
前記第1の基板に前記画素スイッチング素子と同様の工程で
前記映像信号を出力する第1の駆動回路と、
前記走査信号を出力する第2の駆動回路と、
昇圧回路とを設け、
前記昇圧回路には、フレキシブル基板を介して電源電圧が入力され、
前記昇圧回路は、第1の容量素子と、第2の容量素子と、
前記第1の容量素子と第2の容量素子との間に設けられた第1のトランジスタと、
該第1のトランジスタの制御端子に接続された第3の容量素子と、
前記第1の容量素子と前記第3の容量素子と間に設けられ、ダイオード接続した第2のトランジスタと、
前記第3の容量素子と前記第1の容量素子の間に設けられ、制御端子が前記第2の容量素子に接続された第3のトランジスタを有し、
前記第1の容量素子の第1の端子には第1の電圧と、該第1の電圧より低い第2の電圧の間で振幅する第1の昇圧パルスが印加され、前記第1の容量素子の第2の端子は、前記第1のトランジスタの入力端子と、前記第2のトランジスタの入力端子に接続され、
前記第2の容量素子の第3の端子には前記第1の昇圧パルスとは逆相の第2の昇圧パルスが印加され、前記第2の容量素子の第4の端子は前記第1のトランジスタの出力端子と前記第3のトランジスタの制御端子に接続され、
前記第3の容量素子の第5の端子は、前記第1のトランジスタの制御端子に接続され、第6の端子には第3の電圧と、該第3の電圧より低い第4の電圧の間で振幅するパルス信号が供給され、
前記第3の容量素子の第6の端子に前記第4の電圧が印加されている状態で、
前記第1の容量素子の第1の端子に前記第1の昇圧パルスの第1の電圧を印加して、前記第1の容量素子の第2の端子の電圧を第5の電圧に昇圧し、
該昇圧した第5の電圧は前記第3の容量素子の第5の端子に、前記ダイオード接続した第2のトランジスタを介して供給され、
前記昇圧された第5の電圧から前記第2のトランジスタのしきい値電圧が差し引かれた第6の電圧が前記第3の容量素子に保持され、
前記第3の容量素子の第6の端子の電圧を第4の電圧から第3の電圧に変化させて、前記第3の容量素子に保持された第6の電圧を前記第5の電圧より前記第1のトランジスタのしきい値電圧分より高い第7の電圧に昇圧して、
前記第7の電圧を前記第1のトランジスタの制御端子に印加し、第1のトランジスタを介して前記第1の容量素子から前記第2の容量素子の第4の端子に前記第5の電圧を転送し、
前記第5の電圧を前記第2の容量素子に転送後、前記第2の容量素子の前記第3の端子の電圧を第2の電圧から第1の電圧に変化させることで、前記第3のトランジスタをオン状態として前記第3の容量素子の第5の端子の電荷が、前記第1の容量素子の第2の端子に放電され、
前記昇圧回路で昇圧された電圧が前記第1の駆動回路と第2の駆動回路とに供給されることを特徴とする表示装置。 - 前記第1のスイッチング素子はアモルファスシリコン膜を再結晶化したポリシリコン膜を有することを特徴とする請求項1に記載の表示装置。
- 前記第1のスイッチング素子はアモルファスシリコン膜にレーザ照射し、再結晶化したポリシリコン膜を有することを特徴とする請求項1に記載の表示装置。
- 前記第1のスイッチング素子はアモルファスシリコン膜を再結晶化し、結晶粒径が前記アモルファスシリコン膜よりも増加したポリシリコン膜を有することを特徴とする請求項1に記載の表示装置。
- 前記第1のスイッチング素子はアモルファスシリコン膜にレーザ照射し、再結晶化したポリシリコン膜を有することを特徴とする請求項2に記載の表示装置。
- 前記第1のスイッチング素子はアモルファスシリコン膜を再結晶化し、結晶粒径が前記アモルファスシリコン膜よりも増加したポリシリコン膜を有することを特徴とする請求項2に記載の表示装置。
- 前記第1のトランジスタ素子はアモルファスシリコン膜を再結晶化したポリシリコン膜を有することを特徴とする請求項3に記載の表示装置。
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