JP4639600B2 - 半導体パッケージ - Google Patents
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Description
く、良好な高周波伝送特性とEMI特性を有する半導体パッケージを提供することを課題とする。
その結果として、共振現象を抑制することができ、高周波信号の伝送特性が良好で、EMI特性に優れた半導体パッケージの構造となる。特に、スティフナー及び/またはヒートスプレッダを仮想の信号線とし、電気配線板の電源もしくはグランドの導体パターンを仮想のグランドプレーンとし構成される伝送線路の特性インピーダンス近辺の抵抗値を有する抵抗体で接続した場合には、共振抑制効果がもっとも大きくなる。
図1に示すように、電気配線板の最上導体層は、フリップチップパッド3とグランドの導体パターン(グランドプレーン)4で構成されている。半導体チップ1は、フリップチップバンプ2を介して電気配線板の最上導体層のフリップチップパッド3に電気的に接続されている。
BGAパッド10にはハンダボール11が付けられている。この電気配線板の上面と下面には、誘電体であるソルダーレジスト層12、13が形成されている。ソルダーレジスト層12の上部には、図2のような枠状の接着剤層14、導体からなるスティフナー15が順次積層されている。スティフナー15とグランドの導体パターン(グランドプレーン)4は、抵抗体16によって電気的に接続されている。
、50、100Ωと変化させた。図6〜図8のグラフがそのS11特性である。このグラフを見ると、明らかに抵抗値に最適値があることがわかる。スティフナー15が枠状であるために、厳密な特性インピーダンスを定義することはできないが、13Ωと25Ωの特性が良好なことから、スィフナー15を信号線とし、グランドの導体パターン4をグランドプレーンとして構成される仮想の伝送線路の特性インピーダンス近辺に最適値があることがわかる。
第1の実施形態ではグランドの導体パターン(グランドプレーン)4に接続されていて、グランド電位の変動を抑制させたが、この構成では電源層8に接続しているので、電源ノイズの低減に効果を表す。共振特性は、図5とほぼ同様となるので割愛する。この構成においても、抵抗体16に最適値が存在することは、第1の実施形態とまったく同様である。
このときの共振特性を図9に示す。1ポートより高周波信号を与えて、S11特性をみたものである。リファレンスで短絡した場合の特性もプロットしてある。共振は、明らかに第1の実施形態よりも低周波から始まっており、共振周波数も多く存在する。10Ωの抵抗体で接続した場合には、共振の強度が低下し、特に低周波側の共振にその効果が顕著である。このようにヒートスプレッダ17の付いたパッケージでも効果を表す。
2・・・・フリップチップバンプ
3・・・・フリップチップパッド
4・・・・グランドの導体パターン(グランドプレーン)
5、7、9・・・・誘電体層
6・・・・信号線層(導体層)
8・・・・電源層(導体層)
10・・・・BGAパッド
11・・・・ハンダボール
12、13・・・・ソルダーレジスト層
14・・・・接着剤層
15・・・・スティフナー
16・・・・抵抗体
17・・・・ヒートスプレッダ
18・・・・導電性接着剤
Claims (4)
- 誘電体層と導体層を交互に積層してなる電気配線板の最上導体層上に、該最上導体層と電気的に接続された半導体デバイスと、電気配線板を構成する誘電体層とは異なる誘電体層を介して導体からなるスティフナーを設けた半導体パッケージにおいて、該スティフナーは、前記最上導体層の電源もしくはグランドの導体パターン(電源プレーンもしくはグランドプレーン)に、電気抵抗体によって接続されており、前記電気抵抗体の抵抗値は、前記スティフナーと前記電源もしくはグランドの導体パターン(電源プレーンもしくはグランドプレーン)とで仮想的に形成される伝送線路の特性インピーダンス値であることを特徴とする半導体パッケージ。
- 前記スティフナーの上部には、導体からなるヒートスプレッダが形成されていることを特徴とする請求項1に記載の半導体パッケージ。
- 誘電体層と導体層を交互に積層してなる電気配線板の最上導体層上に、該最上導体層と電気的に接続された半導体デバイスと、導電性接着剤を介して導体からなるヒートスプレッダを設けた半導体パッケージにおいて、該ヒートスプレッダは、前記最上導体層の電源もしくはグランドの導体パターン(電源プレーンもしくはグランドプレーン)に、電気抵抗体によって接続されており、前記電気抵抗体の抵抗値は、前記ヒートスプレッダと前記電源もしくはグランドの導体パターン(電源プレーンもしくはグランドプレーン)とで仮想的に形成される伝送線路の特性インピーダンス値であることを特徴とする半導体パッケージ。
- 前記電気抵抗体は、複数個形成されていることを特徴とする請求項1〜3のいずれか1項に記載の半導体パッケージ。
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