JP4580349B2 - 信号処理回路、画像読取装置および画像形成装置 - Google Patents
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Description
図1は、本実施形態のスキャナの構成を示す図である。
本実施形態のAFE1は、クランプ回路部(CLAMP)2と、サンプルホールド(SH)部3と、(可変)ゲインアンプ(VGA)4と、A/Dコンバータ(ADC)5と、ブラッククランプ回路(BLK_CLAMP)6と、D/Aコンバータ(DAC)7と、マルチプレクサ(MPX)8とを備えている。
ここで、クランプ動作は、クランプ回路内のクランプスイッチ(SW)9をON/OFFしてAC結合コンデンサを充放電することで実現され、クランプされたCCD出力信号は、後段のサンプルホールド部3へと入力される。また、ON抵抗とは、このスイッチがONしているときの等価抵抗であり、そのときAFE入力端子とクランプ用電源がON抵抗で接続されていると見なすことができる。
ここでは、ON抵抗可変とベタクランプとを実現するために、クランプ制御部(CLP_CNT)10の機能として、ON抵抗を制御する機能だけでなく、クランプスイッチ(SW)9のON期間を制御する機能を追加している。これは例えば、通常外部からのCLPINでクランプスイッチ(SW)9がONするのを、ベタクランプの場合には、CLPINをクランプスイッチ(SW)9には出力せずに、常時ONし続けるようにすることで実現可能である。
図9および図10は、本実施形態のクランプスイッチ(SW)9の他の一例を示す図である。図9は、ON抵抗の異なるクランプスイッチを用いる場合を示し、図10は、ON抵抗が同じクランプスイッチを用いる場合を示している。
次に、本実施形態において、過大電圧を抑制するためにCCDおよびAFEの動作を順番に制御する制御動作について、図面を用いて説明する。
この場合の制御動作について、図面を用いて説明する。
2 クランプ回路部(CLAMP)
3 サンプルホールド(SH)部
4 (可変)ゲインアンプ(VGA)
5 A/Dコンバータ(ADC)
6 ブラッククランプ回路(BLK_CLAMP)
7 D/Aコンバータ(DAC)
8 マルチプレクサ(MPX)
9 クランプスイッチ部(SW)
10 クランプ制御部(CLP_CNT)
Claims (9)
- 光電変換素子からのアナログデータを、交流結合を介してデジタルデータへと変換する信号処理回路であって、
前記信号処理回路は、
前記アナログデータのオフセットレベルを任意の電位に固定するクランプ手段と、
前記クランプ手段のON/OFFを制御するクランプスイッチと、
前記光電変換素子のON/OFF時には該光電変換素子の通常動作時よりも、前記クランプスイッチのON時における抵抗を小さくないし等価的に小さくするように、前記クランプスイッチを制御するクランプ制御手段と、
を有し、
前記クランプ制御手段は、前記光電変換素子のON/OFF時において、前記光電変換素子の通常動作時よりも前記クランプスイッチをONする期間を長くすることを特徴とする信号処理回路。 - 前記クランプ制御手段は、前記信号処理回路の電源投入時に、前記クランプスイッチをONする期間を長くすることを特徴とする請求項1に記載の信号処理回路。
- 前記信号処理回路は、前記クランプスイッチを複数備え、
前記クランプ制御手段は、該複数のクランプスイッチを少なくとも1以上選択して、前記クランプスイッチのON時における前記抵抗を可変ないし等価的に可変することを特徴とする請求項1または2に記載の信号処理回路。 - 前記クランプ制御手段は、前記信号処理回路の有するレジスタまたは外部端子にて制御されることを特徴とする請求項3に記載の信号処理回路。
- 複数の前記クランプスイッチは、同じ特性を有することを特徴とする請求項3に記載の信号処理回路。
- 前記信号処理回路は、前記クランプスイッチと直列に接続された可変抵抗を有し、
前記クランプ制御手段は、前記可変抵抗を制御して、前記クランプスイッチのON時における前記抵抗を可変ないし等価的に可変することを特徴とする請求項1または2に記載の信号処理回路。 - 前記クランプ制御手段は、前記信号処理回路の有するレジスタまたは外部端子にて制御されることを特徴とする請求項6に記載の信号処理回路。
- 請求項1から7のいずれか1項に記載の信号処理回路を有する画像読取装置。
- 請求項8に記載の画像読取装置を有する画像形成装置。
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