JP4375006B2 - Multilayer ceramic capacitor and manufacturing method thereof - Google Patents

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Description

本願発明は積層セラミックコンデンサおよび積層セラミックコンデンサの製造方法に関し、詳しくは、内部電極の配設状態の良否を判定するための判定マークを備えた積層セラミックコンデンサおよびその製造方法に関する。   The present invention relates to a multilayer ceramic capacitor and a method for manufacturing the multilayer ceramic capacitor, and more particularly to a multilayer ceramic capacitor provided with a determination mark for determining whether the arrangement state of internal electrodes is good and a method for manufacturing the same.

積層セラミックコンデンサは、図12(a),(b)に示すように、セラミック積層素子51中に、複数の内部電極53a,53bがセラミック層52を介して互いに対向するように配設され、その一端側が交互にセラミック積層素子51の異なる側の端面に引き出されており、かつ、セラミック積層素子51の両端側に、内部電極53a,53bと導通するように一対の外部電極54a,54bが配設された構造を有している。   As shown in FIGS. 12A and 12B, the multilayer ceramic capacitor is disposed in a ceramic multilayer element 51 such that a plurality of internal electrodes 53a and 53b are opposed to each other via a ceramic layer 52. One end side is alternately drawn out to an end face on a different side of the ceramic multilayer element 51, and a pair of external electrodes 54a and 54b are disposed on both end sides of the ceramic multilayer element 51 so as to be electrically connected to the internal electrodes 53a and 53b. Has a structured.

外部電極54a,54bはAg粉末などの導電性金属材料、ガラスフリット、樹脂および溶剤などを含有する導電ペーストを塗布して焼き付けることにより形成されており、外部電極54a,54bの表面には、通常、Ag電極のはんだくわれを防止するためのNiめっき膜55およびはんだ付け性を向上させるためのSnめっき膜56が形成されている。   The external electrodes 54a and 54b are formed by applying and baking a conductive paste containing a conductive metal material such as Ag powder, glass frit, resin and solvent, and the surface of the external electrodes 54a and 54b is usually A Ni plating film 55 for preventing soldering of the Ag electrode and a Sn plating film 56 for improving solderability are formed.

ところで、上述のような構成を有する積層セラミックコンデンサにおいて、NiめっきやSnめっきなどを行って外部電極54a,54bの表面にNiめっき膜55やSnめっき膜56を形成する際に、めっき液が、セラミック積層素子51の端面の内部電極の露出している部分から侵入して内部欠陥を引き起こすという問題点がある。   By the way, in the multilayer ceramic capacitor having the above-described configuration, when the Ni plating film 55 and the Sn plating film 56 are formed on the surfaces of the external electrodes 54a and 54b by performing Ni plating or Sn plating, There is a problem that an internal defect is caused by intruding from the exposed portion of the internal electrode on the end face of the ceramic multilayer element 51.

そこで、図13に示すように、内部電極53a,53bの、セラミック積層素子51の端面に引き出される部分(引き出し部)63a,63bの幅W1を、容量形成部57a,57bの幅W2より狭くして、めっき液の侵入を抑制するようにした積層セラミックコンデンサが提案されている(例えば特許文献1,特許文献2参照)。 Therefore, as shown in FIG. 13, the width W 1 of the portions (leading portions) 63a and 63b drawn to the end face of the ceramic multilayer element 51 of the internal electrodes 53a and 53b is made larger than the width W 2 of the capacitance forming portions 57a and 57b. There has been proposed a multilayer ceramic capacitor that is made narrow to suppress the penetration of the plating solution (see, for example, Patent Document 1 and Patent Document 2).

しかしながら、内部電極53a,53bの容量形成部57a,57bと引き出し部63a,63bの幅が異なっているので、セラミック積層素子51(図12)の端面に露出した内部電極53a,53bを観察しても内部電極53a,53bの容量形成部57a,57bが適正な位置に配設されているか否かを判定することができないという問題点がある。すなわち、内部電極53a,53bの、引き出し部63a,63b以外の部分は、外部との導通などが生じたりしないように、セラミック積層素子51の側面や端面から外部に露出せず、セラミック積層素子51の内部に収まっていることが必要になるが、引き出し部63a,63bの幅W1を容量形成部57a,57bの幅W2より狭くした場合、セラミック積層素子51の端面への内部電極53a,53bの露出状態を観察しても内部電極53a,53bの容量形成部57a,57bが適正な位置に配設されていることを確認することができないという問題点がある。 However, since the widths of the capacitance forming portions 57a and 57b and the lead portions 63a and 63b of the internal electrodes 53a and 53b are different, the internal electrodes 53a and 53b exposed on the end face of the ceramic multilayer element 51 (FIG. 12) are observed. However, there is a problem in that it cannot be determined whether or not the capacitance forming portions 57a and 57b of the internal electrodes 53a and 53b are disposed at appropriate positions. That is, portions of the internal electrodes 53a and 53b other than the lead portions 63a and 63b are not exposed to the outside from the side surfaces and end surfaces of the ceramic multilayer element 51 so as not to cause electrical continuity with the outside. However, when the width W 1 of the lead portions 63a and 63b is narrower than the width W 2 of the capacitance forming portions 57a and 57b, the internal electrodes 53a and 53a on the end face of the ceramic multilayer element 51 are required. Even if the exposed state of 53b is observed, there is a problem that it is impossible to confirm that the capacitance forming portions 57a and 57b of the internal electrodes 53a and 53b are disposed at appropriate positions.

また、引き出し部分の幅を狭くすると、セラミックグリーンシートを積層し、圧着することにより、積層体(マザー積層体)を形成する工程で、引き出し部63a,63bの両側の内部電極の存在していない部分では、圧力がかかりにくく、十分に加圧されないため、セラミックグリーンシートの境界部での剥がれ(デラミネーション)が発生しやすくなり、十分な信頼性を確保することが困難であるという問題点がある。   In addition, when the width of the lead-out portion is narrowed, the internal electrodes on both sides of the lead-out portions 63a and 63b are not present in the step of forming a laminated body (mother laminated body) by laminating and pressing the ceramic green sheets. In this part, pressure is not easily applied, and it is not pressurized enough, so peeling (delamination) is likely to occur at the boundary of the ceramic green sheet, and it is difficult to ensure sufficient reliability. is there.

また、引き出し部63a,63bの両側に、内部電極の存在していない部分が存在するため、図14に示すように、セラミック積層素子51の肩の部分が丸みを帯びた形状となることにより、実装信頼性が低下するという問題点がある。
また、上記従来例の構造では、内部電極53a,53bの引き出し方向へのずれも、セラミック積層素子を切断しなければ、確認できず、信頼性が低いという問題点がある。
実開昭54−166560号公報 特開平5−326317号公報
In addition, since there are portions where no internal electrode exists on both sides of the lead portions 63a and 63b, as shown in FIG. 14, the shoulder portion of the ceramic multilayer element 51 has a rounded shape. There is a problem that the mounting reliability is lowered.
Further, the structure of the conventional example has a problem that the displacement of the internal electrodes 53a and 53b in the drawing direction cannot be confirmed unless the ceramic multilayer element is cut, and the reliability is low.
Japanese Utility Model Publication No. 54-166560 Japanese Patent Laid-Open No. 5-326317

本願発明は、上記問題点を解決するものであり、デラミネーションの発生を抑制するとともに、内部電極の位置ずれの有無を確実に検出することが可能な信頼性の高い積層セラミックコンデンサおよびその製造方法を提供することを課題とする。   SUMMARY OF THE INVENTION The present invention solves the above-described problems, and is a highly reliable multilayer ceramic capacitor capable of suppressing the occurrence of delamination and reliably detecting the presence / absence of displacement of internal electrodes, and a method for manufacturing the same It is an issue to provide.

上記課題を解決するために、本願発明(請求項1)の積層セラミックコンデンサは、
複数の内部電極がセラミック層を介して互いに対向するように配設され、かつ、その一端側が交互に異なる側の端面に引き出されたセラミック積層素子の両端側に、内部電極と導通するように外部電極が配設された構造を有する積層セラミックコンデンサにおいて、
セラミック積層素子の端面への内部電極の引き出し部の幅が、内部電極の容量形成に寄与する容量形成部の幅より狭く形成されているとともに、
所定の内部電極の、容量形成部の両側辺を、内部電極引き出し方向に延長した一方側および他方側の延長線のうち、一方側、および/または、他方側の延長線上に少なくともその一部が位置するように、容量形成に寄与しないダミー電極が配設され、かつ、
所定の一つの内部電極についてみた場合、および/または、所定の複数の内部電極についてみた場合に、ダミー電極が一方側の延長線上および他方側の延長線上に位置しており、
セラミック積層素子の端面へのダミー電極の露出状態を調べることにより、少なくとも内部電極の幅方向への位置ずれ量が許容範囲にあるか否かを判定できるように構成されていること
を特徴としている。
In order to solve the above problems, the multilayer ceramic capacitor of the present invention (Claim 1) is:
A plurality of internal electrodes are arranged so as to face each other through the ceramic layer, and external ends are connected to the internal electrodes at both end sides of the ceramic multilayer element in which one end side is alternately drawn to the end face on the different side. In a multilayer ceramic capacitor having a structure in which electrodes are arranged,
The width of the lead portion of the internal electrode to the end face of the ceramic multilayer element is formed narrower than the width of the capacitance forming portion that contributes to the capacitance formation of the internal electrode,
At least a part of one side and / or the other side of the extension line on one side and the other side of both sides of the capacitance forming portion of the predetermined internal electrode extending in the direction of drawing out the internal electrode. A dummy electrode that does not contribute to capacitance formation is disposed, and
When viewed with respect to one predetermined internal electrode and / or when viewed with respect to a plurality of predetermined internal electrodes, the dummy electrode is located on the extension line on one side and the extension line on the other side,
By examining the exposure state of the dummy electrode on the end face of the ceramic multilayer element, it is possible to determine whether or not at least the amount of positional deviation in the width direction of the internal electrode is within an allowable range. .

また、請求項2の積層セラミックコンデンサは、前記ダミー電極が、各内部電極の容量形成部の両側辺を内部電極の引き出し方向に延長した一方側および他方側の両方の延長線上に配設されていることを特徴としている。   Further, in the multilayer ceramic capacitor according to claim 2, the dummy electrode is disposed on both one side and the other side of the extension of the capacitance forming portion of each internal electrode extending in the direction of drawing out the internal electrode. It is characterized by being.

また、請求項3の積層セラミックコンデンサは、前記ダミー電極として、内部電極の引き出し方向長さが、内部電極の引き出し方向への位置ずれ許容範囲より短いダミー電極を備えており、該ダミー電極のセラミック積層素子の端面への露出の有無により、内部電極の引き出し方向への位置ずれ量が許容範囲にあるか否かを判定できるように構成されていることを特徴としている。   According to a third aspect of the present invention, there is provided the multilayer ceramic capacitor as the dummy electrode, wherein the dummy electrode is provided with a dummy electrode in which a length in the lead-out direction of the internal electrode is shorter than a permissible displacement in the lead-out direction of the internal electrode. It is characterized in that it can be determined whether or not the amount of positional deviation in the lead-out direction of the internal electrode is within an allowable range depending on whether or not the end face of the multilayer element is exposed.

また、請求項4の積層セラミックコンデンサは、前記ダミー電極の形状を、内部電極の引き出し方向の位置により幅が異なるような形状として、セラミック積層素子の端面に露出したダミー電極の幅により、内部電極の引き出し方向への位置ずれ量が許容範囲にあるか否かを判定できるように構成されていることを特徴としている。   According to a fourth aspect of the present invention, in the multilayer ceramic capacitor, the dummy electrode is shaped so that the width varies depending on the position of the internal electrode in the lead-out direction, and the internal electrode depends on the width of the dummy electrode exposed on the end face of the ceramic multilayer element. It is characterized in that it can be determined whether or not the amount of positional deviation in the pull-out direction is within an allowable range.

また、請求項5の積層セラミックコンデンサは、前記ダミー電極と平行に、ダミー電極よりも長さの短い第2のダミー電極を配設し、セラミック積層素子の端面への第2のダミー電極の露出の有無により、内部電極の引き出し方向への位置ずれ量が許容範囲にあるか否かを判定できるように構成されていることを特徴としている。   In the multilayer ceramic capacitor according to claim 5, a second dummy electrode having a length shorter than the dummy electrode is disposed in parallel with the dummy electrode, and the second dummy electrode is exposed to the end face of the ceramic multilayer element. It is characterized in that it can be determined whether or not the amount of positional deviation in the lead-out direction of the internal electrode is within an allowable range depending on the presence or absence of this.

また、本願発明(請求項6)の積層セラミックコンデンサの製造方法は、
複数の内部電極がセラミック層を介して互いに対向するように配設され、かつ、その一端側が交互に異なる側の端面に引き出されたセラミック積層素子の両端側に、内部電極と導通するように外部電極が配設された構造を有する積層セラミックコンデンサの製造方法において、
一対の容量形成部領域を両端側に備え、中央部に両端側の容量形成部領域を接続する、容量形成部の幅よりも幅の狭い、引き出し部領域を備え、引き出し部領域で切断することにより2個の内部電極に分割される複数の内部電極パターンと、所定の内部電極パターンを構成する一方の容量形成部領域の両側辺を、他方側の容量形成部領域の両側辺に向かって延長した、一方側および他方側の延長線のうち、一方側、および/または、他方側の延長線上に少なくともその一部が位置するようにダミー電極パターンが配設されたセラミックグリーンシートを、交互に内部電極の引き出し方向となる方向に所定量だけ位置をずらせて積層、圧着して、マザー積層体を形成する工程と、
前記マザー積層体を、内部電極パターンの中央部の引き出し部領域が切断されるように所定の位置で切断することにより、内部電極を備え、かつ、所定の一つの内部電極についてみた場合、および/または、所定の複数の内部電極についてみた場合に、ダミー電極が一方側の延長線上および他方側の延長線上に位置する構造を有する個々の未焼成のセラミック積層素子に分割する工程と、
前記未焼成のセラミック積層素子を焼成する工程と、
焼成されたセラミック積層素子に外部電極を形成する工程と
を具備することを特徴としている。
In addition, the manufacturing method of the multilayer ceramic capacitor of the present invention (Claim 6) is as follows.
A plurality of internal electrodes are arranged so as to face each other through the ceramic layer, and external ends are connected to the internal electrodes at both end sides of the ceramic multilayer element in which one end side is alternately drawn to the end face on the different side. In the method of manufacturing a multilayer ceramic capacitor having a structure in which electrodes are disposed,
A pair of capacitance forming region is provided at both ends, and a capacitance forming region at both ends is connected to the central portion, and has a leading portion region that is narrower than the width of the capacitance forming portion, and is cut at the leading portion region. And a plurality of internal electrode patterns divided into two internal electrodes and both sides of one capacitance forming portion region constituting the predetermined internal electrode pattern are extended toward both sides of the other capacitance forming portion region. The ceramic green sheets on which the dummy electrode patterns are arranged so that at least a part of the extension line on one side and / or the other side of the extension line on one side and / or the other side are located are alternately arranged. A step of forming a mother laminated body by laminating and crimping by a predetermined amount in the direction of the internal electrode drawing direction,
When the mother laminate is viewed at a predetermined position by cutting the mother stacked body at a predetermined position so that the lead-out region at the center of the internal electrode pattern is cut, and / Alternatively, when viewed with respect to a predetermined plurality of internal electrodes, the process of dividing the dummy electrode into individual unfired ceramic multilayer elements having a structure located on one extension line and on the other extension line;
Firing the green ceramic multilayer element;
And a step of forming external electrodes on the fired ceramic laminated element.

また、請求項7の積層セラミックコンデンサの製造方法は、前記セラミックグリーンシートとして、前記一方側および他方側の両方の延長線上にダミー電極パターンが配設されたセラミックグリーンシートを用いることを特徴としている。   The method for manufacturing a multilayer ceramic capacitor according to claim 7 is characterized in that a ceramic green sheet in which dummy electrode patterns are disposed on both of the extension lines on the one side and the other side is used as the ceramic green sheet. .

本願発明(請求項1)の積層セラミックコンデンサは、所定の内部電極の、容量形成部の両側辺を内部電極の引き出し方向に延長した、一方側および他方側の2本の延長線のうち、一方側、および/または、他方側の延長線上に少なくともその一部が位置するように、容量形成に寄与しないダミー電極を配設し、所定の一つの内部電極についてみた場合、および/または、所定の複数の内部電極についてみた場合に、ダミー電極が一方側の延長線上および他方側の延長線上に位置するようにしているので、セラミック積層素子の端面へのダミー電極の露出状態を調べることにより、内部電極の幅方向への位置ずれ量が許容範囲にあるか否かを確実に判定することが可能になり、不良品を除去して、信頼性の高い積層セラミックコンデンサを確実に得ることが可能になる。   The multilayer ceramic capacitor of the present invention (Claim 1) is one of two extension lines on one side and the other side of a predetermined internal electrode, in which both sides of a capacitance forming portion are extended in the direction of drawing out the internal electrode. A dummy electrode that does not contribute to capacitance formation is arranged so that at least a part thereof is located on the extended line on the side and / or the other side, and when the predetermined one internal electrode is viewed, and / or When looking at a plurality of internal electrodes, the dummy electrodes are positioned on the extension line on one side and the extension line on the other side, so by examining the exposure state of the dummy electrode on the end face of the ceramic multilayer element, It is possible to reliably determine whether or not the amount of displacement in the width direction of the electrode is within an allowable range, and remove defective products to ensure a highly reliable multilayer ceramic capacitor. It is possible to get to.

また、請求項2の積層セラミックコンデンサのように、ダミー電極を、各内部電極の容量形成部の両側辺を内部電極の引き出し方向に延長した一方側および他方側の両方の延長線上に配設することにより、すべての内部電極について、幅方向への位置ずれ量が許容範囲にあるか否か確実に判定することが可能になり、さらに信頼性を向上させることが可能になる。   Further, as in the multilayer ceramic capacitor according to claim 2, the dummy electrodes are disposed on both one side and the other side of the extension of the capacitance forming portion of each internal electrode extending in the direction of drawing out the internal electrode. As a result, it is possible to reliably determine whether or not the amount of positional deviation in the width direction is within an allowable range for all the internal electrodes, and it is possible to further improve the reliability.

また、請求項3の積層セラミックコンデンサのように、ダミー電極として、内部電極の引き出し方向長さが、内部電極の引き出し方向への位置ずれ許容範囲より短いダミー電極を備えた構成とすることにより、ダミー電極の、セラミック積層素子の端面への露出の有無により、内部電極の引き出し方向への位置ずれ量が許容範囲にあるか否かを判定できるようになり、さらに信頼性の高い積層セラミックコンデンサを得ることが可能になる。
なお、本願請求項3の積層セラミックコンデンサにおいては、複数のダミー電極のすべてに、または一部に、上記引き出し方向長さが、内部電極の引き出し方向への位置ずれ許容量より短いダミー電極を用いることが可能である。
Further, as in the multilayer ceramic capacitor according to claim 3, the dummy electrode has a dummy electrode in which the length of the internal electrode in the lead-out direction is shorter than the allowable positional deviation in the lead-out direction of the internal electrode. Depending on whether or not the dummy electrode is exposed to the end face of the ceramic multilayer element, it is possible to determine whether or not the amount of positional deviation in the lead-out direction of the internal electrode is within an allowable range. It becomes possible to obtain.
In the multilayer ceramic capacitor according to the third aspect of the present invention, a dummy electrode whose length in the lead-out direction is shorter than the allowable displacement in the lead-out direction of the internal electrode is used for all or a part of the plurality of dummy electrodes. It is possible.

また、請求項4の積層セラミックコンデンサのように、ダミー電極の形状を、内部電極の引き出し方向の位置により幅が異なるような形状とした場合、セラミック積層素子の端面に露出したダミー電極の幅により、内部電極の引き出し方向への位置ずれ量が許容範囲にあるか否かおよび位置ずれの大きさを判定することができるようになり、さらに信頼性の高い積層セラミックコンデンサを得ることが可能になる。
内部電極の引き出し方向の位置により幅が異なるような形状としては、例えば、延長線上に一辺が位置するような三角形状などが例示される。
Further, as in the multilayer ceramic capacitor according to claim 4, when the shape of the dummy electrode is such that the width varies depending on the position of the internal electrode in the drawing direction, it depends on the width of the dummy electrode exposed on the end face of the ceramic multilayer element. In addition, it becomes possible to determine whether or not the amount of positional deviation in the lead-out direction of the internal electrode is within an allowable range and the magnitude of the positional deviation, and it becomes possible to obtain a more reliable multilayer ceramic capacitor. .
Examples of the shape whose width varies depending on the position in the lead-out direction of the internal electrode include, for example, a triangular shape with one side positioned on the extension line.

また、請求項5の積層セラミックコンデンサのように、ダミー電極と平行に、ダミー電極よりも長さの短い第2のダミー電極を配設するようにした場合にも、セラミック積層素子の端面への第2のダミー電極の露出の有無により、内部電極の引き出し方向への位置ずれ量が許容範囲にあるか否かを効率よく判定することが可能になる。
なお、第2のダミー電極の配設数に制約はなく、一つでもよく複数でもよい。さらに、複数とする場合においては、第2のダミー電極のすべてを同じ長さとすることも可能であり、また、一部あるいは全部を異なる長さとすることも可能である。
Further, when the second dummy electrode having a shorter length than the dummy electrode is arranged in parallel with the dummy electrode as in the multilayer ceramic capacitor according to claim 5, the end face of the ceramic multilayer element is also arranged. Whether or not the second dummy electrode is exposed makes it possible to efficiently determine whether or not the amount of positional deviation in the lead-out direction of the internal electrode is within an allowable range.
Note that the number of second dummy electrodes is not limited and may be one or more. Further, in the case where a plurality of dummy electrodes are provided, all of the second dummy electrodes can have the same length, and some or all of the second dummy electrodes can have different lengths.

また、本願発明(請求項6)の積層セラミックコンデンサの製造方法は、一対の容量形成部領域を両端側に備え、中央部に容量形成部領域を接続する、容量形成部の幅よりも幅の狭い、引き出し部領域を備え、引き出し部領域で切断することにより2個の内部電極に分割される複数の内部電極パターンと、一方の容量形成部領域の両側辺を、他方側の容量形成部領域の両側辺に向かって延長した、一方側および他方側の延長線のうち、一方側、および/または、他方側の延長線上に少なくともその一部が位置するようにダミー電極パターンが配設されたセラミックグリーンシートを、交互に内部電極の引き出し方向となる方向に所定量だけ位置をずらせて積層、圧着して、マザー積層体を形成し、これを内部電極パターンの中央の引き出し部となる部分が切断されるように所定の位置で切断した後、焼成し、外部電極を形成するようにしているので、所定の一つの内部電極についてみた場合、および/または、所定の複数の内部電極についてみた場合に、ダミー電極が一方側の延長線上および他方側の延長線上に位置する構造を備えた積層セラミックコンデンサを得ることが可能になる。そして、かかる積層セラミックコンデンサにおいては、セラミック積層素子の端面へのダミー電極の露出状態を調べることにより、内部電極の幅方向への位置ずれ量が許容範囲にあるか否かを確実に判定することが可能であるため、不良品を除去して、信頼性の高い積層セラミックコンデンサを確実に得ることが可能になる。   The method for manufacturing a multilayer ceramic capacitor according to the present invention (Claim 6) is provided with a pair of capacitance forming portion regions at both ends and having a width larger than the width of the capacitance forming portion connecting the capacitance forming portion region to the central portion. A plurality of internal electrode patterns each having a narrow lead portion region and divided into two internal electrodes by cutting at the lead portion region, and both sides of one capacitance forming portion region are connected to the other capacitance forming portion region. The dummy electrode pattern is disposed so that at least a part of the extension line on one side and / or the other side of the extension line on one side and / or the other side extends toward both sides of The ceramic green sheets are alternately laminated by a predetermined amount in the direction of the internal electrode extraction direction, and bonded to form a mother laminate, which is formed at the central extraction portion of the internal electrode pattern. Since the external electrode is formed after being cut at a predetermined position so that a portion to be cut is fired, and / or when viewed with respect to one predetermined internal electrode, and / or a plurality of predetermined internal electrodes When it sees, it becomes possible to obtain the laminated ceramic capacitor provided with the structure where the dummy electrode is located on the extension line on one side and the extension line on the other side. In such a multilayer ceramic capacitor, the exposure state of the dummy electrode on the end face of the ceramic multilayer element is examined to reliably determine whether or not the amount of positional deviation in the width direction of the internal electrode is within an allowable range. Therefore, it is possible to reliably obtain a multilayer ceramic capacitor with high reliability by removing defective products.

また、請求項7の積層セラミックコンデンサの製造方法のように、セラミックグリーンシートとして、一方側および他方側の両方の延長線上にダミー電極パターンが配設されたセラミックグリーンシートを用いることにより、各内部電極の一方側および他方側の両方の延長線上にダミー電極が配設され、すべての内部電極について、幅方向への位置ずれ量を確認することが可能な、さらに信頼性の高い積層セラミックコンデンサを効率よく製造することが可能になる。   Further, as in the method of manufacturing a multilayer ceramic capacitor according to claim 7, by using a ceramic green sheet in which dummy electrode patterns are arranged on both one side and the other side as a ceramic green sheet, A more reliable monolithic ceramic capacitor that has dummy electrodes on both extension lines on one side and the other side of the electrode, and can check the amount of displacement in the width direction for all internal electrodes. It becomes possible to manufacture efficiently.

以下、本願発明の実施例を示して、本願発明の特徴とするところをさらに詳しく説明する。   Hereinafter, the features of the present invention will be described in more detail with reference to examples of the present invention.

図1(a)は本願発明の一実施例にかかる積層セラミックコンデンサを構成するセラミック積層素子の、内部電極およびダミー電極の配設態様を示す透視平面図、図1(b)は内部電極3a,3bの形状を示す分解斜視図、図1(c)は図1(a)のC−C線断面図(側面断面図)、図2(a)は本願発明の一実施例にかかる積層セラミックコンデンサの正面断面図、図2(b)は斜視図である。   FIG. 1A is a perspective plan view showing the arrangement of internal electrodes and dummy electrodes of a ceramic multilayer element constituting a multilayer ceramic capacitor according to an embodiment of the present invention, and FIG. 1B is an exploded perspective view showing the shape of 3b, FIG. 1C is a cross-sectional view taken along the line CC of FIG. 1A, and FIG. 2A is a multilayer ceramic capacitor according to an embodiment of the present invention. FIG. 2B is a perspective view of FIG.

この実施例の積層セラミックコンデンサは、図1(a),(b),(c)、および図2(a),(b)に示すように、複数の内部電極3a,3bがセラミック層2を介して互いに対向するように配設され、かつ、その一端側が交互に異なる側の端面に引き出されたセラミック積層素子(積層セラミックコンデンサ素子)1の両端側に、外部電極4a,4bが形成され、かつ、外部電極4a,4bの表面に、はんだ食われを抑制するためのNiめっき膜5およびはんだ付け性を向上させるためのSnめっき膜6が順に形成された構造を有している。   In the multilayer ceramic capacitor of this embodiment, as shown in FIGS. 1 (a), (b), (c), and FIGS. 2 (a), (b), a plurality of internal electrodes 3a, 3b have ceramic layers 2. External electrodes 4a and 4b are formed on both end sides of a ceramic multilayer element (multilayer ceramic capacitor element) 1 that is disposed so as to face each other, and one end side of which is alternately drawn out to an end face on a different side, In addition, the surface of the external electrodes 4a and 4b has a structure in which an Ni plating film 5 for suppressing solder erosion and an Sn plating film 6 for improving solderability are sequentially formed.

そして、この積層セラミックコンデンサにおいては、セラミック積層素子1の端面に引き出される、内部電極3a,3bの引き出し部13a,13bの幅W1が、他の内部電極3a,3bとセラミック層2を介して対向することにより容量形成に寄与する容量形成部7a,7bの幅W2より狭く形成されているとともに、各内部電極3a,3bの、容量形成部7a,7bの両側辺を内部電極3a,3bの引き出し方向に延長した、一方側および他方側の2本の延長線XおよびY上にその主要部が位置するように、容量形成に寄与しない線状のダミー電極10が配設されている。 In this multilayer ceramic capacitor, the width W 1 of the lead portions 13a and 13b of the internal electrodes 3a and 3b drawn out to the end face of the ceramic multilayer element 1 is determined via the other internal electrodes 3a and 3b and the ceramic layer 2. contribute capacitance forming part 7a in the capacitor formed by opposite, with being narrower than the width W 2 of 7b, the inner electrodes 3a, the 3b, capacitance forming portion 7a, the internal electrodes 3a to both sides of 7b, 3b A linear dummy electrode 10 that does not contribute to capacitance formation is arranged so that its main part is positioned on two extension lines X and Y on one side and the other side that extend in the direction of drawing out.

このように構成された積層セラミックコンデンサにおいては、図1(c)に示すように、内部電極3a,3bの容量形成部7a,7bの両側辺を内部電極の引き出し方向に延長した、一方側および他方側の2本の延長線X(図1(a))およびY(図1(a))上に、内部電極3a,3bを挟むようにダミー電極10が配設された構造を有しているので、セラミック積層素子1の端面へのダミー電極10の露出位置により、内部電極3a,3bの幅方向への位置ずれ量が許容範囲にあるか否か容易かつ確実に判定することができる。例えば、この実施例では、図1(c)に示すように、各内部電極3a,3bの引き出し部13a,13bの両側のダミー電極10がセラミック積層素子1の端面から検出されていれば、内部電極3a,3bの幅方向の位置ずれ量は許容範囲にあること(すなわち、容量形成部7a,7bがセラミック積層素子1の側面から必要なギャップを有してセラミック積層素子1内に確実に配設されていること)がわかる。したがって、信頼性の高い積層セラミックコンデンサを確実に供給することが可能になる。   In the multilayer ceramic capacitor configured as described above, as shown in FIG. 1 (c), both sides of the capacitance forming portions 7a and 7b of the internal electrodes 3a and 3b are extended in the lead-out direction of the internal electrode, A dummy electrode 10 is disposed on the other two extension lines X (FIG. 1 (a)) and Y (FIG. 1 (a)) so as to sandwich the internal electrodes 3a and 3b. Therefore, it is possible to easily and reliably determine whether or not the amount of positional deviation in the width direction of the internal electrodes 3a and 3b is within an allowable range based on the exposed position of the dummy electrode 10 on the end face of the ceramic multilayer element 1. For example, in this embodiment, as shown in FIG. 1C, if the dummy electrodes 10 on both sides of the lead portions 13a and 13b of the internal electrodes 3a and 3b are detected from the end face of the ceramic multilayer element 1, The amount of displacement in the width direction of the electrodes 3a and 3b is within an allowable range (that is, the capacitance forming portions 7a and 7b are securely arranged in the ceramic multilayer element 1 with a necessary gap from the side surface of the ceramic multilayer element 1). You can see that it is installed. Therefore, it is possible to reliably supply a highly reliable multilayer ceramic capacitor.

次に、上記の積層セラミックコンデンサを製造する方法について説明する。
上述のような構造を有する積層セラミックコンデンサを製造するにあたっては、まず、図3に示すように、セラミックグリーンシート21上に、両端側に、他の内部電極とセラミック層を介して対向することにより容量形成に寄与する容量形成部7a,7b(図1(a),(b))となる領域(容量形成部領域)17a,17bが配設され、中央に、幅W01(図4)が容量形成部領域17a,17bの幅W02(図4)より狭い、セラミック積層素子1(図1)の端面への引き出し部となる領域(引き出し部領域)13が配設され、中央の引き出し部領域13で切断されることにより2個の内部電極3a,3b(図1(a),(b))に分割される複数の内部電極パターン20と、所定の内部電極パターン20を構成する一方の容量形成部領域17a(17b)の両側辺を、他方側の容量形成部領域17b(17a)の両側辺に向かって延長した、一方側および他方側の2本の延長線X’,Y’(図4参照)の上に位置するように、容量形成に寄与しない線状のダミー電極パターン30が配設されたセラミックグリーンシート21を、交互に内部電極3a,3b(図1)の引き出し方向に所定量だけ位置をずらせて積層し、圧着することにより、マザー積層体を形成する。なお、内部電極パターン20とダミー電極パターン30は、同一材料(導電ペースト)で形成することが工程を簡略化する見地からは望ましいが、異なる材料で形成することも可能である。
Next, a method for manufacturing the above multilayer ceramic capacitor will be described.
In manufacturing the multilayer ceramic capacitor having the structure as described above, first, as shown in FIG. 3, on both sides of the ceramic green sheet 21, the other internal electrodes are opposed to each other through the ceramic layer. Regions (capacitor forming portion regions) 17a and 17b serving as capacitance forming portions 7a and 7b (FIGS. 1A and 1B) contributing to the capacitance formation are provided, and a width W 01 (FIG. 4) is provided at the center. A region (leader region) 13 serving as a lead-out portion to the end face of the ceramic multilayer element 1 (FIG. 1), which is narrower than the width W 02 (FIG. 4) of the capacitor forming portion regions 17a and 17b, is provided. A plurality of internal electrode patterns 20 that are divided into two internal electrodes 3a and 3b (FIGS. 1A and 1B) by being cut in the region 13, and one of the predetermined internal electrode patterns 20 Capacitance forming region 17a (1 7b) above the two extension lines X ′ and Y ′ (see FIG. 4) on one side and the other side, which are extended toward both sides of the capacitance forming portion region 17b (17a) on the other side. The ceramic green sheets 21 provided with the linear dummy electrode patterns 30 that do not contribute to capacitance formation are alternately shifted by a predetermined amount in the drawing direction of the internal electrodes 3a and 3b (FIG. 1). The mother laminate is formed by laminating and pressing. The internal electrode pattern 20 and the dummy electrode pattern 30 are preferably formed from the same material (conductive paste) from the viewpoint of simplifying the process, but may be formed from different materials.

このとき、交互に位置をずらせて積層される内部電極パターン20の位置関係は、図4に示すように、セラミックグリーンシートを介して互いに対向する内部電極パターン20(20a,20b)がそれぞれ備えている容量形成部領域17a,17bのうち、すなわち、内部電極パターン20(20a)の容量形成部領域17bと内部電極パターン20(20b)の容量形成部領域17aが互いに重なり合い、中央の引き出し部領域13を切断した場合に、図1(a)に示すように、引き出し部13a,13bと、その両側のダミー電極10がセラミック積層素子1の端面から露出するような位置関係とされている。   At this time, as shown in FIG. 4, the internal electrode patterns 20 (20a and 20b) facing each other through the ceramic green sheets are provided for the positional relationship of the internal electrode patterns 20 that are alternately stacked. Among the capacitance forming portion regions 17a and 17b, that is, the capacitance forming portion region 17b of the internal electrode pattern 20 (20a) and the capacitance forming portion region 17a of the internal electrode pattern 20 (20b) overlap each other, and the central lead portion region 13 1A, the lead portions 13a and 13b and the dummy electrodes 10 on both sides thereof are exposed from the end face of the ceramic multilayer element 1 as shown in FIG.

そして、上述のように構成されたマザー積層体を、内部電極パターン20の中央の引き出し部領域13が切断されるように所定の位置で切断し、個々の未焼成のセラミック積層素子1(図5)に分割する。   Then, the mother laminated body configured as described above is cut at a predetermined position so that the lead-out region 13 at the center of the internal electrode pattern 20 is cut, and individual unfired ceramic laminated elements 1 (FIG. 5). ).

それから、セラミック積層素子を焼成した後、焼成されたセラミック積層素子に導電ペーストを塗布、乾燥し、焼き付けることにより外部電極を形成し、外部電極の表面に、はんだ食われを抑制するためのNiめっき膜およびはんだ付け性を向上させるためのSnめっき膜を順に形成する。
これにより、図1(a),(b),(c)および図2(a),(b)に示すような構造を有する積層セラミックコンデンサが得られる。
Then, after firing the ceramic multilayer element, a conductive paste is applied to the fired ceramic multilayer element, dried and baked to form an external electrode, and Ni plating for suppressing solder erosion on the surface of the external electrode An Sn plating film for improving the film and solderability is sequentially formed.
As a result, a multilayer ceramic capacitor having a structure as shown in FIGS. 1A, 1B, 1C and 2A, 2B is obtained.

そして、このようにして積層セラミックコンデンサを製造する過程で、マザー積層体を所定の位置で切断して、個々の未焼成のセラミック積層素子1(図5)に分割したときに、内部電極の位置ずれ量が許容範囲にあるか否かの判定が行われる。   In the process of manufacturing the multilayer ceramic capacitor in this way, when the mother multilayer body is cut at a predetermined position and divided into individual unfired ceramic multilayer elements 1 (FIG. 5), the position of the internal electrode It is determined whether or not the deviation amount is within an allowable range.

すなわち、図5(a)に示すように、内部電極の引き出し部13a(13b)の両側のダミー電極10がいずれも検出された場合、内部電極3a,3bの幅方向の位置ずれが許容範囲であると判定される。
一方、図5(b)に示すように、セラミック積層素子1の側面から各ダミー電極10,10までの距離(ギャップ寸法)が両側で異なる場合には、狭い方のギャップ寸法を測定することにより許容範囲以内であるか否かの判定がなされる。
さらに、図5(c)に示すように、内部電極の引き出し部13a(13b)の両側のダミー電極10のいずれか一方が検出されない場合、内部電極の幅方向の位置ずれが許容範囲を超えている(すなわち、内部電極の容量形成部がセラミック積層素子1の側面に露出するような状態である)と判定される。
That is, as shown in FIG. 5A, when both dummy electrodes 10 on both sides of the internal electrode lead-out portion 13a (13b) are detected, the positional deviation in the width direction of the internal electrodes 3a and 3b is within an allowable range. It is determined that there is.
On the other hand, as shown in FIG. 5B, when the distance (gap size) from the side surface of the ceramic multilayer element 1 to each of the dummy electrodes 10, 10 is different on both sides, the narrower gap size is measured. A determination is made whether it is within an acceptable range.
Further, as shown in FIG. 5C, when any one of the dummy electrodes 10 on both sides of the lead portion 13a (13b) of the internal electrode is not detected, the positional deviation in the width direction of the internal electrode exceeds the allowable range. It is determined that the capacitance forming portion of the internal electrode is exposed on the side surface of the ceramic multilayer element 1.

その結果、内部電極の許容範囲を超える位置ずれの有無(内部電極の配設状態の良否)を容易かつ確実に判定することが可能になり、不良品を確実に除去して、信頼性の高い積層セラミックコンデンサを提供することが可能になる。   As a result, it is possible to easily and reliably determine the presence or absence of misalignment exceeding the permissible range of the internal electrode (the quality of the internal electrode arrangement state), reliably removing defective products, and providing high reliability. It becomes possible to provide a multilayer ceramic capacitor.

また、図5(a)などに示すように、セラミック積層素子1がダミー電極10を備えている場合、ダミー電極を備えていない場合に比べて、内部電極が配設されていない部分が少なくなり、圧着時に圧力の加わり方が均一になるため、デラミネーションの発生を抑制することが可能になる。   In addition, as shown in FIG. 5A and the like, when the ceramic multilayer element 1 includes the dummy electrode 10, the portion where the internal electrode is not disposed is reduced as compared with the case where the dummy electrode 10 is not included. Since pressure is uniformly applied during crimping, the occurrence of delamination can be suppressed.

さらに、ダミー電極を備えていない従来の構造の場合、引き出し部の両側に、内部電極が配設されていない部分が存在するため、図14に示すように、セラミック積層素子51の肩の部分が丸みを帯びた形状となり、実装信頼性が低下するという問題があるが、本願発明の積層セラミックコンデンサはダミー電極を備えているため、セラミック積層素子の肩部が丸くなることを抑制することが可能で、従来の積層セラミックコンデンサで発生していた上述のような問題の発生を防止することが可能になる。   Further, in the case of the conventional structure not provided with the dummy electrode, there are portions where the internal electrode is not disposed on both sides of the lead portion, so that the shoulder portion of the ceramic multilayer element 51 is formed as shown in FIG. There is a problem that the mounting reliability is lowered due to the rounded shape. However, since the multilayer ceramic capacitor of the present invention has a dummy electrode, it is possible to prevent the shoulder of the ceramic multilayer element from being rounded. Thus, it is possible to prevent the occurrence of the above-described problem that has occurred in the conventional multilayer ceramic capacitor.

なお、上記実施例では、各内部電極の引き出し部の両側に線状のダミー電極が配設された構造を有する積層セラミックコンデンサを示したが、以下に説明するように、ダミー電極の配設態様に関し、種々の応用変形を加えることが可能である。   In the above embodiment, a multilayer ceramic capacitor having a structure in which linear dummy electrodes are arranged on both sides of the lead portion of each internal electrode is shown. However, as will be described below, the arrangement of dummy electrodes It is possible to add various application modifications.

<変形例1>
図6(a)は、引き出し部領域13で切断する前の内部電極パターン20およびダミー電極パターン30の形状および配設態様を示す図であり、図6(b)は、個々のセラミック積層素子1に分割した状態の内部電極3a(3b)とダミー電極10の構成および位置関係を示す図である。
<Modification 1>
FIG. 6A is a diagram showing the shape and arrangement of the internal electrode pattern 20 and the dummy electrode pattern 30 before cutting in the lead portion region 13, and FIG. FIG. 3 is a diagram showing a configuration and a positional relationship between an internal electrode 3a (3b) and a dummy electrode 10 in a state divided into two.

この積層セラミックコンデンサにおいては、図6(b)に示すように、ダミー電極10の長さを、内部電極3a,3b(図6(b)では内部電極3a)の引き出し方向への位置ずれ許容量より短くしている。   In this multilayer ceramic capacitor, as shown in FIG. 6 (b), the length of the dummy electrode 10 is set to an allowable amount of displacement in the direction in which the internal electrodes 3a and 3b (internal electrode 3a in FIG. 6 (b)) are pulled out. It is shorter.

これにより、ダミー電極10の、セラミック積層素子1の端面への露出の有無を調べることにより、内部電極3a,3b(図6(b)では内部電極3a)の引き出し方向への位置ずれ量が許容値(内部電極3a(3b)の端部とセラミック積層素子1の端面の間に確保すべきギャップGの大きさの目標値)の範囲内にあるか否かを判定することが可能になる。
すなわち、内部電極の引き出し方向への位置ずれ量が許容範囲を超えると、ダミー電極の位置もそれだけずれるため、セラミック積層素子1の端面に露出しなくなり、内部電極の引き出し方向への位置ずれ量が許容範囲を超えていることを検出することが可能になる。
As a result, by checking whether or not the dummy electrode 10 is exposed to the end face of the ceramic multilayer element 1, the positional deviation amount of the internal electrodes 3 a and 3 b (internal electrode 3 a in FIG. 6B) in the lead-out direction is allowed. It is possible to determine whether the value is within the range of the value (target value of the size of the gap G to be secured between the end of the internal electrode 3a (3b) and the end face of the ceramic multilayer element 1).
That is, when the amount of positional deviation in the lead-out direction of the internal electrode exceeds the allowable range, the position of the dummy electrode is also shifted by that amount, so that it is not exposed at the end face of the ceramic multilayer element 1, and the amount of positional deviation in the lead-out direction of the internal electrode is It is possible to detect that the allowable range is exceeded.

<変形例2>
図7(a)は、変形例2にかかる積層セラミックコンデンサの、引き出し部領域13で切断する前の内部電極パターン20およびダミー電極パターン30の形状および配設態様を示す図であり、図7(b)は、個々のセラミック積層素子1に分割した状態の内部電極3a(3b)とダミー電極10の構成および位置関係を示す図である。なお、図7(a),(b)において、図6(a),(b)と同一符号を付した部分は同一または相当する部分を示している。
<Modification 2>
FIG. 7A is a diagram showing the shape and arrangement of the internal electrode pattern 20 and the dummy electrode pattern 30 before cutting in the lead portion region 13 of the multilayer ceramic capacitor according to Modification 2. FIG. 4B is a diagram showing the configuration and positional relationship between the internal electrode 3a (3b) and the dummy electrode 10 in a state of being divided into individual ceramic multilayer elements 1; 7A and 7B, the same reference numerals as those in FIGS. 6A and 6B denote the same or corresponding parts.

この積層セラミックコンデンサにおいては、図7(b)に示すように、上記実施例1と同じ構成で、ダミー電極10の内側に、さらに、ダミー電極10よりも長さの短い第2のダミー電極10aが配設されている。したがって、第2のダミー電極10aの、セラミック積層素子1の端面への露出の有無により、内部電極3a,3b(図7(b)では内部電極3a)の引き出し方向への位置ずれ量が許容範囲にあるか否かを判定することが可能になる。なお、内部電極3a(3b)の幅方向への許容範囲を超える位置ずれは、ダミー電極10により検出することができる。   In this multilayer ceramic capacitor, as shown in FIG. 7B, the second dummy electrode 10a having the same configuration as that of the first embodiment is disposed inside the dummy electrode 10 and shorter than the dummy electrode 10. Is arranged. Therefore, the positional deviation amount of the internal electrodes 3a and 3b (internal electrode 3a in FIG. 7B) in the lead-out direction is within an allowable range depending on whether or not the second dummy electrode 10a is exposed to the end face of the ceramic multilayer element 1. It is possible to determine whether or not it exists. A positional deviation exceeding the allowable range in the width direction of the internal electrode 3a (3b) can be detected by the dummy electrode 10.

<変形例3>
図8(a)は、変形例3にかかる積層セラミックコンデンサの、引き出し部領域13で切断する前の内部電極パターン20およびダミー電極パターン30の形状および配設態様を示す図であり、図8(b)は、個々のセラミック積層素子1に分割した状態の内部電極3a(3b)とダミー電極10の構成および位置関係を示す図である。なお、図8(a),(b)において、図6(a),(b)と同一符号を付した部分は同一または相当する部分を示している。
<Modification 3>
FIG. 8A is a diagram showing the shapes and arrangement of the internal electrode pattern 20 and the dummy electrode pattern 30 before cutting in the lead region 13 of the multilayer ceramic capacitor according to Modification 3. FIG. 4B is a diagram showing the configuration and positional relationship between the internal electrode 3a (3b) and the dummy electrode 10 in a state of being divided into individual ceramic multilayer elements 1; 8A and 8B, the same reference numerals as those in FIGS. 6A and 6B denote the same or corresponding parts.

この積層セラミックコンデンサにおいては、図8(b)に示すように、引き出し部13a,13b(図8(b)では引き出し部13a)の両側のダミー電極として、長さの長いダミー電極10と長さの短いダミー電極10(10b)を配設しているので、内部電極3a,3b(図8(b)では内部電極3a)の引き出し方向への位置ずれを長さの短い方のダミー電極10(10b)により検出し、内部電極3a(3b)の幅方向への位置ずれの有無は、長さの長い方のダミー電極10により検出することができる。   In this multilayer ceramic capacitor, as shown in FIG. 8B, a dummy electrode 10 having a long length and a length as dummy electrodes on both sides of the lead portions 13a and 13b (the lead portion 13a in FIG. 8B) are used. Since the short dummy electrode 10 (10b) is disposed, the displacement of the internal electrodes 3a and 3b (internal electrode 3a in FIG. 8B) in the pulling direction is shifted to the shorter dummy electrode 10 ( 10b), and whether or not the internal electrode 3a (3b) is displaced in the width direction can be detected by the dummy electrode 10 having the longer length.

<変形例4>
図9(a)は、変形例4にかかる積層セラミックコンデンサの、引き出し部領域13で切断する前の内部電極パターン20およびダミー電極パターン30の形状および配設態様を示す図であり、図9(b)は、個々のセラミック積層素子1に分割した状態の内部電極3a(3b)とダミー電極10の構成および位置関係を示す図である。なお、図9(a),(b)において、図6(a),(b)と同一符号を付した部分は同一または相当する部分を示している。
<Modification 4>
FIG. 9A is a diagram showing the shapes and arrangement of the internal electrode pattern 20 and the dummy electrode pattern 30 before cutting in the lead portion region 13 of the multilayer ceramic capacitor according to Modification 4. FIG. 4B is a diagram showing the configuration and positional relationship between the internal electrode 3a (3b) and the dummy electrode 10 in a state of being divided into individual ceramic multilayer elements 1; 9A and 9B, the same reference numerals as those in FIGS. 6A and 6B indicate the same or corresponding parts.

この積層セラミックコンデンサにおいては、図9(b)に示すように、ダミー電極10の形状を、内部電極3a,3b(図9(b)では内部電極3a)の引き出し方向の位置により幅が異なるような扁平な3角形の形状としている。
したがって、内部電極の引き出し方向に位置ずれが生じた場合、セラミック積層素子1の端面に露出したダミー電極10の幅が変化するため、セラミック積層素子1の端面に露出したダミー電極の幅を調べることにより、内部電極3a(3b)の幅方向への許容範囲を超えた位置ずれの有無、および、内部電極3a(3b)の引き出し方向の位置ずれ量を検出することが可能になる。
In this multilayer ceramic capacitor, as shown in FIG. 9B, the width of the dummy electrode 10 varies depending on the position of the internal electrodes 3a and 3b (internal electrode 3a in FIG. 9B) in the lead-out direction. It has a flat, triangular shape.
Therefore, when the positional deviation occurs in the direction in which the internal electrode is drawn, the width of the dummy electrode 10 exposed at the end face of the ceramic multilayer element 1 changes, so the width of the dummy electrode exposed at the end face of the ceramic multilayer element 1 is examined. Accordingly, it is possible to detect whether or not the internal electrode 3a (3b) is misaligned beyond the allowable range in the width direction and the amount of misalignment in the lead-out direction of the internal electrode 3a (3b).

<変形例5>
図10は、変形例5にかかる積層セラミックコンデンサの側面断面図である。 この積層セラミックコンデンサにおいては、図10に示すように、ダミー電極10を、各内部電極3a(3b)のそれぞれの両側には配置せず、各内部電極3a(3b)の引き出し部13a,13bの一方側にのみダミー電極10を配設し、互いに対向する一対の内部電極の引き出し部についてみた場合には、その両側にダミー電極10が配設された構造となるように構成されている。この構成の場合にも、内部電極の幅方向の位置ずれを検出することが可能になる。
<Modification 5>
FIG. 10 is a side cross-sectional view of a multilayer ceramic capacitor according to Modification 5. In this multilayer ceramic capacitor, as shown in FIG. 10, the dummy electrodes 10 are not disposed on both sides of each internal electrode 3a (3b), and the lead portions 13a and 13b of each internal electrode 3a (3b) are not provided. When the dummy electrode 10 is disposed only on one side and the lead portions of the pair of internal electrodes facing each other are viewed, the dummy electrode 10 is disposed on both sides thereof. Also in this configuration, it is possible to detect a positional shift in the width direction of the internal electrode.

<変形例6>
図11は、変形例6にかかる積層セラミックコンデンサの側面断面図である。 この積層セラミックコンデンサにおいては、図11に示すように、ダミー電極10を、所定の内部電極3a(3b)の引き出し部13a,13bの一方側にのみ配設し、所定の複数の内部電極についてみた場合には、両側にダミー電極10が配設された構造となるように構成されている。この構成の場合にも、内部電極の幅方向の位置ずれを検出することが可能になる。
<Modification 6>
FIG. 11 is a side sectional view of a multilayer ceramic capacitor according to Modification 6. In this multilayer ceramic capacitor, as shown in FIG. 11, the dummy electrode 10 is disposed only on one side of the lead portions 13a and 13b of the predetermined internal electrode 3a (3b), and the predetermined plurality of internal electrodes are viewed. In this case, the dummy electrode 10 is arranged on both sides. Also in this configuration, it is possible to detect a positional shift in the width direction of the internal electrode.

なお、本願発明は、上記実施例および変形例に限定されるものではなく、内部電極およびダミー電極の具体的な形状や積層数、ダミー電極の配設態様などに関し、発明の範囲内において、種々の応用、変形を加えることができる。   The invention of the present application is not limited to the above-described embodiments and modifications, and various modifications can be made within the scope of the invention with respect to the specific shape and number of stacked internal electrodes and dummy electrodes, the arrangement of dummy electrodes, and the like. Application and deformation can be added.

本願発明においては、所定の内部電極の、容量形成部の両側辺を内部電極の引き出し方向に延長した、一方側および他方側の2本の延長線のうち、一方側、および/または、他方側の延長線上に少なくともその一部が位置するように、容量形成に寄与しないダミー電極を配設し、セラミック積層素子の端面へのダミー電極の露出状態により、内部電極の位置ずれ量が許容範囲にあるか否かを判定するようにしているので、内部電極の許容範囲を超える位置ずれを確実に検出して、信頼性の高い積層セラミックコンデンサを確実に供給することが可能になる。
したがって、本願発明は、内部電極の引き出し部の幅を容量形成部よりも狭くした構造を有する積層セラミックコンデンサおよびその製造方法に広く適用することが可能である。
In the present invention, one side and / or the other side of the two extension lines on one side and the other side, in which both sides of the capacitance forming portion of the predetermined internal electrode are extended in the direction of drawing out the internal electrode A dummy electrode that does not contribute to the capacitance formation is disposed so that at least a part of the dummy electrode is located on the extended line of the electrode. Since it is determined whether or not there is, it is possible to reliably detect a positional deviation exceeding the allowable range of the internal electrodes and reliably supply a highly reliable multilayer ceramic capacitor.
Therefore, the present invention can be widely applied to a multilayer ceramic capacitor having a structure in which the width of the lead portion of the internal electrode is narrower than that of the capacitance forming portion, and a method for manufacturing the same.

(a)は本願発明の一実施例にかかる積層セラミックコンデンサを構成するセラミック積層素子の、内部電極およびダミー電極の配設態様を示す透視平面図、(b)は内部電極の形状を示す分解斜視図、(c)は(a)のC−C線断面図(側面断面図)である。(a) is a perspective plan view showing the arrangement of internal electrodes and dummy electrodes of a ceramic multilayer element constituting a multilayer ceramic capacitor according to an embodiment of the present invention, and (b) is an exploded perspective view showing the shape of the internal electrodes. FIG. 4C is a cross-sectional view (side cross-sectional view) taken along the line CC of FIG. (a)は本願発明の一実施例にかかる積層セラミックコンデンサの正面断面図、(b)は斜視図である。(a) is front sectional drawing of the multilayer ceramic capacitor concerning one Example of this invention, (b) is a perspective view. 本願発明の積層セラミックコンデンサの製造に用いた、セラミックグリーンシートに配設した内部電極パターンおよびダミー電極パターンの形状および位置関係を示す平面図である。It is a top view which shows the shape and positional relationship of the internal electrode pattern and dummy electrode pattern which were arrange | positioned at the ceramic green sheet used for manufacture of the multilayer ceramic capacitor of this invention. 本願発明の積層セラミックコンデンサの製造に用いた、セラミックグリーンシートに配設した内部電極パターンおよびダミー電極パターンの重なり状態を示す図である。It is a figure which shows the overlapping state of the internal electrode pattern and dummy electrode pattern which were arrange | positioned at the ceramic green sheet used for manufacture of the multilayer ceramic capacitor of this invention. (a),(b),(c)は、本願発明の一実施例にかかる積層セラミックコンデンサを構成するセラミック積層素子の端面への内部電極の引き出し部の露出状態を示す図である。(a), (b), (c) is a figure which shows the exposure state of the drawer | drawing-out part of the internal electrode to the end surface of the ceramic multilayer element which comprises the multilayer ceramic capacitor concerning one Example of this invention. (a)は、変形例1における、引き出し部領域で切断する前の内部電極パターンおよびダミー電極パターンの形状および配設態様を示す図であり、(b)は、個々のセラミック積層素子に分割した状態の内部電極とダミー電極の構成および位置関係を示す図である。(a) is a figure which shows the shape and arrangement | positioning aspect of the internal electrode pattern and dummy electrode pattern before cut | disconnecting in the extraction | drawer part area | region in the modification 1, (b) divided | segmented into each ceramic multilayer element It is a figure which shows the structure and positional relationship of a state internal electrode and a dummy electrode. (a)は、変形例2における、引き出し部領域で切断する前の内部電極パターンおよびダミー電極パターンの形状および配設態様を示す図であり、(b)は、個々のセラミック積層素子に分割した状態の内部電極とダミー電極の構成および位置関係を示す図である。(a) is a figure which shows the shape and arrangement | positioning aspect of an internal electrode pattern and a dummy electrode pattern before cut | disconnecting in the extraction | drawer part area | region in the modification 2, (b) was divided | segmented into each ceramic multilayer element It is a figure which shows the structure and positional relationship of a state internal electrode and a dummy electrode. (a)は、変形例3における、引き出し部領域で切断する前の内部電極パターンおよびダミー電極パターンの形状および配設態様を示す図であり、(b)は、個々のセラミック積層素子に分割した状態の内部電極とダミー電極の構成および位置関係を示す図である。(a) is a figure which shows the shape and arrangement | positioning aspect of the internal electrode pattern and dummy electrode pattern before cut | disconnecting in the extraction | drawer part area | region in the modification 3, (b) divided | segmented into each ceramic multilayer element It is a figure which shows the structure and positional relationship of a state internal electrode and a dummy electrode. (a)は、変形例4における、引き出し部領域で切断する前の内部電極パターンおよびダミー電極パターンの形状および配設態様を示す図であり、(b)は、個々のセラミック積層素子に分割した状態の内部電極とダミー電極の構成および位置関係を示す図である。(a) is a figure which shows the shape and arrangement | positioning aspect of the internal electrode pattern and dummy electrode pattern before cut | disconnecting in the extraction | drawer part area | region in the modification 4, (b) was divided | segmented into each ceramic laminated element It is a figure which shows the structure and positional relationship of a state internal electrode and a dummy electrode. 本願発明の積層セラミックコンデンサのさらに他の変形例を示す図である。It is a figure which shows the further another modification of the multilayer ceramic capacitor of this invention. 本願発明の積層セラミックコンデンサのさらに他の変形例を示す図である。It is a figure which shows the further another modification of the multilayer ceramic capacitor of this invention. (a)は、従来の積層セラミックコンデンサの正面断面図、(b)は斜視図である。(a) is front sectional drawing of the conventional multilayer ceramic capacitor, (b) is a perspective view. 従来の他の積層セラミックコンデンサの内部電極の形状を示す図である。It is a figure which shows the shape of the internal electrode of the other conventional multilayer ceramic capacitor. 従来の積層セラミックコンデンサの問題点を説明するためのセラミック積層素子の側面断面図である。It is side surface sectional drawing of the ceramic multilayer element for demonstrating the problem of the conventional multilayer ceramic capacitor.

符号の説明Explanation of symbols

1 セラミック積層素子
2 セラミック層
3a,3b 内部電極
4a,4b 外部電極
5 Niめっき膜
6 Snめっき膜
7a,7b 容量形成部
10 ダミー電極
10a 第2のダミー電極
10b 長さの短いダミー電極
13 引き出し部領域
13a,13b 引き出し部
17a,17b 容量形成部領域
20(20a,20b) 内部電極パターン
21 セラミックグリーンシート
30 ダミー電極パターン
G 内部電極の端部とセラミック積層素子の端面の間のギャップ
X,Y 内部電極の容量形成部からの延長線
X’,Y’ 内部電極パターンの容量形成部領域からの延長線
1,W01 引き出し部の幅
2,W02 容量形成部の幅
DESCRIPTION OF SYMBOLS 1 Ceramic laminated element 2 Ceramic layer 3a, 3b Internal electrode 4a, 4b External electrode 5 Ni plating film 6 Sn plating film 7a, 7b Capacity | capacitance formation part 10 Dummy electrode 10a 2nd dummy electrode 10b Short dummy electrode 13 Lead-out part Region 13a, 13b Lead-out portion 17a, 17b Capacitance formation region 20 (20a, 20b) Internal electrode pattern 21 Ceramic green sheet 30 Dummy electrode pattern G Gap between end of internal electrode and end face of ceramic multilayer element X, Y Internal Extension lines X ', Y' from the electrode capacitance forming portion Extension lines from the capacitance forming portion region of the internal electrode pattern W 1 , W 01 Lead width W 2 , W 02 Capacitance formation width

Claims (7)

複数の内部電極がセラミック層を介して互いに対向するように配設され、かつ、その一端側が交互に異なる側の端面に引き出されたセラミック積層素子の両端側に、内部電極と導通するように外部電極が配設された構造を有する積層セラミックコンデンサにおいて、
セラミック積層素子の端面への内部電極の引き出し部の幅が、内部電極の容量形成に寄与する容量形成部の幅より狭く形成されているとともに、
所定の内部電極の、容量形成部の両側辺を、内部電極引き出し方向に延長した一方側および他方側の延長線のうち、一方側、および/または、他方側の延長線上に少なくともその一部が位置するように、容量形成に寄与しないダミー電極が配設され、かつ、
所定の一つの内部電極についてみた場合、および/または、所定の複数の内部電極についてみた場合に、ダミー電極が一方側の延長線上および他方側の延長線上に位置しており、
セラミック積層素子の端面へのダミー電極の露出状態を調べることにより、少なくとも内部電極の幅方向への位置ずれ量が許容範囲にあるか否かを判定できるように構成されていること
を特徴とする積層セラミックコンデンサ。
A plurality of internal electrodes are arranged so as to face each other through the ceramic layer, and external ends are connected to the internal electrodes at both end sides of the ceramic multilayer element in which one end side is alternately drawn to the end face on the different side. In a multilayer ceramic capacitor having a structure in which electrodes are arranged,
The width of the lead portion of the internal electrode to the end face of the ceramic multilayer element is formed narrower than the width of the capacitance forming portion that contributes to the capacitance formation of the internal electrode,
At least a part of one side and / or the other side of the extension line on one side and the other side of both sides of the capacitance forming portion of the predetermined internal electrode extending in the direction of drawing out the internal electrode. A dummy electrode that does not contribute to capacitance formation is disposed, and
When viewed with respect to one predetermined internal electrode and / or when viewed with respect to a plurality of predetermined internal electrodes, the dummy electrode is located on the extension line on one side and the extension line on the other side,
By examining the exposure state of the dummy electrode on the end face of the ceramic multilayer element, it is possible to determine whether or not at least the amount of positional deviation in the width direction of the internal electrode is within an allowable range. Multilayer ceramic capacitor.
前記ダミー電極が、各内部電極の容量形成部の両側辺を内部電極の引き出し方向に延長した一方側および他方側の両方の延長線上に配設されていることを特徴とする請求項1記載の積層セラミックコンデンサ。   2. The dummy electrode according to claim 1, wherein the dummy electrode is arranged on both one side and the other side of the extension of the capacitance forming portion of each internal electrode extending in the direction of drawing out the internal electrode. Multilayer ceramic capacitor. 前記ダミー電極として、内部電極の引き出し方向長さが、内部電極の引き出し方向への位置ずれ許容範囲より短いダミー電極を備えており、該ダミー電極のセラミック積層素子の端面への露出の有無により、内部電極の引き出し方向への位置ずれ量が許容範囲にあるか否かを判定できるように構成されていることを特徴とする請求項1または2記載の積層セラミックコンデンサ。   As the dummy electrode, the length of the internal electrode in the lead-out direction is provided with a dummy electrode that is shorter than the positional deviation allowable range in the lead-out direction of the internal electrode, and depending on whether the dummy electrode is exposed to the end face of the ceramic multilayer element, 3. The multilayer ceramic capacitor according to claim 1, wherein the multilayer ceramic capacitor is configured so as to be able to determine whether or not a positional deviation amount in the lead-out direction of the internal electrode is within an allowable range. 前記ダミー電極の形状を、内部電極の引き出し方向の位置により幅が異なるような形状として、セラミック積層素子の端面に露出したダミー電極の幅により、内部電極の引き出し方向への位置ずれ量が許容範囲にあるか否かを判定できるように構成されていることを特徴とする請求項1または2記載の積層セラミックコンデンサ。   The shape of the dummy electrode is shaped so that the width varies depending on the position of the internal electrode in the drawing direction, and the positional deviation amount in the drawing direction of the internal electrode is within an allowable range depending on the width of the dummy electrode exposed on the end face of the ceramic multilayer element. The multilayer ceramic capacitor according to claim 1, wherein the multilayer ceramic capacitor is configured so as to be able to determine whether or not the capacitor is present. 前記ダミー電極と平行に、ダミー電極よりも長さの短い第2のダミー電極を配設し、セラミック積層素子の端面への第2のダミー電極の露出の有無により、内部電極の引き出し方向への位置ずれ量が許容範囲にあるか否かを判定できるように構成されていることを特徴とする請求項1または2記載の積層セラミックコンデンサ。   A second dummy electrode having a length shorter than that of the dummy electrode is disposed in parallel with the dummy electrode. Depending on whether the second dummy electrode is exposed on the end surface of the ceramic multilayer element, the second dummy electrode is exposed in the direction of drawing out the internal electrode. The multilayer ceramic capacitor according to claim 1, wherein the multilayer ceramic capacitor is configured to be able to determine whether or not the positional deviation amount is within an allowable range. 複数の内部電極がセラミック層を介して互いに対向するように配設され、かつ、その一端側が交互に異なる側の端面に引き出されたセラミック積層素子の両端側に、内部電極と導通するように外部電極が配設された構造を有する積層セラミックコンデンサの製造方法において、
一対の容量形成部領域を両端側に備え、中央部に両端側の容量形成部領域を接続する、容量形成部の幅よりも幅の狭い、引き出し部領域を備え、引き出し部領域で切断することにより2個の内部電極に分割される複数の内部電極パターンと、所定の内部電極パターンを構成する一方の容量形成部領域の両側辺を、他方側の容量形成部領域の両側辺に向かって延長した、一方側および他方側の延長線のうち、一方側、および/または、他方側の延長線上に少なくともその一部が位置するようにダミー電極パターンが配設されたセラミックグリーンシートを、交互に内部電極の引き出し方向となる方向に所定量だけ位置をずらせて積層、圧着して、マザー積層体を形成する工程と、
前記マザー積層体を、内部電極パターンの中央部の引き出し部領域が切断されるように所定の位置で切断することにより、内部電極を備え、かつ、所定の一つの内部電極についてみた場合、および/または、所定の複数の内部電極についてみた場合に、ダミー電極が一方側の延長線上および他方側の延長線上に位置する構造を有する個々の未焼成のセラミック積層素子に分割する工程と、
前記未焼成のセラミック積層素子を焼成する工程と、
焼成されたセラミック積層素子に外部電極を形成する工程と
を具備することを特徴とする積層セラミックコンデンサの製造方法。
A plurality of internal electrodes are arranged so as to face each other through the ceramic layer, and external ends are connected to the internal electrodes at both end sides of the ceramic multilayer element in which one end side is alternately drawn to the end face on the different side. In the method of manufacturing a multilayer ceramic capacitor having a structure in which electrodes are disposed,
A pair of capacitance forming region is provided at both ends, and a capacitance forming region at both ends is connected to the central portion, and has a leading portion region that is narrower than the width of the capacitance forming portion, and is cut at the leading portion region. And a plurality of internal electrode patterns divided into two internal electrodes and both sides of one capacitance forming portion region constituting the predetermined internal electrode pattern are extended toward both sides of the other capacitance forming portion region. The ceramic green sheets on which the dummy electrode patterns are arranged so that at least a part of the extension line on one side and / or the other side of the extension line on one side and / or the other side are located are alternately arranged. A step of forming a mother laminated body by laminating and crimping by a predetermined amount in the direction of the internal electrode drawing direction,
When the mother laminate is viewed at a predetermined position by cutting the mother stacked body at a predetermined position so that the lead-out region at the center of the internal electrode pattern is cut, and / Alternatively, when viewed with respect to a predetermined plurality of internal electrodes, the process of dividing the dummy electrode into individual unfired ceramic multilayer elements having a structure located on one extension line and on the other extension line;
Firing the green ceramic multilayer element;
And a step of forming an external electrode on the fired ceramic multilayer element.
前記セラミックグリーンシートとして、前記一方側および他方側の両方の延長線上にダミー電極パターンが配設されたセラミックグリーンシートを用いることを特徴とする請求項6記載の積層セラミックコンデンサの製造方法。   7. The method of manufacturing a multilayer ceramic capacitor according to claim 6, wherein the ceramic green sheet is a ceramic green sheet in which dummy electrode patterns are disposed on both of the extension lines on the one side and the other side.
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