JP3920649B2 - 画像表示装置および液晶表示装置 - Google Patents
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Description
【発明の属する技術分野】
本発明は画像表示装置に係り、特に、液晶を介して対向配置される各基板のうち一方の基板の液晶側の面に走査信号駆動回路および映像信号駆動回路が形成されている液晶表示装置に関する。
【0002】
【従来の技術】
液晶表示装置は、液晶を介して対向配置される各基板のうち一方の基板の液晶側の面に、並設された複数のゲート信号線とこれらゲート信号線に交差して並設された複数のドレイン信号線とが形成され、これら各信号線によって囲まれた各領域を画素領域とし、この画素領域にはゲート信号線からの走査信号によって作動されるスイッチング素子と、このスイッチング素子を介してドレイン信号線からの映像信号が供給される画素電極とが備えられている。
【0003】
そして、該一方の基板の液晶側の面であって、前記各ゲート信号線の少なくとも一端側にはそれぞれのゲート信号線に走査信号を順次供給するための走査信号駆動回路、前記各ドレイン信号線の少なくとも一端側には該走査信号の供給のタイミングに合わせて映像信号を供給するための映像信号駆動回路が形成されているものがある。
【0004】
【発明が解決しようとする課題】
しかし、このような構成の液晶表示装置は、その走査信号駆動回路あるいは映像信号駆動回路が基板の周辺部に位置づけられて配置されていることから、静電気の飛び込みによる不都合が生じやすいということが指摘されていた。
【0005】
また、背部にバックライトを配置させるようなものにあって、該バックライトからの光りが走査信号駆動回路あるいは映像信号駆動回路の形成部分を通して観察者側へ漏洩してしまうということも指摘されていた。
【0006】
さらに、走査信号駆動回路あるいは映像信号駆動回路はガラス等の基板面に形成していることから放熱効果が充分でなく、回路の誤動作の生じる畏れも指摘されていた。
【0007】
本発明は、このような事情に基づいてなされたもので、その目的は、走査信号駆動回路あるいは映像信号駆動回路への静電気の飛び込みを抑制できる液晶表示装置を提供することにある。
【0008】
また、本発明の他の目的は、走査信号駆動回路あるいは映像信号駆動回路の形成部分を通しての光漏れを抑制できる液晶表示装置を提供することにある。
【0009】
さらに、本発明の他の目的は、走査信号駆動回路あるいは映像信号駆動回路の誤動作を防止できる液晶表示装置を提供することにある。
【0010】
【課題を解決するための手段】
本願において開示される発明のうち、代表的なものの概要を簡単に説明すれば、以下のとおりである。
手段1.
本発明による液晶表示装置は、たとえば、液晶を介して対向配置される各基板の一方の基板の液晶側の面に液晶表示部を構成する各画素と、一方向に並設された各画素からなる画素群に共通のゲート信号線と容量線とが少なくとも形成され、
前記各ゲート信号線の少なくとも一端が接続された走査信号駆動回路と、この走査信号駆動回路を囲むようにして形成された配線層とを備え、
この配線層は液晶表示部と反対側のそれに対して液晶表示部側のそれは線幅が小さく形成されているとともに、
前記容量線は前記走査信号駆動回路を交差して液晶表示部と反対側の前記配線層に接続されていることを特徴とするものである。
【0011】
手段2.
本発明による液晶表示装置は、たとえば、液晶を介して対向配置される各基板の一方の基板の液晶側の面に液晶表示部を構成する各画素と、一方向に並設された各画素からなる画素群に共通のゲート信号線と容量線とが少なくとも形成され、
前記各ゲート信号線の少なくとも一端が接続された走査信号駆動回路と、この走査信号駆動回路を囲むようにして形成された配線層とを備え、
この配線層は液晶表示部と反対側のそれに対して液晶表示部側のそれは線幅が小さく形成されているとともに、
前記容量線は非透光性の材料から構成され、前記走査信号駆動回路の下層を交差して液晶表示部と反対側の前記配線層に接続されていることを特徴とするものである。
【0012】
手段3.
本発明による液晶表示装置は、たとえば、液晶を介して対向配置される各基板のうち一方の基板の液晶側の面に、並設された複数のゲート信号線とこれらゲート信号線に交差して並設された複数のドレイン信号線が形成され、
前記各信号線によって囲まれた領域を画素領域およびこれら画素領域の集合体を液晶表示部とし、
前記画素領域には、ゲート信号線からの走査信号によって駆動されるスイッチング素子と、このスイッチング素子を介してドレイン信号線からの映像信号が供給される画素電極と、対向電圧信号線に接続され前記画素電極との間に電界を生じせしめる対向電極とを備え、
前記対向電極は絶縁層を介して前記ドレイン信号線およびゲート信号線を被うようにして形成された部分を有して対向電圧信号線とともに形成され、
前記各ゲート信号線の少なくとも一端が接続された走査信号駆動回路と、この走査信号駆動回路を囲むようにして形成された配線層とを備え、
この配線層は液晶表示部と反対側のそれに対して液晶表示部側のそれは線幅が小さく形成されているとともに、
前記対向電圧信号線は、前記走査信号駆動回路の上層を交差して液晶表示部と反対側の前記配線層に接続されていることを特徴とするものである。
【0013】
手段4.
本発明による液晶表示装置は、たとえば、手段3の構成を前提として、前記対向電圧信号線は、前記走査信号駆動回路の形成領域の全域を被って形成されていることを特徴とするものである。
【0014】
手段5.
本発明による液晶表示装置は、たとえば、液晶を介して対向配置される各基板のうち一方の基板の液晶側の面に、並設された複数のゲート信号線とこれらゲート信号線に交差して並設された複数のドレイン信号線が形成され、
前記各信号線によって囲まれた領域を画素領域およびこれら画素領域の集合体を液晶表示部とし、
前記画素領域には、ゲート信号線からの走査信号によって駆動されるスイッチング素子と、このスイッチング素子を介してドレイン信号線からの映像信号が供給される画素電極と、対向電圧信号線に接続され前記画素電極との間に電界を生じせしめる対向電極とを備え、
前記対向電極は絶縁層を介して前記ドレイン信号線およびゲート信号線を被うようにして形成された部分を有して対向電圧信号線とともに形成され、
前記各ドレイン信号線の一端が接続された映像信号駆動回路と、この映像信号駆動回路に対して液晶表示部と反対側に該映像信号駆動回路に沿って形成された配線層とを備え、
前記対向電圧信号線は、前記映像信号駆動回路の上層を交差して前記配線層に接続されていることを特徴とするものである。
【0015】
手段6.
本発明による液晶表示装置は、たとえば、液晶を介して対向配置される各基板のうち一方の基板の液晶側の面に、並設された複数のゲート信号線とこれらゲート信号線に交差して並設された複数のドレイン信号線が形成され、
前記各信号線によって囲まれた領域を画素領域およびこれら画素領域の集合体を液晶表示部とし、
前記画素領域には、ゲート信号線からの走査信号によって駆動されるスイッチング素子と、このスイッチング素子を介してドレイン信号線からの映像信号が供給される画素電極と、対向電圧信号線に接続され前記画素電極との間に電界を生じせしめる対向電極とを備え、
前記対向電極は絶縁層を介して前記ドレイン信号線およびゲート信号線を被うようにして形成された部分を有して対向電圧信号線とともに形成され、
前記各ドレイン信号線の一端が接続されたドレイン分配回路を含む映像信号駆動回路と、前記ドレイン分配回路を囲むようにして形成された配線層とを備え、この配線層は液晶表示部と反対側のそれに対して液晶表示部側のそれは線幅が小さく形成されているとともに、
前記対向電圧信号線は、前記映像信号駆動回路の上層を交差して前記配線層に接続されていることを特徴とするものである。
【0016】
手段7.
本発明による液晶表示装置は、たとえば、手段5、6のうちいずれかの構成を前提として、前記対向電圧信号線は、前記映像信号駆動回路の形成領域の全域を被って形成されていることを特徴とするものである。
【0017】
手段8.
本発明による液晶表示装置は、たとえば、液晶を介して対向配置される各基板のうち一方の基板の液晶側の面に、並設された複数のゲート信号線とこれらゲート信号線に交差して並設された複数のドレイン信号線が形成され、
前記各信号線によって囲まれた領域を画素領域およびこれら画素領域の集合体を液晶表示部とし、
前記画素領域には、ゲート信号線からの走査信号によって駆動されるスイッチング素子と、このスイッチング素子を介してドレイン信号線からの映像信号が供給される画素電極と備え、
前記ドレイン信号線の一端に映像信号駆動回路を備えるとともに、他端にイコライズ回路とこのイコライズ回路を囲むようにして形成された配線層とを備え、この配線層は液晶表示部と反対側のそれに対して液晶表示部側のそれは線幅が小さく形成されていることを特徴とするものである。
【0018】
手段9.
本発明による液晶表示装置は、たとえば、手段8の構成を前提として、前記対向電圧信号に接続され前記画素電極との間に電界を生じせしめる対向電極を備えるとともに、前記対向電圧信号線は前記イコライズ回路に対して液晶表示部と反対側の前記配線層に該イコライズ回路を交差して接続されていることを特徴とするものである。
【0019】
手段10.
本発明による液晶表示装置は、たとえば、液晶を介して対向配置される各基板のうち一方の基板の液晶側の面に、並設された複数のゲート信号線とこれらゲート信号線に交差して並設された複数のドレイン信号線が形成され、
前記各信号線によって囲まれた領域を画素領域およびこれら画素領域の集合体を液晶表示部とし、
前記画素領域には、ゲート信号線からの走査信号によって駆動されるスイッチング素子と、このスイッチング素子を介してドレイン信号線からの映像信号が供給される画素電極と、対向電圧信号線に接続され前記画素電極との間に電界を生じせしめる対向電極とが備えられ、
前記ドレイン信号線の一端に映像信号駆動回路を備えるとともに、他端にイコライズ回路とこのイコライズ回路に対して液晶表示部と反対側に配線層とを備え、
前記対向電圧信号線は該イコライズ回路を交差して前記配線層に接続されていることを特徴とするものである。
【0020】
なお、本発明は以上の構成に限定されず、本発明の技術思想を逸脱しない範囲で種々の変更が可能である。
【0021】
【発明の実施の形態】
以下、本発明による液晶表示装置の実施例を図面を用いて説明をする。
実施例1.
《全体の構成》
図2は、本発明による液晶表示装置の一実施例を示す全体構成図であり、液晶を介して対向される各透明基板のうち一方の透明基板の液晶側の面の構成を示している。
【0022】
同図において、一方の透明基板SUB1の周辺を除く中央部には、そのx方向に延在しy方向に並設されるゲート信号GL1、GL2、……(以下、単にゲート信号線GLと称する場合がある)と、y方向に延在しx方向に並設されるドレイン信号線DL1、DL2、……(以下、単にドレイン信号線DLと称する場合がある)とが形成されている。
【0023】
これら各ゲート信号線GLとドレイン信号線DLとで囲まれた各領域を画素領域とし、これら各画素領域の集合体を液晶表示部ARとして構成されている。各画素領域の詳細な構成は後に説明する。
【0024】
各ゲート信号線GLの両端側のそれぞれは走査信号駆動回路GSCL、GSCRに接続され、この走査信号駆動回路GSCL、GSCRによって各ゲート信号線GLに順次走査信号が供給されるようになっている。これら各走査信号駆動回路GSCL、GSCRは例えばポリシリコンを半導体層とする多数のMIS(metal insulator semiconductor)型トランジスタとこれらMIS型トランジスタを接続するための配線層で形成され、透明基板SUB1の表面に形成されたものとなっている。
【0025】
また、各ドレイン信号線DLの一端側(図中上側)のそれぞれは映像信号駆動回路に接続されている。この映像信号駆動回路はドレイン信号線DL側に形成されるドレイン分配回路DDCとそれ以外の回路IDCとで構成されている。
【0026】
ここで、ドレイン分配回路DDCは例えばポリシリコンを半導体層とする多数のMIS型トランジスタとこれらMIS型トランジスタを接続するための配線層で形成され、透明基板SUB1の表面形成されてものとなっている。また、それ以外の回路IDCは透明基板SUB1に搭載される半導体チップからなる半導体層から構成されている。
【0027】
また、各ドレイン信号線DLの他端側(図中下側)のそれぞれはイコライズ回路EQCに接続されている。このイコライズ回路EQCも例えばポリシリコンを半導体層とする多数のMIS型トランジスタとこれらMIS型トランジスタを接続するための配線層で形成されている。
【0028】
なお、前記走査信号駆動回路GSCL、GSCR、ドレイン分配回路DDCとそれ以外の回路IDCには電源・コントロール回路SCCから電源あるいは信号が供給されるようになっている。
【0029】
図3は、前記画素領域の等価回路を示すものである。ゲート信号線GLからの走査信号によってオンする薄膜トランジスタTFTと、この薄膜トランジスタTFTを介してドレイン信号線DLからの映像信号が供給される画素電極PXと、この画素電極PXに対向して配置され該画素電極PXとの間で電界を生じせしめる対向電極CTとが備えられている。
【0030】
該対向電極CTは、対向電圧信号線CLを介して映像信号に対して基準となる信号が供給されるようになっている。
【0031】
画素電極PXと対向電極CTの間に生じる電界のうち透明基板SUB1と平行な成分によって液晶の光透過率を制御するようになっている。
【0032】
また、画素電極PXと対向電圧信号線CLとの間には容量素子Cstgが形成されており、この容量素子Cstgによって該画素電極PXに供給される映像信号を比較的長い時間蓄積させるようになっている。
なお、前記薄膜トランジスタTFTはその半導体層がポリシリコンで形成されている。
【0033】
そして、この薄膜トランジスタTFTはその構成が前記走査信号駆動回路GSCL、GSCR、ドレイン分配回路DDCの構成部品であるMIS型トランジスタとほぼ同様であるから、画素領域の構成の製造に並行して該前記走査信号駆動回路GSCL、GSCR、ドレイン分配回路DDCが製造されるようになっている。
【0034】
《画素の構成》
図4(a)は前記画素領域における構成の一実施例を示す平面図、図4(b)は図4(a)のb−b線における断面図を示している。
【0035】
各図において、まず、透明基板SUB1の表面に下地絶縁膜ULSが形成され、この下地絶縁膜USLの表面の一部にはポリシリコンからなる半導体層PSが形成されている。この半導体層PSは薄膜トランジスタTFTのそれとなるものである。
【0036】
そして、この半導体層PSをも被って透明基板SUB1の表面の全域には絶縁膜GIが形成されている。この絶縁膜GIは該薄膜トランジスタTFTのゲート絶縁膜として機能するようになる。
【0037】
また、この絶縁膜GIの表面には、x方向に延在しy方向に並設されるゲート信号線GL1、GL2(以下、ゲート信号線GLと称する場合がある)が形成されている。
【0038】
これらゲート信号線GLは後述のドレイン信号線DLとともに矩形状の領域を囲むようになっており、この領域を画素領域として構成するようになっている。
【0039】
この場合、ゲート信号線GLは前記半導体層PSを横切るようにして形成され、該半導体層PSとの重畳部は薄膜トランジスタTFTのゲート電極として機能するようになっている。
【0040】
さらに、各ゲート信号線GLの間のほぼ中央、換言すれば画素領域のほぼ中央には該ゲート信号線GLと並行に容量信号線CST1が形成されている。この容量信号線CST1はたとえば該ゲート信号線GLの形成の際に同時に形成されるようになっている。
【0041】
このようにゲート信号線GL、容量信号線CST1が形成された透明基板SUB1の表面には該各信号線をも被って層間絶縁膜IL1が全域に形成されている。
【0042】
そして、この層間絶縁膜IL1の表面にはy方向に延在しx方向に並設されるドレイン信号線DLが形成されている。
【0043】
このドレイン信号線DLは、層間絶縁膜IL1、絶縁膜GIを貫通して予め形成されたスルーホールCNT1を通して前記半導体層PSの一端部(ドレイン領域)と接続され、この部分において薄膜トランジスタTFTのドレイン電極を兼ねるようになっている。
【0044】
また、ドレイン信号線DLの形成の際に同時に、層間絶縁膜IL1のスルーホールCNT3によって露呈された前記容量信号線CST1の一部と接続されるパッド層PADが形成されるようになっている。このパッド層PADは後に説明する対向電極CTと接続されるための介在層となるものである。
【0045】
さらに、ドレイン信号線DLの形成の際に同時に画素電極PXが形成されるようになっている。この画素電極PXはy方向に延在されx方向に並設される複数(図では2本)の帯状の電極からなり、それらは容量信号線CST1の上方において、さらに各端部において一体的に互いに電気的接続がされたパターン(図ではほぼ日の字形)として形成されたものとなっている。
【0046】
そして、この画素電極PXの一部は、前記層間絶縁膜IL1、絶縁膜GIを貫通して予め形成されたスルーホールCNT2を通して前記半導体層PSの他端部(ソース領域)と接続され、この部分において薄膜トランジスタTFTのソース電極を兼ねるようになっている。
【0047】
そして、ドレイン信号線DL、画素電極PX等が形成された透明基板SUB1の表面には無機材料からなる保護膜PAS、有機材料からなる保護膜FPASが順次積層されて形成されている。
【0048】
これら各保護膜の積層体は、前記薄膜トランジスタTFTの液晶との直接の接触を回避するために形成され、またそれ自体の誘電率を低減させるようにしている。
【0049】
さらに、保護膜FPASの上面には対向電極CTが形成されている。この対向電極CTは、たとえばITO (Indium Tin Oxide)、ITZO(Indium Tin Zinc Oxide)、IZO (Indium Zinc Oxide)、SnO2(酸化スズ)、In2O3(酸化インジウム)等の透光性の材料から構成されている。
【0050】
この対向電極CTは前述の画素電極PXと同様にy方向に延在されx方向に並設された複数(図では3本)の電極群から構成され、かつ、それら各電極は、平面的に観た場合、前記画素電極PXを間にして位置付けられるようになっている。
【0051】
すなわち、対向電極CTと画素電極PXは、一方の側のドレイン信号線から他方の側のドレイン信号線にかけて、対向電極、画素電極、対向電極、画素電極、……、対向電極の順にそれぞれ等間隔に配置されている。
【0052】
ここで、画素領域の両側に位置づけられる対向電極CTは、その一部がドレイン信号線DLに重畳されて形成されているとともに、隣接する画素領域の対応する対向電極CTと共通に形成されている。
【0053】
換言すれは、ドレイン信号線DL上には対向電極CTがその中心軸をほぼ一致づけて重畳され、該対向電極CTの幅はドレイン信号線DLのそれよりも大きく形成されている。ドレイン信号線DLに対して左側の対向電極CTは左側の画素領域の各対向電極CTの一つを構成し、右側の対向電極CTは右側の画素領域の各対向電極CTの一つを構成するようになっている。
【0054】
このようにドレイン信号線DLの上方にて該ドレイン信号線DLよりも幅の広い対向電極CTを形成することにより、該ドレイン信号線DLからの電気力線が該対向電極CTに終端し画素電極PXに終端することを回避できるという効果を奏する。ドレイン信号線DLからの電気力線が画素電極PXに終端した場合、それがノイズとなってしまうからである。
【0055】
電極群からなる各対向電極CTは、ゲート信号線GLを充分に被って形成される同一の材料からなる対向電圧信号線CLと一体的に形成され、この対向電圧信号線CLを介して基準電圧が供給されるようになっている。
【0056】
ここで、液晶表示部AR外の領域において、該対向電圧信号線CLおよび対向電極CTに基準電圧信号を供給するための引出線CL1が、画素領域を画する各ゲート信号線GLのうちの一方のゲート信号線GLと容量信号線CST1との間にそれら信号線と平行に形成されている。
【0057】
なお、対向電極PTおよび対向電圧信号線CTの形成の際に同時に、前記画素電極PXと重畳するようにして透光性の画素電極PXTが形成されている。
【0058】
また、前記画素電極PXと容量信号線CST1との間には容量素子Cstgが形成され、この容量素子Cstgはたとえば画素電極PXに供給された映像信号を比較的長く蓄積させる等の機能をもたせるようになっている。図4では、この容量素子Cstgの容量を大きくするため、容量信号線CST1から各画素電極PXに重畳させるようにした延在部CPMを有するようになっている。
【0059】
《走査信号駆動回路周辺の構成》
図1は、前記走査信号駆動回路GSCLおよびその周辺の構成の一実施例を示す平面図である。
【0060】
同図において、まず、対向電圧信号線CLの引出線CL1および容量信号線CST1に接続される配線層COMが走査信号駆動回路GSCLを囲むようにして形成されている。
【0061】
この配線層COMは、前記走査信号駆動回路GSCLが配置されている側において2つの端子CPを備え、一方の端子CPから該走査信号駆動回路GSCLと液晶表示部ARの間を走行し、該走査信号駆動回路GSCLの該液晶表示部ARと反対側に及んで他方の端子CPに至って形成されている。
【0062】
これにより、該走査信号駆動回路GSCLは該配線層COMによって外部からの静電気から保護されるようになる。
【0063】
この場合、走査信号駆動回路GSCLに対して液晶表示部AR側の配線層COM2の線幅は液晶表示部ARと反対側の配線層COM1の線幅よりも細く形成されている。
【0064】
走査信号駆動回路GSCLからは液晶表示部AR側に多数のゲート信号線GLが走行され、これら各ゲート信号線GLと交差して形成しなければならない前記配線層COM2はその線幅を細くすることにより、それらの間に生じる寄生容量を大幅に低減させることができ、ゲート信号線GLの走査信号の遅延を低減させることができる。
【0065】
このことから、液晶表示部AR側の配線層COM2の線幅を細くした分に対応させて液晶表示部ARと反対側の配線層COM1の線幅を充分に太くすることによって、該配線層COM自体の電気的抵抗を高くさせないようにすることができる。
【0066】
また、液晶表示部ARの領域に形成される対向電圧信号CLは引出線CL1を介して液晶表示部AR側の前記配線層CPM2に接続され、容量信号線CST1は走査信号駆動回路GSCLを跨って(交差して)液晶表示部ARと反対側の前記配線層COM1に接続されるようになっている。
【0067】
この場合、容量信号線CST1は金属等のような非透光性の材料で構成されていることから、その部分において遮光機能を有するようになり、パネルの後方から前方にかけての光の漏れを低減させることができるようになる。また、放熱線の役割りをも有するようになり、該放熱線により走査信号駆動回路のGSCLの熱をパネル全面に拡散、放熱できるため、走査信号駆動回路GSCLの正常な動作を達成することができる。
【0068】
前記配線層COMは、たとえば図5に示すように走査信号駆動回路GSCLを完全に囲むようにし一つの端子CPから基準信号を供給するようにして形成するようにしてもよく、さらに図6、図7に示すように互いに最も離れた個所に二つの端子CPを設けそれらの各端子PCに基準信号を供給するようにして形成するようにしてもよいことはいうまでもない。
【0069】
走査信号駆動回路GSCLを囲むCOMは、少なくとも走査信号駆動回路GSCLの液晶表示部AR側と該液晶表示部ARと反対側に形成され、それらが互いに電気的に接続されていればよい。
【0070】
図8(a)は前記走査信号駆動回路GSCLの一部を示す平面図で、そのb−b線、c−c線、d−d線における各断面図を図8(b)、図8(c)、図8(d)に示している。
【0071】
図8(b)、(c)、(d)に示すように配線層COMは層間絶縁膜IL1の上面に形成され、たとえばドレイン信号線DLの形成の際に同時に形成されるようになっている。
【0072】
図8(b)に示すように、容量信号線CST1は走査信号駆動回路GSCL対して層間絶縁膜IL1を介した下層に位置づけられて該走査信号駆動回路GSCLと交差するようにして形成されている。前記配線層COM1との接続は該層間絶縁膜IL1に形成されたスルーホールを通してなされている。
【0073】
この場合の容量信号線CST1は金属で形成することにより、該走査信号駆動回路GSCLの部分において一部遮光機能を有するようになり、パネルの後方から前方にかけての光の漏れを低減させることができるようになる。また、放熱線の役割りをも有するようになり、走査信号駆動回路GSCLの正常な動作を達成することができる。
【0074】
図8(d)に示すように、対向電圧信号線CLの引出線CL1は保護膜FPASおよび保護膜PASを貫通するスルーホールを通して配線層に接続されるようになっている。
【0075】
実施例2.
図9は、本発明による液晶表示装置の他の実施例を示す平面図で、図1に対応した図となっている。
【0076】
図1と比較して異なる構成は、走査信号駆動回路GSCLに対して液晶表示部ARと反対側に形成される配線層COM1と接続される対向電圧信号線CLの引出線CL1は走査信号駆動回路GSCLの上層において該走査信号駆動回路GSCLと交差するようにして形成されていることにある。
【0077】
このようにすることによって、外部から走査信号駆動回路GSCLへの電磁波の飛び込みを該引出線CL1によって一部防止でき、外部ノイズによる走査信号駆動回路GSCLの誤動作を低減させることができる。
【0078】
この場合、容量信号線CST1は走査信号駆動回路GSCLに対して液晶表示部AR側の配線層COM2に接続されるようになっている。
【0079】
なお、この場合においても、前記配線層COMは、たとえば図10に示すように走査信号駆動回路GSCLを完全に囲むようにし一つの端子CPから基準信号を供給するようにして形成するようにしてもよく、さらに図11、図12に示すように互いに最も離れた個所に二つの端子CPを設けそれらの各端子CPに基準信号を供給するようにして形成するようにしてもよいことはいうまでもない。
【0080】
図13(a)は前記走査信号駆動回路の一部を示す平面図で、そのb−b線、c−c線、d−d線における各断面図を図13(b)、図13(c)、図13(d)に示している。
【0081】
図13(b)に示すように、対向電圧信号線CLの引出線CL1は走査信号駆動回路GSCLに対して上層に位置づけられて該走査信号駆動回路GSCLと交差するようにして形成され、保護膜FPAS、保護膜PASに貫通して形成されたスルーホールを通して配線層COM1に接続されている。
【0082】
図13(d)に示すように、容量信号線CST1はその上層の絶縁膜IL1を貫通するスルーホールを通して配線層COM2に接続されるようになっている。
【0083】
実施例3.
図14(a)は前記走査信号駆動回路の一部を示す平面図で、図13(a)と対応した図となっている。また、図14(a)のb−b線における断面図を図14(b)に示している。
【0084】
図13(a)の場合と比較して異なる構成は、対向電圧信号CLの引出線CL1は走査信号駆動回路GSCLの全域を被って形成されていることにある。
【0085】
このようにした場合、外部から走査信号駆動回路GSCLへの電磁波の飛び込みを該引出線CL1によってほぼ完全に防止でき、外部ノイズによる走査信号駆動回路GSCLの誤動作を防止させることができる。
【0086】
実施例4.
図15は、本発明による液晶表示装置の他の実施例を示す平面図で、図9に対応した図となっている。
【0087】
図9の場合と比較して異なる構成は、走査信号駆動回路GSCLを交差して形成される対向電圧信号CLの引出線CL1が液晶表示部ARと反対側の配線層COM1のみに限らず液晶表示部AR側の配線層COM2とも接続されていることにある。
【0088】
このように構成した場合、たとえ液晶表示部ARと反対側の配線層COM1が断線した場合にも、該対向電圧信号線CLには信頼性よく基準信号が供給される効果を奏する。
【0089】
なお、この場合においても、前記配線層COMは、たとえば図16に示すように走査信号駆動回路GSCLを完全に囲むようにし一つの端子CPから基準信号を供給するようにして形成するようにしてもよく、さらに図17、図18に示すように互いに最も離れた個所に二つの端子CPを設けそれらの各端子CPに基準信号を供給するようにして形成するようにしてもよいことはいうまでもない。
【0090】
図19(a)は前記走査信号駆動回路の一部を示す平面図で、そのb−b線、c−c線、d−d線における各断面図を図19(b)、図19(c)、図19(d)に示している。
【0091】
図19(b)に示すように、対向電圧信号線CLの引出線CL1は保護膜FPASおよび保護膜PASを貫通するスルーホールを通して液晶表示部ARと反対側の配線層COM1および液晶表示部AR側の配線層COM2と接続されている。
【0092】
また、この場合において、図20に示すように対向電圧信号線CLの引出線CL1は走査信号駆動回路GSCLの全域を被い、必要な個所にて液晶表示部ARと反対側の配線層COM1および液晶表示部AR側の配線層COM2に接続させるようにしてもよい。
【0093】
実施例5.
図21は、本発明による液晶表示装置の他の実施例を示す平面図で、図15に対応した図となっている。
【0094】
図15の場合と比較して異なる構成は、容量信号線CST1および対向電圧信号線CLの引出線CL1いずれも液晶表示部AR側の配線層COM2のみに接続された構成としたものである。
【0095】
なお、この場合においても、前記配線層COMは、たとえば図22に示すように走査信号駆動回路GSCLを完全に囲むようにし一つの端子CPから基準信号を供給するようにして形成するようにしてもよく、さらに図23、図24に示すように互いに最も離れた個所に二つの端子CPを設けそれらの各端子CPに基準信号を供給するようにして形成するようにしてもよいことはいうまでもない。
【0096】
図25(a)は前記走査信号駆動回路の一部を示す平面図で、そのb−b線、c−c線、d−d線における各断面図を図25(b)、図25(c)、図25(d)に示している。
【0097】
図25(b)に示すように、対向電圧信号線CLの引出線CL1は保護膜FPASおよび保護膜PASを貫通するスルーホールを通して液晶表示部AR側の配線層COM2と接続されている。
【0098】
また、図25(d)に示すように、容量信号線CST1はその上層に形成された層間絶縁膜IL1に形成されたスルーホールを通して液晶表示部AR側の配線層COM2と接続されている。
【0099】
実施例6.
図26は、本発明による液晶表示装置の他の実施例を示す平面図で、図21に対応した図となっている。
【0100】
図21の場合と比較して異なる構成は、容量信号線CST1および対向電圧信号線CLの引出線CL1のいずれもが液晶表示部AR側および反対側の配線層COM1、COM2に接続された構成としたものである。
【0101】
なお、この場合においても、前記配線層は、たとえば図27に示すように走査信号駆動回路GSCLを完全に囲むようにし一つの端子CPから基準信号を供給するようにして形成するようにしてもよく、さらに図28、図29に示すように互いに最も離れた個所に二つの端子CPを設けそれらの各端子CPに基準信号を供給するようにして形成するようにしてもよいことはいうまでもない。
【0102】
実施例7.
図30は、本発明による液晶表示装置の画素の他の実施例を示す平面図で、図4と対応した図となっている。
【0103】
図4の場合と比較して異なる構成は、液晶表示部ARと走査信号駆動回路GSCLとの間に形成される対向電圧信号線CLの引出線CL1はその間の領域全体に形成されていることにある。換言すれば線状のパターンではなく板状のパターンとして形成されている。
【0104】
上述したように、各画素領域の対向電極CTはドレイン信号線DLおよびゲート信号線GLを被うようにして形成され、その延在部として前記対向電圧信号線CLを形成している。
【0105】
このように形成した場合、そのまま延在させて走査信号駆動回路GSCLの全域を被うようにして形成することができるようになる。
【0106】
実施例8.
図31は、本発明による液晶表示装置の画素の他の実施例を示す平面図で、図4と対応した図となっている。
【0107】
図4の場合と比較して異なる構成は、各画素領域において容量信号線と対向電極CT(対向電圧信号線CL)との電気的接続を図るスルーホールが設けられていない構成となっている。いずれも配線層COMと接続させる構成とすることによってその必要がなくなるからである。
このような構成は画素の開口率の向上を図ることができる。
【0108】
実施例9.
図32は、本発明による液晶表示装置の画素の他の実施例を示す平面図で、図31と対応した図となっている。
【0109】
図31の場合と比較して異なる構成は、液晶表示部ARと走査信号駆動回路GSCLとの間に形成される対向電圧信号線CLの引出線CL1はその間の領域全体に形成されていることにある。換言すれば線状のパターンではなく板状のパターンとして形成されている。
【0110】
実施例10.
図33(a)は、本発明による液晶表示装置の他の実施例を示す平面図で、図1に対応した図となっている。
図33(a)は、ゲート信号線GLの他端側に設けた走査信号駆動回路GSCRにも図1と同様な機能をもたせていることにある。
【0111】
このため、図1に示した構成において走査信号駆動回路GSCRの中心を通るy軸線を中心に左右逆にすることによって図1と同様な構成となる。
【0112】
ここで、ゲート信号線GLの他端側に設けた走査信号駆動回路GSCRの周辺の構成の変形例として、上述した各実施例のように構成してもよいことはいうまでもない。
【0113】
なお、この場合においても、前記配線層COMは、たとえば図33(b)に示すように走査信号駆動回路GSCRを完全に囲むようにし一つの端子CPから基準信号を供給するようにして形成するようにしてもよく、さらに図34、図35に示すように互いに最も離れた個所に二つの端子CPを設けそれらの各端子CPに基準信号を供給するようにして形成するようにしてもよいことはいうまでもない。
【0114】
図36(a)は前記走査信号駆動回路GSCRの一部を示す平面図で、そのb−b線、c−c線、d−d線における各断面図を図36(b)、図36(c)、図36(d)に示している。
【0115】
実施例11.
図37は、本発明による液晶表示装置の他の実施例を示す平面図で、映像信号駆動回路およびその周辺の構成を示している。
【0116】
この映像信号駆動回路は液晶表示部AR側にドレイン分配回路DDCを具備するもので、このドレイン分配回路DDCは透明基板SUB1の面にポリシリコンからなる半導体装置およびこれら各半導体装置を接続させるための配線層から構成されている。
【0117】
また、映像信号駆動回路のうちドレイン分配回路DDC以外の回路はたとえば透明基板SUB1に搭載される複数の半導体チップTCPから構成されている。
【0118】
半導体チップTCPの各端子のうち1つの端子からは1つの配線層を介して連続したたとえば3つの映像信号がドレイン分配回路DDCに入力され、各映像信号は該ドレイン分配回路DDCによって3つのドレイン信号線DL1、DL2、DL3……にそれぞれ並列に各ドレイン信号線DLに出力されるようになっている。
【0119】
このようにすることによって、ドレイン信号線DLの数に対して半導体チップTCPの数を少なくすることができる。
【0120】
そして、ドレイン分配回路DDCを囲むようにして配線層COMが形成され、この配線層COMは液晶表示部ARの対向電圧信号線CLの引出線CL1に接続されるようになっている。
【0121】
この場合、ドレイン分配回路DDCに対して液晶表示部AR側の配線層COM2の線幅は液晶表示部ARと反対側の配線層COM1の線幅よりも細く形成されている。
【0122】
ドレイン分配回路DDCからは液晶表示部AR側に多数のドレイン信号線DLが走行され、これら各ドレイン信号線DLと交差して形成しなければならない前記配線層COM2はその線幅を細くすることにより、それらの間に生じる寄生容量を大幅に低減させることができ、ドレイン信号線DLの映像信号の遅延を低減させることができる。
【0123】
図38(a)は前記ドレイン分配回路DDCの一実施例を示す回路図で、図37の領域Bの部分に該当する。
【0124】
半導体チップTCPの1つの端子から連続して出力される3つの映像信号は、それらの各出力のタイミングに合わせてオンする3つの各スイッチング素子Tr1、Tr2、Tr3を介して対応する各ドレイン信号線DL1、DL2、DL3に並列に出力されるようになっている。
【0125】
図38(b)は、透明基板SUB1面に形成された該ドレイン分配回路DDCの配線パターンの一実施例を示す平面図で、図38(a)の回路図と幾何学的に対応した設計となっている。
【0126】
また、図38(c)は図38(b)のc−c線における断面図を示し、液晶表示部ARの各画素領域に形成される対向電圧信号線CLの引出線CL1はこのドレイン分配回路DDCの形成領域にまで及んで形成され、該ドレイン分配回路DDCの液晶表示部AR側の配線層COM2および液晶表示部ARと反対側の配線層COM1にそれぞれ電気的接続されるようになっている。
【0127】
ここで、前記配線層COMはゲート信号線GLと同層に形成され、その上面は絶縁膜IL1、保護膜PAS、保護膜FPASによって順次被われている。対向電圧信号線CLの引出線CL1は該保護膜FPASの上面に形成され、前記配線層との電気的接続は保護膜FPAS、保護膜PAS、絶縁膜IL1を貫通して形成されるスルーホールを通してなされている。そして、対向電圧信号線CLの引出線CL1と配線層COMとの間にドレイン信号線DLの形成の際に同時に形成される介在層を介してなされている。接触抵抗の低減を図るためである。
【0128】
図39および図40は、それぞれ、本発明による液晶表示装置の他の実施例を示す平面図で、図38(b)と対応した図となっている。
【0129】
図38(b)の場合、ドレイン分配回路DDCを交差して配置される対向電圧信号線CLは一定長さ当たり4本としているのに対し、図39の場合、たとえば2本としていることにある。また、図40の場合、ドレイン分配回路DDCを交差して配置される対向電圧信号線CLはドレイン分配回路DDCの形成領域の全域に至って形成させていることにある。図40のように構成した場合、対向電圧信号線CLおよび配線層自体の電気抵抗を低減させる効果を奏する。
【0130】
実施例12.
図41は本発明による液晶表示装置の他の実施例を示す構成図で、図38と対応した図となっている。
【0131】
図38の場合と比較して異なる構成は、ドレイン分配回路DDCの液晶表示部AR側の配線層COM2と液晶表示部ARと反対側の配線層COM1は、それぞれ同層に形成され該ドレイン分配回路DDCを横切る同層の同一の材料からなる配線層によって一体に接続されていることにある。
【0132】
そして、対向電圧信号線CLの引出線CL1は液晶表示部AR側の配線層COM2と保護膜FPAS、保護膜PAS,絶縁膜IL1を貫通するスルーホールを通して電気的接続がなされている。
【0133】
また、図42は本発明による液晶表示装置の他の実施例を示す構成図で、図41(b)に対応した図となっている。
【0134】
図41(b)の場合、ドレイン分配回路DDCの液晶表示部AR側の配線層COM2と液晶表示部ARと反対側の配線層COM1との接続を図る前記配線層は、一定長さ当たり3本としたものであるが、図42に示すように1本としてもよい。
【0135】
このように構成した場合、ドレイン分配回路DDCの負荷容量を低減させることができる。
【0136】
実施例13.
図43は本発明による液晶表示装置の他の実施例を示す構成図で、図41と対応した図となっている。
図41の場合と比較して異なる構成は、ドレイン分配回路DDCを囲む配線層はドレイン信号線DLと同層かつ同材料で構成していることにある。
【0137】
図44および図45は、それぞれ、本発明による液晶表示装置の他の実施例を示す平面図で、図43(b)と対応した図となっている。
【0138】
図43(b)の場合、ドレイン分配回路DDCを交差して配置される対向電圧信号線CLの引出線CL1は一定長さ当たり4本としているのに対し、図44の場合、たとえば2本としていることにある。また、図45の場合、ドレイン分配回路DDCを交差して配置される対向電圧信号線CLはドレイン分配回路DDCの形成領域の全域に至って形成させていることにある。図45のように構成した場合、対向電圧信号線CLおよび配線層自体の電気抵抗を低減させる効果を奏する。
【0139】
実施例14.
図46は本発明による液晶表示装置の他の実施例を示す構成図で、図37と対応した図となっている。
【0140】
図37の場合と比較して異なる構成は、ドレイン分配回路DDCに近接して配置される配線層COMは、液晶表示部ARと反対側の部分に形成されているのみで液晶表示部AR側に形成されていないことにある。換言すれば、前記配線層COMは配線層COM1のみが形成された構成となっている。
【0141】
これにより、各ドレイン信号線DLと他の配線層(配線層COM2)との交差部をなくして該他の配線層との間に生じる寄生容量を低減させている。
【0142】
配線層COM1をドレイン分配回路DDCと半導体チップTCPの間に設けるようにしたのは、半導体チップTCPからドレイン分配回路DDCへの信号の周波数はドレイン分配回路DDCの分配に応じた数だけの高周波となる。
【0143】
周波数が高い場合、半導体チップTCPの信号生成時、その信号が急速に切り替わる場合にいわゆるグリッジが生じてしまうことから、これを前記配線層COM1によって低減させる必要があるからである。これにより、不要な高電圧やノイズが液晶表示部ARの薄膜トランジスタTFTにかかり、該薄膜トランジスタTFTの信頼性が低下することを回避できるようになる。
【0144】
図47は、図46の構成のさらなる具体的な構成を示した図で、図43と対応した図となっている。
【0145】
配線層COM1は絶縁膜GIの上面に形成され、対向電圧信号線CLの引出線CL1は保護膜FPASの上面に形成されている。該引出線CL1は、ドレイン分配回路DDCを交差した後に、保護膜FPAS、保護膜PAS、絶縁膜IL1を貫通するスルーホールを通して該配線層COM1に接続されている。
【0146】
図48および図49は、それぞれ、本発明による液晶表示装置の他の実施例を示す平面図で、図47(b)と対応した図となっている。
【0147】
図47(b)の場合、ドレイン分配回路を交差して配置される対向電圧信号線CLは一定長さ当たり4本としているのに対し、図48の場合、たとえば2本としていることにある。また、図49の場合、ドレイン分配回路DDCを交差して配置される対向電圧信号線CLはドレイン分配回路の形成領域の全域に至った形成させていることにある。図49のように構成した場合、対向電圧信号線CLおよび配線層自体の電気抵抗を低減させる効果を奏する。
【0148】
本実施例では、配線層COM1をドレイン分配回路DDCと半導体チップTCPの間に設け、配線層COM2に相当する配線層を設けていない。これにより、ドレイン分配回路DDCへの不要な高電圧印加を防止し、さらに液晶表示部ARの薄膜トランジスタTFTに印加される信号の波形なまりを防止し、信頼性向上の効果を選択的に充分奏する構成とした。
【0149】
実施例15.
図50は本発明による液晶表示装置の他の実施例を示す構成図で、図47と対応した図となっている。
【0150】
図47の場合と比較して異なる構成は、配線層COM1は絶縁膜IL1の上面にドレイン信号線DLと同層に形成され、保護膜FPASの上面に形成された対向電圧信号線CLの引出線CL1とは保護膜FPAS、保護膜PASに貫通して形成されたスルーホールを通して接続されている。
【0151】
図51および図52は、それぞれ、本発明による液晶表示装置の他の実施例を示す平面図で、図50(b)と対応した図となっている。
【0152】
図50(b)の場合、ドレイン分配回路を交差して配置される対向電圧信号線CLは一定長さ当たり4本としているのに対し、図51の場合、たとえば2本としていることにある。また、図52の場合、ドレイン分配回路を交差して配置される対向電圧信号線CLはドレイン分配回路の形成領域の全域に至った形成させていることにある。図52のように構成した場合、対向電圧信号線CLおよび配線層自体の電気抵抗を低減させる効果を奏する。
【0153】
実施例16.
図53は、本発明による液晶表示装置の他の実施例を示す図である。同図はドレイン信号線DLの一端側に設けた映像信号駆動回路の他に、該ドレイン信号線DLの他端側にも映像信号駆動回路が設けられたものを対象とするものである。
【0154】
該映像信号駆動回路は、たとえば各ドレイン信号線に接続されるドレイン分配回路DDCを含む構成からなり、同図においては、該ドレイン分配回路DDC以外の映像信号駆動回路(半導体チップ)の部分は省略している。
【0155】
そして、該ドレイン分配回路DDCにおいてもそれを囲むようにして配線層COMが形成されている。
この場合も、ドレイン分配回路DDCに対して液晶表示部AR側の配線層の線幅は液晶表示部ARと反対側の配線層の線幅よりも細く形成されている。
【0156】
なお、このように各ドレイン信号線DLの両端に映像信号駆動回路を設ける場合には、偶数番目の各ドレイン信号線DLには一方の映像信号駆動回路を、奇数番目の各ドレイン信号線DLには他方の映像信号駆動回路を接続させるのが通常である。
【0157】
実施例17.
図54は、本発明による液晶表示装置の他の実施例を示す構成図である。同図は、一端に映像信号駆動回路が接続されたドレイン信号線DLの他端にイコライズ回路EQCが形成され、このイコライズ回路EQCを囲むようにして配線層COMを形成していることにある。
【0158】
このイコライズ回路EQCは、ドレイン信号がHighからLow信号へ変化する際、およびLowからHigh信号へ変化する際に、いずれも対向電圧信号(COM)になるように構成され、いわゆるドット反転駆動あるいは行毎反転駆動をする場合において極めて有効となるものである。
【0159】
図62(a)は、該イコライズ回路EQCの一実施例の回路図を示している。各ドレイン信号線DL1、DL2、DL3、……にはスイッチング素子Tr11、Tr12、Tr13、……が形成され、これらスイッチング素子Tr11、Tr12、Tr13、……の各ゲートはEQG線が接続されている。また、スイッチング素子Tr11を介して前記ドレイン信号線DL1はEQS1線が、スイッチング素子Tr12を介して前記ドレイン信号線DL2はEQS2線が、スイッチング素子Tr13を介して前記ドレイン信号線DL3はEQS1線がというように接続されている。
【0160】
この場合においても、液晶表示部AR側の対向電圧信号線CLの引出線CL1は該イコライズ回路EQCを交差するように延在され、配線層COM1に接続されるようになっている。
【0161】
また、図62(b)は通常駆動時のタイミングチャートを示し、これに対して図62(c)はイコライザ駆動時のタイミングチャートを示している。イコライザ駆動時において、1水平走査期間(1H)で画素領域の薄膜トランジスタTFTのゲートがOFFになった後に、ドレイン信号線DLの信号電圧をイコライズ回路EQCの各スイッチング素子Tr11、Tr12、Tr13、……を介してコモン(基準)電圧(EQS1あるいはEQS2)にする。
【0162】
そして、次の1水平走査期間(1H)では、前記ドレイン信号線DL1、DL2、DL3、……には逆極性の電圧を書き込む。
【0163】
このことから、ドレイン信号線の電圧書込効率の向上と、ドライバ出力負荷軽減による消費電力低減が図れるようになる。
【0164】
図55(a)は前記イコライズ回路を示し、図55(b)は透明基板SUB1上に形成した該イコライズ回路の配線パターンを示している。図55(a)と幾何学的に対応したパターンとなっている。また、図55(c)は図55(b)のc−c線における断面図を示している。
【0165】
保護膜FPASの上面に形成された対向電圧信号線CLは該イコライズ回路EQCを交差するようにして延在し、該イコライズ回路EQCに対して液晶表示部ARと反対側に形成されている配線層COM1と電気的に接続されている。
【0166】
図56および図57は、それぞれ、本発明による液晶表示装置の他の実施例を示す平面図で、図55(b)と対応した図となっている。
【0167】
図55(b)の場合、イコライズ回路EQCを交差して配置される対向電圧信号線CLは一定長さ当たり4本としているのに対し、図56の場合、たとえば2本としていることにある。また、図57の場合、イコライズ回路EQCを交差して配置される対向電圧信号線CLはイコライズ回路EQCの形成領域の全域に至って形成されていることにある。図57のように構成した場合、対向電圧信号線CLおよび配線層自体の電気抵抗を低減させる効果を奏する。
【0168】
実施例18.
図58は、本発明による液晶表示装置の他の実施例を示す構成図で、図54と対応した図となっている。
【0169】
図54の場合と比較して異なる構成は、イコライズ回路EQCに近接して配置される配線層は、液晶表示部ARと反対側の部分に形成されているのみで液晶表示部AR側に形成されていないことにある。
【0170】
これにより、各ドレイン信号線DLと他の配線層(配線層COM2)との交差部をなくして該他の配線層との間に生じる寄生容量を低減させている。
【0171】
図59は、図58の構成のさらなる具体的な構成を示した図で、図55と対応した図となっている。
【0172】
図60および図61は、それぞれ、本発明による液晶表示装置の他の実施例を示す平面図で、図59(b)と対応した図となっている。
【0173】
図59(b)の場合、ドレイン分配回路を交差して配置される対向電圧信号線CLは一定長さ当たり4本としているのに対し、図60の場合、たとえば2本としていることにある。また、図61の場合、ドレイン分配回路を交差して配置される対向電圧信号線CLはドレイン分配回路の形成領域の全域に至った形成させていることにある。図61のように構成した場合、対向電圧信号線CLおよび配線層自体の電気抵抗を低減させる効果を奏する。
【0174】
実施例20.
図63および図64はそれぞれ本発明による液晶表示装置の他の実施例を示す構成図である。
【0175】
図63は、透明基板SUB1の周辺に沿って形成される環状の配線層COMが形成されており、この配線層COMは走査信号駆動回路GSCLおよび映像信号駆動回路の外側に形成された構成となっている。
【0176】
この場合において、対向電圧信号線CL(あるいは容量信号線CST)は走査信号駆動回路GSCLおよび映像信号駆動回路を交差するようにして延在されて該配線層COMに電気的に接続されている。
【0177】
また、図64は、たとえば映像信号駆動回路がドレイン分配回路を具備するものであれば、前記配線層COMは該映像信号駆動回路のうちドレイン分配回路とそれ以外の回路との間を走行するようにして形成してもよい。
【0178】
さらに、上述した配線層COMを一部として、走査信号駆動回路GSCL、映像信号駆動回路、ドレイン分配回路DDC、あるいはイコライズ回路EQC等を囲むように配線層を形成するようにしてもよいことはもちろんである。
【0179】
上述した各実施例では、いずれもスイッチング素子としてポリシリコンを半導体層としたものであるが、たとえばアモルファスシリコン等を半導体層としたものにも適用できることはいうまでもない。
また、上述した各実施例を組み合わせて構成するようにしてもよいことはいうまでもない。
【0180】
さらに、上述の各実施例では、液晶表示装置を例に説明したが、液晶を用いない有機EL、無機EL等の自発光素子による画素表示装置においても、各実施例開示の回路構成、回路部のパターン配置を用いる限り、各々の効果を奏することができ、本発明に含むものである。
【0181】
【発明の効果】
以上説明したことから明らかなように、本発明による液晶表示装置によれば、走査信号駆動回路あるいは映像信号駆動回路への静電気の飛び込みを抑制できるようになる。走査信号駆動回路あるいは映像信号駆動回路の形成部分を通しての光漏れを抑制できるようになる。さらに、走査信号駆動回路あるいは映像信号駆動回路の誤動作を防止できるようになる。
【図面の簡単な説明】
【図1】本発明による液晶表示装置の一実施例を示す要部説明図である。
【図2】本発明による液晶表示装置の一実施例を示す全体構成図である。
【図3】本発明による液晶表示装置の画素の一実施例を示す等価回路図である。
【図4】本発明による液晶表示装置の画素の一実施例を示す構成図である。
【図5】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図6】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図7】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図8】本発明による液晶表示装置の走査信号駆動回路とその周辺の一実施例を示す構成図である。
【図9】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図10】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図11】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図12】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図13】本発明による液晶表示装置の走査信号駆動回路とその周辺の他の実施例を示す構成図である。
【図14】本発明による液晶表示装置の走査信号駆動回路とその周辺の他の実施例を示す構成図である。
【図15】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図16】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図17】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図18】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図19】本発明による液晶表示装置の走査信号駆動回路とその周辺の他の実施例を示す構成図である。
【図20】本発明による液晶表示装置の走査信号駆動回路とその周辺の他の実施例を示す構成図である。
【図21】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図22】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図23】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図24】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図25】本発明による液晶表示装置の走査信号駆動回路とその周辺の他の実施例を示す構成図である。
【図26】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図27】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図28】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図29】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図30】本発明による液晶表示装置の画素の一実施例を示す構成図である。
【図31】本発明による液晶表示装置の画素の他の実施例を示す構成図である。
【図32】本発明による液晶表示装置の画素の他の実施例を示す構成図である。
【図33】本発明による液晶表示装置の画素の他の実施例を示す構成図である。
【図34】本発明による液晶表示装置の画素の他の実施例を示す構成図である。
【図35】本発明による液晶表示装置の画素の他の実施例を示す構成図である。
【図36】本発明による液晶表示装置の走査信号駆動回路とその周辺の他の実施例を示す構成図である。
【図37】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図38】本発明による液晶表示装置の映像信号駆動回路とその周辺の他の実施例を示す構成図である。
【図39】本発明による液晶表示装置の映像信号駆動回路とその周辺の他の実施例を示す構成図である。
【図40】本発明による液晶表示装置の映像信号駆動回路とその周辺の他の実施例を示す構成図である。
【図41】本発明による液晶表示装置の映像信号駆動回路とその周辺の他の実施例を示す構成図である。
【図42】本発明による液晶表示装置の映像信号駆動回路とその周辺の他の実施例を示す構成図である。
【図43】本発明による液晶表示装置の映像信号駆動回路とその周辺の他の実施例を示す構成図である。
【図44】本発明による液晶表示装置の映像信号駆動回路とその周辺の他の実施例を示す構成図である。
【図45】本発明による液晶表示装置の映像信号駆動回路とその周辺の他の実施例を示す構成図である。
【図46】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図47】本発明による液晶表示装置の映像信号駆動回路とその周辺の一実施例を示す構成図である。
【図48】本発明による液晶表示装置の映像信号駆動回路とその周辺の他の実施例を示す構成図である。
【図49】本発明による液晶表示装置の映像信号駆動回路とその周辺の他の実施例を示す構成図である。
【図50】本発明による液晶表示装置の映像信号駆動回路とその周辺の他の実施例を示す構成図である。
【図51】本発明による液晶表示装置の映像信号駆動回路とその周辺の他の実施例を示す構成図である。
【図52】本発明による液晶表示装置の映像信号駆動回路とその周辺の他の実施例を示す構成図である。
【図53】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図54】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図55】本発明による液晶表示装置のイコライズ回路とその周辺の一実施例を示す構成図である。
【図56】本発明による液晶表示装置のイコライズ回路とその周辺の他の実施例を示す構成図である。
【図57】本発明による液晶表示装置のイコライズ回路とその周辺の他の実施例を示す構成図である。
【図58】本発明による液晶表示装置の他の実施例を示す要部説明図である。
【図59】本発明による液晶表示装置のイコライズ回路とその周辺の他の実施例を示す構成図である。
【図60】本発明による液晶表示装置のイコライズ回路とその周辺の他の実施例を示す構成図である。
【図61】本発明による液晶表示装置のイコライズ回路とその周辺の他の実施例を示す構成図である。
【図62】本発明による液晶表示装置のイコライズ回路の説明図である。
【図63】本発明による液晶表示装置の他の実施例を示す説明図である。
【図64】本発明による液晶表示装置の他の実施例を示す説明図である。
【符号の説明】
SUB1、SUB2…透明基板、GL…ゲート信号線、DL…ドレイン信号線、CL…対向電圧信号線、CST…容量信号線、TFT…薄膜トランジスタ、Cstg…容量素子、PX…画素電極、CT…対向電極、GSCL…走査信号駆動回路、DDC…ドレイン分配回路、EQC…イコライズ回路、COM…配線層。
Claims (10)
- 液晶を介して対向配置される各基板の一方の基板の液晶側の面に液晶表示部を構成する各画素と、一方向に並設された各画素からなる画素群に共通のゲート信号線と容量線とが少なくとも形成され、
前記各ゲート信号線の少なくとも一端が接続された走査信号駆動回路と、この走査信号駆動回路を囲むようにして形成された配線層とを備え、
この配線層は液晶表示部と反対側のそれに対して液晶表示部側のそれは線幅が小さく形成されているとともに、
前記容量線は前記走査信号駆動回路を交差して液晶表示部と反対側の前記配線層に接続されていることを特徴とする液晶表示装置。 - 液晶を介して対向配置される各基板の一方の基板の液晶側の面に液晶表示部を構成する各画素と、一方向に並設された各画素からなる画素群に共通のゲート信号線と容量線とが少なくとも形成され、
前記各ゲート信号線の少なくとも一端が接続された走査信号駆動回路と、この走査信号駆動回路を囲むようにして形成された配線層とを備え、
この配線層は液晶表示部と反対側のそれに対して液晶表示部側のそれは線幅が小さく形成されているとともに、
前記容量線は非透光性の材料から構成され、前記走査信号駆動回路の下層を交差して液晶表示部と反対側の前記配線層に接続されていることを特徴とする液晶表示装置。 - 液晶を介して対向配置される各基板のうち一方の基板の液晶側の面に、並設された複数のゲート信号線とこれらゲート信号線に交差して並設された複数のドレイン信号線が形成され、
前記各信号線によって囲まれた領域を画素領域およびこれら画素領域の集合体を液晶表示部とし、
前記画素領域には、ゲート信号線からの走査信号によって駆動されるスイッチング素子と、このスイッチング素子を介してドレイン信号線からの映像信号が供給される画素電極と、対向電圧信号線に接続され前記画素電極との間に電界を生じせしめる対向電極とを備え、
前記対向電極は絶縁層を介して前記ドレイン信号線およびゲート信号線を被うようにして形成された部分を有して対向電圧信号線とともに形成され、
前記各ゲート信号線の少なくとも一端が接続された走査信号駆動回路と、この走査信号駆動回路を囲むようにして形成された配線層とを備え、
この配線層は液晶表示部と反対側のそれに対して液晶表示部側のそれは線幅が小さく形成されているとともに、
前記対向電圧信号線は、前記走査信号駆動回路の上層を交差して液晶表示部と反対側の前記配線層に接続されていることを特徴とする液晶表示装置。 - 前記対向電圧信号線は、前記走査信号駆動回路の形成領域の全域を被って形成されていることを特徴とする請求項3に記載の液晶表示装置。
- 液晶を介して対向配置される各基板のうち一方の基板の液晶側の面に、並設された複数のゲート信号線とこれらゲート信号線に交差して並設された複数のドレイン信号線が形成され、
前記各信号線によって囲まれた領域を画素領域およびこれら画素領域の集合体を液晶表示部とし、
前記画素領域には、ゲート信号線からの走査信号によって駆動されるスイッチング素子と、このスイッチング素子を介してドレイン信号線からの映像信号が供給される画素電極と、対向電圧信号線に接続され前記画素電極との間に電界を生じせしめる対向電極とを備え、
前記対向電極は絶縁層を介して前記ドレイン信号線およびゲート信号線を被うようにして形成された部分を有して対向電圧信号線とともに形成され、
前記各ドレイン信号線の一端が接続された映像信号駆動回路と、この映像信号駆動回路に対して液晶表示部と反対側に該映像信号駆動回路に沿って形成された配線層とを備え、
前記対向電圧信号線は、前記映像信号駆動回路の上層を交差して前記配線層に接続されていることを特徴とする液晶表示装置。 - 液晶を介して対向配置される各基板のうち一方の基板の液晶側の面に、並設された複数のゲート信号線とこれらゲート信号線に交差して並設された複数のドレイン信号線が形成され、
前記各信号線によって囲まれた領域を画素領域およびこれら画素領域の集合体を液晶表示部とし、
前記画素領域には、ゲート信号線からの走査信号によって駆動されるスイッチング素子と、このスイッチング素子を介してドレイン信号線からの映像信号が供給される画素電極と、対向電圧信号線に接続され前記画素電極との間に電界を生じせしめる対向電極とを備え、
前記対向電極は絶縁層を介して前記ドレイン信号線およびゲート信号線を被うようにして形成された部分を有して対向電圧信号線とともに形成され、
前記各ドレイン信号線の一端が接続されたドレイン分配回路を含む映像信号駆動回路と、前記ドレイン分配回路を囲むようにして形成された配線層とを備え、この配線層は液晶表示部と反対側のそれに対して液晶表示部側のそれは線幅が小さく形成されているとともに、
前記対向電圧信号線は、前記映像信号駆動回路の上層を交差して前記配線層に接続されていることを特徴とする液晶表示装置。 - 前記対向電圧信号線は、前記映像信号駆動回路の形成領域の全域を被って形成されていることを特徴とする請求項5、6のうちいずれかに記載の液晶表示装置。
- 液晶を介して対向配置される各基板のうち一方の基板の液晶側の面に、並設された複数のゲート信号線とこれらゲート信号線に交差して並設された複数のドレイン信号線が形成され、
前記各信号線によって囲まれた領域を画素領域およびこれら画素領域の集合体を液晶表示部とし、
前記画素領域には、ゲート信号線からの走査信号によって駆動されるスイッチング素子と、このスイッチング素子を介してドレイン信号線からの映像信号が供給される画素電極と備え、
前記ドレイン信号線の一端に映像信号駆動回路を備えるとともに、他端にイコライズ回路とこのイコライズ回路を囲むようにして形成された配線層とを備え、この配線層は液晶表示部と反対側のそれに対して液晶表示部側のそれは線幅が小さく形成されていることを特徴とする液晶表示装置。 - 対向電圧信号に接続され前記画素電極との間に電界を生じせしめる対向電極を備えるとともに、前記対向電圧信号線は前記イコライズ回路に対して液晶表示部と反対側の前記配線層に該イコライズ回路を交差して接続されていることを特徴とする請求項8に記載の液晶表示装置。
- 液晶を介して対向配置される各基板のうち一方の基板の液晶側の面に、並設された複数のゲート信号線とこれらゲート信号線に交差して並設された複数のドレイン信号線が形成され、
前記各信号線によって囲まれた領域を画素領域およびこれら画素領域の集合体を液晶表示部とし、
前記画素領域には、ゲート信号線からの走査信号によって駆動されるスイッチング素子と、このスイッチング素子を介してドレイン信号線からの映像信号が供給される画素電極と、対向電圧信号線に接続され前記画素電極との間に電界を生じせしめる対向電極とが備えられ、
前記ドレイン信号線の一端に映像信号駆動回路を備えるとともに、他端にイコライズ回路とこのイコライズ回路に対して液晶表示部と反対側に配線層とを備え、
前記対向電圧信号線は該イコライズ回路を交差して前記配線層に接続されていることを特徴とする液晶表示装置。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002022655A JP3920649B2 (ja) | 2002-01-31 | 2002-01-31 | 画像表示装置および液晶表示装置 |
US10/354,072 US7098879B2 (en) | 2002-01-31 | 2003-01-30 | Display device |
US11/507,565 US7391397B2 (en) | 2002-01-31 | 2006-08-22 | Display device |
US12/138,739 US7557786B2 (en) | 2002-01-31 | 2008-06-13 | Display device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002022655A JP3920649B2 (ja) | 2002-01-31 | 2002-01-31 | 画像表示装置および液晶表示装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2003222891A JP2003222891A (ja) | 2003-08-08 |
JP3920649B2 true JP3920649B2 (ja) | 2007-05-30 |
Family
ID=27745597
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2002022655A Expired - Fee Related JP3920649B2 (ja) | 2002-01-31 | 2002-01-31 | 画像表示装置および液晶表示装置 |
Country Status (2)
Country | Link |
---|---|
US (3) | US7098879B2 (ja) |
JP (1) | JP3920649B2 (ja) |
Families Citing this family (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3920649B2 (ja) * | 2002-01-31 | 2007-05-30 | 株式会社日立製作所 | 画像表示装置および液晶表示装置 |
US20060056267A1 (en) * | 2004-09-13 | 2006-03-16 | Samsung Electronics Co., Ltd. | Driving unit and display apparatus having the same |
KR101189275B1 (ko) | 2005-08-26 | 2012-10-09 | 삼성디스플레이 주식회사 | 박막 트랜지스터 표시판 및 그 제조 방법 |
JP4623464B2 (ja) * | 2005-09-26 | 2011-02-02 | 株式会社 日立ディスプレイズ | 液晶表示装置 |
JP4786996B2 (ja) | 2005-10-20 | 2011-10-05 | 株式会社 日立ディスプレイズ | 表示装置 |
JP4449953B2 (ja) | 2006-07-27 | 2010-04-14 | エプソンイメージングデバイス株式会社 | 液晶表示装置 |
KR101843337B1 (ko) | 2010-10-28 | 2018-03-30 | 삼성전자주식회사 | 디스플레이 모듈 및 디스플레이 시스템 |
JP5913945B2 (ja) | 2011-12-07 | 2016-05-11 | 株式会社ジャパンディスプレイ | 表示装置 |
WO2015170700A1 (ja) | 2014-05-07 | 2015-11-12 | シャープ株式会社 | 液晶表示装置 |
JP6360718B2 (ja) * | 2014-05-16 | 2018-07-18 | 株式会社ジャパンディスプレイ | 表示装置 |
CN105093751B (zh) * | 2015-08-18 | 2018-09-11 | 京东方科技集团股份有限公司 | 预防esd的goa布局设计 |
KR102399724B1 (ko) | 2015-09-24 | 2022-05-20 | 삼성전자주식회사 | 디스플레이 장치, 그를 가지는 도어 및 냉장고 |
CN109001950A (zh) * | 2018-09-29 | 2018-12-14 | 武汉华星光电技术有限公司 | 阵列基板以及显示装置 |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6049132A (en) * | 1996-07-12 | 2000-04-11 | Kawasaki Steel Corporation | Multiple metallization structure for a reflection type liquid crystal display |
JP3980178B2 (ja) * | 1997-08-29 | 2007-09-26 | 株式会社半導体エネルギー研究所 | 不揮発性メモリおよび半導体装置 |
KR100280874B1 (ko) * | 1997-09-12 | 2001-02-01 | 구본준 | 액정패널 |
JPH11326957A (ja) * | 1998-03-20 | 1999-11-26 | Toshiba Corp | 液晶表示装置 |
JP2000114245A (ja) * | 1998-10-05 | 2000-04-21 | Hitachi Ltd | 半導体集積回路装置およびその製造方法 |
JP4570278B2 (ja) * | 2000-08-28 | 2010-10-27 | シャープ株式会社 | アクティブマトリクス基板 |
JP3920649B2 (ja) * | 2002-01-31 | 2007-05-30 | 株式会社日立製作所 | 画像表示装置および液晶表示装置 |
-
2002
- 2002-01-31 JP JP2002022655A patent/JP3920649B2/ja not_active Expired - Fee Related
-
2003
- 2003-01-30 US US10/354,072 patent/US7098879B2/en not_active Expired - Lifetime
-
2006
- 2006-08-22 US US11/507,565 patent/US7391397B2/en not_active Expired - Fee Related
-
2008
- 2008-06-13 US US12/138,739 patent/US7557786B2/en not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JP2003222891A (ja) | 2003-08-08 |
US20080246707A1 (en) | 2008-10-09 |
US20030179335A1 (en) | 2003-09-25 |
US7391397B2 (en) | 2008-06-24 |
US7098879B2 (en) | 2006-08-29 |
US20060279500A1 (en) | 2006-12-14 |
US7557786B2 (en) | 2009-07-07 |
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Legal Events
Date | Code | Title | Description |
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A621 | Written request for application examination |
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|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20061120 |
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TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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A61 | First payment of annual fees (during grant procedure) |
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|
R150 | Certificate of patent or registration of utility model |
Ref document number: 3920649 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100223 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110223 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110223 Year of fee payment: 4 |
|
S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110223 Year of fee payment: 4 |
|
R371 | Transfer withdrawn |
Free format text: JAPANESE INTERMEDIATE CODE: R371 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110223 Year of fee payment: 4 |
|
S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313111 |
|
S631 | Written request for registration of reclamation of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313631 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110223 Year of fee payment: 4 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120223 Year of fee payment: 5 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120223 Year of fee payment: 5 |
|
S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313121 Free format text: JAPANESE INTERMEDIATE CODE: R313115 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120223 Year of fee payment: 5 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120223 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130223 Year of fee payment: 6 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20140223 Year of fee payment: 7 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
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R250 | Receipt of annual fees |
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R250 | Receipt of annual fees |
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R250 | Receipt of annual fees |
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