JP3423013B2 - 同期化方法及びこの方法を実施する回路装置 - Google Patents

同期化方法及びこの方法を実施する回路装置

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JP3423013B2 JP22291292A JP22291292A JP3423013B2 JP 3423013 B2 JP3423013 B2 JP 3423013B2 JP 22291292 A JP22291292 A JP 22291292A JP 22291292 A JP22291292 A JP 22291292A JP 3423013 B2 JP3423013 B2 JP 3423013B2
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Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は直列データ流のコードデ
ータビットを２ビット幅のデータワードに細分割すると
ともに３ビット幅のコードワードに変換符号化し、隣接
する値１間の３ビット幅のコードワードのシーケンスは
少なくとも１つの値０で多くとも７つの値０を具え、３
ビット幅のコードワードの位相補正復号化に対し所定同
期ビットシーケンスをコードワードのデータ流に挿入す
るようにしたコード比２／３のランレングス−リミッテ
ッド（１．７）−コードに対し同期化を行う方法に関す
るものである。
【０００２】
【従来の技術】ランレングス−リミッテッド（１．７）
−コードは磁気記録／再生データのチャネルコードとし
て用いて記録密度を増大するか、または誤り速度を減少
し得るようにする。ジャーナル ＩＥＥＥ トランザク
ションズ オン マグネチックス，第ＭＡＧ−１２巻，
第６号，１９７６年１１月，第７４０〜７４２頁にはか
かるランレングス−リミッテッド（１．７）−コードが
記載されており、この際各値１（“１”）は諸定数の値
０（“０”）により次の値１（“１”）から分離させる
ようにする必要がある。（１．７）−コードでは、最小
の１と最大の７つの値０（“０”）が次の値１
（“１”）間に発生し得るようにする。符号化ビット順
序内の値１（“１”）ビットはフラックス変化の位置を
特徴付ける。ソース符号器により供給されるデータビッ
トのコードビットへのチャネル符号化を適宜行って、デ
ータビットを２ビットのワードに再分割するとともに３
ビットコードワードに符号変換し得るようにする。
【０００３】米国特許第４，３３７，４５８号には、ラ
ンレングス−リミッテッド（１．７）−コードを２／３
のコード比で符号化する方法が記載されており、この際
値００，０１，１０および１１の４つの可能な２ビット
データワードを３ビットコードワードに変換するように
している。
【０００４】次の表は関連する基本符号化を示す。
【表１】
【０００５】コードワードの制限下でのこの基本符号化
も１ビット距離のみを有する２つの“１”間に遷移を発
生するため、これらの場合に対し追加の符号化記述を用
いる。次の表はこの関連する追加の符号化を示す。
【０００６】
【表２】
【０００７】これがため、このチャネルコードは次の５
つのワード：１０１，１００，００１，０１０による１
ワードのみを用いる。次のワードに対する符号化の依存
性によりこのコードもルックアヘッドコードとも称す
る。ランレングス−リミッテッド（１．７）−コードの
符号化および復号化の表は米国特許第４，３３７，４５
８号の第４欄に示されている。
【０００８】２／３の符号比を有する（１．７）−コー
ドの符号化および復号化の他の形状はＩＢＭ テクニカ
ル ディスクロージュア ブルテン，第２３巻，第９
号，１９８１年２月，第４３７５〜４３７８頁から既知
である。
【０００９】
【発明が解決しようとする課題】磁気キャリアに記録さ
れた３ビットコードワードシーケンスを再生端で２ビッ
トデータワードシーケンスに再変換するために、まず最
初、再生された３ビットコードワードのワード境界を決
める必要がある。記録すべき３ビットコードワードのシ
ーケンスに特定の同期ワードを挿入し、且つこれを３ビ
ットコードワードシーケンスとともに記録することは米
国特許第４，８６８，６９０号から既知である。この場
合には、特定の同期ワードはデジタル値０１０の複数の
コードワードのシーケンスより成る。挿入された同期ワ
ードシーケンスの時間に対する位置を決めて次の復号化
に対する再生されたコードワードのワード境界を規定し
得るようにすることが再生端で試みられている。同期ワ
ードの認識はシフトレジスタとその出力側に接続された
ＡＮＤゲートによって達成するようにしている。再生さ
れたコードワードの同期化には厳しい要求が課せられて
いる。その理由は１ビット長さの誤りのある同期化がデ
ータの総合損失となるからである。
【００１０】本発明の目的は３ビットコードワードの明
瞭な同期化を行うランレングス−リミッテッド（１．
７）−コードの他の同期化方法を提供せんとするにあ
る。
【００１１】
【課題を解決するための手段】本発明同期化方法は直列
データ流のコードデータビットを２ビット幅のデータワ
ードに細分割するとともに３ビット幅のコードワードに
変換符号化し、隣接する値１間の３ビット幅のコードワ
ードのシーケンスは少なくとも１つの値０で多くとも７
つの値０を具え、３ビット幅のコードワードの位相補正
復号化に対し所定同期ビットシーケンスをコードワード
のデータ流に挿入するようにした２／３のコード比のラ
ンレングス−リミッテッド（１．７）−コードに対し同
期化を行うに当たり、少なくとも３つの順次の３ビット
幅のコードワードを具える同期化シーケンスを挿入すべ
き同期化ビットシーケンスとして発生し、このシーケン
スは２つの値１間に少なくとも６つの値０を有し、挿入
された同期化シーケンスの一時的な位置を２つの値１間
の値０の数を決めることにより規定して直列に伝送され
たコードワードのワード境界を識別するようにしたこと
を特徴とする。
【００１２】かかる本発明方法によれば従来の状態と比
較して誤りのある同期化の危険性を低減し得る利点を有
する。
【００１３】同期化シーケンスは“ＸＸ０．１００．０
００．００１．０ＸＸ”のビットシーケンスを有する
か、または、“ＸＸ０．１００．０００．０１０．００
０．００１．０ＸＸ”のビットシーケンスを有するか、
或は“ＸＸＸ．０００．０００．０１０．ＸＸ”のビッ
トシーケンスを有するか、或は又“ＸＸＸ．０１０．０
００．０００．０１０．０００．０００．０１０．０１
０．ＸＸＸ”のビットシーケンスを有し、ここにドット
はワード境界を示し、Ｘは任意のビット値を示し、
“１”は信号遷移を示し、“０”は信号無遷移を示す。
【００１４】ビットシーケンス“ＸＸＸ．０１０．００
０．０００．０１０．０００．０００．０１０．０１
０．ＸＸＸ”を有する同期化シーケンスの関連するデー
タワードは、データ流に挿入するとともに同期化データ
ブロックに対し設けられた同期化ワードの代わりに伝送
し、且つビットシーケンス“ＸＸＸ．０１０．０００．
０００．０１０．０００．０００．０１０．０１０．Ｘ
ＸＸ”を有する伝送された同期化シーケンスの関連する
データワードをデータブロック同期化に対し用いるよう
にする。
【００１５】挿入された同期化シーケンスの一時的な位
置は同期化シーケンスの所定ビットシーケンスと比較す
ることによって決めるようにする。
【００１６】挿入された同期化シーケンスの一時的な位
置は２つの値１間の値０を計数することによって決める
とともに識別された同期化シーケンスの時間に対する位
置に依存し、ビット流に存在するコードワードのワード
境界を割り当てるようにする。
【００１７】本発明の他の利点は方法を実施する回路配
置が少数の回路素子のみを具えることである。
【００１８】
【実施例】図面につき本発明の実施例を説明する。図１
のブロック図において、記号１は磁気テープを示し、こ
れから再生磁気ヘッド２により記録されたデジタル信号
を取出す。記録処理前このデジタル信号には米国特許第
４，３３７，４５８号に記載の方法に従ってチャネル符
号化を施すものとする。また、３ビットコードワードは
１コードワードブロックに結合し、このコードワードブ
ロックはその前段に０．１００．０００．００１．０の
同期化シーケンス、または０．１００．０００．０１
０．０００．００１．０の同期化シーケンスを設けるも
のとする。
【００１９】これら２つの同期化シーケンスにおいて、
ドットはワード境界を示し、値１（“１”）はフラック
ス変化を示し、値０（“０”）はフラックス変化のない
場合を示す。
【００２０】図２のランレングス−リミッテッド（１．
７）−コードの状態図を考慮する際には、２つの提供さ
れた同期化シーケンスによって３ビットコードワードの
同期化を明瞭とすることができる。この状態図におい
て、Ａ，ＢおよびＣは３ビットコードワードの可能な状
態を示す。状態遷移に次ぎ記す数値は２つの遷移間に位
置するビットの数を示す。かようにして、ランレングス
−リミッテッド（１．７）−コードの表示はジャーナル
オブ ＩＥＥＥ トランザクションズ オンコミュニ
ケーションズ、第３７巻第９号、１９８９年９月、第９
０６〜９１７頁から既知である。この状態図は、状態Ｂ
が距離８で同期化シーケンスを発生した後、および距離
７で同期化シーケンスを２回連続発生した後の双方で、
到達することを示す。しかし、距離８でのシーケンスで
は、状態Ａは状態Ｂに直接変化するが、距離７でのシー
ケンスでは、状態Ｂは状態Ｃを経る分散を経て到達す
る。明瞭な同期化は関連する状態図の非対称性から得ら
れる。
【００２１】長い同期化シーケンスを用いる場合には、
誤りの或る同期化の確率は距離８での短い同期化シーケ
ンスの場合よりも小さくなる。しかし、２つの同期化シ
ーケンスを認識するために必要な回路素子の数に対して
は短い同期化シーケンスを実行する必要がある。
【００２２】長い同期化ワードシーケンスを発生させる
ために、前のデータワードおよび次のデータワードの状
態を考慮する必要がある。例えば、次の２進データワー
ド00 00 11 00 10 10 11 11 のビットシーケンス＝Hex
｜ 0 ｜ 3 ｜ 5 ｜ F ｜ によってコードワードを
発生する。
【数１】
【００２３】データワードのこの選択されたビットシー
ケンスは、２つの１６進同期化ワード30 F5 の記録が毎
回最下位ビットで開始する30 F5 の１６進値を有するＥ
ＢＵ標準技術 3252-Ｅに採用されている２つの同期化ワ
ードに相当する。得られたコードワードの下線を付した
ビットは提案された長い同期化シーケンスに相当させる
のが有利である。
【００２４】再生磁気ヘッド２により磁気テープから取
出したデジタル信号を段３で前置増幅するとともに等価
する。かくして用意した信号をシフトレジスタ４の入力
側に供給し、且つクロック発生器５の入力側に供給す
る。用意されたデジタル信号に対する時間軸であるクロ
ック信号をＰＬＬとして形成されたクロック発生器５に
再び得るようにする。このクロック信号によれば、デー
タおよび同期シーケンスを３ビットコードワードとして
具える用意されたデジタル信号をシフトレジスタ４に直
列に導入する。次いでシフトレジスタ４のビット並列出
力側に存在するデータ信号は、挿入された同期化ワード
に相当するビットシーケンスが用意されたデジタル信号
のデータ流に存在するか否かに関して段６でチェックす
る。かかるチェックは、例えば短い同期化シーケンスを
挿入する場合に７つの連続する値０（“０”）の存在を
比較により質問するようにして実施することができる。
【００２５】データ流に挿入された同期化シーケンスを
認識する他の可能性は段３の出力側から取出し得る直列
デジタル信号を２つの値１（“１”）間の値０
（“０”）の数を計数する計数回路に適用することであ
る。かかる計数回路を以下図３につき説明する。
【００２６】直列デジタル信号の流れに所定の同期化シ
ーケンスを認識すると、段６によって同期化パルス（Ｓ
ｙｎｃ）を供給し、このパルスによって３分周器７およ
び３／２分周器８をリセットする。クロック発生器５に
よって発生したクロック信号はこれら分周器７および８
の計数入力端子に存在する。コードワードクロック信号
は３分周器７の出力から取出すことができ、且つデータ
ワードクロック信号は３／２分周器８の出力から取出す
ことができる。
【００２７】シフトレジスタ４はビット並列出力端子の
他に直列出力端子を有する。シフトレジスタ４によって
時間遅延された直列デジタル信号をこの出力端子からメ
モリ９を経て直列／並列変換器１０に供給する。この直
列／並列変換器１０の並列出力端子から取出し得るビッ
ト並列デジタル信号はコードワードクロック制御してレ
ジスタ１１、例えばＤフリップフロップにロードする。
これら直列／並列変換器１０およびレジスタ１１を適宜
設計してレジスタ１１により現在のコードワード、次の
コードワードおよび前のコードワードの最後のビット位
置を具えるビット並列コードワードを供給し得るように
する。かくして得られる並列コードワードは、前述した
米国特許第４，３３７，４５８号に従う復号化表を格納
するメモリ１２にアドレスとして格納する。メモリ１２
の出力データは復号化データワードであり、これらデー
タワードはコードワードクロック制御され、他のレジス
タ１３でバッファリング処理され、並列／直列変換器１
４の並列入力端子に供給される。並列／直列変換器１４
の並列入力端子に存在するデータワードもコードワード
クロック制御され、並列／直列変換器１４により引き継
がれ、次いで入力クロック周波数の２／３で直列／並列
変換され出力端子１５から供給される。データワードの
関連するクロック信号は端子１６から直列に供給された
データワードに並列に供給する。
【００２８】メッセージ９の全メモリレベルまでの前の
データワードは、同期ワード認識回路配置および直列に
得られるコードワードを復号化する回路配置間のメモリ
９を挿入することによって復号化することができる。
【００２９】図３に示す同期化信号を取出す回路配置
は、ビット直列レベルで段３の出力側から取出し得るデ
ジタル信号に所定の同期化シーケンスが存在するか否か
をチェックするに好適である。次いで計数器１７のリセ
ット入力端子はビット直列デジタル信号（コードワー
ド）を受けるとともにクロック入力端子はクロック発生
器により発生したクロック信号（クロック）を受ける。
計数器１７によって２つの遷移（“１”）間のビット周
期を計数する。計数器１７の計数はＡＮＤゲート１８に
より要求する。選択された同期化シーケンスに依存して
計数器１７の対応する口出しタップをＡＮＤゲート１８
の入力端子に接続する必要がある。選択された同期化シ
ーケンスの特徴である対応の長い０シーケンスが供給さ
れたビット直列データ流に認識されると、計数器１７は
ＯＲゲート１９に結合されたＯＲ結合を経てセットされ
るようになる。これと同時にＡＮＤゲート１８の出力側
に存在する論理レベルは計数器７および８をリセットす
る同期信号（Ｓｙｎｃ）を供給するクロック信号（ｃｌ
ｏｃｋ）のクロックとともにレジスタ２０に格納する。
【００３０】かように考慮した同期化シーケンス0.100.
000.001.0 および0.100.000.010.000.001.0 も自然デー
タ流のデータとして具えることができる。コードワード
のデータ流に挿入された同期化シーケンスの真の認識に
は追加の手段を必要とする。本発明方法の他の例では、
元の最大に許容された数よりも１だけ大きな等極ビット
の少なくとも１つのシーケンスを具えるビット直列デー
タ流に同期化シーケンスを挿入する場合に、かかる追加
の手段を省略することができる。このシーケンスは明瞭
な同期化に用いることができる。原理的にはこの方法は
データワードの符号化における変化写像規定と等価であ
る。かかる新たな同期化シーケンスはワードの供給を変
化させることなく発生させることができる。現在の写像
規定と比較することによる相違は、低周波信号スペクト
ルの内容が高い最大ランレングスの場合に増大すること
である。しかし、この変化は同期化シーケンス全体を直
流成分なく形成することにより制限されるようになる。
対応する例では、変化写像規定に基づく同期化シーケン
スが２つの８ビットデータワードの長さを有し、従って
次に示すビットシーケンスが得られるようになる。
【００３１】
【表３】
【００３２】この同期化シーケンスを符号化する場合に
は、ランレングス−リミッテッド（１．７）−コードの
ルックアヘッド特性のため、同期化シーケンスの第１コ
ードワードの前のコードワードの値と、同期化シーケン
スの最後のワードの次のコードワードの値とを考慮する
必要がある。この関係を次表に示す。
【００３３】
【表４】
【００３４】
【表５】
【００３５】これら表において、記号ｄは組合せ禁止を
示す。これら前のコードワードおよび次のコードワード
によれば、同期化シーケンスのランレングスは２〜９，
７，９，９，３および２〜４である。従って、同期化シ
ーケンスの制限で発生したランレングスは米国特許第
４，３３７，４５８号に示される符号化表の写像規定に
違反しないことを確かめた。従ってこの同期化シーケン
スの直列コードワード流への挿入は何ら制限されること
なく可能である。この同期化シーケンスは、所望の直流
自由度の他に、９ビットのデュアルランレングスによっ
てある誤りに対する許容公差で同期化認識回路配置を設
計することができる。
【００３６】この特定の同期化シーケンスはチャネル復
号化器におけるコードワード同期化に有利に用いられる
だけでなく、チャネル復号化器の後段の信号処理回路、
例えば、符号化器端で固定同期ワード（30 F5 hex ）の
代わりにコードワード“010000 000 010 000 000 010 0
10 ”の関連するデータをデータ流に組込むとともに復
号化器端で評価する場合にＥＢＵ標準技術3252-Eに記載
された規定に従って信号を処理する回路に有利に用いる
こともできる。この手段のため、直流データ流に通常発
生しない同期ワードシーケンスが評価されるとともに２
つの８ビット零シーケンスの一方を誤り同期化を生ずる
ことなく１ビット誤りだけ分布し得る１ビット誤り許容
公差システムを得ることができる。
【００３７】前述したように、（１．７）コードのラン
レングスを考慮しながら、２ビットデータワードを３ビ
ットコードワードに変換する符号化および復号化表は異
なる他の手段で形成することができる。ＩＢＭテクニカ
ル ディスクロージュア ブルテン，第２３巻、第９
号、１９８１年２月、第４３７５〜４３７８頁の記載に
従う符号化および復号化表を用いる場合には、“000.00
0.010”のビットシーケンスを有するコードワードデー
タ流に明瞭な同期シーケンスを挿入するのが有利である
ことを確かめた。かかる同期化シーケンスを発生させる
ためには、データ伝送の開始時に規定する必要のある所
定の初期状態が必要となる。従って、コードワードの不
慮の流れに初期状態から出発して同期化シーケンスを挿
入する瞬時まで任意の状態が存在し得ること勿論であ
る。これがため、任意の状態からＩＢＭテクニカル デ
ィスクロージュア ブルテンに示された状態図の開始を
特徴付ける状態σ０まで変化させる必要がある。この目
的のため、挿入すべき同期化シーケンスのデータワード
の前段に可変部分を設けて同期化シーケンスに関してデ
ータワードとコードワードとの間に次に示す成分を設け
るようにする。
【００３８】
【表６】
【００３９】一般に、コードワードのワード幅は有効コ
ードワードを有する以下に示す３つの位相位置とする。
【００４０】位相位置 １：
【表７】
【００４１】位相位置 2:
【表８】
【００４２】位相位置 3:
【表９】
【００４３】ここにσはＩＢＭテクニカル ディスクロ
ージュア ブルテンに示された状態図における状態を示
し、ドットはコードワード間のワード境界を示す。コー
ドワードのシーケンスは任意ではなく、次のワードの選
択が前のコードワードによって固定された状態に依存す
るため、位相位置１のみは復号化器を同期化するための
実際に発生する明瞭なシーケンスを示す。位相位置２で
はコードワード００１を状態σ５で規定し；位相位置３
ではコードワード０００を状態σ４で規定する。
【図面の簡単な説明】
【図１】 本発明同期化方法を説明するためのチャネル
復号化器の構成を示すブロック回路図である。
【図２】 ランレングス−リミッテッド（１．７）−コ
ードの状態図を示す説明図である。
【図３】 同期化信号を取出すための回路図である。
【符号の説明】
１ 磁気テープ ２ 再生磁気ヘッド ３ 増幅兼等化器 ４ シフトレジスタ ５ クロック発生器 ６ 同期チェック段 ７ 分周器 ８ 分周器 ９ メモリ 10 直列／並列変換器 11 レジスタ 12 メモリ 13 レジスタ 14 変換器／直列変換器 15 出力端子 16 端子 17 計数器 18 ＡＮＤゲート 19 ＯＲゲート 20 レジスタ
───────────────────────────────────────────────────── フロントページの続き (72)発明者 エヴァルト フェロウエリ ドイツ連邦共和国 6108 ヴァイテルシ ュタット フォルム ニーデレント ２ (72)発明者 ヴォルフラム ツィールンギブル ドイツ連邦共和国 5261 シュヴァルバ ッハ アドレルシュトラーセ ７ (72)発明者 イェンス レーマン ドイツ連邦共和国 6086 リードシュタ ット １リュッセルハイメルシュトラー セ 12エー (56)参考文献 特開 昭55−70922（ＪＰ，Ａ) 特開 平２−243024（ＪＰ，Ａ) 特開 昭63−174430（ＪＰ，Ａ) 特開 昭62−123848（ＪＰ，Ａ) 特開 平４−51615（ＪＰ，Ａ) 特開 昭61−250875（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) H04L 7/02 H03M 7/14 H04L 25/49 G11B 20/14 351

Claims (13)

    (57)【特許請求の範囲】
  1. 【請求項１】 直列データ流のコードデータビットを２
    ビット幅のデータワードに細分割するとともに３ビット
    幅のコードワードに符号変換し、隣接する値１
    （“１”）間の３ビット幅のコードワードのシーケンス
    は少なくとも１つの値０（“０”）で多くとも７つの値
    ０（“０”）を具え、３ビット幅のコードワードの位相
    補正復号化に対し所定同期ビットシーケンスをコードワ
    ードのデータ流に挿入するようにした２／３のコード比
    のランレングス−リミッテッド（１．７）−コードに対
    し同期化を行うに当たり、少なくとも３つの順次の３ビ
    ット幅のコードワードを具える同期化シーケンスを挿入
    すべき同期化ビットシーケンスとして発生し、このシー
    ケンスは２つの値１（“１”）間に少なくとも６つの値
    ０（“０”）を有し、挿入された同期化シーケンスの一
    時的な位置を２つの値１（“１”）間の値０（“０”）
    の数を決めることにより規定して直列に伝送されたコー
    ドワードのワード境界を認識するようにしたことを特徴
    とする同期化方法。
  2. 【請求項２】 同期化シーケンスは“ＸＸ０．１００．
    ０００．００１．０ＸＸ”のビットシーケンスを有し、
    ここにドットはワード境界を示し、Ｘは任意のビット値
    を示し、“１”は信号遷移を示し、“０”は信号無遷移
    を示すことを特徴とする請求項１に記載の同期化方法。
  3. 【請求項３】 同期化シーケンスは“ＸＸ０．１００．
    ０００．０１０．０００．００１．０ＸＸ”のビットシ
    ーケンスを有し、ここにドットはワード境界を示し、Ｘ
    は任意のビット値を示し、“１”は信号遷移を示し、
    “０”は信号無遷移を示すことを特徴とする請求項１に
    記載の同期化方法。
  4. 【請求項４】 同期化シーケンスは“ＸＸＸ．０００．
    ０００．０１０．ＸＸ”のビットシーケンスを有し、こ
    こにドットはワード境界を示し、Ｘは任意のビット値を
    示し、“１”は信号遷移を示し、“０”は信号無遷移を
    示すことを特徴とする請求項１に記載の同期化方法。
  5. 【請求項５】 同期化シーケンスは“ＸＸＸ．０１０．
    ０００．０００．０１０．０００．０００．０１０．０
    １０．ＸＸＸ”のビットシーケンスを有し、ここにドッ
    トはワード境界を示し、Ｘは任意のビット値を示し、
    “１”は信号遷移を示し、“０”は信号無遷移を示すこ
    とを特徴とする請求項１に記載の同期化方法。
  6. 【請求項６】 ビットシーケンス“ＸＸＸ．０１０．０
    ００．０００．０１０．０００．０００．０１０．０１
    ０．ＸＸＸ”を有する同期化シーケンスの関連するデー
    タワードは、データ流に挿入するとともに同期化データ
    ブロックに対し設けられた同期化ワードの代わりに伝送
    し、且つビットシーケンス“ＸＸＸ．０１０．０００．
    ０００．０１０．０００．０００．０１０．０１０．Ｘ
    ＸＸ”を有する伝送された同期化シーケンスの関連する
    データワードをデータブロック同期化に対し用いるよう
    にしたことを特徴とする請求項５に記載の同期化方法。
  7. 【請求項７】 挿入された同期化シーケンスの一時的な
    位置は同期化シーケンスの所定ビットシーケンスと比較
    することによって決めるようにしたことを特徴とする請
    求項１に記載の同期化方法。
  8. 【請求項８】 挿入された同期化シーケンスの一時的な
    位置は２つの値１間の値０を計数することによって決め
    るとともに識別された同期化シーケンスの時間に対する
    位置に依存し、ビット流に存在するコードワードのワー
    ド境界を割り当てるようにしたことを特徴とする請求項
    １に記載の同期化方法。
  9. 【請求項９】 直列データ流のコードデータビットを２
    ビット幅のデータワードに細分割するとともに３−ビッ
    ト幅のコードワードに符号変換（トランスコード）し、
    隣接する値１（“１”）間の３−ビット幅のコードの同
    期化シーケンスが少なくとも１つの値０（“０”）で多
    くとも７つの値０（“０”）を具える請求項１に記載の
    コード比２／３を有するランレングス−リミッテッド
    （１．７）コード用の同期化方法を実施する回路であっ
    て、前記３−ビット幅のコードワードを正しい位相関係
    で復号化するために、所定の同期化ビットシーケンスを
    コードワードのデータ流に挿入する回路装置において、
    コードワードのデータ流中の同期化シーケンスを認識す
    る装置（４，６；１７〜２０）と、コードワードの１つ
    に一時的に関連するクロック信号を分周し、前記同期化
    シーケンスを認識する装置（４，６；１７〜２０）によ
    り取出された同期化信号によってリセットされる３分周
    器（７）と、前記コードワードに一時的に関連するクロ
    ック信号を分周し、前記同期化シーケンスを認識する装
    置（４，６；１７〜２０）の同期化信号によりリセット
    される３／２分周器（８）と、直列コードワードを直列
    ／並列変換する直列／並列変換器（１０）と、前記３分
    周器（７）の出力側に得られるコードワードクロックの
    制御の下で前記直列／並列変換器（１０）の出力側に得
    られる並列コードワードをバッファリングする第１レジ
    スタ（１１）と、コードワードをデータワードに符号変
    換するリードオンリメモリ（１２）と、このリードオン
    リメモリ（１２）により供給されるデータワードをバッ
    ファリングする第２レジスタ（１３）と、前記コードワ
    ードクロックの制御の下で第２レジスタ（１３）の出力
    からのバッファリングされたデータワードを引き継ぐと
    ともに前記３／２分周器（８）の出力側に得られるデー
    タワードクロックの制御の下で前記データワードをビッ
    ト直列形態で供給する並列／直列変換器（１４）とを具
    えることを特徴とする請求項１に記載の同期化方法を実
    施する回路装置。
  10. 【請求項１０】 前記同期化シーケンスを認識する装置
    （４，６；１７〜２０）はシフトレジスタ（４）を具
    え、このシフトレジスタでコードワードを直列にシフト
    するとともに所定同期化シーケンスとの比較を行う比較
    装置（６）に並列形態で供給することを特徴とする請求
    項９に記載の回路装置。
  11. 【請求項１１】 前記同期化シーケンスを認識する装置
    （４，６；１７〜２０）は計数器（１７）を具え、これ
    により直列コードワードに関連するクロック信号のクロ
    ックパルスを計数するとともに前記計数器の出力側に接
    続された復号器（１８）のリセット信号により直列コー
    ドワードの信号遷移（“１”）でリセットし得るように
    したことを特徴とする請求項９に記載の回路装置。
  12. 【請求項１２】 前記復号器（１８）はその後段にレジ
    スタ（２０）を設け、このレジスタは直列コードワード
    に関連するクロック信号のクロックによってクロック処
    理されるようにしたことを特徴とする請求項１１に記載
    の回路装置。
  13. 【請求項１３】 直列コードワードを時間遅延するメモ
    リ（９）は前記直列／並列変換器（１０）の入力側の前
    段に設けるようにしたことを特徴とする請求項９に記載
    の回路装置。
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