JP3361146B2 - ダイヤモンド材料表面からの自由空間電子放出を利用するトランジスタ・デバイス装置 - Google Patents
ダイヤモンド材料表面からの自由空間電子放出を利用するトランジスタ・デバイス装置Info
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/12—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/16—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only elements of Group IV of the Periodic System
- H01L29/161—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only elements of Group IV of the Periodic System including two or more of the elements provided for in group H01L29/16, e.g. alloys
- H01L29/165—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only elements of Group IV of the Periodic System including two or more of the elements provided for in group H01L29/16, e.g. alloys in different semiconductor regions, e.g. heterojunctions
Description
【0001】
【産業上の利用分野】本発明は一般に電子デバイスに関
し、特にダイヤモンド材料からの電子放出を利用する電
子デバイスに関する。
し、特にダイヤモンド材料からの電子放出を利用する電
子デバイスに関する。
【0002】
【従来の技術】バイポ−ラおよび電界効果トランジスタ
のような半導体電子デバイスは、従来から広く用いられ
ている。しかし、バイポ−ラおよび電界効果トランジス
タの両者は、不十分な絶縁性および逆電圧降下(rev
erse voltage breakdown)によ
って好ましくない特性を有する場合がある。
のような半導体電子デバイスは、従来から広く用いられ
ている。しかし、バイポ−ラおよび電界効果トランジス
タの両者は、不十分な絶縁性および逆電圧降下(rev
erse voltage breakdown)によ
って好ましくない特性を有する場合がある。
【0003】シリアル番号が07/877,931であ
り、1992年5月4日に出願された”ELECTRO
N DEVICE EMPLOYING A DIAM
OND FILM ELECTRON SOURCE”
に記述されているようなダイヤモンド材料電子デバイス
は、能動トランジスタ制御を一体化する手段をダイヤモ
ンド材料電子デバイスに提供することによって改善して
いる。
り、1992年5月4日に出願された”ELECTRO
N DEVICE EMPLOYING A DIAM
OND FILM ELECTRON SOURCE”
に記述されているようなダイヤモンド材料電子デバイス
は、能動トランジスタ制御を一体化する手段をダイヤモ
ンド材料電子デバイスに提供することによって改善して
いる。
【0004】
【発明が解決しようとする課題】したがって、少なくと
も従来の技術における欠点を克服する電子デバイスが望
まれている。
も従来の技術における欠点を克服する電子デバイスが望
まれている。
【0005】
【課題を解決するための手段】これらの必要な動作特性
その他に関する課題は、主面(major surfa
ce)を有する支持基板と、支持基板内に配置され、実
質的に主面内に位置するトランジスタとを含む電子デバ
イスを提供することによって解決される。そのトランジ
スタは、トランジスタ・コレクタ,トランジスタ・ベ−
スおよびトランジスタ・エミッタを含む。トランジスタ
・ベ−ス導体はトランジスタ・ベ−スに実施可能に(o
perably)結合し、トランジスタ・エミッタ導体
はトランジスタ・エミッタに実施可能に結合する。電子
を放出する電子放出面を有するダイヤモンド材料層は、
支持基板の主面上に配置され、トランジスタ・コレクタ
に実施可能に結合する。アノ−ドは、ダイヤモンド材料
層に対して距離を隔てて配置される。
その他に関する課題は、主面(major surfa
ce)を有する支持基板と、支持基板内に配置され、実
質的に主面内に位置するトランジスタとを含む電子デバ
イスを提供することによって解決される。そのトランジ
スタは、トランジスタ・コレクタ,トランジスタ・ベ−
スおよびトランジスタ・エミッタを含む。トランジスタ
・ベ−ス導体はトランジスタ・ベ−スに実施可能に(o
perably)結合し、トランジスタ・エミッタ導体
はトランジスタ・エミッタに実施可能に結合する。電子
を放出する電子放出面を有するダイヤモンド材料層は、
支持基板の主面上に配置され、トランジスタ・コレクタ
に実施可能に結合する。アノ−ドは、ダイヤモンド材料
層に対して距離を隔てて配置される。
【0006】これらの必要な動作特性その他に関する課
題はまた、主面を有する支持基板と、支持基板内で実質
的に主面に配置されるトランジスタとを含む電子デバイ
スを提供することによって解決される。そのトランジス
タは、トランジスタ・ソ−ス,トランジスタ・ドレイン
およびトランジスタ・ゲ−ト・デプレッション領域を含
む。トランジスタ・ソ−ス導体はトランジスタ・ソ−ス
に実施可能に結合し、トランジスタ・ゲ−ト導体はトラ
ンジスタ・ゲ−ト・デプレッション領域に実施可能に結
合する。電子を放出する電子放出面を有するダイヤモン
ド材料層は、支持基板の主面上に配置され、トランジス
タ・ドレインに実施可能に結合する。アノ−ドは、ダイ
ヤモンド材料層に対して距離を隔てて配置される。
題はまた、主面を有する支持基板と、支持基板内で実質
的に主面に配置されるトランジスタとを含む電子デバイ
スを提供することによって解決される。そのトランジス
タは、トランジスタ・ソ−ス,トランジスタ・ドレイン
およびトランジスタ・ゲ−ト・デプレッション領域を含
む。トランジスタ・ソ−ス導体はトランジスタ・ソ−ス
に実施可能に結合し、トランジスタ・ゲ−ト導体はトラ
ンジスタ・ゲ−ト・デプレッション領域に実施可能に結
合する。電子を放出する電子放出面を有するダイヤモン
ド材料層は、支持基板の主面上に配置され、トランジス
タ・ドレインに実施可能に結合する。アノ−ドは、ダイ
ヤモンド材料層に対して距離を隔てて配置される。
【0007】これらの必要な動作特性その他に関する課
題はまた、主面を有する支持基板と、支持基板内で実質
的に主面に配置されるトランジスタとを含む電子デバイ
スを提供することによって解決される。そのトランジス
タは、トランジスタ・ソ−ス,トランジスタ・ドレイン
およびトランジスタ・ゲ−ト領域を含む。トランジスタ
・ソ−ス導体は、トランジスタ・ソ−スに実施可能に結
合する。絶縁層は、トランジスタ・ゲ−ト領域に対応す
る支持基板の主面の一部分上に配置され、トランジスタ
・ゲ−ト導体はその絶縁層上に配置される。電子を放出
する電子放出面を有するダイヤモンド材料層は、支持基
板の主面上に配置され、トランジスタ・ドレインに実施
可能に結合する。アノ−ドは、ダイヤモンド材料層に対
して距離を隔てて配置される。
題はまた、主面を有する支持基板と、支持基板内で実質
的に主面に配置されるトランジスタとを含む電子デバイ
スを提供することによって解決される。そのトランジス
タは、トランジスタ・ソ−ス,トランジスタ・ドレイン
およびトランジスタ・ゲ−ト領域を含む。トランジスタ
・ソ−ス導体は、トランジスタ・ソ−スに実施可能に結
合する。絶縁層は、トランジスタ・ゲ−ト領域に対応す
る支持基板の主面の一部分上に配置され、トランジスタ
・ゲ−ト導体はその絶縁層上に配置される。電子を放出
する電子放出面を有するダイヤモンド材料層は、支持基
板の主面上に配置され、トランジスタ・ドレインに実施
可能に結合する。アノ−ドは、ダイヤモンド材料層に対
して距離を隔てて配置される。
【0008】本発明のいくつかの好適実施例では、ダイ
ヤモンド材料層に対して距離を隔てて配置され、自由空
間領域内に位置するアノ−ドは、改善された絶縁性およ
び改善された降伏電圧特性を有する装置を実現させる。
ヤモンド材料層に対して距離を隔てて配置され、自由空
間領域内に位置するアノ−ドは、改善された絶縁性およ
び改善された降伏電圧特性を有する装置を実現させる。
【0009】本発明のいくつかの好適実施例では、ダイ
ヤモンド材料層の電子放出面からの電子放出は、ダイヤ
モンド材料層に実施可能に結合するトランジスタによっ
て実質的に制御される。
ヤモンド材料層の電子放出面からの電子放出は、ダイヤ
モンド材料層に実施可能に結合するトランジスタによっ
て実質的に制御される。
【0010】
【実施例】図1は、本発明による電子デバイス100を
表示する断面図である。主面(major surfa
ce)111を有する支持基板101は、支持基板10
1の主面111に配置され支持基板101に伸びるバイ
ポ−ラ・トランジスタと共に提供される。バイポ−ラ・
トランジスタは、トランジスタ・コレクタ102,トラ
ンジスタ・ベ−ス103およびトランジスタ・エミッタ
104を含む。トランジスタ・ベ−ス導体105は、ト
ランジスタ・ベ−ス103に対応して主面111上の一
部分上に配置され、実施可能に結合される。トランジス
タ・エミッタ導体106は、トランジスタ・エミッタ1
04に対応して主面111の一部分上に配置され、実施
可能に結合する。少なくとも電子を放出する電子放出面
131を有するダイヤモンド材料層は、トランジスタ・
コレクタ102に対応して主面111の一部分上に配置
され、実施可能に結合する。アノ−ド108は、電子放
出面131に対して距離を隔てて配置され、その結果自
由空間領域132を限定することとなる。
表示する断面図である。主面(major surfa
ce)111を有する支持基板101は、支持基板10
1の主面111に配置され支持基板101に伸びるバイ
ポ−ラ・トランジスタと共に提供される。バイポ−ラ・
トランジスタは、トランジスタ・コレクタ102,トラ
ンジスタ・ベ−ス103およびトランジスタ・エミッタ
104を含む。トランジスタ・ベ−ス導体105は、ト
ランジスタ・ベ−ス103に対応して主面111上の一
部分上に配置され、実施可能に結合される。トランジス
タ・エミッタ導体106は、トランジスタ・エミッタ1
04に対応して主面111の一部分上に配置され、実施
可能に結合する。少なくとも電子を放出する電子放出面
131を有するダイヤモンド材料層は、トランジスタ・
コレクタ102に対応して主面111の一部分上に配置
され、実施可能に結合する。アノ−ド108は、電子放
出面131に対して距離を隔てて配置され、その結果自
由空間領域132を限定することとなる。
【0011】電子デバイス100は、電源のような外部
信号源を少なくとも一部のデバイス素子102,10
3,104さらには一部のデバイス導体105,106
に印加すると、さらに有効的である。たとえば図1は、
アノ−ド108と接地または参照電位との間に第1外部
電源141を実施可能に結合することによって、アノ−
ド108と接地電位として示される参照電位との間に電
圧が印加されている。トランジスタ・ゲ−ト導体105
と接地または参照電位との間に第2外部電源142を実
施可能に結合することによって、トランジスタ・ゲ−ト
導体105と接地または参照電位との間に他の電圧が印
加されている。さらに、トランジスタ・エミッタ導体1
06と接地または参照電位との間に第3外部供給電源1
43を実施可能に結合することによって、トランジスタ
・エミッタ導体106と接地または参照電位との間に他
の電圧が印加されている。これらの外部供給電源のいく
つかを省略し、適切なデバイス素子または導体を参照電
位に実施可能に結合するような改良が可能であることは
予想されるであろう。
信号源を少なくとも一部のデバイス素子102,10
3,104さらには一部のデバイス導体105,106
に印加すると、さらに有効的である。たとえば図1は、
アノ−ド108と接地または参照電位との間に第1外部
電源141を実施可能に結合することによって、アノ−
ド108と接地電位として示される参照電位との間に電
圧が印加されている。トランジスタ・ゲ−ト導体105
と接地または参照電位との間に第2外部電源142を実
施可能に結合することによって、トランジスタ・ゲ−ト
導体105と接地または参照電位との間に他の電圧が印
加されている。さらに、トランジスタ・エミッタ導体1
06と接地または参照電位との間に第3外部供給電源1
43を実施可能に結合することによって、トランジスタ
・エミッタ導体106と接地または参照電位との間に他
の電圧が印加されている。これらの外部供給電源のいく
つかを省略し、適切なデバイス素子または導体を参照電
位に実施可能に結合するような改良が可能であることは
予想されるであろう。
【0012】アノ−ド108に適切な電圧を印加するこ
とによってトランジスタ・ベ−ス導体105およびトラ
ンジスタ・エミッタ導体106に印加する電圧がバイポ
−ラ・トランジスタのベ−ス・エミッタ接合を順方向バ
イアスするとき、図1に示され上記のような外部供給電
源に実施可能に結合される電子デバイス100はONモ
−ドで動作する。アノ−ド108に電圧を印加すると、
電子放出面131において電場が誘発され、矢印109
で表される電子は自由空間領域132内に放出され、一
部の電子はアノ−ド108に集められる。アノ−ド10
8に印加される電圧がダイヤモンド層107の電子放出
面131からの電子放出を十分に誘発しないとき、また
はバイポ−ラ・トランジスタのベ−ス・エミッタ接合が
逆バイアスされるとき、電子デバイス100はOFFモ
−ドである。
とによってトランジスタ・ベ−ス導体105およびトラ
ンジスタ・エミッタ導体106に印加する電圧がバイポ
−ラ・トランジスタのベ−ス・エミッタ接合を順方向バ
イアスするとき、図1に示され上記のような外部供給電
源に実施可能に結合される電子デバイス100はONモ
−ドで動作する。アノ−ド108に電圧を印加すると、
電子放出面131において電場が誘発され、矢印109
で表される電子は自由空間領域132内に放出され、一
部の電子はアノ−ド108に集められる。アノ−ド10
8に印加される電圧がダイヤモンド層107の電子放出
面131からの電子放出を十分に誘発しないとき、また
はバイポ−ラ・トランジスタのベ−ス・エミッタ接合が
逆バイアスされるとき、電子デバイス100はOFFモ
−ドである。
【0013】OFFモ−ドにあるとき、すなわちバイポ
−ラ・トランジスタのベ−ス・エミッタ接合を逆バイア
スするとき、電子デバイス100はアノ−ド108に印
加される電圧または信号に対して比較的敏感ではない。
したがって、本発明の電子デバイス100は、従来の半
導体トランジスタ・デバイスの逆降伏電圧限界(rev
erse breakdown limitatio
n)および良好でない絶縁性を問題としない。
−ラ・トランジスタのベ−ス・エミッタ接合を逆バイア
スするとき、電子デバイス100はアノ−ド108に印
加される電圧または信号に対して比較的敏感ではない。
したがって、本発明の電子デバイス100は、従来の半
導体トランジスタ・デバイスの逆降伏電圧限界(rev
erse breakdown limitatio
n)および良好でない絶縁性を問題としない。
【0014】図2は、図1の実施例を改良したものであ
り、図1において既に述べたような本発明による電子デ
バイス110の断面図である。この場合において、アノ
−ド108は支持基板101の主面111の一部分上に
配置され、ダイヤモンド材料層107の電子放出面13
1に対して距離を隔てて配置され、その結果それらの間
で自由空間領域132を限定する。上述したように電子
デバイス110の動作は、矢印109で示されるように
電子放出面131から図2で示すような自由空間領域1
32へ向かう電子放出を提供する。放出された電子の少
なくともいくらかは、アノ−ド108によって集められ
ることが望ましい。
り、図1において既に述べたような本発明による電子デ
バイス110の断面図である。この場合において、アノ
−ド108は支持基板101の主面111の一部分上に
配置され、ダイヤモンド材料層107の電子放出面13
1に対して距離を隔てて配置され、その結果それらの間
で自由空間領域132を限定する。上述したように電子
デバイス110の動作は、矢印109で示されるように
電子放出面131から図2で示すような自由空間領域1
32へ向かう電子放出を提供する。放出された電子の少
なくともいくらかは、アノ−ド108によって集められ
ることが望ましい。
【0015】図3は、図1,2に描かれた電子デバイス
100,110の両者を表す概略図120である。
100,110の両者を表す概略図120である。
【0016】図4は、本発明による電子デバイスの他の
実施例200を示す断面図である。主面211を有する
支持基板201が準備される。電界効果トランジスタ
は、支持基板201の主面上に配置され、そこから支持
基板201内に伸びる。電界効果トランジスタは、トラ
ンジスタ・チャネル202およびトランジスタ・ゲ−ト
203を含む。トランジスタ・ゲ−ト導体204は、ト
ランジスタ・ゲ−ト203に対応して実施可能に結合す
る主面211の一部分上に配置される。トランジスタ・
ソ−ス導体205は、トランジスタ・チャネル202に
対応して実施可能に結合する主面211の一部分上に配
置される。電子放出のための電子放出面231を有する
ダイヤモンド材料層206は、チャネル202の他の部
分に対応して実施可能に結合する主面111の一部分上
配置される。アノ−ド207は、支持基板201の主面
211の一部分上に配置され、電子放出面231に対し
て距離を隔てて配置され、その結果それらの間で自由空
間領域132を限定することとなる。
実施例200を示す断面図である。主面211を有する
支持基板201が準備される。電界効果トランジスタ
は、支持基板201の主面上に配置され、そこから支持
基板201内に伸びる。電界効果トランジスタは、トラ
ンジスタ・チャネル202およびトランジスタ・ゲ−ト
203を含む。トランジスタ・ゲ−ト導体204は、ト
ランジスタ・ゲ−ト203に対応して実施可能に結合す
る主面211の一部分上に配置される。トランジスタ・
ソ−ス導体205は、トランジスタ・チャネル202に
対応して実施可能に結合する主面211の一部分上に配
置される。電子放出のための電子放出面231を有する
ダイヤモンド材料層206は、チャネル202の他の部
分に対応して実施可能に結合する主面111の一部分上
配置される。アノ−ド207は、支持基板201の主面
211の一部分上に配置され、電子放出面231に対し
て距離を隔てて配置され、その結果それらの間で自由空
間領域132を限定することとなる。
【0017】電界効果トランジスタは、トランジスタ・
ゲ−ト導体204に印加される電圧の大きさおよび極性
によって、ONモ−ドまたはOFFモ−ドの何れかにお
いて動作し、または制御される。印加される電圧は、第
2外部電源242によって与えられる。ONモ−ドで
は、トランジスタ・ゲ−ト導体204に印加される電圧
は、トランジスタ・ゲ−トすなわちゲ−ト・チャネル接
合デプレション領域203をそのような限定された範囲
に制限し、トランジスタ・チャネルすなわちチャネル2
02を絶え間なく維持し、電子がダイヤモンド材料層2
06に伝導する経路を与える。OFFモ−ドでは、トラ
ンジスタ・ゲ−ト導体204に印加される電圧は、チャ
ネル202幅の間でゲ−ト・チャネル接合を広げること
となり、その結果チャネル202は分断され、チャネル
202を介する電荷キャリアの流れすなわち電子の流れ
を遮断する。
ゲ−ト導体204に印加される電圧の大きさおよび極性
によって、ONモ−ドまたはOFFモ−ドの何れかにお
いて動作し、または制御される。印加される電圧は、第
2外部電源242によって与えられる。ONモ−ドで
は、トランジスタ・ゲ−ト導体204に印加される電圧
は、トランジスタ・ゲ−トすなわちゲ−ト・チャネル接
合デプレション領域203をそのような限定された範囲
に制限し、トランジスタ・チャネルすなわちチャネル2
02を絶え間なく維持し、電子がダイヤモンド材料層2
06に伝導する経路を与える。OFFモ−ドでは、トラ
ンジスタ・ゲ−ト導体204に印加される電圧は、チャ
ネル202幅の間でゲ−ト・チャネル接合を広げること
となり、その結果チャネル202は分断され、チャネル
202を介する電荷キャリアの流れすなわち電子の流れ
を遮断する。
【0018】第1の外部供給電源241によってアノ−
ド207に適切な電圧を印加することは、矢印208で
示される電子を誘発し、電界効果トランジスタがONモ
−ドであるときダイヤモンド材料層206の電子放出面
231から電子を放出させる。
ド207に適切な電圧を印加することは、矢印208で
示される電子を誘発し、電界効果トランジスタがONモ
−ドであるときダイヤモンド材料層206の電子放出面
231から電子を放出させる。
【0019】図1,2の電子デバイス100,110の
両者で既に述べたように、図4の電子デバイス200も
またアノ−ド207に印加される電圧あるいは信号に対
して比較的敏感でない。これは自由空間領域232の絶
縁性に起因する。
両者で既に述べたように、図4の電子デバイス200も
またアノ−ド207に印加される電圧あるいは信号に対
して比較的敏感でない。これは自由空間領域232の絶
縁性に起因する。
【0020】図5は、図4に示すような電子デバイス2
00を表す概略図220である。
00を表す概略図220である。
【0021】図6は、本発明による電子デバイスの他の
実施例300の断面図である。主面311を有する支持
基板301は電界効果トランジスタと共に提供され、そ
の電界効果トランジスタは支持基板301の主面311
に配置され、そこから支持基板301内に伸びる。電界
効果トランジスタは、トランジスタ・ドレイン302,
トランジスタ・ソ−ス303,トランジスタ・ゲ−ト領
域308を含む。絶縁層310はトランジスタ・ゲ−ト
領域308に対応する主面311の一部分上に配置され
る。トランジスタ・ゲ−ト導体306は、絶縁層310
上に配置される。トランジスタ・ソ−ス領域307は、
トランジスタ・ソ−ス303の一部分に対応して実施可
能に結合する主面311の一部分上に配置される。矢印
309で示される電子を放出する電子放出面331を有
するダイヤモンド材料層305は、トランジスタ・ドレ
イン302に対応して実施可能に結合される主面311
の一部分上に配置される。アノ−ド304は支持基板3
01の主面311の一部分上に配置され、電子放出面3
31に対して距離を隔てて配置され、それらの間の自由
空間領域332を限定する。
実施例300の断面図である。主面311を有する支持
基板301は電界効果トランジスタと共に提供され、そ
の電界効果トランジスタは支持基板301の主面311
に配置され、そこから支持基板301内に伸びる。電界
効果トランジスタは、トランジスタ・ドレイン302,
トランジスタ・ソ−ス303,トランジスタ・ゲ−ト領
域308を含む。絶縁層310はトランジスタ・ゲ−ト
領域308に対応する主面311の一部分上に配置され
る。トランジスタ・ゲ−ト導体306は、絶縁層310
上に配置される。トランジスタ・ソ−ス領域307は、
トランジスタ・ソ−ス303の一部分に対応して実施可
能に結合する主面311の一部分上に配置される。矢印
309で示される電子を放出する電子放出面331を有
するダイヤモンド材料層305は、トランジスタ・ドレ
イン302に対応して実施可能に結合される主面311
の一部分上に配置される。アノ−ド304は支持基板3
01の主面311の一部分上に配置され、電子放出面3
31に対して距離を隔てて配置され、それらの間の自由
空間領域332を限定する。
【0022】電子デバイス300の動作は、導体30
6,307および図4の電子デバイス300のアノ−ド
304の内のいずれかまたは全てに適切な電圧を印加す
る外部電源の配置によって異なるものになる。電界効果
トランジスタはONモ−ドにおいて、電圧または参照電
位をトランジスタ・ソ−ス導体307に印加し、電圧を
トランジスタ・ゲ−ト導体306に印加することによっ
て配置される。このエンハスメント型の電界効果トラン
ジスタの場合、電子がダイヤモンド材料層305へ移動
できるように伝導路を提供するため、トランジスタ・ゲ
−ト領域308内に反転層を形成する必要がある。その
ような伝導路は、適切な電圧またはバイアスをトランジ
スタ・ゲ−ト導体306に印加することによって提供さ
れ、その結果トランジスタ・ゲ−ト導体306に近いト
ランジスタ・ゲ−ト領域308内に電荷キャリアを集中
させ、バイアスされていない状態から反転させる。
6,307および図4の電子デバイス300のアノ−ド
304の内のいずれかまたは全てに適切な電圧を印加す
る外部電源の配置によって異なるものになる。電界効果
トランジスタはONモ−ドにおいて、電圧または参照電
位をトランジスタ・ソ−ス導体307に印加し、電圧を
トランジスタ・ゲ−ト導体306に印加することによっ
て配置される。このエンハスメント型の電界効果トラン
ジスタの場合、電子がダイヤモンド材料層305へ移動
できるように伝導路を提供するため、トランジスタ・ゲ
−ト領域308内に反転層を形成する必要がある。その
ような伝導路は、適切な電圧またはバイアスをトランジ
スタ・ゲ−ト導体306に印加することによって提供さ
れ、その結果トランジスタ・ゲ−ト導体306に近いト
ランジスタ・ゲ−ト領域308内に電荷キャリアを集中
させ、バイアスされていない状態から反転させる。
【0023】第1外部供給電源341によってアノ−ド
304に適切な電圧を印加することは、電界効果トラン
ジスタがONモ−ドであるとき、矢印309で示される
電子をダイヤモンド材料層305の電子放出面331か
ら放出させる。
304に適切な電圧を印加することは、電界効果トラン
ジスタがONモ−ドであるとき、矢印309で示される
電子をダイヤモンド材料層305の電子放出面331か
ら放出させる。
【0024】図1,2の電子デバイス100,110で
既に述べたように、図6の電子デバイス300はアノ−
ド304に印加される電圧または信号に対して比較的敏
感でないのは、自由空間領域332の絶縁性に起因す
る。
既に述べたように、図6の電子デバイス300はアノ−
ド304に印加される電圧または信号に対して比較的敏
感でないのは、自由空間領域332の絶縁性に起因す
る。
【0025】図7は、図6で述べたような電子デバイス
300を表す概略図320である。
300を表す概略図320である。
【0026】図8は、図6において述べたような本発明
による電子デバイス400の他の実施例を示す断面図で
ある。図6で既に参照したものについては、数字「4」
で始まる同様の番号が付してある。図8で示される電子
デバイス400は、光学的に実質的に透明なフェ−スプ
レ−ト(faceplate)413を有するアノ−ド
を含み、そのフェ−スプレ−トは光学的に実質的に透明
な導電層412上に堆積され、その導電層はルミネセン
ト(luminescent)層411上に配置され
る。アノ−ドは、電子放出面431に対して距離を隔て
て配置され、それらの間で自由空間領域432を限定す
る。
による電子デバイス400の他の実施例を示す断面図で
ある。図6で既に参照したものについては、数字「4」
で始まる同様の番号が付してある。図8で示される電子
デバイス400は、光学的に実質的に透明なフェ−スプ
レ−ト(faceplate)413を有するアノ−ド
を含み、そのフェ−スプレ−トは光学的に実質的に透明
な導電層412上に堆積され、その導電層はルミネセン
ト(luminescent)層411上に配置され
る。アノ−ドは、電子放出面431に対して距離を隔て
て配置され、それらの間で自由空間領域432を限定す
る。
【0027】このように形成されるとONモ−ドで動作
するとき、矢印409で示される電子は、電子放出面4
31から自由空間領域432へ放出され、放出された電
子の一部はアノ−ドの光学的に透明な導電層412に集
められる。アノ−ドで集められる電子の経路では、いく
らかの電子はそのエネルギを、観測者が観測可能な光子
の輻射を誘発するルミネセント層に伝達する。トランジ
スタ・ゲ−ト導体406およびトランジスタ・ソ−ス導
体407の何れかまたは両方に印加する電圧を調整する
ことによって、電子の放出率を制御することが可能であ
り、その結果ルミネセント層411からの光子の輻射を
制御することが可能である。
するとき、矢印409で示される電子は、電子放出面4
31から自由空間領域432へ放出され、放出された電
子の一部はアノ−ドの光学的に透明な導電層412に集
められる。アノ−ドで集められる電子の経路では、いく
らかの電子はそのエネルギを、観測者が観測可能な光子
の輻射を誘発するルミネセント層に伝達する。トランジ
スタ・ゲ−ト導体406およびトランジスタ・ソ−ス導
体407の何れかまたは両方に印加する電圧を調整する
ことによって、電子の放出率を制御することが可能であ
り、その結果ルミネセント層411からの光子の輻射を
制御することが可能である。
【0028】図9は、図1で述べたような本発明による
電子デバイス500の他の実施例を示す断面図である。
したがって、図1で既に参照したものは、図9において
は数字「5」で始まる同様な参照番号で示される。図9
に示される電子デバイス500はさらに、実質的に光学
的に透明なフェ−スプレ−ト513から成るアノ−ドを
含み、そのフェ−スプレ−トは実質的に光学的に透明な
導電層512上に堆積され、その導電層はルミネセント
層511上に堆積される。そのアノ−ドは電子放出面5
31に対して距離を隔てて配置され、それらの間で自由
空間領域532を限定する。
電子デバイス500の他の実施例を示す断面図である。
したがって、図1で既に参照したものは、図9において
は数字「5」で始まる同様な参照番号で示される。図9
に示される電子デバイス500はさらに、実質的に光学
的に透明なフェ−スプレ−ト513から成るアノ−ドを
含み、そのフェ−スプレ−トは実質的に光学的に透明な
導電層512上に堆積され、その導電層はルミネセント
層511上に堆積される。そのアノ−ドは電子放出面5
31に対して距離を隔てて配置され、それらの間で自由
空間領域532を限定する。
【0029】このように構成すると、ONモ−ドで動作
するとき、矢印509で示される電子は、電子放出面5
31から自由空間領域532へ放出され、一部の電子は
アノ−ドの実質的に光学的に透明な導電層512に集め
られる。アノ−ドに集まる電子の経路では、一部の電子
のエネルギは、観測者が観測可能な光子の輻射を誘発す
るルミネセント層511に伝達される。トランジスタ・
ベ−ス導体505およびトランジスタ・エミッタ導体5
06の何れかまたは両方に印加される電圧を調整するこ
とによって、電子の放出率を制御することが可能であ
り、したがってルミネセント層511からの光子の輻射
を制御することが可能である。
するとき、矢印509で示される電子は、電子放出面5
31から自由空間領域532へ放出され、一部の電子は
アノ−ドの実質的に光学的に透明な導電層512に集め
られる。アノ−ドに集まる電子の経路では、一部の電子
のエネルギは、観測者が観測可能な光子の輻射を誘発す
るルミネセント層511に伝達される。トランジスタ・
ベ−ス導体505およびトランジスタ・エミッタ導体5
06の何れかまたは両方に印加される電圧を調整するこ
とによって、電子の放出率を制御することが可能であ
り、したがってルミネセント層511からの光子の輻射
を制御することが可能である。
【0030】
【発明の効果】本発明による利益の1つは、従来の電子
デバイスの妨げとなっていた現象として知られる降伏電
圧限界の影響を受けない電子デバイスを提供することで
ある。この改良は、自由空間領域および電子デバイスの
一部分を介する電子の自由空間伝達を用いる電子デバイ
スを提供することによって実現される。
デバイスの妨げとなっていた現象として知られる降伏電
圧限界の影響を受けない電子デバイスを提供することで
ある。この改良は、自由空間領域および電子デバイスの
一部分を介する電子の自由空間伝達を用いる電子デバイ
スを提供することによって実現される。
【0031】本発明の他の利益は、従来の良好でない絶
縁性の影響を受けない電子デバイスを提供することであ
る。この改良は、自由空間領域および少なくとも電子デ
バイスの一部分を介する電子の自由空間伝達を利用する
電子デバイスを提供することによって実現される。
縁性の影響を受けない電子デバイスを提供することであ
る。この改良は、自由空間領域および少なくとも電子デ
バイスの一部分を介する電子の自由空間伝達を利用する
電子デバイスを提供することによって実現される。
【0032】本発明の他の利益は、包括的に制御される
ダイヤモンド材料電子源を提供することである。その電
子源は、一体的に形成されたトランジスタ・デバイスを
使用して、表示画面から光子の放出を制御する。
ダイヤモンド材料電子源を提供することである。その電
子源は、一体的に形成されたトランジスタ・デバイスを
使用して、表示画面から光子の放出を制御する。
【図1】本発明による電子デバイスの実施例を示す断面
図である。
図である。
【図2】本発明による図1の電子デバイスの実施例を改
良したものを示す断面図である。
良したものを示す断面図である。
【図3】図1および図2両者の実施例を示す概略図であ
る。
る。
【図4】本発明による電子デバイスの他の実施例を示す
断面図である。
断面図である。
【図5】図4に示されるような本発明の実施例を表す概
略図である。
略図である。
【図6】本発明による電子デバイスの更なる実施例を示
す断面図である。
す断面図である。
【図7】図6に示されるような本発明の実施例を表す概
略図である。
略図である。
【図8】本発明による電子デバイスの更なる実施例を示
す断面図である。
す断面図である。
【図9】本発明による電子デバイスの更なる実施例を示
す断面図である。
す断面図である。
100,110 電子デバイス
101 支持基板
102 トランジスタ・コレクタ
103 トランジスタ・ベ−ス
104 トランジスタ・エミッタ
105 トランジスタ・ベ−ス導体
106 トランジスタ・エミッタ導体
107 ダイヤモンド材料層
108 アノ−ド
109 電子
111 主面
131 電子放出面
132 自由空間領域
141,142,143 外部供給電源
200 電子デバイス
201 支持基板
202 トランジスタ・チャネル
203 トランジスタ・ゲ−ト
204 トランジスタ・ゲ−ト導体
205 トランジスタ・ソ−ス導体
206 ダイヤモンド材料層
207 アノ−ド
208 電子
211 主面
231 電子放出面
232 自由空間領域
241,242 外部供給電源
300 電子デバイス
301 支持基板
302 トランジスタ・ドレイン
303 トランジスタ・ソ−ス
304 アノ−ド
305 ダイヤモンド材料層
306 トランジスタ・ゲ−ト導体
307 トランジスタ・ソ−ス導体
308 トランジスタ・ゲ−ト領域
309 電子
310 絶縁層
311 主面
331 電子放出面
332 自由空間領域
341,342,343 外部供給電源
400 電子デバイス
401 支持基板
402 トランジスタ・ドレイン
403 トランジスタ・ソ−ス
405 ダイヤモンド材料層
406 トランジスタ・ゲ−ト導体
407 トランジスタ・ソ−ス導体
408 トランジスタ・ゲ−ト領域
409 電子
411 ルミネセント層
412 導電層
413 フェ−スプレ−ト
431 電子放出面
432 自由空間領域
441,442 外部供給電源
500 電子デバイス
501 支持基板
502 トランジスタ・コレクタ
503 トランジスタ・ベ−ス
504 トランジスタ・エミッタ
505 トランジスタ・ベ−ス導体
506 トランジスタ・エミッタ導体
507 ダイヤモンド材料層
509 電子
511 ルミネセント層
512 導電層
513 フェ−スプレ−ト
531 電子放出面
532 自由空間領域
541,542,543 外部供給電源
フロントページの続き
(58)調査した分野(Int.Cl.7,DB名)
H01L 21/331
H01L 29/73 - 29/737
H01L 29/78
H01L 29/80
H01L 29/16
H01L 29/06
H01L 29/66
H01J 1/30
Claims (2)
- 【請求項1】 主面(111)を有する支持基板(10
1); 実質的に前記支持基板内の前記主面に配置され、少なく
ともコレクタ(102)、ベース(102)およびエミ
ッタ(104)から成るトランジスタ; 前記ベース(103)に動作可能に結合するベース導体
(105); 前記エミッタ(104)に動作可能に結合するエミッタ
導体(106); 電子を放出するための電子放出面(131)を有し、前
記支持基板の前記主面上に配置され、前記コレクタに動
作可能に結合するダイヤモンド材料層(107);およ
び前記ダイヤモンド材料層(107)に対して距離を隔
てて配置されるアノード(108); から構成されることを特徴とする電子デバイス。 - 【請求項2】 主面(311)を有する支持基板(30
1); 実質的に前記支持基板内の前記主面に配置され、ソース
(303)、ドレイン(302)およびゲート領域(3
08)を含むトランジスタ; 前記ソース(303)に動作可能に結合するソース導体
(307); 前記ゲート領域(308)に動作可能に結合するゲート
導体(306); 電子を放出するための電子放出面(331)を有し、前
記支持基板(301)の前記主面(311)上に配置さ
れ、前記ドレイン(302)に動作可能に結合するダイ
ヤモンド材料層(305);および前記ダイヤモンド材
料層(305)に対して距離を隔てて配置されるアノー
ド(304); から構成されることを特徴とする電子デバイス。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US07/878,270 US5256888A (en) | 1992-05-04 | 1992-05-04 | Transistor device apparatus employing free-space electron emission from a diamond material surface |
US878270 | 1992-05-04 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0621084A JPH0621084A (ja) | 1994-01-28 |
JP3361146B2 true JP3361146B2 (ja) | 2003-01-07 |
Family
ID=25371699
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP11926693A Expired - Fee Related JP3361146B2 (ja) | 1992-05-04 | 1993-04-23 | ダイヤモンド材料表面からの自由空間電子放出を利用するトランジスタ・デバイス装置 |
Country Status (2)
Country | Link |
---|---|
US (1) | US5256888A (ja) |
JP (1) | JP3361146B2 (ja) |
Families Citing this family (27)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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US5543684A (en) | 1992-03-16 | 1996-08-06 | Microelectronics And Computer Technology Corporation | Flat panel display based on diamond thin films |
US5600200A (en) | 1992-03-16 | 1997-02-04 | Microelectronics And Computer Technology Corporation | Wire-mesh cathode |
US5675216A (en) | 1992-03-16 | 1997-10-07 | Microelectronics And Computer Technololgy Corp. | Amorphic diamond film flat field emission cathode |
US5763997A (en) | 1992-03-16 | 1998-06-09 | Si Diamond Technology, Inc. | Field emission display device |
US5679043A (en) | 1992-03-16 | 1997-10-21 | Microelectronics And Computer Technology Corporation | Method of making a field emitter |
US5449970A (en) | 1992-03-16 | 1995-09-12 | Microelectronics And Computer Technology Corporation | Diode structure flat panel display |
US6127773A (en) | 1992-03-16 | 2000-10-03 | Si Diamond Technology, Inc. | Amorphic diamond film flat field emission cathode |
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WO1995012835A1 (en) | 1993-11-04 | 1995-05-11 | Microelectronics And Computer Technology Corporation | Methods for fabricating flat panel display systems and components |
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US5578901A (en) * | 1994-02-14 | 1996-11-26 | E. I. Du Pont De Nemours And Company | Diamond fiber field emitters |
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US5531880A (en) * | 1994-09-13 | 1996-07-02 | Microelectronics And Computer Technology Corporation | Method for producing thin, uniform powder phosphor for display screens |
US5619091A (en) * | 1994-10-03 | 1997-04-08 | Universities Research Association, Inc. | Diamond films treated with alkali-halides |
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US6296740B1 (en) | 1995-04-24 | 2001-10-02 | Si Diamond Technology, Inc. | Pretreatment process for a surface texturing process |
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US5647998A (en) * | 1995-06-13 | 1997-07-15 | Advanced Vision Technologies, Inc. | Fabrication process for laminar composite lateral field-emission cathode |
US5703380A (en) * | 1995-06-13 | 1997-12-30 | Advanced Vision Technologies Inc. | Laminar composite lateral field-emission cathode |
JP3135823B2 (ja) * | 1995-08-25 | 2001-02-19 | 株式会社神戸製鋼所 | 冷電子放出素子及びその製造方法 |
US6008502A (en) * | 1996-03-27 | 1999-12-28 | Matsushita Electric Industrial Co., Ltd. | Diamond electron emitting device having an insulative electron supply layer |
US6020677A (en) * | 1996-11-13 | 2000-02-01 | E. I. Du Pont De Nemours And Company | Carbon cone and carbon whisker field emitters |
DE19756873A1 (de) * | 1997-12-19 | 1999-07-01 | Siemens Ag | Elektrische Schaltungsanordnung zur Transformation von magnetischer Feldenergie in elektrische Feldenergie |
JP4835157B2 (ja) * | 2003-11-25 | 2011-12-14 | 住友電気工業株式会社 | ダイヤモンドn型半導体、その製造方法、半導体素子、及び電子放出素子 |
FR2934716B1 (fr) * | 2008-07-31 | 2010-09-10 | Commissariat Energie Atomique | Diode electroluminescente en materiau semiconducteur et son procede de fabrication |
SG194474A1 (en) * | 2011-04-14 | 2013-12-30 | Sage Wise 66 Pty Ltd | An electrical conductor |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5079476A (en) * | 1990-02-09 | 1992-01-07 | Motorola, Inc. | Encapsulated field emission device |
US5202571A (en) * | 1990-07-06 | 1993-04-13 | Canon Kabushiki Kaisha | Electron emitting device with diamond |
US5075595A (en) * | 1991-01-24 | 1991-12-24 | Motorola, Inc. | Field emission device with vertically integrated active control |
US5141460A (en) * | 1991-08-20 | 1992-08-25 | Jaskie James E | Method of making a field emission electron source employing a diamond coating |
US5180951A (en) * | 1992-02-05 | 1993-01-19 | Motorola, Inc. | Electron device electron source including a polycrystalline diamond |
-
1992
- 1992-05-04 US US07/878,270 patent/US5256888A/en not_active Expired - Fee Related
-
1993
- 1993-04-23 JP JP11926693A patent/JP3361146B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JPH0621084A (ja) | 1994-01-28 |
US5256888A (en) | 1993-10-26 |
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