JP3221162B2 - 遅延補正装置 - Google Patents
遅延補正装置Info
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- JP3221162B2 JP3221162B2 JP17598493A JP17598493A JP3221162B2 JP 3221162 B2 JP3221162 B2 JP 3221162B2 JP 17598493 A JP17598493 A JP 17598493A JP 17598493 A JP17598493 A JP 17598493A JP 3221162 B2 JP3221162 B2 JP 3221162B2
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- Japan
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- delay
- digital
- delay circuit
- circuit
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Description
【０００１】
【産業上の利用分野】本発明は、ディジタルミキサを複
数台カスケード接続したディジタル音響機器の遅延補正
装置に関する。
数台カスケード接続したディジタル音響機器の遅延補正
装置に関する。
【０００２】
【従来の技術】複数の信号を処理して混合する機能を有
したディジタルミキサを複数台、カスケード接続して使
用する場合、各ミキサは自らの内部バスから入力する複
数の信号を処理、混合するだけでなく、前段のミキサか
らのカスケード出力信号を加算して更に後段に受け渡す
必要がある。
したディジタルミキサを複数台、カスケード接続して使
用する場合、各ミキサは自らの内部バスから入力する複
数の信号を処理、混合するだけでなく、前段のミキサか
らのカスケード出力信号を加算して更に後段に受け渡す
必要がある。
【０００３】図５は、従来のディジタルミキサを複数台
カスケード接続したディジタル音響機器の一部を示す構
成図である。第１のディジタルミキサ１０は、内部バス
からの各チャンネルの入力信号ＳＡ，ＳＢ，…，ＳＺに
対し固有の遅延を与えるチャンネルディレイ回路１１
と、前段のミキサからのカスケード入力信号Ｃ−ＩＮの
信号形態を変換するＡ／Ｄ変換器やフォーマットコンバ
ータ（ＦＭＣ）１２と、各ディレイ回路１１の出力とＦ
ＭＣ１２の出力を加算する加算器１３と、この加算器１
３の出力の信号形態を変換してカスケード出力信号Ｃ−
ＯＵＴとする出力側のＦＭＣ１４とを備える。第２のデ
ィジタルミキサ１０′も同じ構成であり、この場合の内
部バスからの入力信号はＳＡ′，ＳＢ′，…，ＳＺ′で
ある。
カスケード接続したディジタル音響機器の一部を示す構
成図である。第１のディジタルミキサ１０は、内部バス
からの各チャンネルの入力信号ＳＡ，ＳＢ，…，ＳＺに
対し固有の遅延を与えるチャンネルディレイ回路１１
と、前段のミキサからのカスケード入力信号Ｃ−ＩＮの
信号形態を変換するＡ／Ｄ変換器やフォーマットコンバ
ータ（ＦＭＣ）１２と、各ディレイ回路１１の出力とＦ
ＭＣ１２の出力を加算する加算器１３と、この加算器１
３の出力の信号形態を変換してカスケード出力信号Ｃ−
ＯＵＴとする出力側のＦＭＣ１４とを備える。第２のデ
ィジタルミキサ１０′も同じ構成であり、この場合の内
部バスからの入力信号はＳＡ′，ＳＢ′，…，ＳＺ′で
ある。
【０００４】上記のように複数のディジタルミキサをカ
スケード接続する場合、ディレイ回路１１以外で発生す
るディレイを無視することはできない。例えば、入力側
のＡ／Ｄ変換器やＦＭＣ１２において数サンプルから数
１０サンプルのディレイが生ずる。また、加算器１３に
おいてもディレイが生ずる。さらには出力側のＦＭＣ１
４においてもディレイが発生する。この様なカスケード
接続にともなうディレイが発生すると、例えば信号Ｓ
Ａ，ＳＡ′が図６の（ａ），（ｂ） に示すように同相
でありながら、加算した結果が同図（ｄ）のように位相
ずれしてしまうことがある。これは、ミキサ１０の信号
ＳＡがミキサ１０′の信号ＳＡ′より位相が遅れるため
で、このために合成信号が歪んで音が変わり、希望する
音が得られない問題を生ずる。
スケード接続する場合、ディレイ回路１１以外で発生す
るディレイを無視することはできない。例えば、入力側
のＡ／Ｄ変換器やＦＭＣ１２において数サンプルから数
１０サンプルのディレイが生ずる。また、加算器１３に
おいてもディレイが生ずる。さらには出力側のＦＭＣ１
４においてもディレイが発生する。この様なカスケード
接続にともなうディレイが発生すると、例えば信号Ｓ
Ａ，ＳＡ′が図６の（ａ），（ｂ） に示すように同相
でありながら、加算した結果が同図（ｄ）のように位相
ずれしてしまうことがある。これは、ミキサ１０の信号
ＳＡがミキサ１０′の信号ＳＡ′より位相が遅れるため
で、このために合成信号が歪んで音が変わり、希望する
音が得られない問題を生ずる。
【０００５】
【発明が解決しようとする課題】従来は、上述したカス
ケード接続にともなうディレイを補正して図６（ｃ）の
ように位相ずれのない合成波形を得るために、チャンネ
ルディレイ回路１１を使用している。ところが、チャン
ネルディレイ回路１１は本来、マイクと信号発生源との
距離の補正に使用するものであるため、これをカスケー
ド接続にともなうディレイ調整にも兼用することは、調
整作業が著しく面倒になる欠点がある。本発明は、カス
ケード接続にともなうディレイ調整専用のディレイ回路
を設けることで、ディジタルミキサを複数台カスケード
接続したディジタル音響機器の遅延補正を容易にするこ
とを目的とする。
ケード接続にともなうディレイを補正して図６（ｃ）の
ように位相ずれのない合成波形を得るために、チャンネ
ルディレイ回路１１を使用している。ところが、チャン
ネルディレイ回路１１は本来、マイクと信号発生源との
距離の補正に使用するものであるため、これをカスケー
ド接続にともなうディレイ調整にも兼用することは、調
整作業が著しく面倒になる欠点がある。本発明は、カス
ケード接続にともなうディレイ調整専用のディレイ回路
を設けることで、ディジタルミキサを複数台カスケード
接続したディジタル音響機器の遅延補正を容易にするこ
とを目的とする。
【０００６】
【課題を解決するための手段】本発明は、ディジタルミ
キサを複数台カスケード接続する機能を備えたディジタ
ル音響機器の各ディジタルミキサの内部に備えられた遅
延補正装置において、前記ディジタルミキサの内部バス
から入力される各チャンネルの信号に対し、前記内部バ
ス以前に各チャンネルで生じる時間遅延をそれぞれ補正
する、個々の遅延をサンプル時間単位で与えるように構
成された第１のディレイ回路と、この第１のディレイ回
路を介した各チャンネルの出力サンプル信号に対し、前
記カスケード接続した際にその前段に配置された全ての
ディジタルミキサにおいて前記第１のディレイ回路以外
に生じる時間遅延を一括補正する共通の遅延を前記第１
のディレイ回路とは独立にサンプル時間単位で与えるよ
うに構成された第２のディレイ回路とを備えてなり、前
記各チャンネルの出力サンプル信号は、前記第２のディ
レイ回路の後段側で、前記カスケード接続された他のデ
ィジタルミキサからの入力サンプル信号と加算されるよ
うに構成されていることを特徴とする。
キサを複数台カスケード接続する機能を備えたディジタ
ル音響機器の各ディジタルミキサの内部に備えられた遅
延補正装置において、前記ディジタルミキサの内部バス
から入力される各チャンネルの信号に対し、前記内部バ
ス以前に各チャンネルで生じる時間遅延をそれぞれ補正
する、個々の遅延をサンプル時間単位で与えるように構
成された第１のディレイ回路と、この第１のディレイ回
路を介した各チャンネルの出力サンプル信号に対し、前
記カスケード接続した際にその前段に配置された全ての
ディジタルミキサにおいて前記第１のディレイ回路以外
に生じる時間遅延を一括補正する共通の遅延を前記第１
のディレイ回路とは独立にサンプル時間単位で与えるよ
うに構成された第２のディレイ回路とを備えてなり、前
記各チャンネルの出力サンプル信号は、前記第２のディ
レイ回路の後段側で、前記カスケード接続された他のデ
ィジタルミキサからの入力サンプル信号と加算されるよ
うに構成されていることを特徴とする。
【０００７】
【作用】第１のディレイ回路はチャンネルディレイ回路
であり、これはマイクと信号発生源との距離の補正専用
に使用される。これに対し、第２のディレイ回路はカス
ケード接続にともなう遅延を補正するためのもので、第
１のディレイ回路とは独立して設けられる。従って、本
発明によれば２種類の遅延を独立して調整できるので、
調整作業が簡単且つ明瞭になる。また、それぞれの機種
の遅延量が判明すれば、トータルの遅延量が簡単に計算
できる利点もある。
であり、これはマイクと信号発生源との距離の補正専用
に使用される。これに対し、第２のディレイ回路はカス
ケード接続にともなう遅延を補正するためのもので、第
１のディレイ回路とは独立して設けられる。従って、本
発明によれば２種類の遅延を独立して調整できるので、
調整作業が簡単且つ明瞭になる。また、それぞれの機種
の遅延量が判明すれば、トータルの遅延量が簡単に計算
できる利点もある。
【０００８】
【実施例】以下、図面を参照して、本発明の実施例を説
明する。図１は、本発明の第１の実施例を示すブロック
図である。この図は、カスケード接続されて使用される
ディジタルミキサの１台を示しており、１１は内部バス
からの複数チャンネルの入力信号ＳＡ，ＳＢ，…，ＳＺ
に対する第１のディレイ回路（チャンネルディレイ回
路）である。この例では具体的な回路構成を示すため
に、ディレイ回路１１の後段にイコライザ（ＥＱ）１
５、スイッチ１６、ボリューム１７を配してあるが、基
本的には図５と変わらない。つまり、第１のディレイ回
路１１で個々にマイクと信号発生源との距離を補正され
た信号は加算器１３で加算される。但し、この例ではス
テレオ信号を対象としているため、Ｌ，Ｒの２系統を示
してある。
明する。図１は、本発明の第１の実施例を示すブロック
図である。この図は、カスケード接続されて使用される
ディジタルミキサの１台を示しており、１１は内部バス
からの複数チャンネルの入力信号ＳＡ，ＳＢ，…，ＳＺ
に対する第１のディレイ回路（チャンネルディレイ回
路）である。この例では具体的な回路構成を示すため
に、ディレイ回路１１の後段にイコライザ（ＥＱ）１
５、スイッチ１６、ボリューム１７を配してあるが、基
本的には図５と変わらない。つまり、第１のディレイ回
路１１で個々にマイクと信号発生源との距離を補正され
た信号は加算器１３で加算される。但し、この例ではス
テレオ信号を対象としているため、Ｌ，Ｒの２系統を示
してある。
【０００９】加算器１３の出力に対しては、第２のディ
レイ回路２０において、カスケード接続にともなう遅延
補正が行われる。この遅延補正は、後段の加算器１３′
において加算器１３の出力と前段ミキサから供給される
カスケード入力Ｃ−ＩＮとを加算したとき、何もしなけ
れば図６（ｄ）の様な位相ずれが生ずる遅延を補正し、
図６（ｃ）のように位相ずれのないカスケード出力Ｃ−
ＯＵＴを得るためのものである。この場合、第２のディ
レイ回路２０の遅延量は全て同じ値とする。
レイ回路２０において、カスケード接続にともなう遅延
補正が行われる。この遅延補正は、後段の加算器１３′
において加算器１３の出力と前段ミキサから供給される
カスケード入力Ｃ−ＩＮとを加算したとき、何もしなけ
れば図６（ｄ）の様な位相ずれが生ずる遅延を補正し、
図６（ｃ）のように位相ずれのないカスケード出力Ｃ−
ＯＵＴを得るためのものである。この場合、第２のディ
レイ回路２０の遅延量は全て同じ値とする。
【００１０】図２は、本発明の第２の実施例を示すブロ
ック図である。図１の実施例では、第２のディレイ回路
２０を加算器１３の直後に配置したため、カスケード入
力Ｃ−ＩＮを加える新たな加算器１３′を必要とした。
図２の例では、第２のディレイ回路２０を加算器１３の
前段に配置して加算器１３′を不要とする。その分、第
２のディレイ回路２０の数は増えるが、機能的には図１
の構成と変わらない。この場合も、第２のディレイ回路
２０の遅延量は全て同じ値とする。
ック図である。図１の実施例では、第２のディレイ回路
２０を加算器１３の直後に配置したため、カスケード入
力Ｃ−ＩＮを加える新たな加算器１３′を必要とした。
図２の例では、第２のディレイ回路２０を加算器１３の
前段に配置して加算器１３′を不要とする。その分、第
２のディレイ回路２０の数は増えるが、機能的には図１
の構成と変わらない。この場合も、第２のディレイ回路
２０の遅延量は全て同じ値とする。
【００１１】第２のディレイ回路２０の遅延量は次のよ
うにして設定される。今、図３に示すように、カスケー
ド接続されたミキサ１０とミキサ１０′の間に存在す
る、カスケード接続にともなう遅延量ＤＬＡＢが５サン
プルであるとする。この場合、本発明では図４に示すよ
うに、ミキサ１０，１０′，１０″の第２のディレイ回
路２０，２０′，２０″の遅延量ＤＬＡ，ＤＬＢ，ＤＬ
Ｃをそれぞれ次のように設定する。
うにして設定される。今、図３に示すように、カスケー
ド接続されたミキサ１０とミキサ１０′の間に存在す
る、カスケード接続にともなう遅延量ＤＬＡＢが５サン
プルであるとする。この場合、本発明では図４に示すよ
うに、ミキサ１０，１０′，１０″の第２のディレイ回
路２０，２０′，２０″の遅延量ＤＬＡ，ＤＬＢ，ＤＬ
Ｃをそれぞれ次のように設定する。
【００１２】
【表１】 ＤＬＡ＝０サンプルの時 ＤＬＢ＝０＋５＝５サンプル ＤＬＣ＝０＋５＋５＝１０サンプル
【００１３】
【表２】 ＤＬＡ＝Ｘサンプルの時 ＤＬＢ＝（Ｘ＋５）サンプル ＤＬＣ＝｛（Ｘ＋５）＋５｝サンプル
【００１４】上述した第２のディレイ回路２０の遅延量
は、第１のディレイ回路１１の遅延量とは独立して設定
されるため、チャンネル遅延とカスケード遅延の２要素
を同じディレイ回路で調整する従来法の問題がなく、そ
れぞれ簡単且つ明瞭に設定することができる。
は、第１のディレイ回路１１の遅延量とは独立して設定
されるため、チャンネル遅延とカスケード遅延の２要素
を同じディレイ回路で調整する従来法の問題がなく、そ
れぞれ簡単且つ明瞭に設定することができる。
【００１５】
【発明の効果】以上述べたように本発明によれば、ディ
ジタルミキサを複数台カスケード接続したディジタル音
響機器において、カスケード接続にともなうディレイ調
整専用のディレイ回路を設けたので、各チャンネル毎の
遅延調整とカスケード接続にともなう遅延補正を独立し
て行うことができ、位相差のないミキシング出力を得る
遅延補正を容易に行うことができる利点がある。
ジタルミキサを複数台カスケード接続したディジタル音
響機器において、カスケード接続にともなうディレイ調
整専用のディレイ回路を設けたので、各チャンネル毎の
遅延調整とカスケード接続にともなう遅延補正を独立し
て行うことができ、位相差のないミキシング出力を得る
遅延補正を容易に行うことができる利点がある。
【図１】 本発明の第１の実施例を示すブロック図であ
る。
る。
【図２】 本発明の第２の実施例を示すブロック図であ
る。
る。
【図３】 カスケード接続にともなう遅延の説明図であ
る。
る。
【図４】 本発明による遅延補正の説明図である。
【図５】 従来のディジタルミキサを複数台カスケード
接続したディジタル音響機器の一部を示す構成図であ
る。
接続したディジタル音響機器の一部を示す構成図であ
る。
【図６】 ミキシング時の位相ずれの影響を示す信号波
形図である。
形図である。
１０…ディジタルミキサ、１１…第１のディレイ回路
（チャンネルディレイ回路）、１３…加算器、２０…第
２のディレイ回路。
（チャンネルディレイ回路）、１３…加算器、２０…第
２のディレイ回路。
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭59−127171（ＪＰ，Ａ) 実開 昭59−183033（ＪＰ，Ｕ) 放送技術 第44巻 第９号（平成３年 ９月号）Ｐ．70〜78 藤野輝雄、越智正 人著「ディジタル・ミク４−ＤＭＣ− 1000」、兼六館出版株式会社 1991年９ 月１日発行
Claims (1)
- 【請求項１】 ディジタルミキサを複数台カスケード接
続する機能を備えたディジタル音響機器の各ディジタル
ミキサの内部に備えられた遅延補正装置において、 前記ディジタルミキサの内部バスから入力される各チャ
ンネルの信号に対し、前記内部バス以前に各チャンネル
で生じる時間遅延をそれぞれ補正する、個々の遅延をサ
ンプル時間単位で与えるように構成された第１のディレ
イ回路と、 この第１のデイレイ回路を介した各チャンネルの出力サ
ンプル信号に対し、前記カスケード接続した際にその前
段に配置された全てのディジタルミキサにおいて前記第
１のディレイ回路以外に生じる時間遅延を一括補正する
共通の遅延を前記第１のディレイ回路とは独立にサンプ
ル時間単位で与えるように構成された第２のディレイ回
路とを備えてなり、 前記各チャンネルの出力サンプル信号は、前記第２のデ
ィレイ回路の後段側で、前記カスケード接続された他の
ディジタルミキサからの入力サンプル信号と加算される
ように構成されている ことを特徴とする遅延補正装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17598493A JP3221162B2 (ja) | 1993-06-23 | 1993-06-23 | 遅延補正装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17598493A JP3221162B2 (ja) | 1993-06-23 | 1993-06-23 | 遅延補正装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0715284A JPH0715284A (ja) | 1995-01-17 |
| JP3221162B2 true JP3221162B2 (ja) | 2001-10-22 |
Family
ID=16005670
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17598493A Expired - Lifetime JP3221162B2 (ja) | 1993-06-23 | 1993-06-23 | 遅延補正装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3221162B2 (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4089375B2 (ja) * | 2002-09-30 | 2008-05-28 | ヤマハ株式会社 | ミキシング方法、ミキシング装置およびプログラム |
| EP1571768A3 (en) * | 2004-02-26 | 2012-07-18 | Yamaha Corporation | Mixer apparatus and sound signal processing method |
| JP2010041242A (ja) * | 2008-08-01 | 2010-02-18 | Yamaha Corp | 音響調整卓 |
| JP6102063B2 (ja) * | 2011-03-25 | 2017-03-29 | ヤマハ株式会社 | ミキシング装置 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5875935A (ja) * | 1981-10-30 | 1983-05-07 | Nec Corp | 衛星通信方式 |
-
1993
- 1993-06-23 JP JP17598493A patent/JP3221162B2/ja not_active Expired - Lifetime
Non-Patent Citations (1)
| Title |
|---|
| 放送技術 第４４巻 第９号（平成３年９月号）Ｐ．７０〜７８ 藤野輝雄、越智正人著「ディジタル・ミク４−ＤＭＣ−１０００」、兼六館出版株式会社 １９９１年９月１日発行 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0715284A (ja) | 1995-01-17 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
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