JP3063407B2 - 誘導性負荷の駆動回路 - Google Patents
誘導性負荷の駆動回路Info
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Description
【０００１】
【産業上の利用分野】この発明は誘導性負荷の駆動回路
に係り、特に自動ピアノの鍵やペダル駆動用ソレノイド
等の駆動に用いて好適な駆動回路に関する。
に係り、特に自動ピアノの鍵やペダル駆動用ソレノイド
等の駆動に用いて好適な駆動回路に関する。
【０００２】
【従来の技術】図３はこの種の駆動回路にあって、電圧
制御型駆動回路と呼ばれるものの構成を示す回路図であ
る。この図において、１は誘導性負荷としてのソレノイ
ドである。このソレノイド１の一端はＮＰＮトランジス
タ２のコレクタに接続されており、他端は電源電圧Ｖが
印加される。また、ソレノイド１にはダイオード３が並
列接続されている。このダイオード３は、ＮＰＮトラン
ジスタ２がＯＮ状態からＯＦＦ状態に切り換えられた場
合に、それまでソレノイド１に流れていた電流をキック
バック電流として電源側に逃すために設けられたもので
ある。ＮＰＮトランジスタ２は、エミッタが接地されて
おり、ベースには抵抗４およびコンデンサ５の並列接続
を介し駆動信号ＰＷＭが入力される。この駆動信号ＰＷ
Ｍは、図示しないパルス幅変調回路により、ソレノイド
１に流すべき電流の目標値に応じたデューティ比にパル
ス幅変調されている。なお、ＮＰＮトランジスタ２のベ
ース−エミッタ間には保護抵抗６が接続されている。こ
のような構成によれば、駆動信号ＰＷＭのデューティ比
に応じた平均電流がソレノイド１に流れ、これに伴って
ソレノイド１により発生される磁界により被駆動体（図
示略）が駆動される。
制御型駆動回路と呼ばれるものの構成を示す回路図であ
る。この図において、１は誘導性負荷としてのソレノイ
ドである。このソレノイド１の一端はＮＰＮトランジス
タ２のコレクタに接続されており、他端は電源電圧Ｖが
印加される。また、ソレノイド１にはダイオード３が並
列接続されている。このダイオード３は、ＮＰＮトラン
ジスタ２がＯＮ状態からＯＦＦ状態に切り換えられた場
合に、それまでソレノイド１に流れていた電流をキック
バック電流として電源側に逃すために設けられたもので
ある。ＮＰＮトランジスタ２は、エミッタが接地されて
おり、ベースには抵抗４およびコンデンサ５の並列接続
を介し駆動信号ＰＷＭが入力される。この駆動信号ＰＷ
Ｍは、図示しないパルス幅変調回路により、ソレノイド
１に流すべき電流の目標値に応じたデューティ比にパル
ス幅変調されている。なお、ＮＰＮトランジスタ２のベ
ース−エミッタ間には保護抵抗６が接続されている。こ
のような構成によれば、駆動信号ＰＷＭのデューティ比
に応じた平均電流がソレノイド１に流れ、これに伴って
ソレノイド１により発生される磁界により被駆動体（図
示略）が駆動される。
【０００３】
【発明が解決しようとする課題】ところで、上述した電
圧制御型駆動回路は、駆動信号に対する応答が遅いとい
う問題があった。すなわち、ＮＰＮトランジスタ２がＯ
ＦＦ状態となると、図３に示すようにソレノイド１の両
端がダイオード３（図４では図示略）によって短絡され
ることによりループ回路が形成される。そして、それま
でソレノイド１に流れていた電流は、このループ回路内
を循環しつつ徐々に減衰する。この場合、ループ回路を
循環する電流の減衰速度は、ソレノイド１のインダクタ
ンスＬと内部抵抗ＲL との比である時定数τによって決
定される。したがって、駆動信号ＰＷＮのパルスが遮断
されたにもかかわらず、ソレノイド１に電流が流れ続け
るので、ソレノイド１の動作が緩慢になり、高い応答性
の要求に対し十分に応えることができなかった。
圧制御型駆動回路は、駆動信号に対する応答が遅いとい
う問題があった。すなわち、ＮＰＮトランジスタ２がＯ
ＦＦ状態となると、図３に示すようにソレノイド１の両
端がダイオード３（図４では図示略）によって短絡され
ることによりループ回路が形成される。そして、それま
でソレノイド１に流れていた電流は、このループ回路内
を循環しつつ徐々に減衰する。この場合、ループ回路を
循環する電流の減衰速度は、ソレノイド１のインダクタ
ンスＬと内部抵抗ＲL との比である時定数τによって決
定される。したがって、駆動信号ＰＷＮのパルスが遮断
されたにもかかわらず、ソレノイド１に電流が流れ続け
るので、ソレノイド１の動作が緩慢になり、高い応答性
の要求に対し十分に応えることができなかった。
【０００４】また、一般に、ソレノイドは、発熱状態に
あると内部の時定数τ、特に、内部抵抗ＲL が上昇する
ので、一定電圧下ではソレノイド１による被駆動体の推
力が低下する。上述の例では、この推力低下を見込んで
駆動信号ＰＷＭのデューティ比をより大きくして制御す
るために、さらに、ソレノイド１が発熱するという問題
があった。
あると内部の時定数τ、特に、内部抵抗ＲL が上昇する
ので、一定電圧下ではソレノイド１による被駆動体の推
力が低下する。上述の例では、この推力低下を見込んで
駆動信号ＰＷＭのデューティ比をより大きくして制御す
るために、さらに、ソレノイド１が発熱するという問題
があった。
【０００５】この発明は上述した事情に鑑みてなされた
ものであり、その目的とするところは、電流目標値に対
し正確かつ高速に応答するとともに、発熱による推力低
下しにくい誘導性負荷の駆動回路を提供することにあ
る。
ものであり、その目的とするところは、電流目標値に対
し正確かつ高速に応答するとともに、発熱による推力低
下しにくい誘導性負荷の駆動回路を提供することにあ
る。
【０００６】
【課題を解決するための手段】この発明は上述した課題
を解決するために、誘導性負荷の一端および接地線間に
介挿された第１のスイッチ手段と、前記誘導性負荷の他
端および電源間に介挿された第２のスイッチ手段と、前
記誘導性負荷の一端から前記電源へ向う電流を通過させ
る第１のダイオードと、前記接地線から前記誘導性負荷
の他端へ向う電流を通過させる第２のダイオードと、前
記第１および第２のスイッチ手段がＯＮ状態の時に、前
記誘導性負荷に流れる電流値を検出する第１の電流検出
手段と、前記第１および第２のスイッチ手段がＯＦＦ状
態の時に、前記誘導性負荷に流れる電流値を検出する第
２の電流検出手段と、前記第１、第２の電流検出手段に
よって検出された電流値と目標値との比較によりパルス
幅変調信号を生成するとともに、前記パルス幅変調信号
によって前記第１および第２のスイッチ手段を制御する
制御手段とを具備することを特徴としている。
を解決するために、誘導性負荷の一端および接地線間に
介挿された第１のスイッチ手段と、前記誘導性負荷の他
端および電源間に介挿された第２のスイッチ手段と、前
記誘導性負荷の一端から前記電源へ向う電流を通過させ
る第１のダイオードと、前記接地線から前記誘導性負荷
の他端へ向う電流を通過させる第２のダイオードと、前
記第１および第２のスイッチ手段がＯＮ状態の時に、前
記誘導性負荷に流れる電流値を検出する第１の電流検出
手段と、前記第１および第２のスイッチ手段がＯＦＦ状
態の時に、前記誘導性負荷に流れる電流値を検出する第
２の電流検出手段と、前記第１、第２の電流検出手段に
よって検出された電流値と目標値との比較によりパルス
幅変調信号を生成するとともに、前記パルス幅変調信号
によって前記第１および第２のスイッチ手段を制御する
制御手段とを具備することを特徴としている。
【０００７】
【作用】上記構成によれば、第１および第２のスイッチ
手段がＯＮ状態では、電源→第２のスイッチ手段→誘導
性負荷→第１のスイッチ手段→接地という経路にて電流
が流れる。一方、第１および第２のスイッチ手段がＯＦ
Ｆ状態では、接地→第２のダイオード→誘導性負荷→第
１のダイオード→電源という経路を電流が流れる。この
電流は、電源から接地へ向う方向と逆方向に流れるもの
であるので、急速に減衰し、電流値が０となる。また、
第１および第２のスイッチ手段の制御は、ＯＮ状態およ
びＯＦＦ状態時に誘導性負荷に流れる電流値を帰還する
ことによって行なわれる。
手段がＯＮ状態では、電源→第２のスイッチ手段→誘導
性負荷→第１のスイッチ手段→接地という経路にて電流
が流れる。一方、第１および第２のスイッチ手段がＯＦ
Ｆ状態では、接地→第２のダイオード→誘導性負荷→第
１のダイオード→電源という経路を電流が流れる。この
電流は、電源から接地へ向う方向と逆方向に流れるもの
であるので、急速に減衰し、電流値が０となる。また、
第１および第２のスイッチ手段の制御は、ＯＮ状態およ
びＯＦＦ状態時に誘導性負荷に流れる電流値を帰還する
ことによって行なわれる。
【０００８】
【実施例】以下、この発明の一実施例について図面を参
照して説明する。図１は、この実施例による誘導性負荷
の駆動回路の構成を示す回路図である。上述した電圧制
御型駆動回路では、ソレノイド１の他端には、電源電圧
が直接印加されていた。しかしながら、この実施例では
図示のように、ソレノイド１の他端はＰＮＰトランジス
タ７のコレクタに接続されており、このＰＮＰトランジ
スタ７のエミッタに電源電圧Ｖが接続されている。ＰＮ
Ｐトランジスタ７のエミッタ−ベース間には保護抵抗８
が接続され、さらに、ＰＮＰトランジスタ７のベースと
ソレノイド１の一端とには、抵抗９およびコンデンサ１
０が並列接続されている。そして、ソレノイド１とＰＮ
Ｐトランジスタ７のコレクタとの接続点には、ダイオー
ド１１および検出抵抗１２が直列に接続されている。こ
のダイオード１１は、電源電圧Ｖに対して逆方向に接続
され、検出抵抗１２は接地されている。また、ダイオー
ド１１および検出抵抗１２の接続点は、抵抗１３を介し
て演算増幅器１４の反転入力端に接続されている。
照して説明する。図１は、この実施例による誘導性負荷
の駆動回路の構成を示す回路図である。上述した電圧制
御型駆動回路では、ソレノイド１の他端には、電源電圧
が直接印加されていた。しかしながら、この実施例では
図示のように、ソレノイド１の他端はＰＮＰトランジス
タ７のコレクタに接続されており、このＰＮＰトランジ
スタ７のエミッタに電源電圧Ｖが接続されている。ＰＮ
Ｐトランジスタ７のエミッタ−ベース間には保護抵抗８
が接続され、さらに、ＰＮＰトランジスタ７のベースと
ソレノイド１の一端とには、抵抗９およびコンデンサ１
０が並列接続されている。そして、ソレノイド１とＰＮ
Ｐトランジスタ７のコレクタとの接続点には、ダイオー
ド１１および検出抵抗１２が直列に接続されている。こ
のダイオード１１は、電源電圧Ｖに対して逆方向に接続
され、検出抵抗１２は接地されている。また、ダイオー
ド１１および検出抵抗１２の接続点は、抵抗１３を介し
て演算増幅器１４の反転入力端に接続されている。
【０００９】また、上述した従来の電圧制御型駆動回路
では、ＮＰＮトランジスタ２のエミッタが直接接地され
ていたが、この実施例では、検出抵抗１５を介して接地
されている。検出抵抗１５とＮＰＮトランジスタ２のエ
ミッタとの接続点は、抵抗１６を介して演算増幅器１
４の非反転入力端に供給されており、この非反転入力端
は、抵抗１７およびコンデンサ１８の並列接続を介して
接地されている。そして、演算増幅器１４の出力信号
は、抵抗１９およびコンデンサ２０の並列接続を介して
演算増幅器１４の反転入力端に負帰還されるとともに、
抵抗２１を介して演算増幅器２２の反転入力端に供給さ
れる。ここで、演算増幅器１４の出力点をとする。一
方、演算増幅器２２の非反転入力端には、抵抗２３を介
して、ソレノイド１に流すべき電流の目標値に応じた通
電量指定信号Ｍが入力されている。この非反転入力端
は、抵抗２４およびコンデンサ２５の直列接続を介して
接地されている。
では、ＮＰＮトランジスタ２のエミッタが直接接地され
ていたが、この実施例では、検出抵抗１５を介して接地
されている。検出抵抗１５とＮＰＮトランジスタ２のエ
ミッタとの接続点は、抵抗１６を介して演算増幅器１
４の非反転入力端に供給されており、この非反転入力端
は、抵抗１７およびコンデンサ１８の並列接続を介して
接地されている。そして、演算増幅器１４の出力信号
は、抵抗１９およびコンデンサ２０の並列接続を介して
演算増幅器１４の反転入力端に負帰還されるとともに、
抵抗２１を介して演算増幅器２２の反転入力端に供給さ
れる。ここで、演算増幅器１４の出力点をとする。一
方、演算増幅器２２の非反転入力端には、抵抗２３を介
して、ソレノイド１に流すべき電流の目標値に応じた通
電量指定信号Ｍが入力されている。この非反転入力端
は、抵抗２４およびコンデンサ２５の直列接続を介して
接地されている。
【００１０】そして、演算増幅器２２の出力信号は、コ
ンデンサ２６および抵抗２７の直列接続を介して演算増
幅器２２の反転入力端に帰還されるとともに、比較器２
８の非反転入力端に供給される。かかる演算増幅器２２
の出力信号レベルは、通電量指定信号Ｍのレベルと演算
増幅器１４の出力信号レベルとの差に、抵抗２１、２７
の抵抗値によって定まる係数を乗算したものとなり、そ
の極性は、演算増幅器１４の出力信号レベルが、通電量
指定信号Ｍのレベルよりも高い場合には、負となり、逆
に、演算増幅器１４の出力信号レベルが、通電量指定信
号Ｍのレベルよりも低い場合には、正となる。
ンデンサ２６および抵抗２７の直列接続を介して演算増
幅器２２の反転入力端に帰還されるとともに、比較器２
８の非反転入力端に供給される。かかる演算増幅器２２
の出力信号レベルは、通電量指定信号Ｍのレベルと演算
増幅器１４の出力信号レベルとの差に、抵抗２１、２７
の抵抗値によって定まる係数を乗算したものとなり、そ
の極性は、演算増幅器１４の出力信号レベルが、通電量
指定信号Ｍのレベルよりも高い場合には、負となり、逆
に、演算増幅器１４の出力信号レベルが、通電量指定信
号Ｍのレベルよりも低い場合には、正となる。
【００１１】一方、比較器２８の反転入力端Ａには、図
示しない三角波発生回路（あるいは鋸歯状波発生回路）
が出力する三角波（あるいは鋸歯状波）が入力される。
比較器２８の出力信号は抵抗４を介しＮＰＮトランジス
タ２のベースに供給される。このような構成によれば、
比較器２８はパルス幅変調回路として機能し、その出力
信号は、演算増幅器２２の出力信号レベルに応じたデュ
ーティ比を有するパルス幅変調信号となる。
示しない三角波発生回路（あるいは鋸歯状波発生回路）
が出力する三角波（あるいは鋸歯状波）が入力される。
比較器２８の出力信号は抵抗４を介しＮＰＮトランジス
タ２のベースに供給される。このような構成によれば、
比較器２８はパルス幅変調回路として機能し、その出力
信号は、演算増幅器２２の出力信号レベルに応じたデュ
ーティ比を有するパルス幅変調信号となる。
【００１２】次に、上述した実施例の動作について説明
する。比較器２８による出力信号が、図２に示すよう
に、時刻ｔ1 においてハイレベルとなると、ＮＰＮトラ
ンジスタ２およびＰＮＰトランジスタ７が共にＯＮ状態
となる。したがって、ソレノイド１の一端はＮＰＮトラ
ンジスタ２を介して接地され、他端はＰＮＰトランジス
タ７を介して電源に接続された状態となり、電流は、電
源→ＰＮＰトランジスタ７→ソレノイド１→ＮＰＮトラ
ンジスタ２→検出抵抗１５→接地という経路を流れ、時
定数τによって定まる速度で徐々に上昇していく。この
結果、接続点の電圧は、図２に示すように、時刻ｔ1
においてそれまでソレノイド１に流れていた電流値に対
応する電圧値から徐々に上昇していく。ところで、この
ＯＮ状態では、検出抵抗１２はダイオード１１によって
遮断されるので、接続点の電圧は「０」となる。この
結果、ＮＰＮトランジスタ２およびＰＮＰトランジスタ
７がＯＮ状態においては、接続点の電圧（演算増幅器
１４の出力信号レベル）は、接続点の電圧にのみ依存
したものとなる。
する。比較器２８による出力信号が、図２に示すよう
に、時刻ｔ1 においてハイレベルとなると、ＮＰＮトラ
ンジスタ２およびＰＮＰトランジスタ７が共にＯＮ状態
となる。したがって、ソレノイド１の一端はＮＰＮトラ
ンジスタ２を介して接地され、他端はＰＮＰトランジス
タ７を介して電源に接続された状態となり、電流は、電
源→ＰＮＰトランジスタ７→ソレノイド１→ＮＰＮトラ
ンジスタ２→検出抵抗１５→接地という経路を流れ、時
定数τによって定まる速度で徐々に上昇していく。この
結果、接続点の電圧は、図２に示すように、時刻ｔ1
においてそれまでソレノイド１に流れていた電流値に対
応する電圧値から徐々に上昇していく。ところで、この
ＯＮ状態では、検出抵抗１２はダイオード１１によって
遮断されるので、接続点の電圧は「０」となる。この
結果、ＮＰＮトランジスタ２およびＰＮＰトランジスタ
７がＯＮ状態においては、接続点の電圧（演算増幅器
１４の出力信号レベル）は、接続点の電圧にのみ依存
したものとなる。
【００１３】このように、ソレノイド１に流れる電流が
徐々に上昇していくと、接続点の電圧も時刻ｔ1 から
上昇する。これにより、演算増幅器２２の出力信号レベ
ルは、前述した理由から下降する。この結果、現時点に
おいてハイレベル状態となっている比較器２８の出力信
号は、演算増幅器２２の出力信号レベルに応じてローレ
ベル状態となる。すなわち、比較器２８の出力信号は、
三角波のレベルとの比較によって、演算増幅器２２の出
力信号が小さい場合には短時間で立下がり、演算増幅器
２２の出力信号が大きい場合には長時間で立下がるよう
になる。
徐々に上昇していくと、接続点の電圧も時刻ｔ1 から
上昇する。これにより、演算増幅器２２の出力信号レベ
ルは、前述した理由から下降する。この結果、現時点に
おいてハイレベル状態となっている比較器２８の出力信
号は、演算増幅器２２の出力信号レベルに応じてローレ
ベル状態となる。すなわち、比較器２８の出力信号は、
三角波のレベルとの比較によって、演算増幅器２２の出
力信号が小さい場合には短時間で立下がり、演算増幅器
２２の出力信号が大きい場合には長時間で立下がるよう
になる。
【００１４】このようにして、比較器２８の出力信号
が、時刻ｔ2 において立ち下がると、ＮＰＮトランジス
タ２およびＰＮＰトランジスタ７が共にＯＦＦ状態とな
る。したがって、ソレノイドの一端はダイオード３を介
して電源に接続され、他端はダイオード１１を介して接
地された状態となり、それまでソレノイド１に流れてい
た電流は、検出抵抗１２→ダイオード１１→ソレノイド
１→ダイオード３という経路を介して電源へと戻され
る。このとき、電源および接地間の電圧は、ソレノイド
１を流れる電流の向きに対して逆向きに印加されるの
で、極めて短期間でソレノイド１の電流が遮断される。
そして、電流は接地→電源という逆方向に流れるので、
接続点の電位は、図２に示すように、負であって、時
刻ｔ2 においてそれまでソレノイド１に流れていた電流
値に対応する負電圧値から、上昇していく形となる（絶
対値としては下降する）。ところで、このＯＦＦ状態で
は、検出抵抗１５はＮＰＮトランジスタ２によって遮断
されるので、接続点の電圧は「０」となる。すなわ
ち、ＮＰＮトランジスタ２およびＰＮＰトランジスタ７
がＯＦＦ状態における接続点の電圧は、接続点の電
圧にのみ依存したものであって、極性が反転したものと
なる。このように、ソレノイド１に流れる電流が下降し
ていくと、接続点の電圧も時刻ｔ2 から下降する。こ
れにより、演算増幅器２２の出力信号レベルは、前述し
た理由から上昇する。
が、時刻ｔ2 において立ち下がると、ＮＰＮトランジス
タ２およびＰＮＰトランジスタ７が共にＯＦＦ状態とな
る。したがって、ソレノイドの一端はダイオード３を介
して電源に接続され、他端はダイオード１１を介して接
地された状態となり、それまでソレノイド１に流れてい
た電流は、検出抵抗１２→ダイオード１１→ソレノイド
１→ダイオード３という経路を介して電源へと戻され
る。このとき、電源および接地間の電圧は、ソレノイド
１を流れる電流の向きに対して逆向きに印加されるの
で、極めて短期間でソレノイド１の電流が遮断される。
そして、電流は接地→電源という逆方向に流れるので、
接続点の電位は、図２に示すように、負であって、時
刻ｔ2 においてそれまでソレノイド１に流れていた電流
値に対応する負電圧値から、上昇していく形となる（絶
対値としては下降する）。ところで、このＯＦＦ状態で
は、検出抵抗１５はＮＰＮトランジスタ２によって遮断
されるので、接続点の電圧は「０」となる。すなわ
ち、ＮＰＮトランジスタ２およびＰＮＰトランジスタ７
がＯＦＦ状態における接続点の電圧は、接続点の電
圧にのみ依存したものであって、極性が反転したものと
なる。このように、ソレノイド１に流れる電流が下降し
ていくと、接続点の電圧も時刻ｔ2 から下降する。こ
れにより、演算増幅器２２の出力信号レベルは、前述し
た理由から上昇する。
【００１５】この結果、現時点においてローレベル状態
となっている比較器２８の出力信号は、演算増幅器２２
の出力信号レベルに応じてハイレベル状態となる。すな
わち、比較器２８の出力信号は、三角波のレベルとの比
較によって、ソレノイド１に流れる電流が小さい場合に
は短期間で立上がり、逆に、ソレノイド１に流れる電流
が大きい場合には長期間で立上がるようになる。
となっている比較器２８の出力信号は、演算増幅器２２
の出力信号レベルに応じてハイレベル状態となる。すな
わち、比較器２８の出力信号は、三角波のレベルとの比
較によって、ソレノイド１に流れる電流が小さい場合に
は短期間で立上がり、逆に、ソレノイド１に流れる電流
が大きい場合には長期間で立上がるようになる。
【００１６】このようして、比較器２８による出力信号
が、時刻ｔ3 において立ち上がる。以後、同様な動作が
繰り返される結果、比較器２８の出力信号は、ソレノイ
ド１に常時流れる電流に基づいて、図２に示すように、
パルス幅変調（ＰＷＭ）される。
が、時刻ｔ3 において立ち上がる。以後、同様な動作が
繰り返される結果、比較器２８の出力信号は、ソレノイ
ド１に常時流れる電流に基づいて、図２に示すように、
パルス幅変調（ＰＷＭ）される。
【００１７】上述したようにこの実施例では、ソレノイ
ド１に流れる電流を急速に遮断することができるととも
に、ソレノイド１に常時流れる電流を帰還することによ
って、ＮＰＮトランジスタ２およびＰＮＰトランジスタ
７を制御するので、ソレノイド１に流れる電流の平均値
を、目標とする電流値（通電量指定信号Ｍ）に一致させ
ることができる。したがって、ソレノイド１の発熱を防
止することができるので、発熱による推力低下は発生し
にくくなる。
ド１に流れる電流を急速に遮断することができるととも
に、ソレノイド１に常時流れる電流を帰還することによ
って、ＮＰＮトランジスタ２およびＰＮＰトランジスタ
７を制御するので、ソレノイド１に流れる電流の平均値
を、目標とする電流値（通電量指定信号Ｍ）に一致させ
ることができる。したがって、ソレノイド１の発熱を防
止することができるので、発熱による推力低下は発生し
にくくなる。
【００１８】
【発明の効果】以上説明したこの発明によれば、電流目
標値に対し正確かつ高速に応答することができるととも
に、発熱による推力低下を防止することができる。
標値に対し正確かつ高速に応答することができるととも
に、発熱による推力低下を防止することができる。
【図１】 この発明の一実施例による誘導性負荷の駆動
回路の構成を示す回路図である。
回路の構成を示す回路図である。
【図２】 同実施例の動作を説明する波形図である。
【図３】 従来の、誘導性負荷の駆動回路の構成を示す
回路図である。
回路図である。
【図４】 同駆動回路において、ソレノイド１の電流が
遮断される過程の等価回路を示す回路図である。
遮断される過程の等価回路を示す回路図である。
１……ソレノイド（誘導性負荷）、２……ＮＰＮトラン
ジスタ（第１のスイッチ手段）、７……ＰＮＰトランジ
スタ（第２のトランジスタ）、３……ダイオード（第１
のダイオード）、１１……ダイオード（第２のダイオー
ド）、１５…検出抵抗（第１の電流検出手段）、１２…
…検出抵抗（第２の電流検出手段）、２８……比較器
ジスタ（第１のスイッチ手段）、７……ＰＮＰトランジ
スタ（第２のトランジスタ）、３……ダイオード（第１
のダイオード）、１１……ダイオード（第２のダイオー
ド）、１５…検出抵抗（第１の電流検出手段）、１２…
…検出抵抗（第２の電流検出手段）、２８……比較器
Claims (1)
- 【請求項１】 誘導性負荷の一端および接地線間に介挿
された第１のスイッチ手段と、 前記誘導性負荷の他端および電源間に介挿された第２の
スイッチ手段と、 前記誘導性負荷の一端から前記電源へ向う電流を通過さ
せる第１のダイオードと、 前記接地線から前記誘導性負荷の他端へ向う電流を通過
させる第２のダイオードと、 前記第１および第２のスイッチ手段がＯＮ状態の時に、
前記誘導性負荷に流れる電流値を検出する第１の電流検
出手段と、 前記第１および第２のスイッチ手段がＯＦＦ状態の時
に、前記誘導性負荷に流れる電流値を検出する第２の電
流検出手段と、 前記第１、第２の電流検出手段によって検出された電流
値と目標値との比較によりパルス幅変調信号を生成する
とともに、前記パルス幅変調信号によって前記第１およ
び第２のスイッチ手段を制御する制御手段とを具備する
ことを特徴とする誘導性負荷の駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4210501A JP3063407B2 (ja) | 1992-08-06 | 1992-08-06 | 誘導性負荷の駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4210501A JP3063407B2 (ja) | 1992-08-06 | 1992-08-06 | 誘導性負荷の駆動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0661042A JPH0661042A (ja) | 1994-03-04 |
| JP3063407B2 true JP3063407B2 (ja) | 2000-07-12 |
Family
ID=16590414
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4210501A Expired - Fee Related JP3063407B2 (ja) | 1992-08-06 | 1992-08-06 | 誘導性負荷の駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3063407B2 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3799706B2 (ja) * | 1997-01-23 | 2006-07-19 | ヤマハ株式会社 | ソレノイド駆動回路 |
| US7454864B2 (en) | 2003-04-25 | 2008-11-25 | Smith Thomas J | Planting pots and multi-compartment tray having self-orienting configuration |
| US8627599B2 (en) | 2010-09-22 | 2014-01-14 | Costa Farms, LLC | Planting pot display system |
-
1992
- 1992-08-06 JP JP4210501A patent/JP3063407B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0661042A (ja) | 1994-03-04 |
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