JP3053929B2 - オーバー・サンプリング型のディジタル化機器において測定信号のサンプリングを外部のイベントに同期させるための方法と装置 - Google Patents

オーバー・サンプリング型のディジタル化機器において測定信号のサンプリングを外部のイベントに同期させるための方法と装置

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    • G01V1/00—Seismology; Seismic or acoustic prospecting or detecting
    • G01V1/24—Recording seismic data
    • G01V1/247—Digital recording of seismic data, e.g. in acquisition units or nodes

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】この発明の目的とするところは、
オーバー・サンプリング型のディジタル化機器における
測定信号のサンプリングを外部イベントをもととする基
準信号に同期化させるための方法と装置とである。この
ようなディジタル化機器は、種々の測定信号をサンプル
しなければならないようなすべての分野、例えば、一連
のサンプルを数個の異なる信号捕捉チェーンによって、
サンプルする時、それが相互に実質的に同期するように
するような分野に応用の途を見出す。それは伝搬の時間
間隔を基として算えるべき基準のタイミングが、データ
捕捉システムに対して一定でなければならない地震波探
査の分野において特に注目に価する。一般的に選択され
る最初の基準タイミングは地震波の発生源からの発射の
タイミングである。発射された波は表土と基岩の中間に
ある心土の中を伝搬し、例えば地表に分布されている地
震波感知器によって受信される。これらの感知器に伝え
られた信号は直接又は、最近の方法では、地表の所々に
分布されたデータ捕捉器でとりまとめられて中央制御記
録センタに伝送される。この捕捉器はそれぞれ捕捉され
たすべての信号を信号発生源の発射ごとに、それに従っ
て増幅し、漏波し、ディジタル化して貯蔵する。各発射
−受信のサイクルの後に、又は一定数のサイクル毎に貯
蔵されたデータは中央のセンタに集められる。このよう
な地震波捕捉システムは例えばフランス特許 FR 2,511,
772(US 4,583,206)又はFR 2,538,194(US 4,628,494)に
記載してある。
【０００２】
【従来の技術】各々の捕捉器において、地震波信号は捕
捉チェーンに加えられる。普通の捕捉チェーンの構成は
固定利得の前置増幅器、高域漏波器、アンチ・アリアス
低域漏波器と、変換器の働作範囲にその利得値を合わせ
た可変利得増幅器（V.G.A.）を前にもつアナログ・ディ
ジタル変換器（A.D.C.）とを含んでいる。この変換器は
各ディジタル化されたサンプルに加えられる利得をバイ
ナリの形で与える４ビットのワードによって構成される
12乃至16ビットのディジタル・ワードを出力する。この
在来の構成は、アナログの不゛ふんが多く、いくつかの
欠陥を有する。可変利得増幅器は調整が難しく、又熱の
影響を受け易い。それ故安定な増幅器を得るコストは比
較的高くなる。アンチ・アリアス（anti-aliasing）低
域漏波器についても、いくつかの切替可能のそれをそれ
ぞれ起り得るサンプリングのピッチに合わせるために数
個使用しなければならない為に、同じくコスト上昇を来
す。
【０００３】
【発明が解決しようとする課題】アナログ型のデータ捕
捉チェーンのもつ多くの欠陥がオーバー・サンプリング
として知られる技術によって避けられる。そのようなチ
ェーンの構成を要約する。このデータ捕捉チェーンは前
置増幅器、広域漏波器、オーバー・サンプリング型の変
換器およびディジタル・フィルタから成る。この型の変
換器は広い変換働作範囲をもっているので可変利得増幅
器（V.G.A.）の必要性をなくし、又アンチ・アリアス漏
波器の機能はアナログ・ディジタル変換器（A.D.C.）の
後にあるディジタル・フィルタによって代行される。オ
ーバー・サンプリング技術はアナログ・ディジタル変換
器が在来の変換器よりも小さなフォーマットのディジタ
ル・ワードを出力するが、しかしより高い周波数で信号
をサンプルすることが出来ることによって実現される。
正常の働作範囲は、変換器から出力される信号を特別の
ディジタル・フィルタに与えることによって確保出来
る。このフィルタは、専門家の周知するようにその漏波
機能の外に、一定数のサンプルを適当なウェイティング
をつけて合計するために使われる。オーバー・サンプリ
ングの変換器は例えば数百KHZ の周波数で１ビッドのワ
ードを出力する。ディジタル・フィルタはこれらの多数
の１ビッドのワードを合算し、漏波する働作の後に、１
KHZ 近辺のサンプリング周波数（例えば125HZ から４KH
Z）で、例えば少なくとも20ビッドのディジタル・ワー
ドを出力する。アナログ・ディジタル変換器は内部クロ
ックで固定されるタイミングで信号の一連のアナログ・
サンプルをディジタル化する。このことは変換器が別々
に働作する場合は決して欠陥ではない。それは、一連の
イベントの位置を決めるべき最初の基準タイミングを精
密に定めなければならない場合、特に信号の捕捉が異な
る変換器をもつ機器を通して行われなければならない場
合には欠陥となる。特に地震波予測の働作では、波源か
ら地震波信号が発射された後心土を伝わって来る地震波
が多数の感知器によってピックアップされ、それぞれが
アナログ・ディジタル変換器をもっている屡々かなりの
数に上る異なる捕捉チェーンの機器によって、デジタル
化したサンプルに変換される。基準のタイミングは一般
的に地震波源が解除される時のそれに選ばれ、ピックア
ップされた信号から異なる変換器によって得られた最初
のサンプルが、このタイミングに対して調整されなけれ
ばならない。各変換器のサンプリングのタイミングが内
部クロックのみに依存するならば、基準として選ばれる
外部のイベントに同期しなければならない理由はない。
それ故、或る種のジッターが生じ、それは一般に、捕捉
チェーン毎に異なる。この結果は、すべての在来の地震
波処理において起り得るように、異なる捕捉チェーンに
よって受信され、処理された信号の組合せを取扱う時、
非常に厄介な、同期の欠除である。
【０００４】
【課題を解決するための手段】この発明による装置は、
オーバー・サンプリング型のアナログ・ディジタル変換
器と、これと協働する同期信号を生成するクロックと更
に、測定信号から、該変換器のサンプリング周期の整数
倍の固定周期をもつ一連の有効なサンプルを出力するた
めのディジタル・フィルタとを備えるディジタル化機器
を通して、測定信号の該有効なサンプリングを外部イベ
ントに基づく基準信号で同期されることを可能とするも
のであって、該有効なサンプルの各々はアナログ・ディ
ジタル変換器から出力されたサンプルを一定数ｎ個合計
したものであって、以上によって、上述した欠陥を避け
ることを可能とするものである。それはディジタル・フ
ィルタによって一連の有効なサンプルを生成することを
強制するシフト手段を含み、該サンプルの最初のものが
基準のタイミングに無関係なシフトで、入力信号上にと
られたサンプルに対応するようになっている。このシフ
ト手段は、ディジタル・フィルタによる前記最初の有効
なサンプルの生成を最大で前記固定周期の分数の一定数
倍に等しいシフトをもつように強制するために使われる
もので、この分数は例えば最小で１サンプリング周期に
等しいものである。ディジタル・フィルタによる最初の
有効なサンプルの送出を強制するためのシフト手段は、
例えば、有効なサンプルを生成するためにディジタル・
フィルタによって合算されるべきサンプルの数ｎよりも
大きい数Ｎ個のサンプルのためのメモリと、前記基準信
号の受信の時に前記基準信号の到着とディジタル・フィ
ルタへのその転送のタイミングに従って選択されるべき
ｎ個のサンプルを選択的に抽出することを命令するため
に使われる制御アセンブリとを含む。これによって、デ
ィジタル・フィルタによって生成される基準信号後の最
初の有効なサンプルは、最大でサンプル周期の一定数倍
に等しいシフトをもって、測定信号上からとられるサン
プルに対応することになる。基準信号の到着に先立つｎ
個のサンプルの抽出を命令するためと、それを前記ディ
ジタル・フィルタへ転送するためとに適した制御アセン
ブリが、例えば使われる。基準信号の到着のタイミング
の時間的に両側に分布するｎ個のサンプルを抽出するこ
とを命令するために使用される制御アセンブリを利用す
ることも可能である。メモリは書き込みポインタと読み
取りポインタとを備えており、制御アセンブリは例えば
最大で前記固定周期の数に等しい、時間間隔ｔ以内のサ
ンプリング周期の数を貯えるためのカウンタを含んでい
て、基準信号の到着のタイミングを位置決めすることを
可能とする。また制御アセンブリは基準のタイミングの
後の最初の有効なサンプルを形成するサンプルを選ぶた
めに、前記カウンタに貯えられている数に従って、前記
ポインタを相互に対してシフトするための手段を含んで
いる。メモリに関しては、遅延線路と一緒に動作するた
めに設計された F.I.F.O（先入先出）式の循環型のメモ
リであり、ディジタル・フィルタに転送されるサンプル
に与えられる遅延は、最大でメモリの中のＮ個のサンプ
ルのサンプリングの時間に等しい。以上に定義したよう
な、この発明に従う装置では、測定されるべき各信号の
最初の有効なサンプルは基準信号からサンプリング周期
より小さいそして実質的には常に等しい非常に限定され
た間隔だけ時間的に分離させられているだけであるか
ら、望ましい同期を得ることが可能である。この発明に
よる方法は、それぞれ複数の信号ディジタル化装置によ
る測定信号のサンプリングを外部のイベントに基づく共
通の基準信号で同期化することを可能とする。この信号
ディジタル化装置の各々はオーバー・サンプリング型の
アナログ・ディジタル変換器を含み、また各々が同期化
信号を生成するクロックと、測定信号から固定の周期
(T)をもつ一連の有効なサンプルを生成するために使わ
れるディジタル・フィルタと協働し、更にこの有効なサ
ンプルの各々がアナログ・ディジタル変換器からオーバ
ー・サンプリングによって得られるｎ個の連続サンプル
の合算から得られるようになっている。この方法は次の
各手段を含む： 1) 前記アナログ・ディジタル変換器の各々から来る一
連のサンプルの数ｎよりも大きいＮ個のサンプルを、そ
れらのサンプルを対応するディジタル・フィルタに加え
る前に、貯えておくこと。 2) 各測定信号の永久的に貯えられたＮ個のサンプルの
間から、時間をシフトされたｎ個の連続サンプルの一連
を選び、それによって各ディジタル・フィルタから得ら
れる対応する有効なサンプルが基準のタイミングに無関
係で、実質的にすべてのディジタル化装置に対して同じ
であるシフト量をもって、各信号の上でとられるサンプ
ルに対応するようにすること。 各々の一連のサンプルを選ぶために加えられる時間シフ
トは、例えば、有効なサンプルの転送の瞬間を基準信号
の到着の瞬間から分離する時間を測ることによって得ら
れる。この発明による方法は一連のサンプルの各々を実
質的に同期させることを可能とするもので、特に異なる
サンプル連の組合せを含むすべての処理を可能とする。
【０００５】
【実施例】第１図に示す周知のタイプの装置(1)は２つ
のIC(2と3)とを直列に接続した組合せを作って、例えば
サンプリング周波数ｆでＮビットのディジタル・ワード
を出力する。このICは数社のカタログに見出すことが出
来るもので、デルターシグマ変調器の使用をベースとす
るものである。第１の要素(2)は小さなフォーマットp＜
Nのディジタル・ワードをF=k・fのサンプリング周波数で
連続して出力する変換器である。（ここでkは１より大
きい整数である。）第２の要素(3)は変換器(2)から連続
的に供給される一定数のサンプルから平均値を作り出す
F.I.R.型（有限インパルス対応型）のディジタル・フィ
ルタである。一例として、変換器(2)は例えば256KHzの
周波数で１ビットのディジタル・ワードを出力し、ディ
ジタル・フィルタ(3)が非常に多数の連続するサンプル
を合算して、少なくとも１KHzの周波数で20ビットのデ
ィジタル・ワードを生成する。ディジタル・フィルタ
(3)に伝送されるサンプリング周波数と、連続合算の命
令とは同期信号を送出するクロッ ク(4)によって生成
される。装置(1)はオーバー・サンプリングによって得
られる一定数のサンプルの合算を行って、Ｎビットのワ
ードを形成するが、その生成する各サンプルは内部クロ
ックによって固定されるタイミングに関して時間的にシ
フトされている。このような装置は、一連のディジタル
化されたサンプルを、外部のイベントに対して、それが
どのようなタイミングで起ころうと精密に調整すること
を求められない場合には、常に正しく働作する。第２図
に見るように、各々が一組のサンプルとの合算の結果で
ある連続するサンプルEi、Ei+1、…Ei+4が内部クロック
(4)によって強制される連続的なタイミングti、ti+1、
…ti+4で、周期Ｔをもって、ディジタル・フィルタ(3)
の出力に生成される。外部イベントが任意の２つの連続
するサンプル、例えばEiとEi+1の間の或る時間TBで起こ
ったとする。そしてこの場合タイミングTBとTBの後の最
初のサンプルを生成するタイミングti+1との間の時間間
隔dt1はＯとＴとの間のある値となる。この第１の装置
と同期していない内部クロックで働作する同様の装置
(1)から来る同様の信号は同じ同期Ｔをもつが異なるタ
イミングt'i、…t'i+4等で一連のサンプルE'i、…E'i+4
等を生成する。（第２Ｂ図）タイミングTBとTBの後の最
初のサンプルを生成するタイミングt'i+1との間の時間
間隔dt2は異なるものとなる。もし、このような装置が
多数使われたとすると、それぞれの一連のサンプルは相
互に分散し、又外部強制タイミングTBについてもバラバ
ラになる。この発明による装置も第１図の装置と類似の
変換器(2)、ディジタル・フィルタ(3)およびクロック
(4)を含む。フィルタ(3)は第１の入力に同期信号SYを、
第２の入力にクロック信号CLKを受信する。該装置は又
一定数Ｎの容量をもつメモリ(5)と、後述するようにデ
ィジタル・フィルタ(3)から来る有効なサンプルを再調
整することを可能とする論理制御ユニット(6)とを含
む。クロック信号CLKと同期信号SYNCとはフィルタ(3)の
入力に加えられる。信号SYNCはフィルタ(3)による有効
なサンプルの生成のタイミングを規定する。信号CLKとS
Yとから誘導されるクロック信号Ｈと同期信号SYNCとを
変換器(2)と論理ユニット(6)とに加える接続がなされて
いる。ビット毎の連続的「オーバー・サンプル」ビット
DOを生成する変換器(2)の出力は論理ユニット(6)の入力
ゲートI/iに接続されている。ビット毎のオーバー・サ
ンプルビットDIを生成する論理ユニットの出力ゲートI/
Oはディジタル・フィルタ(3)の入力に接続されている。
論理ユニット(6)は基準信号TBを受ける入力を含んでい
る。論理ユニット(6)とメモリ(5)との間の接続により、
読み込み制御信号RD、書き出し制御信号WRおよびディジ
タル・ワード制御信号ADDをメモリーのアドレスを参照
して、加えることが出来、逆に抽出されるdataを論理ユ
ニットに向けて送り出すことも可能とする。論理ユニッ
トの中には図示していないが、カウンタがあり、これに
クロック信号Ｈが供給されるが、それは新しい有効サン
プルがディジタル・フィルタ(3)によって生成される
と、その都度リセットされる。このカウンタの内容は常
にメモリ(5)によって生成される最後の有効サンプルの
生成以後の時間間隔dtを表している。論理ユニット(6)
の機能は変換器(2)によって生成されたビットをメモリ
(5)に書き込むことと、それを選択的にフィルタ(3)へ転
送することとを指示することである。メモリ(5)はF.I.
F.O.（先入先出）式の循環型メモリである。書き込みポ
インタWPが変換器(2)からの新しいサンプルを書き込む
べきメモリ(5)のアドレスを示し、読み取りポインタRP
がフィルタ(3)に向かって転送されるべきアドレスを指
示することで制御される。新しい書き込み毎に、それと
一緒にメモリのそれに続くアドレスに向かってポインタ
をシフトすることが行われるが、もしメモリのアドレス
が一番終わりに達すると一番始めのアドレスに戻る。同
じように新しく貯えられたサンプルを読み取る毎に読み
取りポインタの後続アドレスへのシフトが行われ、ポイ
ンタがメモリの最後のアドレスに到達するとメモリ(5)
の一番始めに戻る。読み取りと書き込みのポインタが同
じアドレスを指示するような特別の場合には、メモリは
遅延線路として働作する。古いデータが読み出され、新
しいデータが代わりに書き込まれる。適用される遅延量
はメモリ(5)の大きさに依存する。変換器(2)(A.D.C.)は
周期ｔで信号をオーバー・サンプルする。このサンプル
は周期ｔの整数倍の周期Ｔで取り分けられ、（第４図
Ａ）、ディジタル・フィルタ(3)が働作原理上固有の遅
延時間Ｒをもって、ディジタル化したサンプルV3、V4…
等を出力する。このＲはオーバー・サンプルの周期ｔの
一定倍の数に等しい（この例では25である）。基準信号
TBが自律的な働作モードで任意の２つのタイミング（第
４図ではe11とe12）の間にある或るタイミングで到着す
る。この基準信号TBたオーバー・サンプリングの間隔の
どこに到着したかの境界を定める２つの瞬間t1とt2の何
れか１つのタイミングでサンプルe'11が定められるべき
である。メモリ(5)はその時、そこは含まれる多数のオ
ーバー・サンプルの時間量Ｍで第４図Ｄ上にシンボル化
して示してある。第４図Ｄでは第４図Ａの一連のサンプ
ルとの関係において位置ずけられている。メモリからフ
ィルタ(3)に送り出されるビット(DI)はe1のサンプリン
グタイミングに対して間隔Ｒだけシフトされる。変換
器(2)からメモリに入って来るものはメモリ(5)の時間量
だけシフトされる。このメモリの時間間隔Ｍは周期ｔの
オーバー・サンプリングのインパルスによって動く。装
置の働作は次の通り： 1) 信号TBが到着する前は、論理ユニット(6)はメモリ
(5)を遅延線路として扱うように働く。即ち、読み取り
と書き出しのポインタが同じアドレスを指示する。各読
み取り／書き出しのサイクルにおいて、論理ユニット
(6)はポインタRP、WPとによって共通に指示されたアド
レスにある古いビットを引き出し、それをフィルタ(3)
へ向けて転送し、その同じアドレスに変換器(2)から供
給される新しく入って来るビットを書き込み、その後で
両方のポインタを次のアドレスにシフトさせる。 −フィルタ(3)によって有効なサンプルにされた（周期
Ｔの）新しいサンプルを出力する度に、変数dtを供給す
る論理ユニット(6)の中のカウンタはリセットされる。 2) 信号TBの到着は論理ユニット(6)の中のカウンタの
内容を固定する効果をもつ。そのカウンタは今やフィル
タ(3)からの直近の有効なサンプル（第４図ＥのS1）と
信号TBの到着のタイミングとの間の経過時間dtを示す。
論理ユニットは次に読み取りポインタRPのdt一列シフト
を書き込みポインタWPに対して制御する（第４図Ｆ）。
これにより： RP=WP+dt 又は RP=WP+dt-k （RPがkより大きくなった時） 3) TBのタイミングとフィルタ(3)による有効サンプル
の送出との間において、クロックのインパルス毎に論理
ユニット(6)は： a) 変換器(2)によって供給されるビットを書き込みポ
インタによって与えられるアドレスへの書き込み、それ
を１列だけ移すこと、および b) 読み取りポインタRPによって与えられるアドレスに
あるビットをフィル タ(3)に向かって転送するがこの
ポインタはこれ以上シフトしない、即ち変えない。よう
に指示する。これは第４図Ｇ上にメモリーの間隔Ｍのシ
フトとして現れているが、読み取りポインタはシフトさ
せず、不変である。 4) フィルタ(3)がサンプルを生成する瞬間から、オー
バー・サンプリングクロックCLKのインパルス毎に、論
理ユニット(6)は通常の読み取り／書き出しのサイクル
を導く。即ち、変換器(2)によって生成された新しいビ
ットを書き込みポインタの与えるアドレスに書き込み、
このポインタをシフトし、読み取りポインタの指示する
アドレスにあるビットを読み出し、そのポインタをシフ
トする。再調整するために、読み取りポインタのアドレ
スに先立つ2Rの時間間隔の中にあるサンプルe'1、e'2、
…e'7（第４図Ｃ）は有効なものとすることが出来な
い。有効になったディジタル化したサンプルs'8、s'9等
（第４図Ｈ）は後から貯えられたビットに対応してお
り、前の間隔2Rの終わりに位置している。読み取りポイ
ンタRPをメモリ(5)の中に、より直近に書き込まれたビ
ットの方へシフトすることによって、フィルタ(3)によ
って合算されたビットは、出来るだけ信号TBに近くなる
ように自律的働作モードの時に得られるこれに対応する
サンプル（この場合e11）に対して、遅延しているアナ
ログのサンプル（この場合e'11）に対応するものとなる
であろうことが理解出来る。それ故クロックの周波数で
働く数個の装置が（上に述べた場合のように）同じ信号
TBを受けるならば、それらはすべてが実質的に同期して
いる、即ち、最大でオーバー・サンプリングの周期ｔ以
下に揃う、（実際上数マイクロ秒）一連の有効なサンプ
ルをそれぞれ出力することになろう。取り上げられた一
連のサンプル（e'11、e'12等）は、TBのタイミングに直
接近接しているタイミングT1又はT2（第４図Ｂ）上に来
るように再調整されることが望ましい。特別の応用に対
しては、しかし乍ら、このTBのタイミングに対して異な
る再調整を選ぶことが可能であろう。しかし、それはす
べての装置に共通なものであり、この発明の範囲から離
れるものではない。オーバー・サンプリングおよび有効
なサンプルの生成周波数、更にディジタル・ワードのフ
ォーマットに対して与えた数値は発明を限定するもので
はない。オーバー・サンプルをストアし、シフトする上
述の原理はオーバー・サンプリングとディジタル・フィ
ルタリングのどのような組合せにも、また他の応用に対
しても、この発明のスコープを離れることなしに応用し
得るものである。
【図面の簡単な説明】
【図１】周知の型のオーバー・サンプリング式アナログ
・ディジタル変換器の構成を系統図として示したもので
ある。
【図２Ａ】測定すべき任意の信号のサンプリングの時間
関係を示す第１のクロノグラムである。
【図２Ｂ】第２Ａ図と同様であるが時間的にシフトされ
ている、同じ信号のサンプリングの時間関係を示す第２
のクロノグラムである。
【図３】この発明による装置を系統図として示すもので
ある。
【図４】Ａ〜Ｈは、第２図のクロノグラムで示す装置の
働作の時間的経過を明らかにするための種々のクロノグ
ラムを示すものである。
フロントページの続き (56)参考文献 特開 昭63−198417（ＪＰ，Ａ) 特開 昭64−79686（ＪＰ，Ａ) 特開 平２−207618（ＪＰ，Ａ) 特開 平２−250433（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) H03M 3/02

Claims (9)

    (57)【特許請求の範囲】
  1. 【請求項１】 同期信号(CLK)を生成するクロック(4)と
    ディジタル・フィルタ(3)とを伴うオーバー・サンプリ
    ング型のアナログ・ディジタル変換器(2)を含む少なく
    とも１つのディジタル化機器によって測定信号のサンプ
    リングを外部イベントをマークする基準信号(TB)に同期
    させるための装置にして、該ディジタル・フィルタは測
    定信号から、そのサンプリング周期(t)の整数倍の一定
    の周期(T)をもつ一連の有効なサンプル(S1、S2、…)を
    生成するために使用され、該有効なサンプルの１つ１つ
    は該アナログ・ディジタル変換器(2)から得られる一定
    数ｎ個のサンプルを合算することによって得られるもの
    であるような該装置において、該装置はディジタル・フ
    ィルタが一連の有効なサンプルを、その最初のもの(S'1
    1)が、基準のタイミング(TB)に無関係な量のシフトをも
    って、入力信号上でピックアップされたサンプル(e'11)
    に対応するようなタイミングで生成することを強制する
    ためのシフト手段を含んでいることを特徴とする装置。
  2. 【請求項２】 前記請求項(1)に記載の装置において、
    前記シフト手段が前記ディジタル・フィルタをして最大
    で前記一定の周期の一定の分数値に等しいシフトをもっ
    て、前記最初の有効なサンプルを生成せしめるために使
    われることを特徴とする装置。
  3. 【請求項３】 前記請求項(1)又は(2)に記載の装置にお
    いて、ディジタル・フィルタによって、第１の有効なサ
    ンプルを送出させるためのシフト手段が、任意の有効な
    サンプルを生成するためにディジタル・フィルタ(3)に
    よって合算されるべきサンプルの数ｎよりも大きい値の
    Ｎ個のサンプルのためのメモリ(5)と、前記基準信号(T
    B)の到着の瞬間に従って選ばれるＮ個のサンプルを選択
    的に引き出すこと、および、それをディジタル・フィル
    タに転送し、ディジタル・フィルタによって基準信号よ
    り後に有効化された最初のサンプル(S'11)が、最大でサ
    ンプリング周期(t)の一定数倍に等しいシフトをもち、
    測定信号上でピックアップされるサンプル化(e'11)に対
    応するようにすることを、基準信号(TB)を受信した時指
    示するために使われる制御アセンブリ(6)とを含むこと
    を特徴とする装置。
  4. 【請求項４】 前記請求項(3)に記載の装置において、
    制御アセンブリ(6)が、基準信号の到着に先立つｎ個の
    サンプルを引き出すことおよびそれを前記ディジタル・
    フィルタに転送することを命令するために使われること
    を特徴とする装置。
  5. 【請求項５】 前記請求項(3)に記載の装置において、
    制御アセンブリ(6)が基準信号の到着の瞬間の前後どち
    らの側にでも分布しているｎ個のサンプルを引き出すこ
    とを命令するために使われることを特徴とする装置。
  6. 【請求項６】 前記請求項(3)〜(5)のどれかに記載の装
    置において、メモリ(5)が書き込みポインタと読み取り
    ポインタとを備え、制御アセンブリ(6)が時間間隔とし
    てサンプリング周期(t)で測った数で最大で前記一定の
    周期(T)のそれに等しい数をストアするためのカウンタ
    を含み、前記基準信号の到着の瞬間を位置決めすること
    を可能とし、更に制御アセンブリ(6)は基準信号の後で
    最初に有効とされるサンプルを構成するサンプルを選ぶ
    ために前記カウンタにストアされた数に従って前記ポイ
    ンタを相互に対してシフトさせるための手段を含むこと
    を特徴とする装置。
  7. 【請求項７】 前記請求項(3)〜(6)項のうちのどれかに
    記載の装置において、メモリ(5)が F.I.F.O（先入先
    出）式の循環型のもので、遅延路線と協働するように設
    計されており、前記ディジタル・フィルタに転送される
    サンプルに加えられる遅延が、最大でメモリの中のＮ個
    のサンプルのサンプリング持続時間に等しいことを特徴
    とする装置。
  8. 【請求項８】 同期信号を生成するクロック(4)とディ
    ジタル・フィルタ(3)とを伴う、オーバー・サンプリン
    グ型のアナログ・ディジタル変換器を含む複数の信号デ
    ィジタル化機器によって、それぞれの測定信号のサンプ
    リングを、外部イベントをマークする共通の基準信号に
    同期させるための方法にして、該ディジタル・フィルタ
    は、測定信号から、一定の周期(T)をもつ一連の有効な
    サンプルを生成するために使用され、該有効なサンプル
    はそれぞれが、オーバー・サンプリングによって得ら
    れ、アナログ・ディジタル変換器の出力として得られる
    ｎ個の連続するサンプルの一連を合算することから得
    られるものであるような方法において、該方法が： − 前記アナログ・ディジタル変換器のそれぞれから来
    る一連のサンプルの数ｎよりも大きい一定数Ｎ個のサン
    プルを、それが対応するディジタル・フィルタに加えら
    れる前にストアしておくことと、 − 永久的にストアされているＮ個の各測定信号のサン
    プルの間から、ｎ個の連続するサンプルのタイム・シフ
    トされた一連を選び出し、それぞれのディジタルフィル
    タからの出力である対応する有効なサンプルが基準のタ
    イミングに無関係なシフトをもって、実質的にすべての
    ディジタル化装置に対して同じシフトで、それぞれの信
    号に対応するようにすることとを含む方法。
  9. 【請求項９】 前記請求項(8)に記載の方法において、
    各一連のサンプルを選び出すに当り適用されるタイムシ
    フトは有効なサンプルの送出の瞬間を基準信号の到着の
    瞬間から分離させる時間を測定することによって得られ
    ることを特徴とする方法。
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