JP3047037B2 - 受信装置 - Google Patents
受信装置Info
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- JP3047037B2 JP3047037B2 JP4015408A JP1540892A JP3047037B2 JP 3047037 B2 JP3047037 B2 JP 3047037B2 JP 4015408 A JP4015408 A JP 4015408A JP 1540892 A JP1540892 A JP 1540892A JP 3047037 B2 JP3047037 B2 JP 3047037B2
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Description
【０００１】
【産業上の利用分野】本発明は、電流信号を受信してバ
ルブ、電動バルブ、或いは電気／空気変換器などの制御
対象をこの電流信号に対応するステム変位、或いは空気
圧信号などの物理量に変換するために使用する受信装置
に係り、特にゼロ点、或いはスパンの調整が操作性良く
実行することができるように改良した受信装置に関す
る。
ルブ、電動バルブ、或いは電気／空気変換器などの制御
対象をこの電流信号に対応するステム変位、或いは空気
圧信号などの物理量に変換するために使用する受信装置
に係り、特にゼロ点、或いはスパンの調整が操作性良く
実行することができるように改良した受信装置に関す
る。
【０００２】
【従来の技術】従来のこの種の受信装置のゼロ点調整と
スパン調整は、電流信号を既知の所定の値に設定した状
態で、いずれも各々の可変抵抗を調節して出荷時のゼロ
点或いはスパン値と異なるか否かチエックして、出荷時
と違っているときには手動で可変抵抗を調節して別々に
設定し直すことにより実行してきた。
スパン調整は、電流信号を既知の所定の値に設定した状
態で、いずれも各々の可変抵抗を調節して出荷時のゼロ
点或いはスパン値と異なるか否かチエックして、出荷時
と違っているときには手動で可変抵抗を調節して別々に
設定し直すことにより実行してきた。
【０００３】
【発明が解決しようとする課題】しかしながら、以上の
ような従来の受信装置はゼロ／スパンの調整に際して電
流信号を可変する必要があり、しかもゼロ点とスパンに
ついて２度に亘る調整が必要で手間がかかる上に、ゼロ
点とスパンのそれぞれについて人為的に設定をする関係
から設定誤差が発生する余地が多い。
ような従来の受信装置はゼロ／スパンの調整に際して電
流信号を可変する必要があり、しかもゼロ点とスパンに
ついて２度に亘る調整が必要で手間がかかる上に、ゼロ
点とスパンのそれぞれについて人為的に設定をする関係
から設定誤差が発生する余地が多い。
【０００４】
【課題を解決するための手段】本発明は、以上の課題を
解決するための構成として、２本の伝送線を介して電流
信号が入力されこの電流信号を用いて回路電源を作る定
電圧回路と、この定電流回路に直列に接続され先の電流
信号に対応する電圧信号を発生させる入力抵抗と、第１
基準デ−タが格納された第１メモリ領域と出荷のときの
０％と１００％の出荷デ−タが格納された第２メモリ領
域と先の基準データから１００％或いは０％の基準デー
タを作る変換プログラムが格納された第３メモリ領域と
を有するメモリと、先の電圧信号と制御対象から帰還さ
れるフイードバック信号とが入力されこれ等の信号が一
致するように演算して先の制御対象に制御信号を出力す
ると共に先の電流信号が先の第１基準データと関連して
設定された状態で演算開始の指令により先の第１基準デ
ータとこれを先の変換プログラムにより変換した１００
％或いは０％の基準データを先の制御対象に出力しこの
制御対象から帰還されるフイードバック信号が先の出荷
データと異なるときにこの出荷データを補正する補正演
算を実行する演算手段と、この演算手段にゼロ／スパン
の自動補正を行う先の演算開始を指令する設定手段とを
具備するようにしたものである。
解決するための構成として、２本の伝送線を介して電流
信号が入力されこの電流信号を用いて回路電源を作る定
電圧回路と、この定電流回路に直列に接続され先の電流
信号に対応する電圧信号を発生させる入力抵抗と、第１
基準デ−タが格納された第１メモリ領域と出荷のときの
０％と１００％の出荷デ−タが格納された第２メモリ領
域と先の基準データから１００％或いは０％の基準デー
タを作る変換プログラムが格納された第３メモリ領域と
を有するメモリと、先の電圧信号と制御対象から帰還さ
れるフイードバック信号とが入力されこれ等の信号が一
致するように演算して先の制御対象に制御信号を出力す
ると共に先の電流信号が先の第１基準データと関連して
設定された状態で演算開始の指令により先の第１基準デ
ータとこれを先の変換プログラムにより変換した１００
％或いは０％の基準データを先の制御対象に出力しこの
制御対象から帰還されるフイードバック信号が先の出荷
データと異なるときにこの出荷データを補正する補正演
算を実行する演算手段と、この演算手段にゼロ／スパン
の自動補正を行う先の演算開始を指令する設定手段とを
具備するようにしたものである。
【０００５】
【作 用】２本の伝送線を介して電流信号が入力された
定電圧回路はこの電流信号を用いて回路電源を作る。そ
して、この定電流回路に直列に接続された入力抵抗は先
の電流信号に対応する電圧信号を発生させる。
定電圧回路はこの電流信号を用いて回路電源を作る。そ
して、この定電流回路に直列に接続された入力抵抗は先
の電流信号に対応する電圧信号を発生させる。
【０００６】メモリには第１基準デ−タが格納された第
１メモリ領域と出荷のときの０％と１００％の出荷デ−
タが格納された第２メモリ領域と先の基準データから１
００％或いは０％の基準データを作る変換プログラムが
格納された第３メモリ領域とが確保された状態になって
いる。
１メモリ領域と出荷のときの０％と１００％の出荷デ−
タが格納された第２メモリ領域と先の基準データから１
００％或いは０％の基準データを作る変換プログラムが
格納された第３メモリ領域とが確保された状態になって
いる。
【０００７】そこで、先の電圧信号と制御対象から帰還
されるフイードバック信号とが入力され演算手段はこれ
等の信号が一致するように演算して先の制御対象に制御
信号を出力すると共に先の電流信号が先の第１基準デー
タと関連して設定された状態で演算開始の指令により先
の第１基準データとこれを先の変換プログラムにより変
換した１００％或いは０％の基準データを先の制御対象
に出力しこの制御対象から帰還されるフイードバック信
号が先の出荷データと異なるときにこの出荷データを補
正する補正演算を実行する。
されるフイードバック信号とが入力され演算手段はこれ
等の信号が一致するように演算して先の制御対象に制御
信号を出力すると共に先の電流信号が先の第１基準デー
タと関連して設定された状態で演算開始の指令により先
の第１基準データとこれを先の変換プログラムにより変
換した１００％或いは０％の基準データを先の制御対象
に出力しこの制御対象から帰還されるフイードバック信
号が先の出荷データと異なるときにこの出荷データを補
正する補正演算を実行する。
【０００８】そして、設定手段によりこの演算手段にゼ
ロ／スパンの自動補正を行う先の演算開始を指令するこ
とによりゼセロ／スパンのチエックが実行される。
ロ／スパンの自動補正を行う先の演算開始を指令するこ
とによりゼセロ／スパンのチエックが実行される。
【０００９】
【実施例】以下、本発明の実施例について図を用いて説
明する。図１は本発明の１実施例の構成を示すブロック
図、図２はこの実施例を制御対象としてバルブを選定し
ポジショナとして使用したときの構成を示す構成図であ
る。
明する。図１は本発明の１実施例の構成を示すブロック
図、図２はこの実施例を制御対象としてバルブを選定し
ポジショナとして使用したときの構成を示す構成図であ
る。
【００１０】２線式伝送路Ｌは伝送線Ｌ1、Ｌ2から構成
され、入力端子Ｔ1、Ｔ2に接続されている。この入力端
子Ｔ1、Ｔ2には定電圧回路ＣＶＲと入力抵抗Ｒiとが直
列に接続され、定電圧回路ＣＶＲと入力抵抗Ｒiとの接
続点は回路の共通電位点ＣＯＭとされている。
され、入力端子Ｔ1、Ｔ2に接続されている。この入力端
子Ｔ1、Ｔ2には定電圧回路ＣＶＲと入力抵抗Ｒiとが直
列に接続され、定電圧回路ＣＶＲと入力抵抗Ｒiとの接
続点は回路の共通電位点ＣＯＭとされている。
【００１１】定電圧回路ＣＶＲは抵抗Ｒ1、Ｒ2、Ｒ3、
Ｒ4、Ｒ5、ツエナダイオードＤＺ1、ダイオードＤ1、演
算増幅器Ａ1、トランジスタＱ1などで構成されている。
入力端子Ｔ1と共通電位点ＣＯＭとの間には、抵抗Ｒ1と
ツエナダイオードＤＺ 1との直列回路、抵抗Ｒ2とＲ3の
直列回路、演算増幅器Ａ1の電源端、ダイオードＤ1と抵
抗Ｒ4とトランジスタＱ1のコレクタとエミッタ、抵抗Ｒ
5が直列に接続された直列回路が接続されている。
Ｒ4、Ｒ5、ツエナダイオードＤＺ1、ダイオードＤ1、演
算増幅器Ａ1、トランジスタＱ1などで構成されている。
入力端子Ｔ1と共通電位点ＣＯＭとの間には、抵抗Ｒ1と
ツエナダイオードＤＺ 1との直列回路、抵抗Ｒ2とＲ3の
直列回路、演算増幅器Ａ1の電源端、ダイオードＤ1と抵
抗Ｒ4とトランジスタＱ1のコレクタとエミッタ、抵抗Ｒ
5が直列に接続された直列回路が接続されている。
【００１２】また、抵抗Ｒ1とツエナダイオードＤＺ1と
接続点にはツエナー電圧ＶZ1が、抵抗Ｒ2とＲ3の接続点
には入力端子Ｔ1と共通電位点ＣＯＭとの間に発生する
回路電圧ＶBを分圧した分圧電圧Ｖ1が発生し、これ等の
電圧は演算増幅器Ａ1の反転入力端（−）と非反転入力
端（＋）に印加される。そして、その出力端の電圧でト
ランジスタＱ1のベース電流を制御する。
接続点にはツエナー電圧ＶZ1が、抵抗Ｒ2とＲ3の接続点
には入力端子Ｔ1と共通電位点ＣＯＭとの間に発生する
回路電圧ＶBを分圧した分圧電圧Ｖ1が発生し、これ等の
電圧は演算増幅器Ａ1の反転入力端（−）と非反転入力
端（＋）に印加される。そして、その出力端の電圧でト
ランジスタＱ1のベース電流を制御する。
【００１３】ここで、電流信号ＩLが入力端子Ｔ1とＴ2
に流れると、その一部は抵抗Ｒ1とツエナダイオードＤ
Ｚ1との直列回路に流れ、ツエナダイオードＤＺ1の両端
にツエナー電圧ＶZ1を発生させる。
に流れると、その一部は抵抗Ｒ1とツエナダイオードＤ
Ｚ1との直列回路に流れ、ツエナダイオードＤＺ1の両端
にツエナー電圧ＶZ1を発生させる。
【００１４】この場合の電流信号ＩLは、例えば４〜２
０ｍＡの統一された電流信号として調節計等から伝送さ
れる。そして、この電流信号ＩLは４ｍＡが０％、２０
ｍＡが１００％となるレンジとして伝送される。
０ｍＡの統一された電流信号として調節計等から伝送さ
れる。そして、この電流信号ＩLは４ｍＡが０％、２０
ｍＡが１００％となるレンジとして伝送される。
【００１５】演算増幅器Ａ1は分圧電圧Ｖ1がツエナー電
圧ＶZ1に一致するようにトランジスタＱ1のコレクタと
エミッタの間に流れる電流Ｉ1を制御して抵抗Ｒ2とＲ3
の直列回路の両端の回路電圧ＶBが一定になるように制
御している。
圧ＶZ1に一致するようにトランジスタＱ1のコレクタと
エミッタの間に流れる電流Ｉ1を制御して抵抗Ｒ2とＲ3
の直列回路の両端の回路電圧ＶBが一定になるように制
御している。
【００１６】演算増幅器Ａ2、抵抗Ｒ6〜Ｒ8でレベルシ
フト回路ＬＳＣを構成し、入力抵抗ＲＩに電流信号ＩL
によって発生した信号電圧Ｖiは、非反転入力端（＋）
が抵抗Ｒ6を介して共通電位点ＣＯＭに接続され反転入
力端（−）が出力端と抵抗Ｒ7を介して接続された演算
増幅器Ａ2の反転入力端（−）に抵抗Ｒ8を介して入力さ
れる。
フト回路ＬＳＣを構成し、入力抵抗ＲＩに電流信号ＩL
によって発生した信号電圧Ｖiは、非反転入力端（＋）
が抵抗Ｒ6を介して共通電位点ＣＯＭに接続され反転入
力端（−）が出力端と抵抗Ｒ7を介して接続された演算
増幅器Ａ2の反転入力端（−）に抵抗Ｒ8を介して入力さ
れる。
【００１７】回路電圧ＶBで付勢された演算増幅器Ａ2の
出力端に発生した電圧はスイッチＳＷ1を介してアナロ
グ／デジタル変換器ＡＤＣ１を介してデジタル信号に変
換されてマイクロプロセッサμＰの制御のもとに不揮発
性メモリＥ2ＰＲＯＭに格納される。
出力端に発生した電圧はスイッチＳＷ1を介してアナロ
グ／デジタル変換器ＡＤＣ１を介してデジタル信号に変
換されてマイクロプロセッサμＰの制御のもとに不揮発
性メモリＥ2ＰＲＯＭに格納される。
【００１８】マイクロプロセッサμＰはリードオンリメ
モリＲＯＭに格納された演算手順に従って不揮発性メモ
リＥ2ＰＲＯＭに格納されたデータを用いて所定の演算
を実行してデジタル／アナログ変換器ＤＡＣ１を介して
図２に示す電空変換器Ｅ／Ｐにアナログ信号ＡＳとして
出力する。
モリＲＯＭに格納された演算手順に従って不揮発性メモ
リＥ2ＰＲＯＭに格納されたデータを用いて所定の演算
を実行してデジタル／アナログ変換器ＤＡＣ１を介して
図２に示す電空変換器Ｅ／Ｐにアナログ信号ＡＳとして
出力する。
【００１９】この電空変換器Ｅ／Ｐは格別電源の供給を
受けずに給気圧ＰSの供給を受けながらアナログ信号Ａ
Ｓで駆動されて対応する空気圧信号ＰＳを出力する。駆
動装置ＤＲはこの空気圧信号ＰＳに対応してバルブＶを
駆動しそのバルブ開度に対応するシャフトの変位ＤＳを
図１に示す受信装置ＲＥＣのアナログ／デジタル変換器
ＡＤＣ２に出力する。
受けずに給気圧ＰSの供給を受けながらアナログ信号Ａ
Ｓで駆動されて対応する空気圧信号ＰＳを出力する。駆
動装置ＤＲはこの空気圧信号ＰＳに対応してバルブＶを
駆動しそのバルブ開度に対応するシャフトの変位ＤＳを
図１に示す受信装置ＲＥＣのアナログ／デジタル変換器
ＡＤＣ２に出力する。
【００２０】そして、マイクロプロセッサμＰは信号電
圧Ｖiに一致するようにアナログ信号ＡＳを操作して変
位ＤＳを制御する。以上のようにして、受信装置ＲＥＣ
は、通常は、電流信号ＩLに対応するアナログ信号Ａ
Ｓ、ひいてはバルブ開度になるようにして制御対象であ
るバルブＶに送出している。
圧Ｖiに一致するようにアナログ信号ＡＳを操作して変
位ＤＳを制御する。以上のようにして、受信装置ＲＥＣ
は、通常は、電流信号ＩLに対応するアナログ信号Ａ
Ｓ、ひいてはバルブ開度になるようにして制御対象であ
るバルブＶに送出している。
【００２１】しかしながら、この受信装置ＲＥＣを用い
るシステムは稼働中にゼロ点或いはスパンが変動を起こ
すことがあり、このような場合には、ゼロ点（０％）或
いはスパン（１００％）をチェックする必要がある。
るシステムは稼働中にゼロ点或いはスパンが変動を起こ
すことがあり、このような場合には、ゼロ点（０％）或
いはスパン（１００％）をチェックする必要がある。
【００２２】このため、次に説明するスパン／ゼロのチ
エック機能が付加される。マイクロプロセッサμＰには
設定器ＳＥＴからゼロ／スパンの自動補正を行う演算開
始を指令する指令信号Ｓ0が入力される。
エック機能が付加される。マイクロプロセッサμＰには
設定器ＳＥＴからゼロ／スパンの自動補正を行う演算開
始を指令する指令信号Ｓ0が入力される。
【００２３】さらに、リードオンリメモリＲＯＭには、
少なくとも０％、５０％、或いは１００％のいずれかに
対応する基準データＳ0、Ｓ50、或いはＳ100などが保存
されている。
少なくとも０％、５０％、或いは１００％のいずれかに
対応する基準データＳ0、Ｓ50、或いはＳ100などが保存
されている。
【００２４】また、不揮発性メモリＥ2ＰＲＯＭには、
受信装置ＲＥＣとバルブＶなどが組み合わされてポジシ
ョナとして出荷された時点の０％、および１００％に対
応する出荷データＨ0とＨ100、駆動装置ＤＲから帰還さ
れた変位ＤＳに対応する変位データＨXが格納される。
受信装置ＲＥＣとバルブＶなどが組み合わされてポジシ
ョナとして出荷された時点の０％、および１００％に対
応する出荷データＨ0とＨ100、駆動装置ＤＲから帰還さ
れた変位ＤＳに対応する変位データＨXが格納される。
【００２５】この他に、０％、５０％、或いは１００％
のいずれか１つの基準データＳ0、Ｓ50、或いはＳ100か
ら他の基準データを演算により作り出す変換プログラム
が格納されている。
のいずれか１つの基準データＳ0、Ｓ50、或いはＳ100か
ら他の基準データを演算により作り出す変換プログラム
が格納されている。
【００２６】さらに、出荷データＨ0、或いはＨ100と変
位データＨXとの偏差αが所定の許容値の中にないとき
はこれを補正することとなるが、この補正演算を実行す
るに必要な係数、演算式などはこの不揮発性メモリＥ2
ＰＲＯＭに格納されている。
位データＨXとの偏差αが所定の許容値の中にないとき
はこれを補正することとなるが、この補正演算を実行す
るに必要な係数、演算式などはこの不揮発性メモリＥ2
ＰＲＯＭに格納されている。
【００２７】次に、以上のように構成された受信装置Ｒ
ＥＣのスパン／ゼロの調整について図３に示すフロー図
を用いて説明する。以下の説明では、この受信装置ＲＥ
Ｃの０％と１００％の間の直線性は確保されているもの
とする。
ＥＣのスパン／ゼロの調整について図３に示すフロー図
を用いて説明する。以下の説明では、この受信装置ＲＥ
Ｃの０％と１００％の間の直線性は確保されているもの
とする。
【００２８】ステップ１では、スパン／ゼロの調整に先
立って、電流信号ＩLを４ｍＡ（０％）に設定する。こ
の状態でマイクロプロセッサμＰに設定器ＳＥＴからゼ
ロ／スパンの自動補正を行う演算開始を指令する指令信
号Ｓ0を設定する。この指令信号Ｓ0に基づいてマイクロ
プロセッサμＰは４ｍＡ（０％）に対応する信号電圧Ｖ
iをレベルシフト回路ＬＳＣを介して不揮発性メモリＥ2
ＰＲＯＭの所定領域に取り込む。
立って、電流信号ＩLを４ｍＡ（０％）に設定する。こ
の状態でマイクロプロセッサμＰに設定器ＳＥＴからゼ
ロ／スパンの自動補正を行う演算開始を指令する指令信
号Ｓ0を設定する。この指令信号Ｓ0に基づいてマイクロ
プロセッサμＰは４ｍＡ（０％）に対応する信号電圧Ｖ
iをレベルシフト回路ＬＳＣを介して不揮発性メモリＥ2
ＰＲＯＭの所定領域に取り込む。
【００２９】次に、ステップ２に移行する。ここではマ
イクロプロセッサμＰはリードオンリメモリＲＯＭに格
納されている０％の基準データＳ0を呼び出して、デジ
タル／アナログ変換器ＤＡＣ１を介して図２に示す電空
変換器Ｅ／Ｐに０％の基準データＳ0に対応するアナロ
グ信号ＡＳを出力する。
イクロプロセッサμＰはリードオンリメモリＲＯＭに格
納されている０％の基準データＳ0を呼び出して、デジ
タル／アナログ変換器ＤＡＣ１を介して図２に示す電空
変換器Ｅ／Ｐに０％の基準データＳ0に対応するアナロ
グ信号ＡＳを出力する。
【００３０】この結果、アナログ信号ＡＳに対応するバ
ルブ開度が駆動装置ＤＲから帰還されアナログ／デジタ
ル変換器ＡＤＣ２を介して変位データＨX（Ｘ＝０）と
してマイクロプロセッサμＰの制御のもとに不揮発性メ
モリＥ2ＰＲＯＭの所定エリアに格納される。
ルブ開度が駆動装置ＤＲから帰還されアナログ／デジタ
ル変換器ＡＤＣ２を介して変位データＨX（Ｘ＝０）と
してマイクロプロセッサμＰの制御のもとに不揮発性メ
モリＥ2ＰＲＯＭの所定エリアに格納される。
【００３１】ここで出荷データＨ0と変位データＨX（Ｘ
＝０）とが比較され、これ等の偏差αが例えばリードオ
ンリメモリＲＯＭに格納されている演算手順に基づいて
算出される。
＝０）とが比較され、これ等の偏差αが例えばリードオ
ンリメモリＲＯＭに格納されている演算手順に基づいて
算出される。
【００３２】ステップ３はこの偏差αの絶対値が所定誤
差、例えば０．０５％以内に入るか否かが判断される。
判断の結果、０．０５％を越えているときは、次のステ
ップ４に移行する。偏差αが０．０５％以内のときは、
そのままステップ５にスキップする。
差、例えば０．０５％以内に入るか否かが判断される。
判断の結果、０．０５％を越えているときは、次のステ
ップ４に移行する。偏差αが０．０５％以内のときは、
そのままステップ５にスキップする。
【００３３】このステップ４では、０％の出荷データＨ
0を＋αして補正した補正データＨ0’として不揮発性メ
モリＥ2ＰＲＯＭの所定エリアに格納してステップ５に
移行する。
0を＋αして補正した補正データＨ0’として不揮発性メ
モリＥ2ＰＲＯＭの所定エリアに格納してステップ５に
移行する。
【００３４】ステップ５は１００％データのチエックを
実行するが、この実行に先立ってマイクロプロセッサμ
Ｐは不揮発性メモリＥ2ＰＲＯＭに格納されている変換
プログラムを用いて、リードオンリメモリＲＯＭに格納
されている０％の基準データＳ0を５倍して１００％デ
ータ（２０ｍＡ相当値）に対する基準データＳ100を作
成して、不揮発性メモリＥ2ＰＲＯＭに格納しておく。
実行するが、この実行に先立ってマイクロプロセッサμ
Ｐは不揮発性メモリＥ2ＰＲＯＭに格納されている変換
プログラムを用いて、リードオンリメモリＲＯＭに格納
されている０％の基準データＳ0を５倍して１００％デ
ータ（２０ｍＡ相当値）に対する基準データＳ100を作
成して、不揮発性メモリＥ2ＰＲＯＭに格納しておく。
【００３５】そこで、マイクロプロセッサμＰは不揮発
性メモリＥ2ＰＲＯＭに格納された１００％の基準デー
タＳ100を呼び出して、デジタル／アナログ変換器ＤＡ
Ｃ１を介して図２に示す電空変換器Ｅ／Ｐに１００％の
基準データＳ100に対応するアナログ信号ＡＳを出力す
る。
性メモリＥ2ＰＲＯＭに格納された１００％の基準デー
タＳ100を呼び出して、デジタル／アナログ変換器ＤＡ
Ｃ１を介して図２に示す電空変換器Ｅ／Ｐに１００％の
基準データＳ100に対応するアナログ信号ＡＳを出力す
る。
【００３６】この結果、アナログ信号ＡＳに対応するバ
ルブ開度が駆動装置ＤＲから帰還されアナログ／デジタ
ル変換器ＡＤＣ２を介して変位データＨX（Ｘ＝１０
０）としてマイクロプロセッサμＰの制御のもとに不揮
発性メモリＥ2ＰＲＯＭの所定エリアに格納される。
ルブ開度が駆動装置ＤＲから帰還されアナログ／デジタ
ル変換器ＡＤＣ２を介して変位データＨX（Ｘ＝１０
０）としてマイクロプロセッサμＰの制御のもとに不揮
発性メモリＥ2ＰＲＯＭの所定エリアに格納される。
【００３７】次に、ステップ６に移行し、ここで出荷デ
ータＨ100と変位データＨX（Ｘ＝１００）とが比較さ
れ、これ等の偏差βが例えばリードオンリメモリＲＯＭ
に格納されている演算手順に基づいて算出される。
ータＨ100と変位データＨX（Ｘ＝１００）とが比較さ
れ、これ等の偏差βが例えばリードオンリメモリＲＯＭ
に格納されている演算手順に基づいて算出される。
【００３８】ステップ７はこの偏差βの絶対値が所定誤
差、例えば０．０５％以内に入るか否かが判断される。
判断の結果、０．０５％を越えているときは、次のステ
ップ８に移行する。偏差βが０．０５％以内のときは、
チエックを終了する。ステップ８では、スパンに関する
出荷データＨ100のスパン係数をβ分だけ補正した補正
データＨ100’として不揮発性メモリＥ2ＰＲＯＭの所定
エリアに格納して終了する。
差、例えば０．０５％以内に入るか否かが判断される。
判断の結果、０．０５％を越えているときは、次のステ
ップ８に移行する。偏差βが０．０５％以内のときは、
チエックを終了する。ステップ８では、スパンに関する
出荷データＨ100のスパン係数をβ分だけ補正した補正
データＨ100’として不揮発性メモリＥ2ＰＲＯＭの所定
エリアに格納して終了する。
【００３９】この後、マイクロプロセッサμＰはこれら
のゼロ／スパンのチエックモードを解除して通常の測定
に移る。
のゼロ／スパンのチエックモードを解除して通常の測定
に移る。
【００４０】以上のようにして、設定器ＳＥＴによりゼ
ロ／スパンの自動補正を行う演算開始を行うことにより
出力される指令信号Ｓ0に基づいてステップ１からステ
ップ８に亘る演算が自動的に実行される。
ロ／スパンの自動補正を行う演算開始を行うことにより
出力される指令信号Ｓ0に基づいてステップ１からステ
ップ８に亘る演算が自動的に実行される。
【００４１】図４は図１に示す受信装置ＲＥＣを電空変
換器Ｅ／Ｐと組み合わせて出力される空気圧信号ＰＳを
空気圧／電気変換器Ｐ／Ｅを介して電気信号に変換しこ
れを変位信号ＤＳとして受信装置ＲＥＣに帰還して全体
として電流／空気圧変換器を構成した場合の構成を示
す。このほかに、この受信装置ＲＥＣの後段に制御対象
として電動バルブなどを接続しても良い。
換器Ｅ／Ｐと組み合わせて出力される空気圧信号ＰＳを
空気圧／電気変換器Ｐ／Ｅを介して電気信号に変換しこ
れを変位信号ＤＳとして受信装置ＲＥＣに帰還して全体
として電流／空気圧変換器を構成した場合の構成を示
す。このほかに、この受信装置ＲＥＣの後段に制御対象
として電動バルブなどを接続しても良い。
【００４２】以上の説明では、メモリとしてリードオン
リメモリＲＯＭと不揮発性メモリＥ 2ＰＲＯＭとの２つ
に分離してデータ、プログラムを格納するようにした
が、これに限らず、例えばこれ等を不揮発性メモリＥ2
ＰＲＯＭだけに格納するようにしても良い。
リメモリＲＯＭと不揮発性メモリＥ 2ＰＲＯＭとの２つ
に分離してデータ、プログラムを格納するようにした
が、これに限らず、例えばこれ等を不揮発性メモリＥ2
ＰＲＯＭだけに格納するようにしても良い。
【００４３】また、定電圧回路ＣＶＲは単にツエナダイ
オードだけで構成しても良い。さらに、以上の説明で
は、基準データとしてＳ0を記憶させておき、電流信号
ＩLを４ｍＡ（０％）に設定してこれを用いて１００％
の基準データＳ100を変換プログラムにより作成する構
成として説明したが、逆に基準データとしてＳ100を記
憶させておき、電流信号ＩLを２０ｍＡ（１００％）に
設定してこれを用いて０％の基準データＳ0を変換プロ
グラムにより作成して、これを用いてチエックするよう
にしても良い。
オードだけで構成しても良い。さらに、以上の説明で
は、基準データとしてＳ0を記憶させておき、電流信号
ＩLを４ｍＡ（０％）に設定してこれを用いて１００％
の基準データＳ100を変換プログラムにより作成する構
成として説明したが、逆に基準データとしてＳ100を記
憶させておき、電流信号ＩLを２０ｍＡ（１００％）に
設定してこれを用いて０％の基準データＳ0を変換プロ
グラムにより作成して、これを用いてチエックするよう
にしても良い。
【００４４】さらに、基準データとして例えば５０％相
当としてＳ50を記憶させておき、電流信号ＩLを１２ｍ
Ａ（５０％）に設定して（１２＊２−４）相当の演算で
１００％の基準データＳ100を、［１２＊（１／３）］
相当の演算で０％の基準データＳ0を変換プログラムに
より作成し、これ等を基準データとしてゼロ／スパンの
調整を実行するようにしても良い。
当としてＳ50を記憶させておき、電流信号ＩLを１２ｍ
Ａ（５０％）に設定して（１２＊２−４）相当の演算で
１００％の基準データＳ100を、［１２＊（１／３）］
相当の演算で０％の基準データＳ0を変換プログラムに
より作成し、これ等を基準データとしてゼロ／スパンの
調整を実行するようにしても良い。
【００４５】
【発明の効果】以上、実施例と共に具体的に説明したよ
うに本発明によれば、既知の任意の電流信号を設定した
状態で単に設定手段によりゼロ／スパン調整開始の指令
を与えるだけで自動的にゼロ／スパン調整が実行され、
従来に比べてこれらのチェックが簡単になり、操作性を
大幅に向上させることができる。
うに本発明によれば、既知の任意の電流信号を設定した
状態で単に設定手段によりゼロ／スパン調整開始の指令
を与えるだけで自動的にゼロ／スパン調整が実行され、
従来に比べてこれらのチェックが簡単になり、操作性を
大幅に向上させることができる。
【図１】本発明の１実施例の構成を示すブロック図であ
る。
る。
【図２】図１に示す実施例と組み合わせたポジショナの
構成を示す構成図である。
構成を示す構成図である。
【図３】図１に示す実施例の動作を説明するフロー図で
ある。
ある。
【図４】図１に示す受信装置を電気／空気圧変換部に送
出して全体として電空変換器として構成した構成図であ
る。
出して全体として電空変換器として構成した構成図であ
る。
Ｌ1、Ｌ2 伝送線 ＣＶＲ 定電圧回路 ＬＳＣ レベルシフト回路 μＰ マイクロプロセッサ ＲＯＭ リードオンリメモリ Ｅ2ＰＲＯＭ 不揮発性メモリ ＡＤＣ１、ＡＤＣ２ アナログ／デジタル変換器 ＤＡＣ１ デジタル／アナログ変換器 ＳＥＴ 設定器 ＣＳ 制御信号 ＤＲ 駆動装置 ＲＥＣ 受信装置
───────────────────────────────────────────────────── フロントページの続き (72)発明者 久保田 龍作 東京都武蔵野市中町２丁目９番32号 横 河電機株式会社内 (72)発明者 林 寛 東京都武蔵野市中町２丁目９番32号 横 河電機株式会社内 (72)発明者 西島 剛志 東京都武蔵野市中町２丁目９番32号 横 河電機株式会社内 (72)発明者 翠川 稔 東京都武蔵野市中町２丁目９番32号 横 河電機株式会社内 (72)発明者 笠原 康男 東京都武蔵野市中町２丁目９番32号 横 河電機株式会社内 (72)発明者 井上 晃 東京都武蔵野市中町２丁目９番32号 横 河電機株式会社内 (58)調査した分野(Int.Cl.7，ＤＢ名) G01D 3/02 G01D 3/04
Claims (1)
- 【請求項１】２本の伝送線を介して電流信号が入力され
この電流信号を用いて回路電源を作る定電圧回路と、こ
の定電流回路に直列に接続され前記電流信号に対応する
電圧信号を発生させる入力抵抗と、第１基準デ−タが格
納された第１メモリ領域と出荷のときの０％と１００％
の出荷デ−タが格納された第２メモリ領域と前記基準デ
ータから１００％或いは０％の基準データを作る変換プ
ログラムが格納された第３メモリ領域とを有するメモリ
と、前記電圧信号と制御対象から帰還されるフイードバ
ック信号とが入力されこれ等の信号が一致するように演
算して前記制御対象に制御信号を出力すると共に前記電
流信号が前記第１基準データと関連して設定された状態
で演算開始の指令により前記第１基準データとこれを前
記変換プログラムにより変換した１００％或いは０％の
基準データを前記制御対象に出力しこの制御対象から帰
還されるフイードバック信号が前記出荷データと異なる
ときにこの出荷データを補正する補正演算を実行する演
算手段と、この演算手段にゼロ／スパンの自動補正を行
う前記演算開始を指令する設定手段とを具備することを
特徴とする受信装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4015408A JP3047037B2 (ja) | 1992-01-30 | 1992-01-30 | 受信装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4015408A JP3047037B2 (ja) | 1992-01-30 | 1992-01-30 | 受信装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05209760A JPH05209760A (ja) | 1993-08-20 |
| JP3047037B2 true JP3047037B2 (ja) | 2000-05-29 |
Family
ID=11887914
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4015408A Expired - Lifetime JP3047037B2 (ja) | 1992-01-30 | 1992-01-30 | 受信装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3047037B2 (ja) |
-
1992
- 1992-01-30 JP JP4015408A patent/JP3047037B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH05209760A (ja) | 1993-08-20 |
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