JP2984310B2 - 薄膜半導体装置の製造方法 - Google Patents
薄膜半導体装置の製造方法Info
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Description
しくは、ディスプレー、ファクシミリ、イメージスキャ
ナなどに好適に用いられる薄膜トランジスタや光センサ
等の薄膜半導体装置の製造方法に関する。
プレーや画像を電気信号に変換する入出力デバイスは、
ワードプロセッサー、パーソナルコンピューター、ファ
クシミリ等のOA機器のマンマシーンインターフェイスと
して、重要視されるだけでなく、その入出力デバイスや
それを用いた装置の軽量化、薄型化、低価格化が要望さ
れている。
モルファスシリコン、ポリシリコン等を、大面積の絶縁
基板上に形成し、薄膜トランジスタを構成したアクティ
ブマトリクス方式の液晶ディスプレイや、光センサーを
構成した光電変換装置等の開発が進められている。
を示す模式的断面図である。
のゲート電極2上にゲート絶縁膜3を堆積し、更にチャ
ネルとなる薄膜半導体4、例えば、水素化アモルファス
シリコン(以下a−Si:H)などを設け、更にソース ド
レイン電極6、7の金属電極の間に、n+層5設けた構
成のTFTが示されている。前記n+層5は、電子に対し
てオーミック性、正孔に対してブロッキング性となる接
合を形成する。このように構成されたTFTは、nチャン
ネルトランジスターとして動作する。なお、第1図のTF
Tは2次光電流型の光センサーとしても応用できる(例
えば特開昭60−101940号公報)。
を示す(例えば特開昭63−9157号公報参照)。
膜を設け、ゲート電極2を形成した後、例えばプラズマ
CVD法でゲート絶縁膜となるシリコン窒化膜3を3000
Å、半導体層となるa−Si:H4層4を5000Å、n+層5
を1500Å 連続的に堆積する。(第2図(a)) 次に、ソース ドレイン電極6、7となるアルミニウ
ムをスパッタ法等で堆積した後、感光性樹脂8を全面に
設け、露光・現像して該感光性樹脂8をパターニングす
る。(第2図(b)) 次に、ソース ドレイン電極6、7となるアルミニウ
ムを前記感光性樹脂8をレジストとして用いてパターニ
ングする。(第2図(c)) 続いて、電極の上にある感光性樹脂8をマスクにし
て、n+層5を所定の深さにRIE(リアクティブ・イオ
ン・エッチ)等のエッチングによりエッチングした後、
感光性樹脂8を剥離する。(第2図(d)) 更に、必要に応じてTFTを素子間分離し、TFTが作成さ
れる。(第2図(e)) 薄膜トランジスタの半導体薄膜の表面は、雰囲気の影
響を受けやすく、酸素ガスや水蒸気が直接これらの表面
に吸着あるいは拡散すれば、半導体薄膜が、非常に薄い
ため、電気的特性が大きく変動する。このため、場合に
よって、素子の表面をチッ化シリコン(Si3N4)や、酸
化シリコン(SiO2)などの保護膜で、また、熱処理によ
り重合させたポリイミド樹脂膜を保護膜として被覆する
ことが提案されている。(第2図(f)) [発明が解決しようとしている課題] しかしながら、前記したような従来の方法によって、
形成された薄膜トランジスターは、特に光センサとして
用いる場合、光の入射する半導体薄膜の表面が、雰囲気
の影響を受けやすく、酸素ガスや水蒸気が直接これらの
表面に、吸着、あるいは、拡散すれば、半導体薄膜が、
非常に薄いため、電気的特性が大きく変動する。このた
め、前記したように素子の表面を窒化シリコン(Si
3N4)から成る保護膜で被覆することが検討されてい
る。しかし、薄膜半導体層に用いられているアモルファ
スシリコンは、高温の熱履歴を受けると、膜中の水素が
拡散、放出されたり、オーミックコンタクト層中のP
(リン)や電極のAl(アルミニウム)との相互拡散が起
きたりして、薄膜半導体表面はダメージを受けるため、
アモルファスシリコンに対して高温の熱履歴を与えるこ
とができない。
膜される事が必要となるが、通常、窒化シリコンの成膜
に用いられるプラズマCVD法で保護膜としての特性を満
足させるには、300℃程度の基板温度が必要であり、通
常のアモルファスシリコンの成膜温度と同等、もしく
は、高い温度である。窒化シリコンを、プラズマCVD法
によりさらに低温で作成した場合、NH3やN2などの原料
ガスの分解反応が、あまり進まないために、膜の緻密性
は低く、マイクロクラックなどの欠陥が多い構造になっ
てしまう。これらの保護膜の膜質の悪化により、暗電流
の増加、耐圧の低下などの望ましくない特性となる。ま
た、保護膜としてポリイミド等の有機材料を用いた場合
も、熱処理による影響については同様に考えられる。ま
た、有機材料では充分な耐湿性が期待できない場合があ
る。
センサーを実際に製品として応用する場合に充分な性能
を持った保護層が形成されていないと、重大な障害とな
る場合がある。たとえば、光センサーの場合、その基本
特性である光電流、暗電流が、不安定で、読み取り画像
の大きな劣化を引き起こす場合がある。
においては、保護膜形成時のアモルファスシリコンへの
熱の影響が心配されるために、より良質な保護膜が得ら
れず、更なる信頼性や安定性という点で、より一層厳し
い環境下に於ける特性や性能の保証が充分できない場合
があるという問題点があった。
信頼性や安定性という点で、より一層厳しい環境下に於
ける特性や性能の保証が充分可能に成るような保護層を
有する薄膜半導体装置の製造方法を提供することを目的
とする。
体装置において、その保護膜の成膜温度を半導体薄膜
(例えばアモルファスシリコン)の成膜温度から決め
て、さらに保護層成膜後に熱処理を行うことにより、よ
り一層の信頼性、安定性が確保された薄膜薄膜半導体装
置得ることを目的とする。
支持体上に設けられたアモルファスシリコン膜と、該ア
モルファスシリコン膜上に設けられた窒化シリコン膜の
保護層と、を有する薄膜半導体装置の製造方法であっ
て、前記窒化シリコン膜の成膜温度TS2と、前記アモル
ファスシリコン膜の成膜温度TS1とが、TS2≦TS1−50な
る関係とされ、且つ、前記窒化シリコン膜の成膜後に前
記成膜温度TS1を越えない熱処理温度TAで熱処理するこ
とを特徴とする。
もとづき説明する。
1図及び第2図においてそれぞれ説明したものと同じで
ある。
製方法を更に詳しく説明する。
形成し、続いてゲート絶縁膜3となる水素化アモルファ
スシリコン窒化膜(a−SiNx:H 以下 窒化シリコン
膜)を3000Å,第1の薄膜半導体4となる水素化アモル
ファスシリコン(以下 a−Si:H)を5000Å、n型不純
物を含有するアモルファスシリコン層であるn+層5を
1500ÅプラズマCVD法により、順次堆積した(第2図
(a))。このとき、ゲート絶縁膜3となる窒化シリコ
ン膜の成膜温度は350℃、薄膜半導体4となる水素化ア
モルファスシリコンの成膜温度TS1は200℃、さらにn+
層5はの成膜温度は190℃とされた。
ムを1μmの厚みにスパッタリング法で堆積後、ソー
ス、ドレイン電極のパターニング用の感光性レジスト
(感光性樹脂)8を塗布した(第2図(b))。
グ後、感光性レジスト8をマスクとしてソース、ドレイ
ン電極をウエットエッチングにより形成した(第2図
(c))。
感光性レジスト間の露出している部分のn+層5をエッ
チングした後にレジスト8を剥離した(第2図
(d))。
後、不要部分の各層をRIEによって除去し、素子分離を
行なった(第2図(e))。
窒化シリコン膜の保護層10をプラズマCVD法により形成
した(第2図(f))。
度TS2を150℃としてプラズマCVD法により堆積させた。
を200℃として1時間の熱処理をして本発明のTFT型光セ
ンサを得た。
シリコン膜の単膜について、熱処理温度TA=200℃で熱
処理した膜と、していない膜との各物性値の比較を、第
1表に示した。
り、BHFエッチングレイトの減少から、緻密性の向上が
見られ、また、ESRスピン密度の減少から、膜中の欠陥
が減少したことがわかる。更に、熱処理した膜は、耐圧
特性も良好になっている。
暗電流特性をあらわすトランジスタのVg−Id特性を第3
図に示す。第3図に示されるように良好なON/OFF比を持
つ特性であった。
を変えて作成されたトランジスタのVg−Id特性を第4図
(a)乃至第4図(c)に示す。第4図に示されるよう
に、ゲート電圧Vg=0Vでの暗電流Idは、保護膜の成膜温
度が高くなると増加し、トランジスタとしてのON/OFF
比、また光センサとしてのS/N比は悪化してしまうこと
がわかる。また、半導体層のアモルファスシリコンの成
膜温度TS1が200℃の場合、保護膜の成膜温度TS2は150℃
程度が良好であることがわかる。
は、良質な膜ではないため、保護膜としてそのまま用い
た場合、第5図の高温高湿放置時間に対する暗電流変化
率を示す図に示されるように、光センサ特性で特に暗電
流の高温高湿での変化率が大きく、耐湿性が悪いことが
わかる。
の改善を行った後に保護膜として用いることで、第5図
のように、暗電流の変化は小さくなり耐湿性は満足され
る。
4図で見られたのと同様なVg−Id特性の劣化が現れる。
熱処理による膜質の改善も、アモルファスシリコン成膜
時の温度である200℃程度で飽和するため、それ以上高
温にする必要はない。
が、200℃の場合について述べたが、アモルファスシリ
コンの成膜温度TS1が、これと異なる温度であっても、
保護膜の窒化シリコンの成膜温度TS2は、それより50℃
以上低い温度で選び、さらに熱処理温度TAは、アモルフ
ァスシリコンの成膜温度TS1より低い温度で選べば、本
発明が適用できる。
サーをファクシミリ等の画像読み取り装置に応用した場
合の側断面図を第6図に示す。第6図において、61はガ
ラス基板、62はゲート電極、63はゲート絶縁膜、64は半
導体薄膜、65はオーミックコンタクト層、66は上部電
極、67は保護層、68は接着層、69は原稿、70は耐摩耗
層、71は光源である。
で反射して、光センサの光電変換部に入射して光電変換
される。
全コンタクト型センサの回路の平面図の一例を示す。同
図において、20はマトリクスに形成された配線部、21は
本発明によるTFT型光センサを用いた光センサ部、22は
電荷蓄積部、23aは本発明によるTFTを用いた転送用スイ
ッチ、24bは電荷蓄積部22の電荷をリセットする本発明
によるTFTを用いた放電用スイッチ、25は転送用スイッ
チの信号出力を信号処理ICに接続する引き出し線であ
る。本実施例では光センサ部21、転送用スイッチ23a及
び放電用スイッチ23bを構成する光導電性半導体層とし
てa−Si:H膜が用いられ、絶縁層としてプラズマCVDに
よる窒化シリコン膜が用いられている。尚、第7図にお
いては、煩雑さを避けるために、上下2層の電極配線の
み示し、上記光導電性半導体層及び絶縁層は図示してい
ない。また上層電極配線と半導体層との界面にはn+層
が形成され、オーミック接合が取られている。
全コンタクト型センサの回路の等価回路を示す。同図に
おいて、Si,1、Si,2、Si,3、・・・・Si,n、は、第
7図の光センサ部21を構成している光センサであり、i
はブロックの番号、1〜nはブロック内のビット数であ
る。(以下Si,nと記す。)また同図において、Ci,nは
電荷蓄積部22のコンデンサで、光センサSi,nに対応し
てそれぞれの光電流を蓄積する。また、蓄積コンデンサ
Ci,nの電荷を負荷コンデンサCXnに転送するための転送
用スイッチ23aのトランジスタSTi,n、電荷をリセットす
る放電用スイッチ23bのトランジスタSRi,nも同様に対応
している。これらの、光センサSi,n、蓄積コンデンサ
Ci,n、転送用スイッチトランジスタSTi,n、および放電
用スイッチトランジスタSRi,nは、それぞれ一列にアレ
イ状に配置され、n個で1ブロックを構成し、全体とし
てm個のブロックに分けられている。たとえば、センサ
が1728個で構成されているとすれば、n=32、m=54と
することができる。アレイ状に設けられた転送用スイッ
チSTi,n、放電用スイッチSRi,nのゲート電極は、ゲート
配線部に接続される。転送用スイッチSTi,nのゲート電
極は1番目のブロック内で共通に接続され、放電用スイ
ッチSRi,nのゲート電極は次の順位のブロックの転送用
スイッチのゲート電極に接続される。
3,・・・Gm)はゲート駆動部246によりドライブされ
る。一方信号出力は、マトリクス構成になっている引き
出し線230(信号出力線D1,D2,D3,・・・Dn)を介して信
号処理部247(ブロック単位で)接続される。また、光
センサSi,nのゲート電極は駆動部250に接続されて、負
のバイアスが加えられる。かかる構成において、ゲート
駆動線G1,G2,G3,・・・Gmにはゲート駆動部246から順次
選択パルス(VG1,VG2,VG3・・・VGm)が供給される。ま
ず、ゲート駆動線にG1選択されると、転送用スイッチST
1,1〜ST1,nがON状態となり、蓄積コンデンサC1,1〜C
1,nに蓄積された電荷が負荷コンデンサCX1〜CXnに転送
される。次に、ゲート駆動線G2が選択されると、転送用
スイッチST2,1〜ST2,nがON状態となり、蓄積コンデンサ
C2,1〜C2,nに蓄積された電荷が負荷コンデンサCX1〜C
Xnに転送され、同時に放電用スイッチSR1,1〜SR1,nより
蓄積コンデンサC1,1〜C1,nの電荷がリセットされる。
以下同様にして、ゲート駆動線G3,G4,G5,・・・Gmにつ
いても選択されて、読み取り動作が行われる。これらの
動作は各ブロックごとに行われ、各ブロックの信号出力
VX1,VX2,VX3,・・・VXnは信号処理部247の入力D1,D2,
D3,・・・Dnに送られ、シリアル信号に変換されて出力
される。
いた読み取り装置は、長時間に亙る使用に対しても特性
等の劣化がなく安定した読み取りを行うことができた。
かに安定していた。
は、第6図に示すように光センサの上部に耐摩耗層70を
形成してセンサの裏面から光源71により照明し、原稿69
を読み取るレンズレスの完全コンタクトセンサアレイの
みならず、等倍結像レンズ(たとえば、日本板硝子社製
のセルフォックレンズなど)を用いた完全コンタクトセ
ンサアレイにも使用可能である。
度内(例えば100℃以上)にするのが好ましい。
一般には1時間から数時間(例えば2〜3時間)とする
のが好ましい。
成方法において、半導体層に用いられるアモルファスシ
リコンの成膜温度TS1に応じて、保護膜の成膜温度TS2を
TS1よりも低い温度、より好ましくは50℃以上低温にな
るように選び、さらに、保護膜の成膜温度TAを、薄膜半
導体層(例えばアモルファスシリコン層)の成膜温度T
S1の温度を越えないように選ぶことにより、半導体層に
対する熱的なダメージを最小限度にとどめながら、しか
も、より一層の信頼性、安定性を満足する保護膜を形成
できた。
第2図は、第1図に示される薄膜半導体装置の作製方法
を説明するための工程図、第3図は、本発明による光セ
ンサにおける、トランジスタのVg−Id特性を示す図、第
4図(a)乃至第4図(c)は、それぞれ従来の方法に
より保護層を形成した場合の、それぞれ作成されたトラ
ンジスタのVg−Id特性を示す図、第5図は、高温高湿放
置時間に対する暗電流変化率を示す図、第6図は、本発
明による光センサを用いた画像読み取り装置の模式的断
面図、第7図は、本発明による光センサを用いた画像読
み取り装置の模式的平面図、第8図は、本発明による光
センサを用いた画像読み取り装置の等価回路である。 1,61:ガラス基板 2,62:ゲート電極 3,63:ゲート絶縁膜 4,64:光導電性半導体膜 5,65:n+層(オーミックコンタクト層) 6,66:上部電極層 8:レジスト 10,67:保護層 69:原稿 70:耐摩耗層 71:光源 20,210:マトリクス形成されたゲゲート配線部 21:光センサ部 22:電荷蓄積部 23a:転送用スイッチ 23b:放電用スイッチ 25,230:信号出力の引き出し線 26:光入射窓 246:ゲート駆動部 247:信号処理部 250:センサゲート駆動部 Si,n:光センサ Ci,n:蓄積コンデンサ CXn:負荷コンデンサ STi,n:転送用スイッチングトランジスタ SRi,n:リセット用スイッチングトランジスタ
Claims (2)
- 【請求項1】支持体と、該支持体上に設けられたアモル
ファスシリコン膜と、該アモルファスシリコン膜上に設
けられた窒化シリコン膜の保護層と、を有する薄膜半導
体装置の製造方法であって、前記窒化シリコン膜の成膜
温度TS2と、前記アモルファスシリコン膜の成膜温度TS1
とが、TS2≦TS1−50なる関係とされ、且つ、前記窒化シ
リコン膜の成膜後に前記成膜温度TS1を越えない熱処理
温度TAで熱処理することを特徴とする薄膜半導体装置の
製造方法。 - 【請求項2】前記薄膜半導体装置は更に補助電極、オー
ミックコンタクト層及び対向電極を有し、前記支持体側
から補助電極、絶縁層、アモルファスシリコン膜、オー
ミックコンタクト層、対向電極の順に積層された構造を
有することを特徴とする請求項1に記載の薄膜半導体装
置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2080010A JP2984310B2 (ja) | 1990-03-27 | 1990-03-27 | 薄膜半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2080010A JP2984310B2 (ja) | 1990-03-27 | 1990-03-27 | 薄膜半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH03278481A JPH03278481A (ja) | 1991-12-10 |
JP2984310B2 true JP2984310B2 (ja) | 1999-11-29 |
Family
ID=13706356
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2080010A Expired - Lifetime JP2984310B2 (ja) | 1990-03-27 | 1990-03-27 | 薄膜半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2984310B2 (ja) |
-
1990
- 1990-03-27 JP JP2080010A patent/JP2984310B2/ja not_active Expired - Lifetime
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Publication number | Publication date |
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JPH03278481A (ja) | 1991-12-10 |
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