JP2982930B2 - Ｄｃ／ｄｃコンバータ - Google Patents
Ｄｃ／ｄｃコンバータInfo
- Publication number
- JP2982930B2 JP2982930B2 JP4338276A JP33827692A JP2982930B2 JP 2982930 B2 JP2982930 B2 JP 2982930B2 JP 4338276 A JP4338276 A JP 4338276A JP 33827692 A JP33827692 A JP 33827692A JP 2982930 B2 JP2982930 B2 JP 2982930B2
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- JP
- Japan
- Prior art keywords
- diode
- transistor
- converter
- choke coil
- main circuit
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Description
【０００１】
【産業上の利用分野】本発明はＤＣ／ＤＣコンバ−タに
関する。
関する。
【０００２】
【従来の技術】従来のチョッパ型ＤＣ／ＤＣコンバータ
の動作を図２に示す。図においてスイッチングトランジ
スタ４のエミッタには、電源端子１を介して電源を接続
し、コレクタには出力端子２を介して負荷を接続する。
比較部９は設定電圧Ｖと出力電圧Ｖｏとを比較し、その
差が所定の値になるような制御信号を制御部８に出力す
る。制御部８は発振回路を有し、前記比較部からの制御
信号に応じて発振周波数を可変してスイッチングトラン
ジスタのベースに送り、所定のデューティ・サイクルで
スイッチングトランジスタをＯＮ／ＯＦＦするようにな
っている。上記の構成において前記スイッチングトラン
ジスタがＯＮの時、電源電圧はチョーク・コイル６を通
じ負荷３に負荷電流を供給する。スイッチングトランジ
スタがＯＦＦになるとチョーク・コイル６から負荷に電
流が流れ込む。コンデンサ７は平滑用である。スイッチ
ングトランジスタの電圧降下分と電源電圧の変動分があ
るので、マージンを見込んで入力電圧の値を出力電圧の
値よりも高く設定しておく必要があり、入力電圧が変動
しても前記スイッチングトランジスタのデューティ・サ
イクルを変化させることによって出力電圧の値を一定に
保ことができる。しかしながら前記入力電圧が変動した
場合であっても、その最低値は出力電圧よりも高くなけ
ればならない。
の動作を図２に示す。図においてスイッチングトランジ
スタ４のエミッタには、電源端子１を介して電源を接続
し、コレクタには出力端子２を介して負荷を接続する。
比較部９は設定電圧Ｖと出力電圧Ｖｏとを比較し、その
差が所定の値になるような制御信号を制御部８に出力す
る。制御部８は発振回路を有し、前記比較部からの制御
信号に応じて発振周波数を可変してスイッチングトラン
ジスタのベースに送り、所定のデューティ・サイクルで
スイッチングトランジスタをＯＮ／ＯＦＦするようにな
っている。上記の構成において前記スイッチングトラン
ジスタがＯＮの時、電源電圧はチョーク・コイル６を通
じ負荷３に負荷電流を供給する。スイッチングトランジ
スタがＯＦＦになるとチョーク・コイル６から負荷に電
流が流れ込む。コンデンサ７は平滑用である。スイッチ
ングトランジスタの電圧降下分と電源電圧の変動分があ
るので、マージンを見込んで入力電圧の値を出力電圧の
値よりも高く設定しておく必要があり、入力電圧が変動
しても前記スイッチングトランジスタのデューティ・サ
イクルを変化させることによって出力電圧の値を一定に
保ことができる。しかしながら前記入力電圧が変動した
場合であっても、その最低値は出力電圧よりも高くなけ
ればならない。
【０００３】
【発明が解決しようとする課題】上記のように従来の技
術は入力電圧は出力電圧よりも高くなければならず、入
力電圧よりも高い出力電圧を得ることができないもので
あった。本発明は上記の課題を解決し入力電圧よりも高
い出力電圧を得ることができるＤＣ／ＤＣコンバ−タの
制御方法を提供することにある。
術は入力電圧は出力電圧よりも高くなければならず、入
力電圧よりも高い出力電圧を得ることができないもので
あった。本発明は上記の課題を解決し入力電圧よりも高
い出力電圧を得ることができるＤＣ／ＤＣコンバ−タの
制御方法を提供することにある。
【０００４】
【課題を解決するための手段】主回路トランジスタのベ
ースに対し、前記ＤＣ／ＤＣコンバ−タ出力電圧の設定
値と検出値との差を比較し、その差を所定の値にするよ
うな制御信号を制御部に送り、制御部は比較部からの制
御信号によって前記主回路トランジスタのＯＮ／ＯＦＦ
タイムの比率を設定するようにし、一方の側に負荷と平
滑用コンデンサを接続し、他方の側にダイオードのカソ
ードを接続した第１チョークコイルとでなる回路の、前
記ダイオードのカソード側を前記スイッチングトランジ
スタのコレクタに接続し、該エミッタには第２ダイオー
ドのカソードを接続し、該第２ダイオードのアノードに
電源と第２チョークコイルの一方の側を接続し、該第２
チョークコイルの他方の側を昇圧用トランジスタのコレ
クタを介して第３ダイオードのアノードを接続する。該
第３ダイオードのカソードには、コンデンサを接続し、
さらに前記第３ダイオードのカソードを第４ダイオード
のアノードに接続する。第４ダイオードのカソードを前
記主回路スイッチングトランジスタのエミッタに接続
し、前記昇圧用トランジスタのエミッタを接地し、この
ベースには前記制御信号発生部を接続してＤＣ／ＤＣコ
ンバータの出力電圧を入力電圧よりも高くできるように
する。
ースに対し、前記ＤＣ／ＤＣコンバ−タ出力電圧の設定
値と検出値との差を比較し、その差を所定の値にするよ
うな制御信号を制御部に送り、制御部は比較部からの制
御信号によって前記主回路トランジスタのＯＮ／ＯＦＦ
タイムの比率を設定するようにし、一方の側に負荷と平
滑用コンデンサを接続し、他方の側にダイオードのカソ
ードを接続した第１チョークコイルとでなる回路の、前
記ダイオードのカソード側を前記スイッチングトランジ
スタのコレクタに接続し、該エミッタには第２ダイオー
ドのカソードを接続し、該第２ダイオードのアノードに
電源と第２チョークコイルの一方の側を接続し、該第２
チョークコイルの他方の側を昇圧用トランジスタのコレ
クタを介して第３ダイオードのアノードを接続する。該
第３ダイオードのカソードには、コンデンサを接続し、
さらに前記第３ダイオードのカソードを第４ダイオード
のアノードに接続する。第４ダイオードのカソードを前
記主回路スイッチングトランジスタのエミッタに接続
し、前記昇圧用トランジスタのエミッタを接地し、この
ベースには前記制御信号発生部を接続してＤＣ／ＤＣコ
ンバータの出力電圧を入力電圧よりも高くできるように
する。
【０００５】
【作用】以上のように構成したので、本発明によるＤＣ
／ＤＣコンバータにおいては、昇圧用トランジスタと、
第２チョークコイルとによって、電源電圧よりも高い出
力電圧を主回路トランジスタのコレクタに供給するよう
にして、ＤＣ／ＤＣコンバータの出力電圧を電源電圧よ
りも高くできるようにした。
／ＤＣコンバータにおいては、昇圧用トランジスタと、
第２チョークコイルとによって、電源電圧よりも高い出
力電圧を主回路トランジスタのコレクタに供給するよう
にして、ＤＣ／ＤＣコンバータの出力電圧を電源電圧よ
りも高くできるようにした。
【０００６】
【実施例】以下図に基づいて本発明によるＤＣ／ＤＣコ
ンバータの実施例を詳細に説明する。図１の破線で囲っ
た部分16の内部は、従来のチョッパ型ＤＣ／ＤＣコンバ
ータと全く同様の構成である。本発明によって新たに付
け加えた部分において、第２ダイオード10のアノード側
は、電源の入力端子１に接続され、カソード側は第４ダ
イオード11のカソードに接続されている。昇圧用トラン
ジス13のコレクタには、一方の側を電源端子１に接続し
た第２チョークコイル12の他方の側を接続し、アースと
第３ダイオード14のカソードとの間に接続したコンデン
サ15と、前記第２チョークコイル12と昇圧用トランジス
タ13とでなるステップアップ回路を構成する。前記第３
ダイオード14のカソードを第４ダイオード11のアノード
に接続し、かつ、第４ダイオード11のカソード側を前記
主回路スイッチングトランジスタ４のコレクタに接続す
るようにする。昇圧用トランジス13のベースには制御部
８を接続し、制御パルス信号によって、昇圧用トランジ
スタ13を所定のデューティ・サイクルでスイッチングす
るようにして昇圧をおこなう。
ンバータの実施例を詳細に説明する。図１の破線で囲っ
た部分16の内部は、従来のチョッパ型ＤＣ／ＤＣコンバ
ータと全く同様の構成である。本発明によって新たに付
け加えた部分において、第２ダイオード10のアノード側
は、電源の入力端子１に接続され、カソード側は第４ダ
イオード11のカソードに接続されている。昇圧用トラン
ジス13のコレクタには、一方の側を電源端子１に接続し
た第２チョークコイル12の他方の側を接続し、アースと
第３ダイオード14のカソードとの間に接続したコンデン
サ15と、前記第２チョークコイル12と昇圧用トランジス
タ13とでなるステップアップ回路を構成する。前記第３
ダイオード14のカソードを第４ダイオード11のアノード
に接続し、かつ、第４ダイオード11のカソード側を前記
主回路スイッチングトランジスタ４のコレクタに接続す
るようにする。昇圧用トランジス13のベースには制御部
８を接続し、制御パルス信号によって、昇圧用トランジ
スタ13を所定のデューティ・サイクルでスイッチングす
るようにして昇圧をおこなう。
【０００７】次に本発明によるＤＣ／ＤＣコンバータの
動作を説明する。図１の破線で囲った部分15の内部は、
従来のチョッパ型ＤＣ／ＤＣコンバータと全く同様の動
作を行う。本発明によって新たに付け加えた部分の動作
はステップアップによって電源電圧よりも高い出力電圧
を前記ステップダウン回路に供給する部分で、ダイオー
ド10のアノード側は、電源の入力端子１に接続され、カ
ソード側はダイオード11のカソードに接続されているた
め、昇圧用トランジスタがＯＦＦの時に第２チョークコ
イルに発生する電圧が電源電圧よりも高くなった場合に
おいても、電源側に電流が逆流するということはない。
上記の構成において昇圧用トランジスタ13がＯＮになっ
た時点からコンデンサ15の電圧は上昇しはじめ、やがて
電源電圧の2 倍に迄達するようになるので、前記昇圧用
トランジスタのＯＮ／ＯＦＦの比を所定の値に設定する
ことにより、電源電圧よりも高い電圧を得ることができ
る。
動作を説明する。図１の破線で囲った部分15の内部は、
従来のチョッパ型ＤＣ／ＤＣコンバータと全く同様の動
作を行う。本発明によって新たに付け加えた部分の動作
はステップアップによって電源電圧よりも高い出力電圧
を前記ステップダウン回路に供給する部分で、ダイオー
ド10のアノード側は、電源の入力端子１に接続され、カ
ソード側はダイオード11のカソードに接続されているた
め、昇圧用トランジスタがＯＦＦの時に第２チョークコ
イルに発生する電圧が電源電圧よりも高くなった場合に
おいても、電源側に電流が逆流するということはない。
上記の構成において昇圧用トランジスタ13がＯＮになっ
た時点からコンデンサ15の電圧は上昇しはじめ、やがて
電源電圧の2 倍に迄達するようになるので、前記昇圧用
トランジスタのＯＮ／ＯＦＦの比を所定の値に設定する
ことにより、電源電圧よりも高い電圧を得ることができ
る。
【０００８】
【発明の効果】本発明によれば、ＤＣ／ＤＣコンバータ
の出力電圧を定電圧制御するフィードバック電圧制御系
に対して、第２チョーク・コイルの逆起電力によって発
生する電圧を主回路スイッチングトランジスタの入力側
に加算して負荷電流を流す事により、前記ＤＣ／ＤＣコ
ンバータの出力電圧を電源電圧よりも高くすることがで
きる。
の出力電圧を定電圧制御するフィードバック電圧制御系
に対して、第２チョーク・コイルの逆起電力によって発
生する電圧を主回路スイッチングトランジスタの入力側
に加算して負荷電流を流す事により、前記ＤＣ／ＤＣコ
ンバータの出力電圧を電源電圧よりも高くすることがで
きる。
【図１】本発明によるＤＣ／ＤＣコンバータにのブロッ
ク図である。
ク図である。
【図２】従来のＤＣ／ＤＣコンバータにのブロック図で
ある。
ある。
１ 入力端子 ２ 出力端子 ３ 負荷 ４ トランジスタ ５ ダイオード ６ チョーク・コイル ７ コンデンサ ８ 制御部 ９ 比較部 10 ダイオード 11 ダイオード 12 第2 チョーク・コイル 13 トランジスタ 14 ダイオード 15 コンデンサ 16 ステップダウン回路
Claims (1)
- 【請求項１】 主回路スイッチングトランジスタのＯＮ
／ＯＦＦタイムの比率を制御して定電圧制御を行うＤＣ
／ＤＣコンバ−タの電圧制御において、前記主回路スイ
ッチングトランジスタのベースに、前記ＤＣ／ＤＣコン
バ−タの出力電圧と所要の設定値とを比較し、比較部に
もとずき前記主回路スイッチングトランジスタのＯＮ／
ＯＦＦタイムを設定する信号を出力する制御信号発生部
を接続し、前記主回路スイッチングトランジスタのコレ
クタに第１ダイオードと第１チョークコイルとを接続
し、前記第１チョークコイルに平滑用コンデンサと負荷
とを接続し、前記主回路スイッチングトランジスタのエ
ミッタに第２ダイオードのカソードを接続し、第２ダイ
オードのアノードに電源と第２チョークコイルを接続
し、この前記第２チョークコイルに、昇圧用トランジス
タのコレクタと第３ダイオードのアノードを接続し、か
つ第３ダイオードのカソードに、コンデンサと、第４ダ
イオードのアノードを接続し、この第４ダイオードのカ
ソードを前記主回路スイッチングトランジスタのエミッ
タに接続し、前記昇圧用トランジスタのエミッタを接地
し、ベースに前記制御信号発生部の出力を接続したこと
を特徴とするＤＣ／ＤＣコンバ−タ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4338276A JP2982930B2 (ja) | 1992-12-18 | 1992-12-18 | Ｄｃ／ｄｃコンバータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4338276A JP2982930B2 (ja) | 1992-12-18 | 1992-12-18 | Ｄｃ／ｄｃコンバータ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06189526A JPH06189526A (ja) | 1994-07-08 |
| JP2982930B2 true JP2982930B2 (ja) | 1999-11-29 |
Family
ID=18316604
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4338276A Expired - Fee Related JP2982930B2 (ja) | 1992-12-18 | 1992-12-18 | Ｄｃ／ｄｃコンバータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2982930B2 (ja) |
-
1992
- 1992-12-18 JP JP4338276A patent/JP2982930B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH06189526A (ja) | 1994-07-08 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |