JP2978351B2 - 樹脂封止型半導体装置 - Google Patents
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Description
体無線機器などに使用される高周波帯域で微弱な電波を
増幅するための半導体装置に係り、特に、雑音特性が良
好で安価な樹脂封止型GaAs系素子に関するものであ
る。
の高周波機器に用いられるGaAs半導体装置は、微弱
な電波を増幅するため低雑音,高利得が厳しく要求さ
れ、高周波領域での寄生容量に起因する誘電損および/
または雑音を抑制するため、一般に中空のセラミック製
パッケージが使用されている。
パッケージを用いた半導体装置は構造が複雑で、加工工
程が多く、また、材料コストが高いために、完成した半
導体装置自体のコストが高くつくと云う問題がある。
は、一般の半導体装置と同様に樹脂封止を行えばよいわ
けであるが、通常の封止材料を用いると素子の雑音特性
が著しく低下すると云う問題がある。
中空になっているため信号伝播経路の周辺(素子、ワイ
ヤ、バンプまたはリード)の比誘電率が1.0と小さい
ために寄生容量が発生しにくゝ誘電損失が少ない。これ
に対し、樹脂封止品は封止材料の誘電率が3.8〜4.3
と大きいために寄生容量が発生し易く、誘電損失が大き
くなるためと云われている。
素子特性が得られるようにするために、パッケージ構造
並びに封止材料の面から種々の改良が提案されている。
隔、形状等を規定する提案(特開平2−17664号お
よび同3−64033号公報)がある。また、樹脂封止
した半導体装置の隣接するリード間に溝を形成し、リー
ド間に低誘電率の空気層を介在させて寄生容量を低減
し、高周波特性を向上する方法が提案(特開平4−97
549号公報)されている。
際、第1の樹脂層と第2の樹脂層で構成し、第1の樹脂
層に第2の樹脂層よりも誘電率が小さな材料を用いる方
法が提案(特開昭61−237455号および特開平4
−137753号公報)されている。
止品よりも特性が改善されるものゝ、セラミックパッケ
ージ品に比べ特性がいま一つ劣ると云う問題がある。一
方、素子の封止層を第1の樹脂層と第2の樹脂層で構成
し、第1の樹脂層には第2の樹脂層よりも低誘電率の材
料を用いる方法は、封止材料の低誘電率化に効果がある
ものゝ、封止工程が第1と第2の工程からなり、煩雑で
あると云う問題がある。また、特開昭61−23745
5号公報に開示されている封止材料は、誘電率が3.0
であり低誘電率化の効果が必ずしも十分とは云い難い。
み、構造が簡単で、製造コストが安く、しかも、誘電損
失の小さい高周波帯域用の樹脂封止型半導体装置を提供
することにある。
明の要旨は次のとおりである。
レムが電気的に接続され、少なくとも素子表面および電
極とリードとの接合部が樹脂で一体に封止された高周波
帯域用の樹脂封止型半導体装置であって、前記封止樹脂
の比誘電率が1.3〜3未満、ガラス転移温度(Tg)
もしくは熱変形温度(HDT)が130℃以上の三次元
橋かけ樹脂で構成されていることを特徴とする高周波帯
域用の樹脂封止型半導体装置。
よび/または側鎖に重合性の二重結合を含有する化合物
を重合して得られた樹脂である高周波帯域用の樹脂封止
型半導体装置。
ブタジエン系化合物、ポリイミド系化合物をはじめ主鎖
および/または側鎖にビニル基、アクリル基、メタアク
リル基などの重合性の基を含有するフッ素系化合物、シ
リコーン系化合物およびポリパラビニルフェノール系化
合物を指し、これらはラジカル発生剤である有機過酸化
物を用い、加熱硬化することによって得ることができ
る。
〔1〕で示されるものから選択できる。
たは〔3〕で示されるものから選択できる。
合物は一般式〔4〕または〔5〕で示されるものから選
択できる。
分子量あるいは反応性稀釈剤であるスチレンやジビニル
ベンゼンのような共重合性の低粘度化合物を併用するこ
とによって、粘度を大幅に調整することができる。ま
た、必要に応じて発明の目的を損なわない範囲で硬化促
進剤、着色剤、カップリング剤、離形剤、難燃化剤など
を添加することができる。
学構造や分子量あるいは樹脂一分子当たりの共重合性二
重結合の濃度を調整することによって、130℃以上に
することは容易であり、条件によっては300℃以上に
することもできる。
め特開昭61−237455号公報に記載されているよ
うに、封止樹脂層を二重にする必要がないので、一度の
封止作業でパッケージを成形することができる。また、
封止樹脂層の耐熱性が優れているために、はんだ付け作
業時の熱ストレスにも十分耐えることができる。
熱膨張係数の低減などを目的に溶融シリカ、結晶性シリ
カ、アルミナ等の微粒子を充填剤として配合している。
本発明においても発明の目的を損なわない範囲で、充填
剤を配合できるが、一般的にこれら充填剤は硬化物の誘
電率を高める作用がある。本発明のGaAs系素子はチ
ップサイズが小さいため、封止品に発生する熱応力が小
さく、封止材料の熱膨張係数を特別小さくしなくても実
用上十分な耐温度サイクル性や耐湿信頼性が得られる。
しかし、成形性の観点から充填剤を添加して樹脂の粘度
を調整する必要が生じる場合がある。その際には、充填
剤としてはフッ素樹脂あるいはシリコーン樹脂の粉末の
ように、比誘電率が低い材料を用いるのが望ましい。
泡剤を配合して硬化樹脂中に気泡を形成し、それによっ
て硬化樹脂の誘電率を小さくすることもできる。
止は、通常の半導体と同様に低圧トランスファモールド
法、ポッテイング法、デイッピング法などの方法で行う
ことができる。
誘電損失が少なく、雑音特性が良好な樹脂封止型半導体
装置を容易に得ることができる。さらに、本発明が用い
た樹脂は耐熱性や耐湿性などが良好なため、封止層を特
に二層構造とする必要がないので一回の封止作業で得る
ことができる。
る。
ータとして使用するGaAs系電界効果トランジスタの
セラミックパッケージ封止品の模式断面図を示す。セラ
ミックパッケージ5の内側底辺に設けたチップ搭載部に
銀ペースト3を用いGaAs系素子1(チップ)を固着
した後、その表面の電極部と配線4とを金ワイヤ2を用
いてボンデイングし電気的に接続した。その後、セラミ
ックパッケージの蓋5’を被せて中空型のセラミックパ
ッケージを作製した。
造を有する素子の12GHzにおける最小雑音指数並び
に雑音最小電力利得を測定した。その結果、それぞれ
0.72dBおよび11.5dBであった。
ブタジエン系化合物90重量部、スチレン9重量部、硬
化触媒としてジクミルパーオキサイド1重量部を混合
し、注形用液状樹脂を調製した。
効果トランジスタ(チップ)を、図1に示すように銅系
のリードフレーム7に銀ペースト3を用いて固着後、チ
ップ1の表面の電極部とリードフレーム7間を金ワイヤ
2でボンデイングして電気的に接続したものを金型にセ
ットし、上記の注形用液状樹脂を滴下して、チップ、金
ワイヤおよびインナーリードを封止した。その後金型を
150℃で1時間、180℃で2時間加熱し封止樹脂8
を硬化した。こうして得られた素子の12GHzにおけ
る最小雑音指数並びに雑音最小電力利得を測定した。そ
の結果、それぞれ0.74dBおよび11.4dBであっ
た。なお、上記注形用液状樹脂を150℃で1時間、1
80℃で2時間加熱した樹脂硬化物の1MHzの誘電率
は2.4、熱膨張係数の変曲点から求めたTgは225
℃であった。
ド80重量部、ジアリルフタレート20重量部に硬化触
媒としてジクミルパーオキサイド1重量部を二軸ロール
を用いて約80℃で10分間混練し封止材料を調製し
た。次いで参考例で用いたGaAs系電界効果トランジ
スタ(チップ)をトランスファプレスの上下金型間に挾
持し、上記封止材料を用いてチップ、金ワイヤおよびイ
ンナーリードを低圧トランスファモールド法により封止
した。封止条件は金型温度180℃、成形圧力70kg
/cm2、成形時間90秒で行った。金型から取り出し
た成形品は、その後180で5時間の後硬化を行った。
る最小雑音指数並びに雑音最小電力利得はそれぞれ0.
72dBおよび11.4dBであった。また、硬化樹脂
の1MHzの誘電率は2.2、熱膨張係数の変曲点から
求めたTgは285℃であった。
ブタジエン系化合物50重量部、ポリジメチルシリコー
ンの微粉末(平均粒径6μm)49重量部、硬化触媒と
してジクミルパーオキサイド1重量部を二軸ロールを用
いて約40℃で10分間混合し、塊状の封止材料を調製
した。次に、図2に示すようなGaAs系電界効果トラ
ンジスタ(チップ)1の電極部に金バンプ9を介して銅
系リードフレーム7を接続し、トランスファプレスの上
下金型間に挾持し、上記封止材料でチップ、金ワイヤお
よびリードフレームを低圧トランスファモールド法によ
り封止した。封止条件は金型温度180℃、成形圧力7
0kg/cm2、成形時間90秒で行った。金型から取
り出した成形品はその後180で5時間の後硬化を行っ
た。
る最小雑音指数並びに雑音最小電力利得は、それぞれ
0.76dBおよび12.0dBであった。また、硬化樹
脂の1MHzの誘電率は2.8、熱膨張係数の変曲点か
ら求めたTgは225℃であった。
ブタジエン系化合物50重量部、フッ素樹脂粉末(平均
粒径6μm)49重量部、硬化触媒としてジクミルパー
オキサイド1重量部を二軸ロールを用いて約40℃で1
0分間混合し塊状の封止材料を調製した。次いで、図2
に示すようにGaAs系電界効果トランジスタ(チッ
プ)の電極部に金バンプ9を介して銅系リードフレーム
7を接続し、これをトランスファプレスの上下金型間に
挾持し、上記封止材料を用いて低圧トランスファモール
ド法により樹脂封止した。成形条件は金型温度180
℃、成形圧力70kg/cm2、成形時間90秒で行っ
た。金型から取り出した成形品はその後180で5時間
の後硬化を行った。
雑音指数並びに雑音最小電力利得はそれぞれ0.72d
Bおよび12.0dBであった。また、硬化樹脂の1M
Hzの誘電率は2.2、熱膨張係数の変曲点から求めた
Tgは225℃であった。
レゾールノボラック型エポキシ樹脂85重量部および臭
素化ビスフェノールA型エポキシ樹脂15重量部、硬化
剤としてフェノールノボラック樹脂を52重量部、硬化
促進剤として1,8−ジアザビシクロ(5,4,0)−7
−ウンデセン1.5重量部、可撓化剤として両末端にア
ミノ基を有する分子量が約80,000のポリジメチル
シロキサン8重量部、充填剤として溶融シリカを350
重量部、カップリング剤としてエポキシシランを2重量
部、離形剤してモンタン酸エステル1重量部、難燃化助
剤として三酸化アンチモン10重量部、着色剤としてカ
ーボンブラック1重量部を計量した。
した二軸ロールを用いて約15分間混練し、通常の半導
体用封止材料として広く用いられいる低圧トランスファ
封止材料を作製した。
果トランジスタ(チップ)を低圧トランスファモールド
法により樹脂封止した。成形条件は金型温度180℃、
成形圧力70kg/cm2、成形時間90秒で行った。
金型から取り出した成形品はその後180で5時間の後
硬化を行った。
る最小雑音指数並びに雑音最小電力利得はそれぞれ0.
86dBおよび12.0dBであった。また、上記低圧
トランスファ封止材料を180℃で5時間加熱した硬化
樹脂の1MHzの誘電率は4.3、熱膨張係数の変曲点
から求めたTgは165℃であった。
導体装置は、封止材料として広く用いられいるエポキシ
樹脂系の低圧トランスファ封止材料で封止した場合に比
べ、雑音指数が著しく小さく、セラミックパッケージ品
に近い特性が得られる。また、樹脂作業も容易であり、
セラミックパッケージ品に比べて安価に生産することが
できる。
た本発明の半導体装置の模式断面図である。
た本発明の半導体装置の模式断面図である。
パッケージに封止した従来の半導体装置の模式断面図で
ある。
ペースト、4…配線、5…セラミックパッケージ、5’
…セラミックパッケージの蓋、6…ろう付け剤、7…リ
ードフレーム、8…封止樹脂、9…金バンプ。
Claims (8)
- 【請求項1】 GaAs系素子の電極とリードフレムが
電気的に接続され、少なくとも素子表面および電極とリ
ードとの接合部が樹脂で一体に封止された高周波帯域用
の樹脂封止型半導体装置であって、前記封止樹脂の比誘
電率が1.3〜3未満、ガラス転移温度(Tg)もしく
は熱変形温度(HDT)が130℃以上の三次元橋かけ
樹脂で構成されていることを特徴とする高周波帯域用の
樹脂封止型半導体装置。 - 【請求項2】 前記三次元橋かけ樹脂は、主鎖および/
または側鎖に重合性の二重結合を含有する化合物を重合
して得られた樹脂である請求項1に記載の高周波帯域用
の樹脂封止型半導体装置。 - 【請求項3】 前記三次元橋かけ樹脂は、主鎖および/
または側鎖に重合性の二重結合を含有するブタジエン系
化合物、フッ素系化合物、シリコーン系化合物、および
ポリパラビニルフェノール系化合物の少なくとも一種を
主成分とする樹脂組成物の重合体である請求項1または
2に記載の高周波帯域用の樹脂封止型半導体装置。 - 【請求項4】 前記ブタジエン系化合物が下記一般式
〔1〕で示される請求項3に記載の高周波帯域用の樹脂
封止型半導体装置。 【化1】 - 【請求項5】 前記ポリイミド系化合物が下記一般式
〔2〕または〔3〕で示される請求項3に記載の高周波
帯域用の樹脂封止型半導体装置。 【化2】 - 【請求項6】 前記ポリパラビニルフェノール系化合物
が下記一般式〔4〕または〔5〕で示される請求項3に
記載の高周波帯域用の樹脂封止型半導体装置。 【化3】 - 【請求項7】 前記三次元橋かけ樹脂は、無機または有
機充填剤を含み比誘電率が1.3〜3未満、ガラス転移
温度(Tg)もしくは熱変形温度(HDT)が130℃
以上である請求項1〜6のいずれかに記載の高周波帯域
用の樹脂封止型半導体装置。 - 【請求項8】 前記三次元橋かけ樹脂は、シリコーン樹
脂またはフッ素樹脂系の微粉末を充填剤として含む比誘
電率が1.3〜3未満、ガラス転移温度(Tg)もしく
は熱変形温度(HDT)が130℃以上である請求項1
〜6のいずれかに記載の高周波帯域用の樹脂封止型半導
体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5026711A JP2978351B2 (ja) | 1993-02-16 | 1993-02-16 | 樹脂封止型半導体装置 |
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Publication Number | Publication Date |
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JPH06244320A JPH06244320A (ja) | 1994-09-02 |
JP2978351B2 true JP2978351B2 (ja) | 1999-11-15 |
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Country | Link |
---|---|
JP (1) | JP2978351B2 (ja) |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3303915B2 (ja) | 1999-11-04 | 2002-07-22 | ダイキン工業株式会社 | 半導体製造装置用エラストマー成形品および架橋性フッ素系エラストマー組成物 |
US6870243B2 (en) * | 2002-11-27 | 2005-03-22 | Freescale Semiconductor, Inc. | Thin GaAs die with copper back-metal structure |
-
1993
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---|---|
JPH06244320A (ja) | 1994-09-02 |
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