JP2856111B2 - 電源入力回路 - Google Patents
電源入力回路Info
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- JP2856111B2 JP2856111B2 JP7154888A JP15488895A JP2856111B2 JP 2856111 B2 JP2856111 B2 JP 2856111B2 JP 7154888 A JP7154888 A JP 7154888A JP 15488895 A JP15488895 A JP 15488895A JP 2856111 B2 JP2856111 B2 JP 2856111B2
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Description
【０００１】
【産業上の利用分野】交流（ＡＣ）電源を入力し、整流
ダイオードと平滑コンデンサにて直流電圧を得る電源の
入力回路において、特に、ＡＣ電源投入時に生じる突入
電流を抑制するための突入電流抑圧回路を有する電源入
力回路に関する。
ダイオードと平滑コンデンサにて直流電圧を得る電源の
入力回路において、特に、ＡＣ電源投入時に生じる突入
電流を抑制するための突入電流抑圧回路を有する電源入
力回路に関する。
【０００２】
【従来の技術】従来の電源入力回路では、図６に示す様
にＡＣ電源１と全波整流器１０と平滑コンデンサ１１と
負荷１２を備えた一般的な整流回路において、ＡＣ電源
１用スイッチ２０を投入した時に発生する突入電流を制
限する為の突入電流制限抵抗２と、定常時にこの突入電
流制限抵抗２に電流が流れることにより余計な電力を消
費することを改善する為、突入電流制限抵抗２と並列に
接続したリレー接点３’と負荷側回路の短絡等の事故に
より突入電流制限抵抗の焼損を防ぐ為に電源側に設け
た、リレー接点３’を駆動させる為のリレー３と、リレ
ー３の駆動電圧を得る為の整流用ダイオード４とリレー
３への電流制限抵抗５とリレー３に生じるサージ吸収用
ダイオード６とリレー３用に定電圧を得る為の定電圧ダ
イオード７とリレー３の立上り時間を決定する為の時定
数設定用コンデンサ８にて構成していた。
にＡＣ電源１と全波整流器１０と平滑コンデンサ１１と
負荷１２を備えた一般的な整流回路において、ＡＣ電源
１用スイッチ２０を投入した時に発生する突入電流を制
限する為の突入電流制限抵抗２と、定常時にこの突入電
流制限抵抗２に電流が流れることにより余計な電力を消
費することを改善する為、突入電流制限抵抗２と並列に
接続したリレー接点３’と負荷側回路の短絡等の事故に
より突入電流制限抵抗の焼損を防ぐ為に電源側に設け
た、リレー接点３’を駆動させる為のリレー３と、リレ
ー３の駆動電圧を得る為の整流用ダイオード４とリレー
３への電流制限抵抗５とリレー３に生じるサージ吸収用
ダイオード６とリレー３用に定電圧を得る為の定電圧ダ
イオード７とリレー３の立上り時間を決定する為の時定
数設定用コンデンサ８にて構成していた。
【０００３】
【発明が解決しようとする課題】前述の従来技術によれ
ば、ＡＣ電源１のスイッチ２０を断にした後瞬時にスイ
ッチ２０を再投入しＡＣ電源を入力するような時、リレ
ーの時定数設定用に設けたコンデンサ８の放電回路がな
い為に、リレー接点が閉じた状態でＡＣ電源が入ること
により突入電流が主経路に流れてしまい、主経路の電気
部品の寿命劣化等を発生する問題を発生していた。
ば、ＡＣ電源１のスイッチ２０を断にした後瞬時にスイ
ッチ２０を再投入しＡＣ電源を入力するような時、リレ
ーの時定数設定用に設けたコンデンサ８の放電回路がな
い為に、リレー接点が閉じた状態でＡＣ電源が入ること
により突入電流が主経路に流れてしまい、主経路の電気
部品の寿命劣化等を発生する問題を発生していた。
【０００４】
【課題を解決するための手段】本発明の電源入力回路
は、交流電源入力及び全波整流回路と平滑コンデンサと
の間に設けられ、前記交流電源入力の突入電流を制限す
る突入電流制限抵抗と、前記交流電源入力が定常状態の
場合に、前記突入電流制限抵抗をバイパスするリレー接
点と、前記交流電源入力より整流ダイオードと抵抗との
直列回路とをコンデンサ，ツェナーダイオードと前記リ
レーとの並列回路に接続された前記リレー駆動回路とを
有する電源入力回路において、前記並列回路にサーミス
タを並列に取り付けたことを特徴としている。
は、交流電源入力及び全波整流回路と平滑コンデンサと
の間に設けられ、前記交流電源入力の突入電流を制限す
る突入電流制限抵抗と、前記交流電源入力が定常状態の
場合に、前記突入電流制限抵抗をバイパスするリレー接
点と、前記交流電源入力より整流ダイオードと抵抗との
直列回路とをコンデンサ，ツェナーダイオードと前記リ
レーとの並列回路に接続された前記リレー駆動回路とを
有する電源入力回路において、前記並列回路にサーミス
タを並列に取り付けたことを特徴としている。
【０００５】
【実施例】以下、図面を参照して本発明の実施例につい
て詳細に説明する。
て詳細に説明する。
【０００６】図１は、本発明の第１の実施例のブロック
図を示している。
図を示している。
【０００７】本図において、図６の従来の電源入力回路
と同一構成については、同一符号を付してある。図６と
異なるのはサーミスタ９が時定数設定用コンデンサ８と
並列に接続された点にある。
と同一構成については、同一符号を付してある。図６と
異なるのはサーミスタ９が時定数設定用コンデンサ８と
並列に接続された点にある。
【０００８】図１は、ＡＣ電源１がスイッチ２０を投入
された時に発生する突入電流を制限する為の突入電流制
限抵抗２と、定常時にこの突入電流制限抵抗２に電流が
流れることにより余計な電力を消費することを改善する
為、突入電流制限抵抗２と並列に接続したリレー接点
３’と負荷側回路の短絡等の事故により突入電流制限抵
抗２の焼損を防ぐ為に電源側に設けた、リレー接点３’
を駆動させる為のリレー３と、リレー３の駆動電圧を得
る為の整流用ダイオード４とリレー３への電流制限抵抗
５とリレー３に生じるサージ吸収用ダイオード６とリレ
ー３用に定電圧を得る為の定電圧ダイオード７と、リレ
ー３の立上り時間を決定する為の時定数設定用コンデン
サ８と、リレー３と並列にサーミスタ９を接続した回路
構成からなっている。
された時に発生する突入電流を制限する為の突入電流制
限抵抗２と、定常時にこの突入電流制限抵抗２に電流が
流れることにより余計な電力を消費することを改善する
為、突入電流制限抵抗２と並列に接続したリレー接点
３’と負荷側回路の短絡等の事故により突入電流制限抵
抗２の焼損を防ぐ為に電源側に設けた、リレー接点３’
を駆動させる為のリレー３と、リレー３の駆動電圧を得
る為の整流用ダイオード４とリレー３への電流制限抵抗
５とリレー３に生じるサージ吸収用ダイオード６とリレ
ー３用に定電圧を得る為の定電圧ダイオード７と、リレ
ー３の立上り時間を決定する為の時定数設定用コンデン
サ８と、リレー３と並列にサーミスタ９を接続した回路
構成からなっている。
【０００９】ここで、サーミスタ９は、ＡＣ電源１が一
度断となった後リレー３の立上り時間を決定している時
定数設定用コンデンサ８に充電されている電荷を発熱に
より抵抗値を下げ、瞬時にリレー３が復帰電圧以下にな
るよう放電するように機能している。
度断となった後リレー３の立上り時間を決定している時
定数設定用コンデンサ８に充電されている電荷を発熱に
より抵抗値を下げ、瞬時にリレー３が復帰電圧以下にな
るよう放電するように機能している。
【００１０】また、定電圧ダイオード７のツェナー電位
は、リレー３を駆動する定格電圧値に選ばれる。
は、リレー３を駆動する定格電圧値に選ばれる。
【００１１】さらに、本発明の動作をさらに詳細に図を
用いて説明する。
用いて説明する。
【００１２】 図２は、図１の突入電流制限回路に関す
る部分の機能ブロック図である。ＡＣ電源１を投入後、
リレー３の立ち上がり時間を決定する時定数設定用のコ
ンデンサ８に充電される。次に、電源を投入後サーミス
タ９に通電されると、サーミスタ９の抵抗値が発熱によ
って小さくなる。このサーミスタ９には発熱時のサーミ
スタ内部抵抗値が、リレー３の内部抵抗値３”よりも小
さくなるものを選択する。この結果、電源を断とした
時、短時間の間サーミスタ９の抵抗値が発熱によって、
並列に接続されているリレー３の内部抵抗３”よりも低
い値を維持しているため、コンデンサ８に充電されてい
る電荷を急速に放電する。
る部分の機能ブロック図である。ＡＣ電源１を投入後、
リレー３の立ち上がり時間を決定する時定数設定用のコ
ンデンサ８に充電される。次に、電源を投入後サーミス
タ９に通電されると、サーミスタ９の抵抗値が発熱によ
って小さくなる。このサーミスタ９には発熱時のサーミ
スタ内部抵抗値が、リレー３の内部抵抗値３”よりも小
さくなるものを選択する。この結果、電源を断とした
時、短時間の間サーミスタ９の抵抗値が発熱によって、
並列に接続されているリレー３の内部抵抗３”よりも低
い値を維持しているため、コンデンサ８に充電されてい
る電荷を急速に放電する。
【００１３】図３は、図２に示す電位ＶR 、の時間的変
化を示す図である。
化を示す図である。
【００１４】本図において、縦軸はＶR 、すなわち、リ
レー３に加えられる電圧を表し、横軸は経過時間を表
す。また、Ａはリレー３の両端にかかる定格電圧、Ｂは
リレーの復帰電圧、Ｃはサーミスタ９がなかった場合の
リレー３の電位が定格電圧から復帰電圧に達するまでの
時間、Ｃ’は本発明におけるリレー３の電位が定格電圧
から復帰電圧に達するまでの時間を表す。
レー３に加えられる電圧を表し、横軸は経過時間を表
す。また、Ａはリレー３の両端にかかる定格電圧、Ｂは
リレーの復帰電圧、Ｃはサーミスタ９がなかった場合の
リレー３の電位が定格電圧から復帰電圧に達するまでの
時間、Ｃ’は本発明におけるリレー３の電位が定格電圧
から復帰電圧に達するまでの時間を表す。
【００１５】図４は、ＡＣ電源１を一定周期で短時間に
オン，オフしてリレー３の電位ＶRを図１に示す場合と
図５に示す場合とについて示したものである。
オン，オフしてリレー３の電位ＶRを図１に示す場合と
図５に示す場合とについて示したものである。
【００１６】図６におけるＶR はＡＣ電源１がオンから
オフになってもコンデンサ８に充電された電圧が放電す
るのに長時間要するため、リレー後復帰電圧に達する前
に次のＡＣ電源１の投入がなされている。このため、リ
レー３は常にオン状態となったままになっている。
オフになってもコンデンサ８に充電された電圧が放電す
るのに長時間要するため、リレー後復帰電圧に達する前
に次のＡＣ電源１の投入がなされている。このため、リ
レー３は常にオン状態となったままになっている。
【００１７】一方、図１におけるＶR は、ＡＣ電源がサ
ーミスタ９の抵抗により放電されリレー復帰電圧以下に
なるため、確実にリレー３がオン，オフしている。
ーミスタ９の抵抗により放電されリレー復帰電圧以下に
なるため、確実にリレー３がオン，オフしている。
【００１８】以上説明した実施例では、サーミスタ９を
用いてコンデンサ８の充電電圧を放電したがこの結果、
サーミスタ９が発熱により抵抗値が低くなることによ
り、リレー３の電位が定格電圧から復帰電圧に達するま
での時間が短縮化され、従来技術よりも早くリレーの復
帰電圧以下となるので、電源再投入時においてもリレー
接点３’が開放している為、確実に突入電流を突入電流
制限抵抗に流すことができる。
用いてコンデンサ８の充電電圧を放電したがこの結果、
サーミスタ９が発熱により抵抗値が低くなることによ
り、リレー３の電位が定格電圧から復帰電圧に達するま
での時間が短縮化され、従来技術よりも早くリレーの復
帰電圧以下となるので、電源再投入時においてもリレー
接点３’が開放している為、確実に突入電流を突入電流
制限抵抗に流すことができる。
【００１９】以上サーミスタを用いた実施例について説
明したが、他の実施例について以下に説明する。
明したが、他の実施例について以下に説明する。
【００２０】図５は、本発明の第２の実施例の主要構成
を示した図である。
を示した図である。
【００２１】本図において、図１に示した機能と同一の
ものは、同一符号を付してある。
ものは、同一符号を付してある。
【００２２】図５において、電源入力部に、整流ダイオ
ード２１，電源制限用抵抗２２，コンデンサ８の充放電
時間を制御するためのリレー２５，ＡＣ電源の再投入時
の立上り時間を決定する時定数設定用コンデンサ２３，
リレー保護用ダイオード２４を設けている。
ード２１，電源制限用抵抗２２，コンデンサ８の充放電
時間を制御するためのリレー２５，ＡＣ電源の再投入時
の立上り時間を決定する時定数設定用コンデンサ２３，
リレー保護用ダイオード２４を設けている。
【００２３】そして、リレー２５の接点２５’は抵抗２
６と直列接続し、抵抗２６の開閉を行なっている。
６と直列接続し、抵抗２６の開閉を行なっている。
【００２４】本図の場合において、ＡＣ電源が投入され
突入電流が発生した時に、コンデンサ８が充電されてリ
レー３がオンとなる。また、コンデンサ２３が充電され
てリレー２５もオンとなる。その後、電源を断とした場
合に、コンデンサ８よりもコンデンサ２３の方が先に放
電を完了してリレー２５をオフさせ、リレー接点２５’
がショートされる。この結果、コンデンサ８の電圧は抵
抗２６を介して瞬時に放電することができる。この場合
抵抗２６はできる限り小さな抵抗値にするのが望まし
い。
突入電流が発生した時に、コンデンサ８が充電されてリ
レー３がオンとなる。また、コンデンサ２３が充電され
てリレー２５もオンとなる。その後、電源を断とした場
合に、コンデンサ８よりもコンデンサ２３の方が先に放
電を完了してリレー２５をオフさせ、リレー接点２５’
がショートされる。この結果、コンデンサ８の電圧は抵
抗２６を介して瞬時に放電することができる。この場合
抵抗２６はできる限り小さな抵抗値にするのが望まし
い。
【００２５】
【発明の効果】以上説明したように、本発明の突入電流
抑圧回路は、ＡＣ電源が一度断となった後リレーの立上
り時間を決定している時定数設定用コンデンサに充電さ
れている電荷を発熱により抵抗値の下がったサーミスタ
により瞬時にリレーが復帰電圧以下になるよう放電させ
るようにしたことによって、確実に突入電流を突入電流
制限抵抗に流すことができる効果を有する。
抑圧回路は、ＡＣ電源が一度断となった後リレーの立上
り時間を決定している時定数設定用コンデンサに充電さ
れている電荷を発熱により抵抗値の下がったサーミスタ
により瞬時にリレーが復帰電圧以下になるよう放電させ
るようにしたことによって、確実に突入電流を突入電流
制限抵抗に流すことができる効果を有する。
【図１】本発明の第１の実施例の主要回路を示す図であ
る。
る。
【図２】図１の一部を示す図である。
【図３】リレーの両端電圧対放電時間の関係を示す図で
ある。
ある。
【図４】電源ＯＮ／ＯＦＦ時のコンデンサ充放電特性を
示す図である。
示す図である。
【図５】本発明の第２の実施例の主要回路を示す図であ
る。
る。
【図６】従来の電源入力回路を示す図である。
１ ＡＣ電源 ２ 突入電流吸収用抵抗 ３ リレー ３’ リレー接点 ３” リレー抵抗 ４ 整流ダイオード ５ 抵抗 ６ サージ吸収用ダイオード ７ 定電圧ダイオード ８ コンデンサ ９ サーミスタ １０ 全波整流ダイオード １１ 平滑コンデンサ １２ 負荷 ２０ 電源スイッチ ２１ ダイオード ２２ 抵抗 ２３ コンデンサ ２４ ダイオード ２５ リレー
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.6，ＤＢ名) H02H 9/02 H02J 1/00
Claims (2)
- 【請求項１】 交流電源入力及び全波整流回路と平滑コ
ンデンサとの間に設けられ、 前記交流電源入力の突入電流を制限する突入電流制限抵
抗と、 前記交流電源入力が定常状態の場合に、前記突入電流制
限抵抗と並列接続されて、前記突入電源制限抵抗をバイ
パスするリレー接点と、 前記交流電源入力より整流ダイオードと抵抗との直列回
路を、コンデンサ，ツェナーダイオードと前記リレーと
の並列回路に接続された前記リレー駆動回路とを有する
電源入力回路において、 前記並列回路にサーミスタを並列に取り付けたことを特
徴とする電源入力回路。 - 【請求項２】 交流電源入力及び全波整流回路と平滑コ
ンデンサとの間に設けられ、 前記交流電源入力の突入電流を制限する突入電流制限抵
抗と、 前記交流電源入力が定常状態の場合に、前記突入電流制
限抵抗と並列接続されて前記突入電流制限抵抗をバイパ
スする第１のリレー接点と、 前記交流電源入力より第１の整流ダイオードと第１の抵
抗との第１の直列回路を第１のコンデンサ，ツェナーダ
イオードと前記第１のリレーとの第１の並列回路に接続
した第１のリレー駆動回路とを有する電源入力回路にお
いて、 前記並列回路に第２の抵抗と第２のリレー接点との直列
回路を並列に接続し、前記第１のリレー駆動回路の前段
に、第２の整流ダイオードと第２の抵抗との第１の直列
回路を第２のコンデンサと第２のリレーとの第２の並列
回路に接続した第２のリレー駆動回路とを有することを
特徴とする電源入力回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7154888A JP2856111B2 (ja) | 1995-06-21 | 1995-06-21 | 電源入力回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7154888A JP2856111B2 (ja) | 1995-06-21 | 1995-06-21 | 電源入力回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH099497A JPH099497A (ja) | 1997-01-10 |
| JP2856111B2 true JP2856111B2 (ja) | 1999-02-10 |
Family
ID=15594158
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7154888A Expired - Fee Related JP2856111B2 (ja) | 1995-06-21 | 1995-06-21 | 電源入力回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2856111B2 (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20020084402A (ko) * | 2001-04-30 | 2002-11-07 | 삼성전기주식회사 | 쇄도전류 제어장치 |
| CN101263439B (zh) * | 2005-09-15 | 2010-08-04 | 皇家飞利浦电子股份有限公司 | 浪涌电流限制器设备和包括该设备的功率因数控制电路 |
| DE102018208292A1 (de) * | 2018-02-19 | 2019-08-22 | Brose Fahrzeugteile GmbH & Co. Kommanditgesellschaft, Würzburg | Entladevorrichtung, elektrische Einheit und Entladeverfahren |
| CN113765080A (zh) * | 2021-08-31 | 2021-12-07 | 长春捷翼汽车零部件有限公司 | 抑制电源启动浪涌的电路、方法、充电装置及存储介质 |
-
1995
- 1995-06-21 JP JP7154888A patent/JP2856111B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH099497A (ja) | 1997-01-10 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19981027 |
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