JP2791344B2 - 異常電流遮断回路 - Google Patents
異常電流遮断回路Info
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- JP2791344B2 JP2791344B2 JP4203835A JP20383592A JP2791344B2 JP 2791344 B2 JP2791344 B2 JP 2791344B2 JP 4203835 A JP4203835 A JP 4203835A JP 20383592 A JP20383592 A JP 20383592A JP 2791344 B2 JP2791344 B2 JP 2791344B2
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- current
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- H02H—EMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
- H02H3/00—Emergency protective circuit arrangements for automatic disconnection directly responsive to an undesired change from normal electric working condition with or without subsequent reconnection ; integrated protection
- H02H3/08—Emergency protective circuit arrangements for automatic disconnection directly responsive to an undesired change from normal electric working condition with or without subsequent reconnection ; integrated protection responsive to excess current
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
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- B41J29/387—Automatic cut-off devices
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- G05—CONTROLLING; REGULATING
- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
- G05F1/00—Automatic systems in which deviations of an electric quantity from one or more predetermined values are detected at the output of the system and fed back to a device within the system to restore the detected quantity to its predetermined value or values, i.e. retroactive systems
- G05F1/10—Regulating voltage or current
- G05F1/46—Regulating voltage or current wherein the variable actually regulated by the final control device is dc
- G05F1/56—Regulating voltage or current wherein the variable actually regulated by the final control device is dc using semiconductor devices in series with the load as final control devices
- G05F1/565—Regulating voltage or current wherein the variable actually regulated by the final control device is dc using semiconductor devices in series with the load as final control devices sensing a condition of the system or its load in addition to means responsive to deviations in the output of the system, e.g. current, voltage, power factor
- G05F1/569—Regulating voltage or current wherein the variable actually regulated by the final control device is dc using semiconductor devices in series with the load as final control devices sensing a condition of the system or its load in addition to means responsive to deviations in the output of the system, e.g. current, voltage, power factor for protection
Description
【０００１】
【産業上の利用分野】本発明は、プリンタの印字ヘッド
の駆動回路等に流れる異常電流を遮断する異常電流遮断
回路に関するものである。
の駆動回路等に流れる異常電流を遮断する異常電流遮断
回路に関するものである。
【０００２】
【従来の技術】従来、負荷の動作時に、負荷に設けられ
た電流検知装置により異常電流を検知し、その出力を受
けて電源の陰極陽極間に設けられたサイリスタを作動さ
せ電源ラインに設けられたヒューズを切り電源ラインを
遮断するものがある。
た電流検知装置により異常電流を検知し、その出力を受
けて電源の陰極陽極間に設けられたサイリスタを作動さ
せ電源ラインに設けられたヒューズを切り電源ラインを
遮断するものがある。
【０００３】
【発明が解決しようとする課題】従来のものでは、正常
動作時の電流値を越えなければ異常電流として検知され
ず、このような低電流値の異常電流に対して遮断動作は
行なわれないという問題点を有し、安全対策として不十
分なものである。
動作時の電流値を越えなければ異常電流として検知され
ず、このような低電流値の異常電流に対して遮断動作は
行なわれないという問題点を有し、安全対策として不十
分なものである。
【０００４】例えば、プリンタ等に使用した場合、プリ
ンタでは印字データにより印字ヘッド動作時の電流値は
変化し、通常文字の印字時とベタ文字の印字時とでは電
流値は大きく異なり、後者ではより大きな電流値を要す
る。このため、通常文字印字時に異常電流が流れても、
その電流値がベタ文字印字に要する電流値に達しないも
のであれば、異常電流として検知されず、異常電流は流
れ続け発熱を生じ、最悪の場合には発火に至る。また、
電流検出手段および、ヒューズをとばせるほどの大電流
のサイリスタ等に多くの部品点数を要し、コストがかか
る。
ンタでは印字データにより印字ヘッド動作時の電流値は
変化し、通常文字の印字時とベタ文字の印字時とでは電
流値は大きく異なり、後者ではより大きな電流値を要す
る。このため、通常文字印字時に異常電流が流れても、
その電流値がベタ文字印字に要する電流値に達しないも
のであれば、異常電流として検知されず、異常電流は流
れ続け発熱を生じ、最悪の場合には発火に至る。また、
電流検出手段および、ヒューズをとばせるほどの大電流
のサイリスタ等に多くの部品点数を要し、コストがかか
る。
【０００５】本発明は、安価な構成で、異常電流に対し
ても異常電を確実に検知して電源の遮断を行ない、安全
性を向上させることを目的とする。
ても異常電を確実に検知して電源の遮断を行ない、安全
性を向上させることを目的とする。
【０００６】
【課題を解決するための手段】負荷の駆動時には、第２
のスイッチング回路により電源ラインに設けられた第１
のスイッチング回路をオンとし負荷に電源を供給し、ス
タンバイ時には、第１のスイッチング回路をオフとし、
上記第１のスイッチング回路に並列に接続された遮断回
路を介して負荷に電源を供給する。スタンバイ時に異常
電流が流れた場合、遮断回路により電源ライン遮断し、
遮断回路による電源ライン遮断とともに第２のスイッチ
ング回路により第１のスイッチング回路をオフとするこ
とで目的を達成する。
のスイッチング回路により電源ラインに設けられた第１
のスイッチング回路をオンとし負荷に電源を供給し、ス
タンバイ時には、第１のスイッチング回路をオフとし、
上記第１のスイッチング回路に並列に接続された遮断回
路を介して負荷に電源を供給する。スタンバイ時に異常
電流が流れた場合、遮断回路により電源ライン遮断し、
遮断回路による電源ライン遮断とともに第２のスイッチ
ング回路により第１のスイッチング回路をオフとするこ
とで目的を達成する。
【０００７】
【実施例】本発明をプリンタに用いた一実施例を図を参
照しながら説明する。図１は一実施例の遮断回路の構成
を示した図であり、１は電源としての電源回路であり、
駆動系への２４ＶとＣＰＵ等の電子回路系への５Ｖの電
源電圧を生じる。２、３はそれぞれドライバと、駆動部
であり、ドライバ２は駆動部３に設けられたキャリモー
タａ、ＬＦモータｂ、印字ヘッドｃを駆動する。これら
２と３により負荷は構成される。４は遮断回路としての
ヒューズであり、スタンバイ時にドライバ２に電源を供
給し、例えば、１００ｍＡの電流が流れると切れるもの
である。ヒューズ４と並列に接続された５は第１のスイ
ッチング回路としてのトランジスタであり、負荷の駆動
時にドライバ２に電源を供給する。６はダイオードであ
り、ヒューズ４と直列に接続されており、トランジスタ
５のオン電圧を吸収する。７は第２のスイッチング回路
としてのトランジスタであり、トランジスタ５のスイッ
チングを行なう。８はＣＰＵ、ＲＡＭ、ＲＯＭ等から成
る制御回路であり、オープンコレクタ出力である駆動状
態信号を出力しトランジスタ７のスイッチングを行なう
とともに、トライバ制御信号を出力しドライバ２の制御
を行なう。Ｒ１、Ｒ２は抵抗である。なお、オープンコ
レクタ出力とは、トランジスタのコレクタを出力端子と
して用い、上記トランジスタのオン、オフに応じてこの
出力端子に現れるものである。ここでは、図示しないが
制御回路８内部にｎｐｎトランジスタを設け、そのエミ
ッタを接地し、そのコレクタを出力端子として抵抗Ｒ１
およびトランジスタ７のベースに接続してある。すなわ
ち、ここでのオープンコレクタ出力である駆動状態信号
とは、スタンバイ時においては上記トランジスタをオン
としてトランジスタ７のベースを接地する信号であり、
負荷の駆動時においては上記トランジスタをオフとして
トランジスタ７のベースをオープン状態とする信号であ
る。
照しながら説明する。図１は一実施例の遮断回路の構成
を示した図であり、１は電源としての電源回路であり、
駆動系への２４ＶとＣＰＵ等の電子回路系への５Ｖの電
源電圧を生じる。２、３はそれぞれドライバと、駆動部
であり、ドライバ２は駆動部３に設けられたキャリモー
タａ、ＬＦモータｂ、印字ヘッドｃを駆動する。これら
２と３により負荷は構成される。４は遮断回路としての
ヒューズであり、スタンバイ時にドライバ２に電源を供
給し、例えば、１００ｍＡの電流が流れると切れるもの
である。ヒューズ４と並列に接続された５は第１のスイ
ッチング回路としてのトランジスタであり、負荷の駆動
時にドライバ２に電源を供給する。６はダイオードであ
り、ヒューズ４と直列に接続されており、トランジスタ
５のオン電圧を吸収する。７は第２のスイッチング回路
としてのトランジスタであり、トランジスタ５のスイッ
チングを行なう。８はＣＰＵ、ＲＡＭ、ＲＯＭ等から成
る制御回路であり、オープンコレクタ出力である駆動状
態信号を出力しトランジスタ７のスイッチングを行なう
とともに、トライバ制御信号を出力しドライバ２の制御
を行なう。Ｒ１、Ｒ２は抵抗である。なお、オープンコ
レクタ出力とは、トランジスタのコレクタを出力端子と
して用い、上記トランジスタのオン、オフに応じてこの
出力端子に現れるものである。ここでは、図示しないが
制御回路８内部にｎｐｎトランジスタを設け、そのエミ
ッタを接地し、そのコレクタを出力端子として抵抗Ｒ１
およびトランジスタ７のベースに接続してある。すなわ
ち、ここでのオープンコレクタ出力である駆動状態信号
とは、スタンバイ時においては上記トランジスタをオン
としてトランジスタ７のベースを接地する信号であり、
負荷の駆動時においては上記トランジスタをオフとして
トランジスタ７のベースをオープン状態とする信号であ
る。
【０００８】次に同図を参照しながら動作について説明
する。
する。
【０００９】通常プリンタでは、１行の印字開始から終
了までの駆動状態と、その終了から次の行の印字開始ま
での間、駆動部３に設けられたキャリモータａ、ＬＦモ
ータｂ、印字ヘッドｃのいずれも駆動されていないスタ
ンバイ状態がある。
了までの駆動状態と、その終了から次の行の印字開始ま
での間、駆動部３に設けられたキャリモータａ、ＬＦモ
ータｂ、印字ヘッドｃのいずれも駆動されていないスタ
ンバイ状態がある。
【００１０】駆動状態では、制御回路８から出力される
オープンコレクタ出力である駆動状態信号によりトラン
ジスタ７はオンとなる。すなわち、制御回路８内の上記
トランジスタがオフとなり、トランジスタ７のベースが
接地されず、ヒューズ４を介した電源回路１からの電流
が抵抗Ｒ１を介し、トランジスタ５のベースに流れるこ
とによりトランジスタ７はオンとなる。それに伴いトラ
ンジスタ５もオンとなり、トランジスタ５を介しドライ
バ２へ＋２４Ｖの電源電圧が供給され、最大で３Ａ程度
の電流が流れる。なお、トランジスタ５のオンに伴なう
電圧はダイオード６の順方向の電圧に吸収され、ヒュー
ズ４に電圧として加えられない。
オープンコレクタ出力である駆動状態信号によりトラン
ジスタ７はオンとなる。すなわち、制御回路８内の上記
トランジスタがオフとなり、トランジスタ７のベースが
接地されず、ヒューズ４を介した電源回路１からの電流
が抵抗Ｒ１を介し、トランジスタ５のベースに流れるこ
とによりトランジスタ７はオンとなる。それに伴いトラ
ンジスタ５もオンとなり、トランジスタ５を介しドライ
バ２へ＋２４Ｖの電源電圧が供給され、最大で３Ａ程度
の電流が流れる。なお、トランジスタ５のオンに伴なう
電圧はダイオード６の順方向の電圧に吸収され、ヒュー
ズ４に電圧として加えられない。
【００１１】またスタンバイ状態では、制御回路８から
出力される駆動状態信号によりトランジスタ７はオフと
なる。すなわち、制御回路８内の上記トランジスタがオ
ンとなり、トランジスタ７のベースが接地されるため、
トランジスタ７はオフとなる。それに伴いトランジスタ
５もオフとなり、トランジスタ５を介したドライバ２へ
の電源供給は停止される。
出力される駆動状態信号によりトランジスタ７はオフと
なる。すなわち、制御回路８内の上記トランジスタがオ
ンとなり、トランジスタ７のベースが接地されるため、
トランジスタ７はオフとなる。それに伴いトランジスタ
５もオフとなり、トランジスタ５を介したドライバ２へ
の電源供給は停止される。
【００１２】スタンバイ状態においては、キャリモータ
ａ、ＬＦモータｂには停止位置を確実に保持するため
に、ドライバ２にヒューズ４とダイオード６を介して合
計７０ｍＡの電流が供給されるものとする。なおこのと
き印字ヘッドｃへの電源供給は行なわない。
ａ、ＬＦモータｂには停止位置を確実に保持するため
に、ドライバ２にヒューズ４とダイオード６を介して合
計７０ｍＡの電流が供給されるものとする。なおこのと
き印字ヘッドｃへの電源供給は行なわない。
【００１３】印字ヘッド等に絶縁不良が生じ異常電流が
流れると、スタンバイ時にヒューズ４に流れる電流が増
加する。ここでヒユーズ４の許容量が１００ｍＡである
ため、異常電流が３０ｍＡを越えると、ヒューズ４が切
れる。その後、次の駆動状態信号が出力されてもトラン
ジスタ７はオンとはならない。すなわち、駆動状態信号
はオープンコレクタ信号であり、制御回路８側から積極
的にトランジスタ７のベースにベース電流を供給し、こ
れをオン、オフするというものではない。このため、ヒ
ューズ４が切断され、抵抗Ｒ１を介した電流の供給が途
絶えると、トランジスタ７のベースの接地を解いてもト
ランジスタ７にはベース電流が流れず、トランジスタ７
はオフのままである。このため、トランジスタ５もオフ
のままとなる。これによりドライバ２への＋２４Ｖ電源
供給ラインが遮断され、駆動部３の動作を停止する。
流れると、スタンバイ時にヒューズ４に流れる電流が増
加する。ここでヒユーズ４の許容量が１００ｍＡである
ため、異常電流が３０ｍＡを越えると、ヒューズ４が切
れる。その後、次の駆動状態信号が出力されてもトラン
ジスタ７はオンとはならない。すなわち、駆動状態信号
はオープンコレクタ信号であり、制御回路８側から積極
的にトランジスタ７のベースにベース電流を供給し、こ
れをオン、オフするというものではない。このため、ヒ
ューズ４が切断され、抵抗Ｒ１を介した電流の供給が途
絶えると、トランジスタ７のベースの接地を解いてもト
ランジスタ７にはベース電流が流れず、トランジスタ７
はオフのままである。このため、トランジスタ５もオフ
のままとなる。これによりドライバ２への＋２４Ｖ電源
供給ラインが遮断され、駆動部３の動作を停止する。
【００１４】以上のように、異常電流が流れた場合、ス
タンバイ状態において、ヒューズ４が切断され、＋２４
Ｖ電源供給ラインを遮断するため、３０ｍＡ程度の異常
電流が流れた場合でも直ちに電源供給ラインを遮断でき
る。これが従来の正常な動作状態での電流値を越えた場
合に遮断をおこなうものであれば、３Ａを越える異常電
流が流れて始めて機能するものであり、従来のものと比
較して安全性の面ではるかに向上させることが可能であ
る。
タンバイ状態において、ヒューズ４が切断され、＋２４
Ｖ電源供給ラインを遮断するため、３０ｍＡ程度の異常
電流が流れた場合でも直ちに電源供給ラインを遮断でき
る。これが従来の正常な動作状態での電流値を越えた場
合に遮断をおこなうものであれば、３Ａを越える異常電
流が流れて始めて機能するものであり、従来のものと比
較して安全性の面ではるかに向上させることが可能であ
る。
【００１５】また異常電流が流れ発火に至るまで通常あ
る程度時間を要し、しかも駆動状態が続くのはせいぜい
数秒であるため、スタンバイ状態にはいった時点で電源
ラインを遮断することで発火等を防ぐことができる。万
一短時間に発火の可能性がある極めて大きな異常電流が
流れた場合には、電源回路１内に通常設けられているヒ
ューズ等（図示せず）が切れ電源の供給を停止する。
る程度時間を要し、しかも駆動状態が続くのはせいぜい
数秒であるため、スタンバイ状態にはいった時点で電源
ラインを遮断することで発火等を防ぐことができる。万
一短時間に発火の可能性がある極めて大きな異常電流が
流れた場合には、電源回路１内に通常設けられているヒ
ューズ等（図示せず）が切れ電源の供給を停止する。
【００１６】なお、上記制御回路８にさらなる安全性向
上のため追加機能を設けることが考えられる。例えば、
駆動状態信号がＬｏｗレベルでタイマをクリアし、Ｈｉ
ｇｈレベルが一定時間以上続いた場合は制御回路８にリ
セットをかけ、強制的にスタンバイ状態にするウオッチ
・ドッグ・タイマ（図示せず）を設ける。これにより、
制御回路８に異常が生じ駆動状態信号がＨｉｇｈレベル
の状態で固定されると、ウオッチ・ドッグ・タイマによ
り制御回路８をリセットし、強制的スタンバイ状態とす
る。これにより制御回路に異常が生じ、かつ異常電流が
流れた場合でも電源ラインの遮断が可能となる。
上のため追加機能を設けることが考えられる。例えば、
駆動状態信号がＬｏｗレベルでタイマをクリアし、Ｈｉ
ｇｈレベルが一定時間以上続いた場合は制御回路８にリ
セットをかけ、強制的にスタンバイ状態にするウオッチ
・ドッグ・タイマ（図示せず）を設ける。これにより、
制御回路８に異常が生じ駆動状態信号がＨｉｇｈレベル
の状態で固定されると、ウオッチ・ドッグ・タイマによ
り制御回路８をリセットし、強制的スタンバイ状態とす
る。これにより制御回路に異常が生じ、かつ異常電流が
流れた場合でも電源ラインの遮断が可能となる。
【００１７】また一実施例の構成のうち、トランジスタ
５のオンに伴う電圧を吸収するため、ダイオード６を用
いたたが、それに代り抵抗を用いても同様の効果を得ら
れる。同様に遮断回路としてのヒューズ４と上記ダイオ
ード６の２つに代えて、ヒューズ抵抗を用い、また上記
ヒューズ４に代り、ブレーカを用いても同様の効果が得
られる。
５のオンに伴う電圧を吸収するため、ダイオード６を用
いたたが、それに代り抵抗を用いても同様の効果を得ら
れる。同様に遮断回路としてのヒューズ４と上記ダイオ
ード６の２つに代えて、ヒューズ抵抗を用い、また上記
ヒューズ４に代り、ブレーカを用いても同様の効果が得
られる。
【００１８】また、本発明は、プリンタに限らず、他の
電気機器に使用できる。例えばビデオカメラ等の駆動部
の多い電気機器に対して使用した場合、安全性向上に有
効である。
電気機器に使用できる。例えばビデオカメラ等の駆動部
の多い電気機器に対して使用した場合、安全性向上に有
効である。
【００１９】
【発明の効果】本発明によれば、異常電流が流れた場
合、スタンバイ時における低電流値の異常電流を受けた
遮断回路により、電源ラインを遮断するため、正常動作
時の電流値より極めて小さな異常電流に対しても遮断動
作が可能となる。従来の正常動作時の電流値を越えた異
常電流に対してのみ機能するものに比べ、低電流の異常
電流が継続的に流れることによる発火の可能性が低下
し、安全性の面ではるかに向上するとともに、従来必要
とした大電流のサイリスタや電流検出機等が不要とな
り、回路構成の面でも簡素化が可能となる。
合、スタンバイ時における低電流値の異常電流を受けた
遮断回路により、電源ラインを遮断するため、正常動作
時の電流値より極めて小さな異常電流に対しても遮断動
作が可能となる。従来の正常動作時の電流値を越えた異
常電流に対してのみ機能するものに比べ、低電流の異常
電流が継続的に流れることによる発火の可能性が低下
し、安全性の面ではるかに向上するとともに、従来必要
とした大電流のサイリスタや電流検出機等が不要とな
り、回路構成の面でも簡素化が可能となる。
【図１】本発明の一実施例を示す電気回路図
１ 電源 ２ ドライバ ３ 駆動部 ４ 遮断回路 ５ 第１のスイッチング回路 ７ 第２のスイッチング回路
フロントページの続き (58)調査した分野(Int.Cl.6，ＤＢ名) B41J 29/38 B41J 29/46 H02H 3/08 - 3/087
Claims (1)
- 【請求項１】電源と、この電源により動作する負荷と、 この負荷のスタンバイ時に電源から負荷への電源ライン
に異常電流が流れた時、上記電源ラインを遮断する遮断
回路と、 この遮断回路に並列して接続され、上記負荷の駆動時に
上記負荷に電源供給を行なう第１のスイッチング回路
と、 この第１のスイッチング回路の動作を制御し、上記遮断
回路の遮断時には上記第１のスイッチング回路をオフと
する第２のスイッチング回路とを具備する異常電流遮断
回路。
Priority Applications (7)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4203835A JP2791344B2 (ja) | 1992-07-30 | 1992-07-30 | 異常電流遮断回路 |
| TW082103788A TW215128B (en) | 1992-07-30 | 1993-05-14 | Circuit to mask abnormal current |
| US08/098,643 US5485342A (en) | 1992-07-30 | 1993-07-28 | Abnormal current cutoff circuit |
| DE4325370A DE4325370A1 (de) | 1992-07-30 | 1993-07-28 | Fehlerstrom-Abschaltkreis |
| KR1019930014499A KR940003136A (ko) | 1992-07-30 | 1993-07-29 | 이상 전류 차단 회로 |
| GB9315731A GB2269283B (en) | 1992-07-30 | 1993-07-29 | Abnormal current cutoff circuit |
| KR2019970035392U KR200155585Y1 (en) | 1992-07-30 | 1997-12-03 | Abnormal current cutoff circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4203835A JP2791344B2 (ja) | 1992-07-30 | 1992-07-30 | 異常電流遮断回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0671982A JPH0671982A (ja) | 1994-03-15 |
| JP2791344B2 true JP2791344B2 (ja) | 1998-08-27 |
Family
ID=16480495
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4203835A Expired - Fee Related JP2791344B2 (ja) | 1992-07-30 | 1992-07-30 | 異常電流遮断回路 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US5485342A (ja) |
| JP (1) | JP2791344B2 (ja) |
| KR (1) | KR940003136A (ja) |
| DE (1) | DE4325370A1 (ja) |
| GB (1) | GB2269283B (ja) |
| TW (1) | TW215128B (ja) |
Families Citing this family (13)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| GB9514514D0 (en) * | 1995-07-15 | 1996-04-24 | British Aerospace | Powerr switching circuits |
| KR100202195B1 (ko) * | 1996-09-03 | 1999-06-15 | 문정환 | 과전원 차단 회로 |
| DE19936397B4 (de) * | 1998-08-03 | 2013-07-11 | Denso Corporation | Lastantriebssteuervorrichtung |
| US6424035B1 (en) * | 1998-11-05 | 2002-07-23 | Fairchild Semiconductor Corporation | Semiconductor bilateral switch |
| US6178075B1 (en) | 1999-06-04 | 2001-01-23 | Visteon Global Technologies, Inc. | Electronic module with moisture protection |
| US20050097385A1 (en) * | 2003-10-15 | 2005-05-05 | Ahne Adam J. | Method of fault correction for an array of fusible links |
| CN101521461B (zh) * | 2008-02-26 | 2012-05-23 | 瑞昱半导体股份有限公司 | 一种两段式电压电平转换电路 |
| DE102008064393B4 (de) * | 2008-12-22 | 2012-12-06 | Lisa Dräxlmaier GmbH | Vorrichtung und Verfahren zur Absicherung einer elektrischen Leitung |
| CN104062544A (zh) * | 2013-03-22 | 2014-09-24 | 鸿富锦精密工业（深圳）有限公司 | 指示装置 |
| JP6257264B2 (ja) * | 2013-10-29 | 2018-01-10 | 三菱電機株式会社 | 半導体装置 |
| JP5991311B2 (ja) * | 2013-12-20 | 2016-09-14 | コニカミノルタ株式会社 | ユニット搭載装置、ユニット搭載装置の制御方法、およびユニット搭載装置の制御プログラム |
| CN104124731A (zh) * | 2014-06-17 | 2014-10-29 | 开曼群岛威睿电通股份有限公司 | 高压电池供电控制电路与高压电池供电控制方法 |
| JP7110757B2 (ja) * | 2018-06-25 | 2022-08-02 | 京セラドキュメントソリューションズ株式会社 | インクジェット記録装置 |
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