JP2767830B2 - Ｄチャネルアクセス回路 - Google Patents
Ｄチャネルアクセス回路Info
- Publication number
- JP2767830B2 JP2767830B2 JP63246641A JP24664188A JP2767830B2 JP 2767830 B2 JP2767830 B2 JP 2767830B2 JP 63246641 A JP63246641 A JP 63246641A JP 24664188 A JP24664188 A JP 24664188A JP 2767830 B2 JP2767830 B2 JP 2767830B2
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- Japan
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- signal
- channel
- input
- gate
- layer
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、CCITT（国際電信電話諮問委員会）勧告I.4
30インタフェースにおけるＤチャネルアクセス回路に関
する。
30インタフェースにおけるＤチャネルアクセス回路に関
する。
CCITT勧告I.430準拠のTE（Terminal Equipment）側の
Ｄチャネルアクセス回路には、レイヤ１側回路に備えら
れて、レイヤ２側回路から入力されるＤチャネル信号
を、Ｄチャネル送出信号として出力するものがある。入
力されるＤチャネル信号は、データ通信におけるダイヤ
ル信号等を運ぶ信号チャネルに係る信号である。
Ｄチャネルアクセス回路には、レイヤ１側回路に備えら
れて、レイヤ２側回路から入力されるＤチャネル信号
を、Ｄチャネル送出信号として出力するものがある。入
力されるＤチャネル信号は、データ通信におけるダイヤ
ル信号等を運ぶ信号チャネルに係る信号である。
このようなＤチャネルアクセス回路の一例を第２図に
示す。第２図において、レイヤ２側回路からのＤチャネ
ル信号ｆが、レイヤ１側回路のＤチャネルアクセス回路
のゲート21に入力される。そして、レイヤ２側回路から
Ｄチャネルアクセス要求信号ｇがゲート21に入力される
と、ゲート21がＤチャネル信号ｆをレイヤ１でのＤチャ
ネル送出信号ｈとして出力する。
示す。第２図において、レイヤ２側回路からのＤチャネ
ル信号ｆが、レイヤ１側回路のＤチャネルアクセス回路
のゲート21に入力される。そして、レイヤ２側回路から
Ｄチャネルアクセス要求信号ｇがゲート21に入力される
と、ゲート21がＤチャネル信号ｆをレイヤ１でのＤチャ
ネル送出信号ｈとして出力する。
上述した従来のＤチャネルアクセス回路は、Ｄチャネ
ル信号の送出要求の場合、レイヤ１側回路とレイヤ２側
回路との間で、Ｄチャネル信号そのものとそれに加えて
Ｄチャネルアクセス要求信号の２つを必要とする欠点を
有している。
ル信号の送出要求の場合、レイヤ１側回路とレイヤ２側
回路との間で、Ｄチャネル信号そのものとそれに加えて
Ｄチャネルアクセス要求信号の２つを必要とする欠点を
有している。
本発明の目的は、このような欠点を除去し、Ｄチャネ
ルアクセス要求信号を設けることなく、入力されるＤチ
ャネル信号を出力できるＤチャネルアクセス回路を提供
することにある。
ルアクセス要求信号を設けることなく、入力されるＤチ
ャネル信号を出力できるＤチャネルアクセス回路を提供
することにある。
本発明は、レイヤ１側回路に備えられて、レイヤ２側
回路から入力されるＤチャネル信号を、Ｄチャネル送出
信号として送出するＤチャネルアクセス回路であって、 前記Ｄチャネル信号の２進“0"を検出して“0"のセッ
ト信号を出力する第１の検出部と、 前記Ｄチャネル信号の２進“1"の所定数連続を検出し
て“1"のリセット信号を出力する第２の検出部と、 前記第１の検出部からのセット信号と、前記第２の検
出部からのリセット信号とを入力とするフリップフロッ
プと、 前記レイヤ２側回路から入力されるＤチャネル信号を
一方の入力とし、前記フリップフロップの出力信号を他
方の入力とするゲートとを備え、 前記ゲートは、前記他方の入力に入力される前記フリ
ップフロップの出力信号が“1"のとき、前記Ｄチャネル
信号を、レイヤ１側回路として前記Ｄチャネル送出信号
として出力し、また、前記他方の入力に入力される前記
フリップフロップの出力信号が“0"のとき、前記Ｄチャ
ネル信号の通過を阻止する、 ことを特徴としている。
回路から入力されるＤチャネル信号を、Ｄチャネル送出
信号として送出するＤチャネルアクセス回路であって、 前記Ｄチャネル信号の２進“0"を検出して“0"のセッ
ト信号を出力する第１の検出部と、 前記Ｄチャネル信号の２進“1"の所定数連続を検出し
て“1"のリセット信号を出力する第２の検出部と、 前記第１の検出部からのセット信号と、前記第２の検
出部からのリセット信号とを入力とするフリップフロッ
プと、 前記レイヤ２側回路から入力されるＤチャネル信号を
一方の入力とし、前記フリップフロップの出力信号を他
方の入力とするゲートとを備え、 前記ゲートは、前記他方の入力に入力される前記フリ
ップフロップの出力信号が“1"のとき、前記Ｄチャネル
信号を、レイヤ１側回路として前記Ｄチャネル送出信号
として出力し、また、前記他方の入力に入力される前記
フリップフロップの出力信号が“0"のとき、前記Ｄチャ
ネル信号の通過を阻止する、 ことを特徴としている。
次に、本発明の実施例について図面を参照して説明す
る。
る。
第１図は、本発明の一実施例を示す回路図である。こ
のＤチャネルアクセス回路は、レイヤ１側回路に備えら
れており、検出部11,12と、ゲート13,14,15とで構成さ
れる。
のＤチャネルアクセス回路は、レイヤ１側回路に備えら
れており、検出部11,12と、ゲート13,14,15とで構成さ
れる。
このような構成のＤチャネルアクセス回路において、
検出部11と検出部12とは、入力されるＤチャネル信号ａ
の特性を利用して、Ｄチャネルの２進“0"を検出し、Ｄ
チャネルの２進“1"連続７個を検出する。そして、２進
“0"を検出する検出部11が、２進“0"の検出信号を、セ
ット信号ｂとしてゲート13に出力する。また、２進“1"
連続７個を検出する検出部12が、２進“1"連続７個の検
出信号を、リセット信号ｃとしてゲート14に出力する。
検出部11と検出部12とは、入力されるＤチャネル信号ａ
の特性を利用して、Ｄチャネルの２進“0"を検出し、Ｄ
チャネルの２進“1"連続７個を検出する。そして、２進
“0"を検出する検出部11が、２進“0"の検出信号を、セ
ット信号ｂとしてゲート13に出力する。また、２進“1"
連続７個を検出する検出部12が、２進“1"連続７個の検
出信号を、リセット信号ｃとしてゲート14に出力する。
ゲート13とゲート14とは、フリップフロップを構成し
ており、入力されるセット信号ｂとリセット信号ｄとに
基づいて、出力信号ｄをゲート15の他方の入力端子に出
力する。
ており、入力されるセット信号ｂとリセット信号ｄとに
基づいて、出力信号ｄをゲート15の他方の入力端子に出
力する。
ゲート15は、一方の入力端子にＤチャネル信号ａが入
力され、他方の入力端子に入力される出力信号に基づい
て、Ｄチャネル信号ａをレイヤ１側回路のＤチャネル送
出信号ｅとして送出する。
力され、他方の入力端子に入力される出力信号に基づい
て、Ｄチャネル信号ａをレイヤ１側回路のＤチャネル送
出信号ｅとして送出する。
次に、本実施例の動作について説明する。
レイヤ２側回路からＤチャネル信号ａが出力される
と、このＤチャネル信号ａがゲート15の一方の入力端子
と、検出部11,12とに入力される。Ｄチャネル信号ａが
入力されると、検出部11がＤチャネル信号ａにおける、
２進“0"の検出をする。そして、検出部11が２進“0"の
検出信号をセット信号ｂとして、ゲート13に出力する。
一方、Ｄチャネル信号ａが入力されると、検出部12がＤ
チャネル信号ａにおける、２進“1"の７個連続を検出す
る。そして、検出部12が２進“1"の７個連続検出信号を
リセット信号ｃとして、ゲート14に出力する。このセッ
ト信号ｂとリセット信号ｃに基づいて、ゲート13とゲー
ト14とで構成されるフリップフロップが出力信号ｄを、
ゲート15の他方の入力端子に出力する。一方の入力端子
にＤチャネル信号ａが入力されているゲート15は、他方
の入力端子に入力される出力信号ｄが２進“1"のとき、
Ｄチャネル信号ａを、レイヤ１側回路としてのＤチャネ
ル送出信号ｅとして出力する。また、入力される出力信
号ｄが２進“0"のとき、ゲート15はＤチャネル信号ａの
通過を阻止する。
と、このＤチャネル信号ａがゲート15の一方の入力端子
と、検出部11,12とに入力される。Ｄチャネル信号ａが
入力されると、検出部11がＤチャネル信号ａにおける、
２進“0"の検出をする。そして、検出部11が２進“0"の
検出信号をセット信号ｂとして、ゲート13に出力する。
一方、Ｄチャネル信号ａが入力されると、検出部12がＤ
チャネル信号ａにおける、２進“1"の７個連続を検出す
る。そして、検出部12が２進“1"の７個連続検出信号を
リセット信号ｃとして、ゲート14に出力する。このセッ
ト信号ｂとリセット信号ｃに基づいて、ゲート13とゲー
ト14とで構成されるフリップフロップが出力信号ｄを、
ゲート15の他方の入力端子に出力する。一方の入力端子
にＤチャネル信号ａが入力されているゲート15は、他方
の入力端子に入力される出力信号ｄが２進“1"のとき、
Ｄチャネル信号ａを、レイヤ１側回路としてのＤチャネ
ル送出信号ｅとして出力する。また、入力される出力信
号ｄが２進“0"のとき、ゲート15はＤチャネル信号ａの
通過を阻止する。
このようにして本実施例は、Ｄチャネルの２進“0"検
出信号をセット信号とし、Ｄチャネルの２進“1"連続７
検出信号をリセット信号とするフリップフロップ、すな
わちゲート信号作成回路を有し、この回路からの出力信
号でＤチャネル信号のゲートをとるので、レイヤ１とし
てのＤチャネル送出信号を出力できる。
出信号をセット信号とし、Ｄチャネルの２進“1"連続７
検出信号をリセット信号とするフリップフロップ、すな
わちゲート信号作成回路を有し、この回路からの出力信
号でＤチャネル信号のゲートをとるので、レイヤ１とし
てのＤチャネル送出信号を出力できる。
以上説明したように本発明は、Ｄチャネル送出用の信
号として特にＤチャネルアクセス要求信号を設けること
なく、Ｄチャネル送出信号を送出できる。
号として特にＤチャネルアクセス要求信号を設けること
なく、Ｄチャネル送出信号を送出できる。
第１図は、本発明の一実施例を示す回路図、 第２図は、従来のＤチャネルアクセス回路の一例を示す
回路図である。 11,12……検出部 13,14,15……ゲート
回路図である。 11,12……検出部 13,14,15……ゲート
Claims (1)
- 【請求項１】レイヤ１側回路に備えられて、レイヤ２側
回路から入力されるＤチャネル信号を、Ｄチャネル送出
信号として送出するＤチャネルアクセス回路であって、 前記Ｄチャネル信号の２進“0"を検出して“0"のセット
信号を出力する第１の検出部と、 前記Ｄチャネル信号の２進“1"の所定数連続を検出して
“1"のリセット信号を出力する第２の検出部と、 前記第１の検出部からのセット信号と、前記第２の検出
部からのリセット信号とを入力とするフリップフロップ
と、 前記レイヤ２側回路から入力されるＤチャネル信号を一
方の入力とし、前記フリップフロップの出力信号を他方
の入力とするゲートとを備え、 前記ゲートは、前記他方の入力に入力される前記フリッ
プフロップの出力信号が“1"のとき、前記Ｄチャネル信
号を、レイヤ１側回路としての前記Ｄチャネル送出信号
として出力し、また、前記他方の入力に入力される前記
フリップフロップの出力信号が“0"のとき、前記Ｄチャ
ネル信号の通過を阻止する、 ことを特徴とするＤチャネルアクセス回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63246641A JP2767830B2 (ja) | 1988-09-30 | 1988-09-30 | Ｄチャネルアクセス回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63246641A JP2767830B2 (ja) | 1988-09-30 | 1988-09-30 | Ｄチャネルアクセス回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0294946A JPH0294946A (ja) | 1990-04-05 |
| JP2767830B2 true JP2767830B2 (ja) | 1998-06-18 |
Family
ID=17151433
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63246641A Expired - Lifetime JP2767830B2 (ja) | 1988-09-30 | 1988-09-30 | Ｄチャネルアクセス回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2767830B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4753465B2 (ja) * | 2000-11-15 | 2011-08-24 | トックベアリング株式会社 | ダンパとその製造方法 |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6074839A (ja) * | 1983-09-30 | 1985-04-27 | Toshiba Corp | リピ−タ装置 |
| JPS63227247A (ja) * | 1987-03-17 | 1988-09-21 | Fujitsu Ltd | Ｉｓｄｎ網のｄチヤネルエコ−機能検査装置 |
-
1988
- 1988-09-30 JP JP63246641A patent/JP2767830B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0294946A (ja) | 1990-04-05 |
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