JP2666533B2 - スイツチモジユール - Google Patents
スイツチモジユールInfo
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- JP2666533B2 JP2666533B2 JP2206875A JP20687590A JP2666533B2 JP 2666533 B2 JP2666533 B2 JP 2666533B2 JP 2206875 A JP2206875 A JP 2206875A JP 20687590 A JP20687590 A JP 20687590A JP 2666533 B2 JP2666533 B2 JP 2666533B2
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- input
- terminals
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04Q—SELECTING
- H04Q3/00—Selecting arrangements
- H04Q3/64—Distributing or queueing
- H04Q3/68—Grouping or interlacing selector groups or stages
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- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
- Keying Circuit Devices (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は伝送路のクロスコネクトシステムのスイツチ
に係り、特にＮ×Ｎ（N:任意の自然数）のノンブロツキ
ング３段スイツチを構成するスイツチモジユールに関す
るものである。
に係り、特にＮ×Ｎ（N:任意の自然数）のノンブロツキ
ング３段スイツチを構成するスイツチモジユールに関す
るものである。
従来、Ｎ×Ｎのノンブロツキングな３段スイツチを構
成する１次スイツチ,2次スイツチおよび３次スイツチの
スイツチサイズは、各々入力数と出力数が異なるスイツ
チを用いていた。もしくは、スイツチモジユールとし
て、ｍ×ｍ（m:任意の自然数）のスイツチを用い、ｎ×
2n（n:任意の自然数）の１次スイツチ，あるいは2n×ｎ
の３次スイツチとして使用していた。
成する１次スイツチ,2次スイツチおよび３次スイツチの
スイツチサイズは、各々入力数と出力数が異なるスイツ
チを用いていた。もしくは、スイツチモジユールとし
て、ｍ×ｍ（m:任意の自然数）のスイツチを用い、ｎ×
2n（n:任意の自然数）の１次スイツチ，あるいは2n×ｎ
の３次スイツチとして使用していた。
このような従来のスイツチの構成では、スイツチの入
力数と出力数が異なるので、３種類のスイツチを用意す
るという課題があつた。
力数と出力数が異なるので、３種類のスイツチを用意す
るという課題があつた。
また、ｍ×ｍのスイツチを用いてｎ×2nのスイツチと
して使用すると、（ｍ≧2n）ｍ×ｍのスイツチ内に使用
しない無駄なクロスポイントが生じることになり、余計
な電力の原因，あるいはコストが高くなるなどの課題が
あつた。
して使用すると、（ｍ≧2n）ｍ×ｍのスイツチ内に使用
しない無駄なクロスポイントが生じることになり、余計
な電力の原因，あるいはコストが高くなるなどの課題が
あつた。
本発明のスイツチモジユールは、Ｎ個（N:任意の自然
数）の入力とＮ個の出力を有し、任意の入力と任意の出
力を１対１で接続することが可能な３段リンクスイツチ
システムであつて、スイツチサイズがｎ×2n（n:任意の
自然数，ただしｎ＞０）である１次スイツチがｎ個（n2
≧Ｎ）と，スイツチサイズがｎ×ｎである２次スイツチ
が2n個と，スイツチサイズが2n×ｎである３次スイツチ
がｎ個により構成され、上記１次スイツチと上記２次ス
イツチ間および上記２次スイツチと上記３次スイツチ間
がリンク接続されている３段スイツチに使用するスイツ
チモジユールにおいて、信号を1:2に分岐して出力する2
n個の分岐回路と、２つの信号から１つの信号を選択し
て出力する2n個の2:1セレクタと、任意の入力と任意の
出力を接続できかつスイツチサイズがｎ×ｎの２個のス
イツチによつて構成され、入力端子2n個と出力端子2n個
を有し、上記入力端子2n個のうちｎ個は各々１組目のｎ
個のセレクタの片側の入力に接続され，残りの入力端子
ｎ個は１組目のｎ個の分岐回路の入力に接続され,1組目
のｎ個の分岐回路の片側の出力は各々１組目のセレクタ
の入力に接続され、１組目のｎ個の分岐回路の残りの出
力は２個目のｎ×ｎのスイツチの入力に接続され,1組目
のｎ個のセレクタの出力は１個目のｎ×ｎのスイツチの
入力に接続され,2個のうち１個目のスイツチの出力は各
々２組目のｎ個のセレクタの入力の片側に接続され,2個
目のスイツチの出力は２組目のｎ個の分岐回路の入力に
１本ずつ接続され,2組目のｎ個の分岐回路の出力の片側
は各々２組目のｎ個のセレクタの入力の残りに接続さ
れ,2組目のｎ個の分岐回路の残りの出力はスイツチモジ
ユールのｎ個の出力端子に接続されるスイツチモジユー
ルを設け、このスイツチモジユールを１次スイツチとし
て使用する際は、そのスイツチモジユールの入力端子の
うち分岐回路に接続されているｎ個と，そのスイツチモ
ジユールの入力端子2n個を各々ｎ×2nの１次スイツチの
入力と出力とみなし、２次スイツチに使用する際は、そ
のスイツチモジユールの入力端子のうち分岐回路に接続
されている入力端子ｎ個と，そのスイツチモジユールの
出力端子のうちセレクタに接続されている出力端子ｎ個
を各々ｎ×ｎの２次スイツチの入力と出力とみなし、か
つそのスイツチモジユールの残りの入力端子ｎ個と出力
端子ｎ個を各々もう１個のｎ×ｎの２次スイツチの入力
と出力とみなし、３次スイツチに使用する際はそのスイ
ツチモジユールの出力端子のうち分岐回路に接続されて
いる出力端子ｎ個と入力端子2n個を各々2n×ｎの３次ス
イツチの出力と入力とみなすことにより、３段スイツチ
を構成できるようにしたものである。
数）の入力とＮ個の出力を有し、任意の入力と任意の出
力を１対１で接続することが可能な３段リンクスイツチ
システムであつて、スイツチサイズがｎ×2n（n:任意の
自然数，ただしｎ＞０）である１次スイツチがｎ個（n2
≧Ｎ）と，スイツチサイズがｎ×ｎである２次スイツチ
が2n個と，スイツチサイズが2n×ｎである３次スイツチ
がｎ個により構成され、上記１次スイツチと上記２次ス
イツチ間および上記２次スイツチと上記３次スイツチ間
がリンク接続されている３段スイツチに使用するスイツ
チモジユールにおいて、信号を1:2に分岐して出力する2
n個の分岐回路と、２つの信号から１つの信号を選択し
て出力する2n個の2:1セレクタと、任意の入力と任意の
出力を接続できかつスイツチサイズがｎ×ｎの２個のス
イツチによつて構成され、入力端子2n個と出力端子2n個
を有し、上記入力端子2n個のうちｎ個は各々１組目のｎ
個のセレクタの片側の入力に接続され，残りの入力端子
ｎ個は１組目のｎ個の分岐回路の入力に接続され,1組目
のｎ個の分岐回路の片側の出力は各々１組目のセレクタ
の入力に接続され、１組目のｎ個の分岐回路の残りの出
力は２個目のｎ×ｎのスイツチの入力に接続され,1組目
のｎ個のセレクタの出力は１個目のｎ×ｎのスイツチの
入力に接続され,2個のうち１個目のスイツチの出力は各
々２組目のｎ個のセレクタの入力の片側に接続され,2個
目のスイツチの出力は２組目のｎ個の分岐回路の入力に
１本ずつ接続され,2組目のｎ個の分岐回路の出力の片側
は各々２組目のｎ個のセレクタの入力の残りに接続さ
れ,2組目のｎ個の分岐回路の残りの出力はスイツチモジ
ユールのｎ個の出力端子に接続されるスイツチモジユー
ルを設け、このスイツチモジユールを１次スイツチとし
て使用する際は、そのスイツチモジユールの入力端子の
うち分岐回路に接続されているｎ個と，そのスイツチモ
ジユールの入力端子2n個を各々ｎ×2nの１次スイツチの
入力と出力とみなし、２次スイツチに使用する際は、そ
のスイツチモジユールの入力端子のうち分岐回路に接続
されている入力端子ｎ個と，そのスイツチモジユールの
出力端子のうちセレクタに接続されている出力端子ｎ個
を各々ｎ×ｎの２次スイツチの入力と出力とみなし、か
つそのスイツチモジユールの残りの入力端子ｎ個と出力
端子ｎ個を各々もう１個のｎ×ｎの２次スイツチの入力
と出力とみなし、３次スイツチに使用する際はそのスイ
ツチモジユールの出力端子のうち分岐回路に接続されて
いる出力端子ｎ個と入力端子2n個を各々2n×ｎの３次ス
イツチの出力と入力とみなすことにより、３段スイツチ
を構成できるようにしたものである。
本発明においては、分岐回路で信号を１対２に分岐し
て出力し、2:1セレクタで２つの信号から１つの信号を
選択して出力し、任意の入力と任意の出力を接続でき，
かつスイツチサイズがｎ×ｎのスイツチ２個を備えてい
る。
て出力し、2:1セレクタで２つの信号から１つの信号を
選択して出力し、任意の入力と任意の出力を接続でき，
かつスイツチサイズがｎ×ｎのスイツチ２個を備えてい
る。
以下、図面に基づき本発明の実施例を詳細に説明す
る。
る。
第１図は本発明の一実施例を示すブロツク図で、スイ
ツチモジユールの構成を示すものである。
ツチモジユールの構成を示すものである。
この第１図において、１−1,1−２…１−ｎおよび１
−（ｎ＋１）,1−（ｎ＋２）…１−2nは2n個の入力端
子、２−1,2−２…２−ｎは２つの信号から１つの信号
を選択して出力する2n個の2:1セレクタ、３−1,3−２…
３−ｎは信号を１対２に分岐して出力する2n個の分岐回
路、４−1,4−２は任意の入力と任意の出力を接続でき
かつスイツチサイズがｎ×ｎのスイツチ、５−1,5−２
…５−ｎは２つの信号から１つの信号を選択して出力す
る2n個の2:1セレクタ、６−1,6−２…６−ｎは信号を1:
2に分岐して出力する2n個の分岐回路、７−1,7−２…７
−ｎおよび７−（ｎ＋１）,7−（ｎ＋２）…７−2nは2n
個の出力端子である。
−（ｎ＋１）,1−（ｎ＋２）…１−2nは2n個の入力端
子、２−1,2−２…２−ｎは２つの信号から１つの信号
を選択して出力する2n個の2:1セレクタ、３−1,3−２…
３−ｎは信号を１対２に分岐して出力する2n個の分岐回
路、４−1,4−２は任意の入力と任意の出力を接続でき
かつスイツチサイズがｎ×ｎのスイツチ、５−1,5−２
…５−ｎは２つの信号から１つの信号を選択して出力す
る2n個の2:1セレクタ、６−1,6−２…６−ｎは信号を1:
2に分岐して出力する2n個の分岐回路、７−1,7−２…７
−ｎおよび７−（ｎ＋１）,7−（ｎ＋２）…７−2nは2n
個の出力端子である。
そして、入力端子2n個と出力端子2n個を有し、その入
力端子2n個のうちｎ個は各々１組目のｎ個のセレクタ２
−１〜２−ｎの片側の入力に接続され、残りの入力端子
ｎ個は１組目のｎ個の分岐回路３−１〜３−ｎの入力に
接続され、１組目のｎ個の分岐回路３−１〜３−ｎの片
側の出力は各々１組目のセレクタ２−１〜２−ｎの入力
に接続され,1組目のｎ個の分岐回路３−１〜３−ｎの残
りの出力は２個目のｎ×ｎのスイツチ４−２の入力に接
続され,1組目のｎ個のセレクタ２−１〜２−ｎの出力は
１個目のｎ×ｎのスイツチ４−１の入力に接続され,2個
のうち１個目のスイツチ４−１の出力は各々２組目のｎ
個のセレクタ５−１〜５−ｎの入力の片側に接続され,2
個目のスイツチ４−２の出力は２組目のｎ個の分岐回路
６−１〜６−ｎの入力に１本ずつ接続され,2組目のｎ個
の分岐回路６−１〜６−ｎの出力の片側は各々２組目の
ｎ個のセレクタ５−１〜５−ｎの入力の残りに接続さ
れ,2組目のｎ個の分岐回路６−１〜６−ｎの残りの出力
はスイツチモジユールのｎ個の出力端子７−（ｎ＋１）
〜７−2nに接続されている。
力端子2n個のうちｎ個は各々１組目のｎ個のセレクタ２
−１〜２−ｎの片側の入力に接続され、残りの入力端子
ｎ個は１組目のｎ個の分岐回路３−１〜３−ｎの入力に
接続され、１組目のｎ個の分岐回路３−１〜３−ｎの片
側の出力は各々１組目のセレクタ２−１〜２−ｎの入力
に接続され,1組目のｎ個の分岐回路３−１〜３−ｎの残
りの出力は２個目のｎ×ｎのスイツチ４−２の入力に接
続され,1組目のｎ個のセレクタ２−１〜２−ｎの出力は
１個目のｎ×ｎのスイツチ４−１の入力に接続され,2個
のうち１個目のスイツチ４−１の出力は各々２組目のｎ
個のセレクタ５−１〜５−ｎの入力の片側に接続され,2
個目のスイツチ４−２の出力は２組目のｎ個の分岐回路
６−１〜６−ｎの入力に１本ずつ接続され,2組目のｎ個
の分岐回路６−１〜６−ｎの出力の片側は各々２組目の
ｎ個のセレクタ５−１〜５−ｎの入力の残りに接続さ
れ,2組目のｎ個の分岐回路６−１〜６−ｎの残りの出力
はスイツチモジユールのｎ個の出力端子７−（ｎ＋１）
〜７−2nに接続されている。
第２図は本発明のスイツチモジユールを適用する３段
スイツチの構成例を示すブロツク図である。
スイツチの構成例を示すブロツク図である。
この第２図において、８−１〜８−ｎはスイツチサイ
ズがｎ×2n（ただしｎ＞０）であるｎ個（n2≧Ｎ）の１
次スイツチ、９−１〜９−2nはスイツチサイズがｎ×ｎ
である2n個の２次スイツチ、10−１〜10−ｎはスイツチ
サイズが2n×ｎであるｎ個の３次スイツチで、この１次
スイツチ８−１〜８−ｎと２次スイツチ９−１〜９−2n
間および２次スイツチ９−１〜９−2nと３次スイツチ10
−１〜10−ｎ間がリンク接続されている３段スイツチに
使用するスイツチモジユールを構成している。
ズがｎ×2n（ただしｎ＞０）であるｎ個（n2≧Ｎ）の１
次スイツチ、９−１〜９−2nはスイツチサイズがｎ×ｎ
である2n個の２次スイツチ、10−１〜10−ｎはスイツチ
サイズが2n×ｎであるｎ個の３次スイツチで、この１次
スイツチ８−１〜８−ｎと２次スイツチ９−１〜９−2n
間および２次スイツチ９−１〜９−2nと３次スイツチ10
−１〜10−ｎ間がリンク接続されている３段スイツチに
使用するスイツチモジユールを構成している。
つぎにこの第１図および第２図に示す実施例の動作を
説明する。
説明する。
まず、スイツチモジユールをｎ×2nの１次スイツチと
して使用する場合は、セレクタ２−１〜２−ｎを各々分
岐回路３−１〜３−ｎから入力される信号を選択するよ
うに固定に設定し、セレクタ５−１〜５−ｎを各々分岐
回路６ー１から６−ｎから入力される信号を選択するよ
うに固定に設定し、入力として入力端子１−（ｎ＋１）
〜１−2nを使用すれは、ｎ×2nのスイツチとしてスイツ
チモジユールは機能する。
して使用する場合は、セレクタ２−１〜２−ｎを各々分
岐回路３−１〜３−ｎから入力される信号を選択するよ
うに固定に設定し、セレクタ５−１〜５−ｎを各々分岐
回路６ー１から６−ｎから入力される信号を選択するよ
うに固定に設定し、入力として入力端子１−（ｎ＋１）
〜１−2nを使用すれは、ｎ×2nのスイツチとしてスイツ
チモジユールは機能する。
つぎに、スイツチモジユールをｎ×ｎの２次スイツチ
として使用する場合には、セレクタ２−１〜２−ｎを各
々入力端子１−１〜１−ｎから入力される信号を選択す
るように固定に設定し、セレクタ５−１〜５−ｎを各々
スイツチ４−１から出力される信号を選択するように固
定に設定し、入力として入力端子１−１〜１−ｎを，入
力として出力端子７−１〜７−ｎを使用すれば、１個の
ｎ×ｎのスイツチとして機能し、これと同時に入力とし
て入力端子１−（ｎ＋１）〜１−2nを，出力として出力
端子７−（ｎ−１）〜７−2nを使用すれば、１個のｎ×
ｎスイツチとして機能するので、スイツチモジユールを
２個のスイツチとして使用できる。
として使用する場合には、セレクタ２−１〜２−ｎを各
々入力端子１−１〜１−ｎから入力される信号を選択す
るように固定に設定し、セレクタ５−１〜５−ｎを各々
スイツチ４−１から出力される信号を選択するように固
定に設定し、入力として入力端子１−１〜１−ｎを，入
力として出力端子７−１〜７−ｎを使用すれば、１個の
ｎ×ｎのスイツチとして機能し、これと同時に入力とし
て入力端子１−（ｎ＋１）〜１−2nを，出力として出力
端子７−（ｎ−１）〜７−2nを使用すれば、１個のｎ×
ｎスイツチとして機能するので、スイツチモジユールを
２個のスイツチとして使用できる。
つぎに、スイツチモジユールを2n×ｎの３次スイツチ
として使用する場合は、セレクタ２−１〜２−ｎを各々
入力端子１−１〜１−ｎから入力される信号を選択する
ように固定に設定し、スイツチ４−1,スイツチ４−２と
セレクタ５−１〜５−ｎを入力と出力の接続に応じて設
定すれば、2n×ｎの３次スイツチとして機能する。
として使用する場合は、セレクタ２−１〜２−ｎを各々
入力端子１−１〜１−ｎから入力される信号を選択する
ように固定に設定し、スイツチ４−1,スイツチ４−２と
セレクタ５−１〜５−ｎを入力と出力の接続に応じて設
定すれば、2n×ｎの３次スイツチとして機能する。
このように、スイツチモジユールを１次スイツチとし
て使用する際はそのスイツチモジユールの入力端子のう
ち分岐回路３−１〜３−ｎに接続されているｎ個と，ス
イツチモジユールの出力端子2n個を各々ｎ×2nの１次ス
イツチの入力と出力とみなし、２次スイツチに使用する
際は、そのスイツチモジユールの入力端子のうち分岐回
路３−１〜３−ｎに接続されている入力端子ｎ個とその
スイツチモジユールの出力端子のうちセレクタ５−１〜
５−ｎに接続されている出力端子ｎ個を各々ｎ×ｎの２
次スイツチの入力と出力とみなし，かつそのスイツチモ
ジユールの残りの入力端子ｎ個と出力端子ｎ個を各々も
う１個のｎ×ｎの２次スイツチの入力と出力とみなし、
３次スイツチに使用する際はそのスイツチモジユールの
出力端子のうち、分岐回路６−１〜６−ｎに接続されて
いる出力端子ｎ個と入力端子2n個を各々2n×ｎの３次ス
イツチの出力と入力とみなすことにより、３段スイツチ
を構成することができる。
て使用する際はそのスイツチモジユールの入力端子のう
ち分岐回路３−１〜３−ｎに接続されているｎ個と，ス
イツチモジユールの出力端子2n個を各々ｎ×2nの１次ス
イツチの入力と出力とみなし、２次スイツチに使用する
際は、そのスイツチモジユールの入力端子のうち分岐回
路３−１〜３−ｎに接続されている入力端子ｎ個とその
スイツチモジユールの出力端子のうちセレクタ５−１〜
５−ｎに接続されている出力端子ｎ個を各々ｎ×ｎの２
次スイツチの入力と出力とみなし，かつそのスイツチモ
ジユールの残りの入力端子ｎ個と出力端子ｎ個を各々も
う１個のｎ×ｎの２次スイツチの入力と出力とみなし、
３次スイツチに使用する際はそのスイツチモジユールの
出力端子のうち、分岐回路６−１〜６−ｎに接続されて
いる出力端子ｎ個と入力端子2n個を各々2n×ｎの３次ス
イツチの出力と入力とみなすことにより、３段スイツチ
を構成することができる。
以上説明したように本発明は、分岐回路で信号を1:2
に分岐して出力し、2:1のセレクタで２つの信号から１
つの信号を選択して出力し、そして、任意の入力と任意
の出力を接続でき，かつスイツチサイズがｎ×ｎのスイ
ツチ２個を備えることにより、１種類のスイツチモジユ
ールを１次スイツチ,2次スイツチ,3次スイツチとして使
用できるので、コストの低減を図ることができる効果が
ある。また、無駄なスイツチ交点がないので効率的にス
イツチを構成することができるという効果を有する。
に分岐して出力し、2:1のセレクタで２つの信号から１
つの信号を選択して出力し、そして、任意の入力と任意
の出力を接続でき，かつスイツチサイズがｎ×ｎのスイ
ツチ２個を備えることにより、１種類のスイツチモジユ
ールを１次スイツチ,2次スイツチ,3次スイツチとして使
用できるので、コストの低減を図ることができる効果が
ある。また、無駄なスイツチ交点がないので効率的にス
イツチを構成することができるという効果を有する。
第１図は本発明の一実施例を示すブロツク図、第２図は
本発明のスイツチモジユールを適用する３段スイツチの
構成例を示すブロツク図である。 １−１〜１−n,1−（ｎ＋１）〜１−2n……入力端子、
２−１〜２−ｎ……セレクタ、３−１〜３−ｎ……分岐
回路、４−1,4−２……スイツチ、５−１〜５−ｎ……
セレクタ、６−１〜６−ｎ……分岐回路、７−１〜７−
n,7（ｎ＋１）〜７−2n……出力端子、８−１〜８−ｎ
……１次スイツチ、９−１〜９−2n……２次スイツチ、
10−１〜10−ｎ……３次スイツチ。
本発明のスイツチモジユールを適用する３段スイツチの
構成例を示すブロツク図である。 １−１〜１−n,1−（ｎ＋１）〜１−2n……入力端子、
２−１〜２−ｎ……セレクタ、３−１〜３−ｎ……分岐
回路、４−1,4−２……スイツチ、５−１〜５−ｎ……
セレクタ、６−１〜６−ｎ……分岐回路、７−１〜７−
n,7（ｎ＋１）〜７−2n……出力端子、８−１〜８−ｎ
……１次スイツチ、９−１〜９−2n……２次スイツチ、
10−１〜10−ｎ……３次スイツチ。
Claims (1)
- 【請求項１】Ｎ個（N:任意の自然数）の入力とＮ個の出
力を有し、任意の入力と任意の出力を１対１で接続する
ことが可能な３段リンクスイツチシステムであつて、ス
イツチサイズがｎ×2n（n:任意の自然数，ただし、ｎ＞
０）である１次スイツチがｎ個（n2≧Ｎ）と，スイツチ
サイズがｎ×ｎである２次スイツチが2n個と，スイツチ
サイズが2n×ｎである３次スイツチがｎ個により構成さ
れ、前記１次スイツチと前記２次スイツチ間および前記
２次スイツチと前記３次スイツチ間がリンク接続されて
いる３段スイツチに使用するスイツチモジユールにおい
て、信号を1:2に分岐して出力する2n個の分岐回路と、
２つの信号から１つの信号を選択して出力する2n個の2:
1セレクタと、任意の入力と任意の出力を接続できかつ
スイツチサイズがｎ×ｎのスイツチが２個によつて構成
され、入力端子2n個と出力端子2n個を有し、前記入力端
子2n個のうちｎ個は各々１組目のｎ個のセレクタの片側
の入力に接続され，残りの入力端子ｎ個は１組目のｎ個
の分岐回路の入力に接続され、１組目のｎ個の分岐回路
の片側の出力は各々１組目のセレクタの入力に接続さ
れ,1組目のｎ個の分岐回路の残りの出力は２個目のｎ×
ｎのスイツチの入力に接続され,1組目のｎ個のセレクタ
の出力は１個目のｎ×ｎのスイツチの入力に接続され,2
個のうち１個目のスイツチの出力は各々２組目のｎ個の
セレクタの入力の片側に接続され,2個目のスイツチの出
力は２組目のｎ個の分岐回路の入力に１本ずつ接続さ
れ,2組目のｎ個の分岐回路の出力の片側は各々２組目の
ｎ個のセレクタの入力の残りに接続され,2組目のｎ個の
分岐回路の残りの出力はスイツチモジユールの出力端子
ｎ個に接続されるスイツチモジユールを設け、このスイ
ツチモジユールを１次スイツチとして使用する際は、該
スイツチモジュールの入力端子のうち分岐回路に接続さ
れているｎ個と，該スイツチモジユールの出力端子2n個
を各々ｎ×2nの１次スイツチの入力と出力とみなし、２
次スイツチに使用する際は、該スイツチモジユールの入
力端子のうち分岐回路に接続されている入力端子ｎ個
と，該スイツチモジユールの出力端子のうちセレクタに
接続されている出力端子ｎ個を各々ｎ×ｎの２次スイツ
チの入力と出力とみなし，かつ該スイツチモジユールの
残りの入力端子ｎ個と出力端子ｎ個を各々もつ１個のｎ
×ｎの２次スイツチの入力と出力とみなし、３次スイツ
チに使用する際は、該スイツチモジユールの出力端子の
うち分岐回路に接続されている出力端子ｎ個と入力端子
2n個を各々2n×ｎの３次スイツチの出力と入力とみなす
ことにより、３段スイツチを構成し得るようにしたこと
を特徴とするスイツチモジユール。
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