JP2644775B2 - 増幅回路 - Google Patents
増幅回路Info
- Publication number
- JP2644775B2 JP2644775B2 JP62270253A JP27025387A JP2644775B2 JP 2644775 B2 JP2644775 B2 JP 2644775B2 JP 62270253 A JP62270253 A JP 62270253A JP 27025387 A JP27025387 A JP 27025387A JP 2644775 B2 JP2644775 B2 JP 2644775B2
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- JP
- Japan
- Prior art keywords
- circuit
- level
- amplifier circuit
- variable gain
- input signal
- Prior art date
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- Control Of Amplification And Gain Control (AREA)
Description
【発明の詳細な説明】 〔概要〕 増幅回路、特に入力信号レベルが過大であると利得を
制限される可変利得増幅回路を備えた増幅回路に関し、 入力信号レベルが過大であっても出力信号レベルを一
定に制限することなく最大許容入力信号レベル近傍でも
良好に入力信号を増幅可能とすることを目的とし、 増幅器及び抵抗分圧による減衰器を有し入力信号を増
幅する可変利得増幅回路と、該可変利得増幅回路の出力
信号レベルに応じて該可変利得増幅回路の利得を可変制
御するレベル検出回路を備えた増幅回路において、該レ
ベル検出回路は、該可変利得増幅回路の出力信号レベル
が複数の所定レベルを越える毎に前記減衰器の合成抵抗
を制御することによって該可変利得制御回路の利得を互
いに異なる１以上の範囲で低下するように可変制御を行
なうように構成する。
制限される可変利得増幅回路を備えた増幅回路に関し、 入力信号レベルが過大であっても出力信号レベルを一
定に制限することなく最大許容入力信号レベル近傍でも
良好に入力信号を増幅可能とすることを目的とし、 増幅器及び抵抗分圧による減衰器を有し入力信号を増
幅する可変利得増幅回路と、該可変利得増幅回路の出力
信号レベルに応じて該可変利得増幅回路の利得を可変制
御するレベル検出回路を備えた増幅回路において、該レ
ベル検出回路は、該可変利得増幅回路の出力信号レベル
が複数の所定レベルを越える毎に前記減衰器の合成抵抗
を制御することによって該可変利得制御回路の利得を互
いに異なる１以上の範囲で低下するように可変制御を行
なうように構成する。
本発明は増幅回路、特に入力信号レベルが過大である
と利得を制限される可変利得増幅回路を備えた増幅回路
に関する。
と利得を制限される可変利得増幅回路を備えた増幅回路
に関する。
音声信号用の増幅回路は、通常線形増幅回路を用いて
おり、出力信号Voutと入力信号Vinとの振幅は第６図
（ａ）に示す如く一定の比例関係にある。この一定の比
例関係は増幅回路の出力段トランジスタが飽和するまで
は保たれるが、出力段トランジスタの飽和領域である入
力信号Vinの振幅がVs以上では入力信号Vinの波形と出力
信号Voutの波形とは一致せず、第６図（ａ）の実線に示
す如く、Vs以上で比例関係が異なってしまう。飽和領域
では、第６図（ａ）に示す如く高調波成分による歪率の
悪化が著しい。
おり、出力信号Voutと入力信号Vinとの振幅は第６図
（ａ）に示す如く一定の比例関係にある。この一定の比
例関係は増幅回路の出力段トランジスタが飽和するまで
は保たれるが、出力段トランジスタの飽和領域である入
力信号Vinの振幅がVs以上では入力信号Vinの波形と出力
信号Voutの波形とは一致せず、第６図（ａ）の実線に示
す如く、Vs以上で比例関係が異なってしまう。飽和領域
では、第６図（ａ）に示す如く高調波成分による歪率の
悪化が著しい。
従来の増幅回路は、大略入力信号を増幅する可変利得
増幅回路とレベル検出回路とよりなる。レベル検出回路
は、可変利得増幅回路の出力信号Voutが所定レベル以
上、即ち、入力信号VinのレベルがVLi以上で過大である
と、第６図（ａ）に破線で示す如く出力信号Voutのレベ
ルをVLoに制限するように可変利得増幅回路を可変制御
する。この様な従来回路は、AGC（自動利得制御）回路,
ALC（自動レベル制御）回路として公知である。
増幅回路とレベル検出回路とよりなる。レベル検出回路
は、可変利得増幅回路の出力信号Voutが所定レベル以
上、即ち、入力信号VinのレベルがVLi以上で過大である
と、第６図（ａ）に破線で示す如く出力信号Voutのレベ
ルをVLoに制限するように可変利得増幅回路を可変制御
する。この様な従来回路は、AGC（自動利得制御）回路,
ALC（自動レベル制御）回路として公知である。
従来回路では、レベルがVLi以上の入力信号Vinに対し
て出力信号VoutのレベルがVLoなる一定のレベルに制限
されてしまうので、増幅回路の最大許容入力信号レベル
近傍での信号増幅が行なえないという問題が生じてい
た。
て出力信号VoutのレベルがVLoなる一定のレベルに制限
されてしまうので、増幅回路の最大許容入力信号レベル
近傍での信号増幅が行なえないという問題が生じてい
た。
本発明は、入力信号レベルが過大であっても出力信号
レベルを一定に制限することなく最大許容入力信号レベ
ル近傍でも良好に入力信号を増幅可能とすることのでき
る増幅回路を提供することを目的とする。
レベルを一定に制限することなく最大許容入力信号レベ
ル近傍でも良好に入力信号を増幅可能とすることのでき
る増幅回路を提供することを目的とする。
第１図は本発明の原理説明図、第２図は本発明の原理
説明用入出力特性図である。
説明用入出力特性図である。
第１図中、１は入力信号を増幅する可変利得増幅回
路、２は可変利得増幅回路１の出力信号レベルに応じて
可変利得増幅回路１の利得を可変制御するレベル検出回
路である。
路、２は可変利得増幅回路１の出力信号レベルに応じて
可変利得増幅回路１の利得を可変制御するレベル検出回
路である。
レベル検出回路２は、第２図に実線で示す如く可変利
得増幅回路１の出力信号レベルが所定のレベルVL1,VL2,
VL3を越える毎に可変利得制御回路１の利得を互いに異
なる１以上の範囲で低下するように可変制御を行なう。
なお、第２図中、破線は増幅回路自体の特性を示す。
得増幅回路１の出力信号レベルが所定のレベルVL1,VL2,
VL3を越える毎に可変利得制御回路１の利得を互いに異
なる１以上の範囲で低下するように可変制御を行なう。
なお、第２図中、破線は増幅回路自体の特性を示す。
従って、入力信号レベルが過大であっても出力信号レ
ベルを一定に制限することなく最大許容入力信号レベル
近傍でも良好に入力信号を増幅できる。
ベルを一定に制限することなく最大許容入力信号レベル
近傍でも良好に入力信号を増幅できる。
第３図は本発明回路の一実施例を示す。
同図中、可変利得増幅回路１は、増幅器11,12と、抵
抗R1〜R3と、トランジスタＱとよりなる。レベル検出回
路２は、整流回路13と、コンパレータ14と、基準電圧供
給源VREFと、抵抗R4と、コンデンサＣとよりなる。
抗R1〜R3と、トランジスタＱとよりなる。レベル検出回
路２は、整流回路13と、コンパレータ14と、基準電圧供
給源VREFと、抵抗R4と、コンデンサＣとよりなる。
整流回路13は、可変利得増幅回路１の出力信号Voutを
整流してコンパレータ14に供給する。このコンパレータ
14には、基準電圧供給源VREFからの基準電圧VREFも供給
されており、整流回路13からの電圧基準電圧VREFより大
である期間ハイレベル信号を出力する。これにより、ト
ランジスタＱはこの期間オンとされ、抵抗R1〜R3よりな
る減衰回路の減衰量が大となる。トランジスタＱがオン
の時の減衰量ATT（ON）は｛R2/（R1＋R2）｝であり、ト
ランジスタＱがオフの時の減衰量ATT（OFF）は｛（R2＋
R3）／（R1＋R2＋R3）｝である。
整流してコンパレータ14に供給する。このコンパレータ
14には、基準電圧供給源VREFからの基準電圧VREFも供給
されており、整流回路13からの電圧基準電圧VREFより大
である期間ハイレベル信号を出力する。これにより、ト
ランジスタＱはこの期間オンとされ、抵抗R1〜R3よりな
る減衰回路の減衰量が大となる。トランジスタＱがオン
の時の減衰量ATT（ON）は｛R2/（R1＋R2）｝であり、ト
ランジスタＱがオフの時の減衰量ATT（OFF）は｛（R2＋
R3）／（R1＋R2＋R3）｝である。
第４図は、本実施例の入力対出力特性を示す。同図
中、実線で示す如く、入力信号VinのレベルがV1を越え
ると可変利得制御回路１の利得が低下されるので、最大
許容入力信号レベル近傍でも良好に入力信号Vinを増幅
し得、大レベルの出力信号Voutを得ることができる。な
お、一点鎖線は利得一定とされた場合の増幅回路自体の
特性を示し、本実施例では入力信号VinのレベルがV2を
越えるとこの増幅回路自体の特性に沿ったものとなる。
又、比較のため、第６図（ａ）に示した従来回路の特性
を破線で示す。
中、実線で示す如く、入力信号VinのレベルがV1を越え
ると可変利得制御回路１の利得が低下されるので、最大
許容入力信号レベル近傍でも良好に入力信号Vinを増幅
し得、大レベルの出力信号Voutを得ることができる。な
お、一点鎖線は利得一定とされた場合の増幅回路自体の
特性を示し、本実施例では入力信号VinのレベルがV2を
越えるとこの増幅回路自体の特性に沿ったものとなる。
又、比較のため、第６図（ａ）に示した従来回路の特性
を破線で示す。
第５図は全高調波歪率を示す。線−は従来回路で
利得一定とされた場合の全高調波歪率、線−は増幅
回路自体の全高調波歪率、線−は本実施例の全高調
波歪率を示す。増幅回路自体の全高調波歪率は入力信号
VinがVs以上となると出力段トランジスタの飽和のため
著しく悪化する。しかし、本実施例では、入力信号Vin
がV2となるまで全高調波歪率が小であり、従来回路と異
なり大レベルの入力信号Vinに対しても全高調波歪率が
小なる出力信号Voutが得られる。
利得一定とされた場合の全高調波歪率、線−は増幅
回路自体の全高調波歪率、線−は本実施例の全高調
波歪率を示す。増幅回路自体の全高調波歪率は入力信号
VinがVs以上となると出力段トランジスタの飽和のため
著しく悪化する。しかし、本実施例では、入力信号Vin
がV2となるまで全高調波歪率が小であり、従来回路と異
なり大レベルの入力信号Vinに対しても全高調波歪率が
小なる出力信号Voutが得られる。
そして本発明では、レベル検出回路２は、出力信号Vo
を複数の基準レベルと比較して出力信号レベルが各基準
レベルを越える毎に可変利得制御回路１の利得を互いに
異なる１以上の範囲で低下させる構成としているので、
各基準レベルに応じた適正な利得制御が可能であり、そ
の結果、入出力特性が良好になる。
を複数の基準レベルと比較して出力信号レベルが各基準
レベルを越える毎に可変利得制御回路１の利得を互いに
異なる１以上の範囲で低下させる構成としているので、
各基準レベルに応じた適正な利得制御が可能であり、そ
の結果、入出力特性が良好になる。
以上本発明を実施例により説明したが、本発明は本発
明の趣旨に従い種々の変形が可能であり、本発明からこ
れらを排除するものではない。
明の趣旨に従い種々の変形が可能であり、本発明からこ
れらを排除するものではない。
本発明によれば、レベル検出回路は可変利得増幅回路
の出力信号レベルが複数の所定レベルを越える毎に可変
利得制御回路の利得を互いに異なる１以上の範囲で低下
するように可変制御を行なうので、入力信号レベルが過
大であっても出力信号レベルを一定に制限することなく
最大許容入力信号レベル近傍でも良好に入力信号を増幅
することができ、特に音声信号用の増幅回路のとしての
効果が大であり、実用的に極めて有用である。
の出力信号レベルが複数の所定レベルを越える毎に可変
利得制御回路の利得を互いに異なる１以上の範囲で低下
するように可変制御を行なうので、入力信号レベルが過
大であっても出力信号レベルを一定に制限することなく
最大許容入力信号レベル近傍でも良好に入力信号を増幅
することができ、特に音声信号用の増幅回路のとしての
効果が大であり、実用的に極めて有用である。
【図面の簡単な説明】 第１図は本発明の原理説明図、 第２図は本発明の原理説明用入出力特性図、 第３図は本発明回路の一実施例を示す回路図、 第４図は実施例の入力対出力特性を示す図、 第５図は全高調波歪率を示す図、 第６図（ａ），（ｂ）は増幅回路の説明用特性図であ
る。 第１図〜第５図において、 １は可変利得増幅回路、 ２はレベル検出回路、 11,12は増幅器、 13は整流回路、 14はコンパレータ、 R1〜R4は抵抗、 Ｃはコンデンサ、 VREFは基準電圧供給源、 Ｑはトランジスタ を示す。
る。 第１図〜第５図において、 １は可変利得増幅回路、 ２はレベル検出回路、 11,12は増幅器、 13は整流回路、 14はコンパレータ、 R1〜R4は抵抗、 Ｃはコンデンサ、 VREFは基準電圧供給源、 Ｑはトランジスタ を示す。
Claims (1)
- 【請求項１】増幅器及び抵抗分圧による減衰器を有し入
力信号を増幅する可変利得増幅回路と、 該可変利得増幅回路の出力信号レベルに応じて該可変利
得増幅回路の利得を可変制御するレベル検出回路を備え
た増幅回路において、 該レベル検出回路は、該可変利得増幅回路の出力信号レ
ベルが複数の所定レベルを越える毎に前記減衰器の合成
抵抗を制御することによって該可変利得制御回路の利得
を互いに異なる１以上の範囲で低下するように可変制御
を行なう、増幅回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62270253A JP2644775B2 (ja) | 1987-10-28 | 1987-10-28 | 増幅回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62270253A JP2644775B2 (ja) | 1987-10-28 | 1987-10-28 | 増幅回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01114208A JPH01114208A (ja) | 1989-05-02 |
| JP2644775B2 true JP2644775B2 (ja) | 1997-08-25 |
Family
ID=17483670
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62270253A Expired - Lifetime JP2644775B2 (ja) | 1987-10-28 | 1987-10-28 | 増幅回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2644775B2 (ja) |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6228094Y2 (ja) * | 1980-10-31 | 1987-07-18 | ||
| JPS6198007A (ja) * | 1984-10-18 | 1986-05-16 | Matsushita Electric Ind Co Ltd | 自動利得制御装置 |
| JPS6228094U (ja) * | 1985-08-05 | 1987-02-20 |
-
1987
- 1987-10-28 JP JP62270253A patent/JP2644775B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH01114208A (ja) | 1989-05-02 |
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