JP2535565B2 - 半導体装置 - Google Patents

半導体装置

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JP2535565B2
JP2535565B2 JP27630487A JP27630487A JP2535565B2 JP 2535565 B2 JP2535565 B2 JP 2535565B2 JP 27630487 A JP27630487 A JP 27630487A JP 27630487 A JP27630487 A JP 27630487A JP 2535565 B2 JP2535565 B2 JP 2535565B2
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    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/7606Transistor-like structures, e.g. hot electron transistor [HET]; metal base transistor [MBT]

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Description

【発明の詳細な説明】 〔概要〕 InAlAs/InPヘテロ接合を用いたホットエレクトロント
ランジスタ(HET)に関し, 結晶成長を容易にすることを目的とし, InP基板上に順次形成された一導電型InPからなるコレ
クタ層,InAlAsからなるコレクタバリア層,一導電型InP
からなるベース層,エミッタバリア層,および一導電型
InPからなるエミッタ層とを有するように構成する。
〔産業上の利用分野〕
本発明は半導体装置,特にInAlAs/InPヘテロ接合を用
いたホットエレクトロントランジスタ(HET)に関す
る。
HETは電子がエミッタよりベースに注入されたとき,
高い位置エネルギを運動エネルギに変換して高速で走行
できる利点を持つ。その飽和速度は通常のトランジスタ
では107cm/secであるが,HETではその10倍程度になる。
HETの中でも,共鳴トンネリングホットエレクトロン
(RHET)は,共鳴トンネリング効果を利用し,高いエネ
ルギを持つホットエレクトロンの動きを制御できるの
で,高速の論理,記憶等の機能を持つことができる。さ
らに,少数のデバイスでLSIを構成する回路機能を実現
できるため将来の新機能デバイスとして注目されてい
る。
従って,ここではRHETを例にとり説明する。
〔従来の技術〕
従来のInGaAsベース層の(R)HETは,ベース層のΓ
谷とL谷間のセパレーションエネルギ(後述)が大きい
ため電流利得が大きく有利である。さらにこの場合,コ
レクタバリア層は電流利得を向上させるために上記セパ
レーションエネルギが比較的大きいInAlGaAs4元混晶と
している。
第3図は従来のInGaAs/InAlGaAsヘテロ接合を用いたR
HETの断面図である。
図において,InP基板1上に,例えばMBE法により順次n
+−In0.53Ga0.47Asコレクタ層2,In0.52(Al0.5Ga0.5
0.48Asコレクタバリア層3,n−In0.53Ga0.47Asベース層
4,さらにIn0.53Al0.47Asバリア層5,In0.53Ga0.47Asウエ
ル層6,In0.53Al0.47Asバリア層7からなる量子井戸層,
およびn+−In0.53Ga0.47Asエミッタ層8を成長する。
上記各層の諸元は,例えば次の通りである。
エミッタ層8,ベース層4,コレクタ層2上にそれぞれ厚
さ200/3000ÅのCr/Au電極が取り付けられる。
単に,HETの場合は,量子井戸層5,6,7の代わりにエミ
ッタバリア層として,厚さ100〜250ÅのIn0.53Al0.47As
層を形成する。
第4図は従来例のRHETのバンド構造図である。
図において,Γ谷(伝導帯底Ecと一致)とL谷のセパ
レーションエネルギΔE(Γ−L)は,In0.52(Al0.5Ga
0.50.48Asコレクタバリア層3が約0.43eV,n+−In0.53
Ga0.47Asコレクタ層2が約0.55eVである。
ΔE(Γ−L)が大きいほど,コレクタバリア層3中
を通過するホットエレクトロン(矢印)がΓ谷よりL谷
に移り,Γ−L谷間散乱を受けてその走行速度を低下さ
せることは少ない。
因に,Γ谷の電子の有効質量mは m=0.042m0. ここに,m0:電子の静止質量 であり,L谷ではその10倍程度と大きくなり,電子のエネ
ルギは低下し,電子はコレクタに到達しなくなる。
〔発明が解決しようとする問題点〕
従来のInGaAsベース層の(R)HETは共鳴バリアにInA
lAs3元結晶を,コレクタバリアにInAlGaAs4元結晶を用
いており,成長過程が複雑であり,製造上問題であっ
た。
〔問題点を解決するための手段〕
上記問題点の解決は,InP基板上に順次形成された一導
電型InPからなるコレクタ層,InAlAsからなるコレクタバ
リア層,一導電型InPからなるベース層,エミッタバリ
ア層,および一導電型InPからなるエミッタ層とを有す
る半導体装置により達成される。
RHETの場合は,前記エミッタバリア層はInAlAsからな
る第1の量子井戸バリア層,InPからなる量子井戸ウエル
層,InAlAsからなる第2の量子井戸バリア層からなる量
子井戸層であり,HETの場合は,前記エミッタバリア層は
InAlAsからなる単一層である。
〔作用〕
本発明は,ベース層として2元系結晶のInPを用い,
コレクタバリア層としてInAlAs,共鳴バリア層あるいは
エミッタバリア層として(In)AlAsを用いることにより
成長を容易にして,かつ電流利得を低下させないで
(R)HETが得られるようにしたものである。
共鳴バリア層あるいはエミッタバリア層の(In)AlAs
は40Åと薄く格子不整合でも支障はないので,バリア高
さを高くするためにInの組成比を従来例の0.53よりさら
に減らしていってもよく,さらにAlAs2元結晶としても
よい。
エミッタ層,量子井戸のウエル層,ベース層はInP2元
結晶を用いる。
さらに,コレクタバリア層形成に従来のInAlGaAs4元
結晶からInAlAs3元結晶にして成長を容易にしている。
この場合,InAlAsのコレクタバリアの高さΔEcは0.28eV
で,InAlGaAsの0.25eVと略同程度であるので問題はな
い。また,InAlAsのΔE(Γ−L)は約0.40eVでΓ−L
谷間散乱による電子走行速度の低下も通常程度である。
〔実施例〕
第1図は本発明の一実施例によるInAlAs/InPヘテロ接
合を用いたRHETの断面図である。
図において,InP基板1上に,例えばMOCVD法,またはM
OMBE法により順次n+−InPコレクタ層12,In0.53Al0.47As
コレクタバリア層13,n−InPベース層14,さらにInxAl1-x
As(x=0.53〜0)バリア層15,InPウエル層16,InxAl
1-xAs(x=0.53〜0)バリア層17からなる量子井戸
層,およびn+−InPエミッタ層18を成長する。
上記各層の諸元は,例えば次の通りである。
この場合,各層の成長は燐(P)を含むため通常のMB
E法によらないで,上記のMOCVD法,またはMOMBE法を用
いた。
エミッタ層18,ベース層14,コレクタ層12上にそれぞれ
厚さ200/3000ÅのCr/Au電極が取り付けられる。
第2図は実施例のRHETのバンド構造図である。
図において,ΔE(Γ−L)は,InAlAsが約0.40eV,In
Pが0.55eVである。
また,第4図の従来例のバンド構造図と比較すると,I
nP基板1とn+−InPコレクタ層12間にエネルギのギャッ
プがなく,コレクタ抵抗を低下させることができる。
〔発明の効果〕
以上説明したように本発明によれば,(R)HETの電
流利得を低下させることなく,2元系,3元系の結晶のみを
使ってその層構造を形成できるため,結晶成長が容易に
なる。
また,基板とコレクタ層間のギャップがなくなって良
好な特性が得られる。
さらにInPはInGaAsに比しバンドギャップが広いの
で,低温にしなくても安定な動作を行うことができる。
また,InP基板/i−InGaAsバッファ層/n+−InGaAsコレ
クタ層のように,バッファ層を挿入した場合はInPとInG
aAsのエネルギギャップにより,バッファ層内の基板と
の界面に2次元電子ガス層を生ずるが,実施例にバッフ
ァ層を挿入した場合はInP基板/i−InPバッファ層/n+−I
nGaAsコレクタ層となり,このような問題は起きない。
【図面の簡単な説明】
第1図は本発明の一実施例によるInAlAs/InPヘテロ接合
を用いたRHETの断面図, 第2図は実施例のRHETのバンド構造図, 第3図は従来のInGaAs/InAlGaAsヘテロ接合を用いたRHE
Tの断面図, 第4図は従来例のRHETのバンド構造図である。 図において, 1はInP基板, 12はn+−InPコレクタ層, 13はInAlAsコレクタバリア層, 14はn−InPベース層, 15は(In)AlAs量子井戸バリア層, 16はInP量子井戸ウエル層, 17は(In)AlAs量子井戸バリア層, 18はn+−InPエミッタ層 である。

Claims (3)

    (57)【特許請求の範囲】
  1. 【請求項1】InP基板上に順次形成された一導電型InPか
    らなるコレクタ層,InAlAsからなるコレクタバリア層,
    一導電型InPからなるベース層,エミッタバリア層,お
    よび一導電型InPからなるエミッタ層とを有することを
    特徴とする半導体装置。
  2. 【請求項2】前記エミッタバリア層がInAlAsからなる第
    1の量子井戸バリア層,InPからなる量子井戸ウエル層,I
    nAlAsからなる第2の量子井戸バリア層からなる量子井
    戸層であることを特徴とする特許請求の範囲第1項記載
    の半導体装置。
  3. 【請求項3】前記エミッタバリア層がInAlAsからなる単
    一層であることを特徴とする特許請求の範囲第1項記載
    の半導体装置。
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