JP2023050647A5 - 電源回路及び電圧検出回路 - Google Patents

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本発明は電圧検出回路に関し、例えば、電源回路の出力電圧の検出に用いられる電圧検出回路に関する。
本発明にかかる電源回路の一態様は、出力電圧に応じて変動する検出電圧をデジタル値に変換したデジタル検出値を出力する電圧検出回路と、前記デジタル検出値に応じて生成される制御信号に基づき負荷回路を駆動して前記出力電圧を生成する駆動部と、を有し、前記電圧検出回路は、オフセット電圧を生成するオフセット電圧生成回路と、前記検出電圧と前記オフセット電圧とを加算した電圧値から、前処理サイクルで算出された前デジタル検出値に対応するアナログ値を有するＤＡＣ出力電圧を減算してエラー変動電圧を生成するアナログ加減算回路と、前記エラー変動電圧に対応するデジタル値を有するエラー変動値を生成するアナログデジタル変換回路と、前記エラー変動値を前記前デジタル検出値と加算して、現在の前記デジタル検出値を生成するデジタル加算回路と、前記デジタル検出値に基づき前記ＤＡＣ出力電圧を生成するデジタルアナログ変換回路と、を有し、前記アナログデジタル変換回路は、前記オフセット電圧近傍ほど分解能が高く設定される。
本発明にかかる電圧検出回路の一態様は、オフセット電圧を生成するオフセット電圧生成回路と、出力電圧に応じて変動する検出電圧と前記オフセット電圧とを加算した電圧値から、前処理サイクルで算出された前デジタル検出値に対応するアナログ値を有するＤＡＣ出力電圧を減算してエラー変動電圧を生成するアナログ加減算回路と、前記エラー変動電圧に対応するデジタル値を有するエラー変動値を生成するアナログデジタル変換回路と、前記エラー変動値を前記前デジタル検出値と加算して、現在のデジタル検出値を生成するデジタル加算回路と、前記デジタル検出値に基づき前記ＤＡＣ出力電圧を生成するデジタルアナログ変換回路と、を有し、前記アナログデジタル変換回路は、前記オフセット電圧近傍ほど分解能が高く設定される。



Claims (6)

  1. 出力電圧に応じて変動する検出電圧をデジタル値に変換したデジタル検出値を出力する電圧検出回路と、
    前記デジタル検出値に応じて生成される制御信号に基づき負荷回路を駆動して前記出力電圧を生成する駆動部と、を有し、
    前記電圧検出回路は、
    オフセット電圧を生成するオフセット電圧生成回路と、
    前記検出電圧と前記オフセット電圧とを加算した電圧値から、前処理サイクルで算出された前デジタル検出値に対応するアナログ値を有するＤＡＣ出力電圧を減算してエラー変動電圧を生成するアナログ加減算回路と、
    前記エラー変動電圧に対応するデジタル値を有するエラー変動値を生成するアナログデジタル変換回路と、
    前記エラー変動値を前記前デジタル検出値と加算して、現在の前記デジタル検出値を生成するデジタル加算回路と、
    前記デジタル検出値に基づき前記ＤＡＣ出力電圧を生成するデジタルアナログ変換回路と、を有し、
    前記アナログデジタル変換回路は、
    前記オフセット電圧近傍ほど分解能が高く設定される電源回路。
  2. 前記アナログデジタル変換回路は、フラッシュ型アナログデジタル変換回路である請求項１に記載の電源回路。
  3. 前記フラッシュ型アナログデジタル変換回路は、上位側基準電圧と下位側基準電圧との間に直列に抵抗が接続され、前記抵抗の接続点から複数の比較電圧を出力する抵抗ストリングと、
    それぞれが、前記複数の比較電圧のいずれか１つと、前記エラー変動電圧と、の大小関係に応じてハイ電圧とロウ電圧とのいずれか一方を出力する複数の比較器と、
    前記複数の比較器の出力値をデコードして前記オフセット電圧を中心に符号が逆転する符号付きデジタル値となる前記エラー変動値を出力するデコーダと、を有し、
    前記比較電圧は、前記オフセット電圧に近いほど隣接する前記比較電圧との電圧差が小さくなる請求項２に記載の電源回路。
  4. 前記オフセット電圧は、前記フラッシュ型アナログデジタル変換回路の変換レンジの中心電圧であり、
    前記フラッシュ型アナログデジタル変換回路は、前記オフセット電圧を中心として符号が逆転する符号付きデジタル値により前記エラー変動値を出力する請求項２又は３に記載の電源回路。
  5. 前記デジタル検出値と基準値との誤差を算出する加算処理部と、
    前記誤差に対してＰＩＤ処理を施すＰＩＤ制御部と、
    前記ＰＩＤ制御部の出力値に応じたデューティー比のＰＷＭ信号を前記制御信号として出力するＰＷＭ生成部と、
    を更に有する請求項１乃至４のいずれか１項に記載の電源回路。
  6. オフセット電圧を生成するオフセット電圧生成回路と、
    出力電圧に応じて変動する検出電圧と前記オフセット電圧とを加算した電圧値から、前処理サイクルで算出された前デジタル検出値に対応するアナログ値を有するＤＡＣ出力電圧を減算してエラー変動電圧を生成するアナログ加減算回路と、
    前記エラー変動電圧に対応するデジタル値を有するエラー変動値を生成するアナログデジタル変換回路と、
    前記エラー変動値を前記前デジタル検出値と加算して、現在のデジタル検出値を生成するデジタル加算回路と、
    前記デジタル検出値に基づき前記ＤＡＣ出力電圧を生成するデジタルアナログ変換回路と、を有し、
    前記アナログデジタル変換回路は、
    前記オフセット電圧近傍ほど分解能が高く設定される電圧検出回路。
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