JP2022544673A - マスク形状を制御し、選択性対プロセスマージンのトレードオフを破壊するためのマルチステートrfパルス - Google Patents
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- 238000000034 method Methods 0.000 title claims abstract description 132
- 230000008569 process Effects 0.000 title claims abstract description 50
- 238000005530 etching Methods 0.000 claims abstract description 48
- 238000012545 processing Methods 0.000 claims abstract description 17
- 239000000758 substrate Substances 0.000 claims abstract description 16
- 238000002161 passivation Methods 0.000 claims description 20
- 230000000694 effects Effects 0.000 claims description 14
- 239000000463 material Substances 0.000 claims description 5
- 210000003739 neck Anatomy 0.000 description 36
- 150000002500 ions Chemical class 0.000 description 23
- 239000011295 pitch Substances 0.000 description 13
- 238000000151 deposition Methods 0.000 description 11
- 230000008021 deposition Effects 0.000 description 11
- 238000005516 engineering process Methods 0.000 description 9
- 239000007789 gas Substances 0.000 description 8
- 239000003990 capacitor Substances 0.000 description 6
- 238000010586 diagram Methods 0.000 description 6
- 230000007935 neutral effect Effects 0.000 description 6
- 239000000376 reactant Substances 0.000 description 6
- 238000004519 manufacturing process Methods 0.000 description 5
- 230000008901 benefit Effects 0.000 description 4
- 230000007423 decrease Effects 0.000 description 4
- 238000004590 computer program Methods 0.000 description 3
- 230000007547 defect Effects 0.000 description 3
- 229920000642 polymer Polymers 0.000 description 3
- 239000000126 substance Substances 0.000 description 3
- 238000013459 approach Methods 0.000 description 2
- 230000001419 dependent effect Effects 0.000 description 2
- 238000005137 deposition process Methods 0.000 description 2
- 230000006870 function Effects 0.000 description 2
- 239000000203 mixture Substances 0.000 description 2
- 238000011112 process operation Methods 0.000 description 2
- 230000009467 reduction Effects 0.000 description 2
- 238000004544 sputter deposition Methods 0.000 description 2
- 238000009966 trimming Methods 0.000 description 2
- 240000007594 Oryza sativa Species 0.000 description 1
- 235000007164 Oryza sativa Nutrition 0.000 description 1
- 230000004913 activation Effects 0.000 description 1
- 230000004888 barrier function Effects 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 239000000112 cooling gas Substances 0.000 description 1
- 239000003989 dielectric material Substances 0.000 description 1
- 230000003090 exacerbative effect Effects 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 239000011261 inert gas Substances 0.000 description 1
- 238000007689 inspection Methods 0.000 description 1
- 238000003475 lamination Methods 0.000 description 1
- 230000000873 masking effect Effects 0.000 description 1
- 230000007246 mechanism Effects 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- NJPPVKZQTLUDBO-UHFFFAOYSA-N novaluron Chemical group C1=C(Cl)C(OC(F)(F)C(OC(F)(F)F)F)=CC=C1NC(=O)NC(=O)C1=C(F)C=CC=C1F NJPPVKZQTLUDBO-UHFFFAOYSA-N 0.000 description 1
- 238000011165 process development Methods 0.000 description 1
- 238000010926 purge Methods 0.000 description 1
- 235000009566 rice Nutrition 0.000 description 1
- 238000013515 script Methods 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
- 238000003860 storage Methods 0.000 description 1
- 230000007704 transition Effects 0.000 description 1
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3105—After-treatment
- H01L21/311—Etching the insulating layers by chemical or physical means
- H01L21/31105—Etching inorganic layers
- H01L21/31111—Etching inorganic layers by chemical means
- H01L21/31116—Etching inorganic layers by chemical means by dry-etching
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01J—ELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
- H01J37/00—Discharge tubes with provision for introducing objects or material to be exposed to the discharge, e.g. for the purpose of examination or processing thereof
- H01J37/32—Gas-filled discharge tubes
- H01J37/32009—Arrangements for generation of plasma specially adapted for examination or treatment of objects, e.g. plasma sources
- H01J37/32082—Radio frequency generated discharge
- H01J37/32137—Radio frequency generated discharge controlling of the discharge by modulation of energy
- H01J37/32146—Amplitude modulation, includes pulsing
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01J—ELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
- H01J37/00—Discharge tubes with provision for introducing objects or material to be exposed to the discharge, e.g. for the purpose of examination or processing thereof
- H01J37/32—Gas-filled discharge tubes
- H01J37/32009—Arrangements for generation of plasma specially adapted for examination or treatment of objects, e.g. plasma sources
- H01J37/32082—Radio frequency generated discharge
- H01J37/32137—Radio frequency generated discharge controlling of the discharge by modulation of energy
- H01J37/32155—Frequency modulation
- H01J37/32165—Plural frequencies
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01J—ELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
- H01J37/00—Discharge tubes with provision for introducing objects or material to be exposed to the discharge, e.g. for the purpose of examination or processing thereof
- H01J37/32—Gas-filled discharge tubes
- H01J37/32917—Plasma diagnostics
- H01J37/32935—Monitoring and controlling tubes by information coming from the object and/or discharge
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3105—After-treatment
- H01L21/311—Etching the insulating layers by chemical or physical means
- H01L21/31144—Etching the insulating layers by chemical or physical means using masks
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/67005—Apparatus not specifically provided for elsewhere
- H01L21/67011—Apparatus for manufacture or treatment
- H01L21/67017—Apparatus for fluid treatment
- H01L21/67063—Apparatus for fluid treatment for etching
- H01L21/67069—Apparatus for fluid treatment for etching for drying etching
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10B—ELECTRONIC MEMORY DEVICES
- H10B12/00—Dynamic random access memory [DRAM] devices
- H10B12/01—Manufacture or treatment
- H10B12/02—Manufacture or treatment for one transistor one-capacitor [1T-1C] memory cells
- H10B12/03—Making the capacitor or connections thereto
- H10B12/033—Making the capacitor or connections thereto the capacitor extending over the transistor
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10B—ELECTRONIC MEMORY DEVICES
- H10B41/00—Electrically erasable-and-programmable ROM [EEPROM] devices comprising floating gates
- H10B41/20—Electrically erasable-and-programmable ROM [EEPROM] devices comprising floating gates characterised by three-dimensional arrangements, e.g. with cells on different height levels
- H10B41/23—Electrically erasable-and-programmable ROM [EEPROM] devices comprising floating gates characterised by three-dimensional arrangements, e.g. with cells on different height levels with source and drain on different levels, e.g. with sloping channels
- H10B41/27—Electrically erasable-and-programmable ROM [EEPROM] devices comprising floating gates characterised by three-dimensional arrangements, e.g. with cells on different height levels with source and drain on different levels, e.g. with sloping channels the channels comprising vertical portions, e.g. U-shaped channels
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- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10B—ELECTRONIC MEMORY DEVICES
- H10B43/00—EEPROM devices comprising charge-trapping gate insulators
- H10B43/20—EEPROM devices comprising charge-trapping gate insulators characterised by three-dimensional arrangements, e.g. with cells on different height levels
- H10B43/23—EEPROM devices comprising charge-trapping gate insulators characterised by three-dimensional arrangements, e.g. with cells on different height levels with source and drain on different levels, e.g. with sloping channels
- H10B43/27—EEPROM devices comprising charge-trapping gate insulators characterised by three-dimensional arrangements, e.g. with cells on different height levels with source and drain on different levels, e.g. with sloping channels the channels comprising vertical portions, e.g. U-shaped channels
-
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- H01J—ELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
- H01J2237/00—Discharge tubes exposing object to beam, e.g. for analysis treatment, etching, imaging
- H01J2237/32—Processing objects by plasma generation
- H01J2237/33—Processing objects by plasma generation characterised by the type of processing
- H01J2237/334—Etching
- H01J2237/3343—Problems associated with etching
- H01J2237/3346—Selectivity
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- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
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- Plasma & Fusion (AREA)
- Analytical Chemistry (AREA)
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- Drying Of Semiconductors (AREA)
Abstract
Description
Claims (24)
- プラズマ処理システムにおいて基板にエッチングプロセスを実施するための方法であって、
前記プラズマ処理システムの電極にソースRF電力を印加する工程と、
前記電極にバイアスRF電力を印加する工程と、を含み、
前記ソースRF電力および前記バイアスRF電力は共に、複数のマルチステートパルスRFのサイクルを規定するパルス信号であり、各サイクルは、第1の状態、第2の状態、および第3の状態を有し、
前記第1の状態は、第1のソースRF電力レベルを有する前記ソースRF電力、および、第1のバイアスRF電力レベルを有する前記バイアスRF電力によって規定され、
前記第2の状態は、実質的にゼロの電力レベルを有する前記ソースRF電力、および、実質的にゼロの電力レベルを有する前記バイアスRF電力によって規定され、
前記第3の状態は、前記第1のソースRF電力レベルよりも低い第2のソースRF電力レベルを有する前記ソースRF電力、および、実質的にゼロの電力レベルを有する前記バイアスRF電力によって規定される、方法。 - 請求項1に記載の方法であって、
前記第1の状態は、前記基板の表面のフィーチャのエッチングをもたらすように構成されている、方法。 - 請求項2に記載の方法であって、
前記第2の状態は、前記基板の前記表面の前記フィーチャのパッシベーションをもたらすように構成されている、方法。 - 請求項2に記載の方法であって、
前記第3の状態は、前記フィーチャのネックを形成する材料の除去をもたらすように構成されている、方法。 - 請求項1に記載の方法であって、
前記バイアスRF電力は、約10MHzよりも小さい周波数を有する、方法。 - 請求項1に記載の方法であって、
前記ソースRF電力は、約20MHzよりも大きい周波数を有する、方法。 - 請求項1に記載の方法であって、
前記第3の状態は、前記第1の状態の持続期間のおよそ1~5倍の持続期間を有する、方法。 - 請求項1に記載の方法であって、
前記第2の状態は、前記第1の状態の持続期間とおよそ等しい持続期間を有する、方法。 - 請求項1に記載の方法であって、
前記第1のソースRF電力レベルは、およそ1~6kWの範囲であり、
前記第1のバイアスRF電力レベルは、およそ5~20kWの範囲である、方法。 - 請求項1に記載の方法であって、
前記第2のソースRF電力レベルは、およそ100Wから6kWの範囲である、方法。 - 請求項1に記載の方法であって、
各サイクル内で、前記第3の状態は、前記第2の状態のすぐ後に続く、方法。 - 請求項1に記載の方法であって、
各サイクル内で、前記第2の状態は、前記第3の状態のすぐ後に続く、方法。 - プラズマ処理システムにおける基板へのエッチングプロセスを前記プラズマ処理システムに行わせるように構成された制御装置であって、前記方法は、
前記プラズマ処理システムの電極にソースRF電力を印加する動作と、
前記電極にバイアスRF電力を印加する動作と、を含み、
前記ソースRF電力および前記バイアスRF電力は共に、複数のマルチステートパルスRFのサイクルを規定するパルス信号であり、各サイクルは、第1の状態、第2の状態、および第3の状態を有し、
前記第1の状態は、第1のソースRF電力レベルを有する前記ソースRF電力、および、第1のバイアスRF電力レベルを有する前記バイアスRF電力によって規定され、
前記第2の状態は、実質的にゼロの電力レベルを有する前記ソースRF電力、および、実質的にゼロの電力レベルを有する前記バイアスRF電力によって規定され、
前記第3の状態は、前記第1のソースRF電力レベルよりも低い第2のソースRF電力レベルを有する前記ソースRF電力、および、実質的にゼロの電力レベルを有する前記バイアスRF電力によって規定される、方法。 - 請求項13に記載の方法であって、
前記第1の状態は、前記基板の表面のフィーチャのエッチングをもたらすように構成されている、方法。 - 請求項14に記載の方法であって、
前記第2の状態は、前記基板の前記表面の前記フィーチャのパッシベーションをもたらすように構成されている、方法。 - 請求項14に記載の方法であって、
前記第3の状態は、前記フィーチャのネックを形成する材料の除去をもたらすように構成されている、方法。 - 請求項13に記載の方法であって、
前記バイアスRF電力は、約10MHzよりも小さい周波数を有する、方法。 - 請求項13に記載の方法であって、
前記ソースRF電力は、約20MHzよりも大きい周波数を有する、方法。 - 請求項13に記載の方法であって、
前記第3の状態は、前記第1の状態の持続期間のおよそ1~5倍の持続期間を有する、方法。 - 請求項13に記載の方法であって、
前記第2の状態は、前記第1の状態の持続期間とおよそ等しい持続期間を有する、方法。 - 請求項13に記載の方法であって、
前記第1のソースRF電力レベルは、およそ1~6kWの範囲であり、
前記第1のバイアスRF電力レベルは、およそ5~20kWの範囲である、方法。 - 請求項13に記載の方法であって、
前記第2のソースRF電力レベルは、およそ100Wから6kWの範囲である、方法。 - 請求項13に記載の方法であって、
各サイクル内で、前記第3の状態は、前記第2の状態のすぐ後に続く、方法。 - 請求項13に記載の方法であって、
各サイクル内で、前記第2の状態は、前記第3の状態のすぐ後に続く、方法。
Applications Claiming Priority (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US201962890285P | 2019-08-22 | 2019-08-22 | |
US62/890,285 | 2019-08-22 | ||
US201962909781P | 2019-10-03 | 2019-10-03 | |
US62/909,781 | 2019-10-03 | ||
PCT/US2020/047370 WO2021035132A1 (en) | 2019-08-22 | 2020-08-21 | Multi-state rf pulsing to control mask shape and breaking selectivity versus process margin trade-off |
Publications (3)
Publication Number | Publication Date |
---|---|
JP2022544673A true JP2022544673A (ja) | 2022-10-20 |
JPWO2021035132A5 JPWO2021035132A5 (ja) | 2023-08-04 |
JP7562637B2 JP7562637B2 (ja) | 2024-10-07 |
Family
ID=74660375
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2022509590A Active JP7562637B2 (ja) | 2019-08-22 | 2020-08-21 | マスク形状を制御し、選択性対プロセスマージンのトレードオフを破壊するためのマルチステートrfパルス |
Country Status (5)
Country | Link |
---|---|
US (1) | US20220285130A1 (ja) |
JP (1) | JP7562637B2 (ja) |
KR (1) | KR20220044845A (ja) |
CN (1) | CN114342049A (ja) |
WO (1) | WO2021035132A1 (ja) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20240120205A1 (en) * | 2021-06-29 | 2024-04-11 | Lam Research Corporation | Multiple State Pulsing for High Aspect Ratio Etch |
US11987879B2 (en) * | 2022-02-16 | 2024-05-21 | Applied Materials, Inc. | High aspect ratio taper improvement using directional deposition |
Family Cites Families (16)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US9123509B2 (en) | 2007-06-29 | 2015-09-01 | Varian Semiconductor Equipment Associates, Inc. | Techniques for plasma processing a substrate |
JP5172417B2 (ja) | 2008-03-27 | 2013-03-27 | Sppテクノロジーズ株式会社 | シリコン構造体の製造方法及びその製造装置並びにその製造プログラム |
US8382999B2 (en) * | 2009-03-26 | 2013-02-26 | Applied Materials, Inc. | Pulsed plasma high aspect ratio dielectric process |
JP5395491B2 (ja) | 2009-03-31 | 2014-01-22 | 東京エレクトロン株式会社 | 基板処理装置及び基板処理方法 |
US8987140B2 (en) * | 2011-04-25 | 2015-03-24 | Applied Materials, Inc. | Methods for etching through-silicon vias with tunable profile angles |
US8883028B2 (en) * | 2011-12-28 | 2014-11-11 | Lam Research Corporation | Mixed mode pulsing etching in plasma processing systems |
US9462672B2 (en) * | 2012-02-22 | 2016-10-04 | Lam Research Corporation | Adjustment of power and frequency based on three or more states |
JP6159757B2 (ja) * | 2014-07-10 | 2017-07-05 | 東京エレクトロン株式会社 | 基板の高精度エッチングのプラズマ処理方法 |
JP6670692B2 (ja) | 2015-09-29 | 2020-03-25 | 株式会社日立ハイテク | プラズマ処理装置およびプラズマ処理方法 |
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JP7175239B2 (ja) * | 2018-06-22 | 2022-11-18 | 東京エレクトロン株式会社 | 制御方法、プラズマ処理装置、プログラム及び記憶媒体 |
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WO2021118862A2 (en) * | 2019-12-13 | 2021-06-17 | Lam Research Corporation | Multi-state pulsing for achieving a balance between bow control and mask selectivity |
US11545364B2 (en) * | 2020-08-24 | 2023-01-03 | Tokyo Electron Limited | Pulsed capacitively coupled plasma processes |
US20240120205A1 (en) * | 2021-06-29 | 2024-04-11 | Lam Research Corporation | Multiple State Pulsing for High Aspect Ratio Etch |
-
2020
- 2020-08-21 CN CN202080059513.3A patent/CN114342049A/zh active Pending
- 2020-08-21 WO PCT/US2020/047370 patent/WO2021035132A1/en active Application Filing
- 2020-08-21 JP JP2022509590A patent/JP7562637B2/ja active Active
- 2020-08-21 KR KR1020227009367A patent/KR20220044845A/ko unknown
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Publication number | Publication date |
---|---|
US20220285130A1 (en) | 2022-09-08 |
CN114342049A (zh) | 2022-04-12 |
JP7562637B2 (ja) | 2024-10-07 |
KR20220044845A (ko) | 2022-04-11 |
WO2021035132A1 (en) | 2021-02-25 |
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